JPH0179138U - - Google Patents

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JPH0179138U
JPH0179138U JP1987174899U JP17489987U JPH0179138U JP H0179138 U JPH0179138 U JP H0179138U JP 1987174899 U JP1987174899 U JP 1987174899U JP 17489987 U JP17489987 U JP 17489987U JP H0179138 U JPH0179138 U JP H0179138U
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JP
Japan
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memory
internal memory
microprocessor
monitor
target microprocessor
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JP1987174899U
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  • Test And Diagnosis Of Digital Computers (AREA)
  • Debugging And Monitoring (AREA)

Description

【図面の簡単な説明】
第1図は本考案に係る内部メモリモニタ回路の
一実施例を示す構成図、第2図は動作を説明する
ためのタイムチヤートである。 1……ターゲツト・マイクロプロセツサ、2…
…メモリ、3,4,8……バツフア、5……モニ
タ用メモリ、6……バス制御回路、7……データ
バス、9……エミユレータ内モニタ回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 内部にメモリを持つターゲツト・マイクロプロ
    セツサを対象とし、内部メモリをモニタするため
    のモニタ用メモリが用意され、内部メモリに対し
    書き込み動作を実行した時にはモニタ用メモリに
    もデータを書き込み、データを読み込む動作を実
    行した時にはマイクロプロセツサは自分自身の内
    部メモリを読み取ると共に、エミユレータに対し
    てはモニタ用メモリからデータを出力させるよう
    にしたエミユレータにおいて、 ターゲツト・マイクロプロセツサに対しリセツ
    ト信号が入力された場合最優先の割り込み信号を
    ターゲツト・マイクロプロセツサに与えると共に
    データバスの接続の切り替えを制御するバス制御
    回路と、 ターゲツト・マイクロプロセツサにより実行さ
    れるプログラムであつて、前記バス制御回路から
    の最優先の割り込み処理である初期値書き込みの
    割り込み処理ルーチンが格納されたメモリと を具備し、ターゲツト・マイクロプロセツサにリ
    セツト信号が入力されたときモニタ用メモリの初
    期値が内部メモリの初期値と一致するように書き
    込まれるようにしたことを特徴とする内部メモリ
    モニタ回路。
JP1987174899U 1987-11-16 1987-11-16 Pending JPH0179138U (ja)

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JPH0179138U true JPH0179138U (ja) 1989-05-26

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ID=31466729

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