JPH01287745A - Data processor - Google Patents

Data processor

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JPH01287745A
JPH01287745A JP63117258A JP11725888A JPH01287745A JP H01287745 A JPH01287745 A JP H01287745A JP 63117258 A JP63117258 A JP 63117258A JP 11725888 A JP11725888 A JP 11725888A JP H01287745 A JPH01287745 A JP H01287745A
Authority
JP
Japan
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data
list
address
memory device
main
Prior art date
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Pending
Application number
JP63117258A
Other languages
Japanese (ja)
Inventor
Satoshi Emura
江村 里志
Hideaki Ishimatsu
石松 英明
Miyako Miyabe
宮部 都
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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Abstract

PURPOSE:To process list data of optional depth by storing data following an element address in addresses of an element memory device which are indicated by an overflow information storage device for list data including element data which is deficient in the number of items of the element address part of the element memory device. CONSTITUTION:The value of the overflow flag of a list identification address in an overflow information memory 5 is '1', addresses which are included in the item N of the element address part among addresses of element data are stored in the list identification addresses 21 in respective element memory devices 6, and information on an element is put in a value part 25. Further, addresses in an element memory stored with a part following the address part of the element data is written in the auxiliary address part 23 of the list identification address 21. Further, parts following address parts of the element data in the same element memory device are written in the element address parts of the addresses of respective element memory devices having the same value as said address value. Consequently, list data of optional depth can be processed.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は主に人工知能分野に使用することを目的とした
データ処理装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention relates to a data processing device mainly intended for use in the field of artificial intelligence.

従来の技術 近年、コンピュータ応用の一つとして人工知能分野が盛
んに研究されている。
BACKGROUND OF THE INVENTION In recent years, the field of artificial intelligence has been actively researched as one of computer applications.

この分野においては構造を持ったデータを処理する必要
があシ、そのため構造データを取り扱うことのできる言
語であるLISPが広く使用されている。LISP言語
を汎用のコンピュータで実行するのは非効率であるため
様々な工夫を施した専用マシンが開発されてきた。
In this field, it is necessary to process structured data, and therefore LISP, a language that can handle structured data, is widely used. Since it is inefficient to execute the LISP language on a general-purpose computer, special-purpose machines with various improvements have been developed.

これら専用マシンは主に言語的側面からアプローチを行
って改善を行ったものでその改善の内容の代表的なもの
を以下に示す。
These dedicated machines were improved mainly from a linguistic perspective, and the typical improvements made are shown below.

(1)  CAR,CDR等、原始的関数はマイクロプ
ログラムレベルで実行する。
(1) Primitive functions such as CAR and CDR are executed at the microprogram level.

(2)  ジェネリックデータタイ7゛を扱うためTA
G付きデータ形式とする。
(2) TA for handling generic data type 7゛
Data format with G.

(3)  スタック処理を高速にするためノ・−ドウエ
アコントロールスタックを設ける。
(3) Provide a node-ware control stack to speed up stack processing.

(参考文献1−LISPマシン」情報処理Vo1゜23
N0.8pp752−772) しかしながら、上記したような言語の実行系に関する改
善はなされてきたものの、計算機内部における構造体デ
ータの表現としては基本的には要素の順序関係と結合の
方法をポインタで表現したもの(以下リストと呼ぶ)を
使用している。一般にリストは2進木で表現され、始点
のノードから始まって順次左右に分岐して行き葉のノー
ドでそれぞれの分岐が終了する形をとる。葉のノードに
はアトムノードとNILノードの2種類がある。
(Reference 1-LISP Machine” Information Processing Vol. 1゜23
No. 0.8 pp. 752-772) However, although improvements have been made to the execution system of the language as described above, the representation of structure data inside a computer basically uses pointers to represent the order of elements and the method of connection. (hereinafter referred to as the list). Generally, a list is expressed as a binary tree, starting from a starting node and branching left and right sequentially, ending at each leaf node. There are two types of leaf nodes: atom nodes and NIL nodes.

葉のノードでないノードは分岐が続行している事を示す
リストノードである。このリストノードは葉のメートの
位置を間接的に表すためのものである。
Nodes that are not leaf nodes are list nodes that indicate that the branch is continuing. This list node is used to indirectly represent the position of leaf mates.

ポインタ表現ではこのリスト構造をそのままの形で表現
し、全てのノードをアドレスで接続したセルで表現して
いるために次のような問題がある。
In pointer representation, this list structure is expressed as is, and all nodes are expressed as cells connected by addresses, which causes the following problems.

1、任意の位置にある要素のアクセス、リスト内での任
意の要素の検索、リストの分解・結合にリストたぐりを
伴い効率が悪い。
1. Accessing an element at an arbitrary position, searching for an arbitrary element within a list, and decomposing/combining a list involve going through the list, making it inefficient.

2、リストのマツチング、リスト内での任意のサブリス
トの検索にリストの分解操作を伴うため非効率である。
2. Matching of lists and searching for arbitrary sublists within a list involve decomposition of the list, which is inefficient.

これらの問題点を解決するためには、基本的にリストデ
ータの表現をかえる必要がある。すなわち、葉のノード
の位置を直接的に表すことができれば、リストノードの
情報を持つ必要はない。したがって、葉の位置情報と葉
自身の情報を順次並べた表で、等価なリストデータを表
現することができる。この葉のノード位置を表現する方
法としてリストの長さ方向に順次番号を付け、深さ方向
に順次項目を割り当てた一次元ベクトル表現を用いると
、リストデータは葉の位置情報を示すベクトルと葉自身
の情報を組としたデータの集合として表形式で表現され
る。
In order to solve these problems, it is basically necessary to change the expression of list data. That is, if the position of a leaf node can be directly expressed, there is no need to have list node information. Therefore, equivalent list data can be expressed by a table in which leaf position information and leaf information are sequentially arranged. If we use a one-dimensional vector representation in which the list is numbered sequentially in the length direction and items are assigned sequentially in the depth direction as a way to express the node position of this leaf, the list data will be a vector indicating the leaf position information and a leaf node position. It is expressed in a tabular format as a set of data that includes its own information.

第4図にリストデータの表現例を示す。これは8式で表
記した場合(ム(B(())D)となるリストデータの
図式表現(1)、および、表形式表現(2)を示したも
のである。図式表現において丸印はリストノードを表し
、四角で囲ったものは葉のノードを示している。また各
ノードの上に付記した数字列は上記した方法に従って表
したノード位置を示すものである。この葉の部分を抜き
だして表の形で表現したものが表形式表現(2)であっ
て、要素アドレス部にノード位置ベクトルが、バリュー
部に葉の要素が入った表で構成されている。
FIG. 4 shows an example of list data expression. This shows the graphical representation (1) and tabular representation (2) of list data that becomes (B(())D) when expressed in 8 formulas. In the diagrammatic representation, circles are Represents a list node, and the box enclosed in a square indicates a leaf node.The number string added above each node indicates the node position expressed according to the method described above.Extract this leaf part. The table representation (2) is a table representation (2) in which the element address field contains the node position vector and the value field contains the leaf elements.

リストをこのような表形式で表現した場合、ポインタを
たぐることなく各要素をアクセスすることができ、さら
に各要素の演算を並列に行うことKlっで、パターンマ
ツチングなどのリスト処理を高速に行うことが出来る。
When a list is expressed in a table format like this, each element can be accessed without passing through pointers, and the operations on each element can be performed in parallel, which speeds up list processing such as pattern matching. It can be done.

以下図面を参照しながら上述した従来のデータ処理装置
の一例について説明する。
An example of the conventional data processing device mentioned above will be described below with reference to the drawings.

第6図は従来のデータ処理装置の構成を示すものである
FIG. 6 shows the configuration of a conventional data processing device.

第6図において51は主メモリ装置、62は主レジスタ
装置、63は主演算装置、64は主メモリ装置61と複
数の主レジスタ装置62と主演算装置63により構成さ
れる主データ処理部、56は要素メモリ装置、66は要
素レジスタ装置、67は要素演算装置、58は要素メモ
リ装置55と複数の要素レジスタ装置66と要素演算装
置57により構成される複数の要素データ処理部、59
は制御装置である。
In FIG. 6, 51 is a main memory device, 62 is a main register device, 63 is a main processing unit, 64 is a main data processing section composed of the main memory device 61, a plurality of main register devices 62, and a main processing device 63; 59 is an element memory device; 66 is an element register device; 67 is an element operation device;
is the control device.

以上のように構成されたデータ処理装置につき、以下第
4図、第6図および第6図を用いてその動作を説明する
The operation of the data processing apparatus configured as described above will be explained below with reference to FIGS. 4, 6, and 6.

まず、第6図は主メモリ装置と要素メモリ装置との関係
を示す図である。
First, FIG. 6 is a diagram showing the relationship between the main memory device and the element memory devices.

第6図において、51は主メモリ装置、66は要素メモ
リ装置、61はリストデータの識別情報であり、62は
要素アドレス部、63はバリュー部である。
In FIG. 6, 51 is a main memory device, 66 is an element memory device, 61 is identification information of list data, 62 is an element address field, and 63 is a value field.

リストデータは、識別情報と複数の要素データからなる
。リストデータの識別情報61は、要素メモリ内のアド
レスであり、主メモリ装置61に記憶されている。また
、リストの要素データは、各々要素アドレス部62とバ
リュ一部63からなり、同一のリストデータを構成する
複数の要素データは、複数の要素メモリ装置66におい
てリストデータの識別情報61に示される同一アドレス
に記憶されている。
List data consists of identification information and a plurality of element data. The identification information 61 of the list data is an address within the element memory and is stored in the main memory device 61. Further, each element data of a list consists of an element address part 62 and a value part 63, and a plurality of element data constituting the same list data is indicated by identification information 61 of the list data in a plurality of element memory devices 66. stored at the same address.

同様に、主レジスタ装置62と各要素レジスタ装置5e
も対応関係を持つ。
Similarly, the main register device 62 and each element register device 5e
also has a correspondence relationship.

リストデータに対する処理が必要なときには、リストデ
ータの識別情報61を主メモリ装置51から主レジスタ
装置52に転送すると同時に、制御装置59により各要
素処理部58に対し同一のアドレスを流し、各要素処理
部58において、要素メモリ装置56の指示されたアド
レスから要素データを要素レジスタ装置s6に転送する
。さらに、主演算装置53に対する演算命令と同時に、
制御装置59により各要素処理部68に対し同一の演算
命令を流し、複数の要素演算装置57により複数の要素
データに対し、並列に演算を施すことができる。
When processing is required for list data, the identification information 61 of the list data is transferred from the main memory device 51 to the main register device 52, and at the same time, the same address is sent to each element processing section 58 by the control device 59, and each element processing In section 58, element data is transferred from the indicated address of element memory device 56 to element register device s6. Furthermore, at the same time as the calculation instruction to the main processing unit 53,
The control device 59 sends the same calculation command to each element processing section 68, and the plurality of element calculation devices 57 can perform calculations on a plurality of element data in parallel.

発明が解決しようとする課題 しかしながら上記のような構成では、表形式リストデー
タの要素の位置を表現する要素アドレス部の項目数に制
限があるため、要素アドレス部の項目数が不足する要素
データを含むリストデータ、つまり深さが要素アドレス
部の項目数を越えるようなリストデータは処理できない
という課題を有していた。
Problems to be Solved by the Invention However, in the above configuration, there is a limit to the number of items in the element address field that expresses the position of the element in the tabular list data. There is a problem in that it is not possible to process list data that includes list data, that is, list data whose depth exceeds the number of items in the element address field.

本発明は上記課題に鑑み、表形式のりストテ゛−タの並
列処理において、任意の深さのリストデータを処理でき
るようなデータ処理装置を提供するものである。
In view of the above problems, the present invention provides a data processing device that can process list data of arbitrary depth in parallel processing of tabular list data.

課題を解決するだめの手段 上記課題を解決するために本発明のテ゛−タ処理装置は
、リストデータの要素の格納位置情報を記憶する主メモ
リ装置と、上記主メモリ装置に記憶されたデータを転送
して記憶する主レジスタ装置と、上記主レジスタ装置に
記憶されたデータを演算する主演算装置とから構成され
る主データ処理部と、リストデータの各要素をノードの
位置を示す要素アドレス部とデータ値の格納位置を示す
バリュ一部とで構成して記憶する要素メモリ装置と、上
記要素メモリ装置に記憶された要素を転送して記憶する
要素レジスタ装置と、上記要素レジスタ装置に記憶され
た要素を演算する要素演算装置とから構成される複数の
要素データ処理部と、要素アドレス部の項目数が不足す
る要素データを含むリストデータのオーバーフロー情報
を記憶するオーバーフロー情報記憶装置と、制御装置と
を具備し、任意の深さのリストデータを処理できるよう
にしたものである。
Means for Solving the Problems In order to solve the above problems, the data processing device of the present invention includes a main memory device that stores storage position information of elements of list data, and a main memory device that stores data stored in the main memory device. A main data processing section consisting of a main register device that transfers and stores data, a main processing device that operates on the data stored in the main register device, and an element address section that indicates the position of a node for each element of list data. and a value portion indicating a storage position of a data value; an element register device that transfers and stores the elements stored in the element memory device; and an element register device that stores the elements stored in the element register device. a control device; The system is equipped with the following functions and is capable of processing list data of arbitrary depth.

作用 本発明は上記した構成によって、要素メモリ装置の要素
アドレス部の項目数が不足する要素データを含むリスト
データに対し、オーバーフロー情報記憶装置により指示
された要素メモリ装置のアドレスに、要素アドレスの続
きを記憶することにより、任意の深さのリストデータを
処理できるようにしたものである。
Effects of the present invention With the above-described configuration, for list data including element data for which the number of items in the element address section of the element memory device is insufficient, the continuation of the element address is added to the address of the element memory device specified by the overflow information storage device. By storing , list data of arbitrary depth can be processed.

実施例 以下本発明の一実施例のデータ処理装置について、図面
を参照しながら説明する。
Embodiment Hereinafter, a data processing apparatus according to an embodiment of the present invention will be described with reference to the drawings.

第1図は本発明の実施例におけるデータ処理装置の構成
を示すものである。
FIG. 1 shows the configuration of a data processing device in an embodiment of the present invention.

第1図において1は主メモリ装置、2は主レジスタ装置
、3は主演算装置、4は主メモリ装置1゜主レジスタ装
置2.主演算装置3よシ構成される主データ処理部、5
はオーバーフロー情報記憶装置、6は要素メモリ装置、
7は要素レジスタ装置、8は要素演算装置、9は要素メ
モリ装置θ、要素レジスタ装置7.要素演算装置8より
構成される複数の要素データ処理部、1oは制御装置で
ある。
In FIG. 1, 1 is a main memory device, 2 is a main register device, 3 is a main arithmetic unit, and 4 is a main memory device 1, a main register device 2. A main data processing unit composed of the main processing unit 3, 5
is an overflow information storage device, 6 is an element memory device,
7 is an element register device, 8 is an element operation device, 9 is an element memory device θ, and element register device 7. A plurality of element data processing units constituted by element calculation devices 8, 1o is a control device.

以上のように構成されたデータ処理装置につき、以下第
1図、第2図および第3図を用いてその動作を説明する
The operation of the data processing apparatus configured as described above will be explained below with reference to FIGS. 1, 2, and 3.

まず、第2図は上記実施例のデータ処理装置において、
深さ方向にオーバーフローしているリストデータの記憶
方法を示す図である。
First, FIG. 2 shows that in the data processing apparatus of the above embodiment,
FIG. 6 is a diagram illustrating a method of storing list data that overflows in the depth direction.

第2図において1は主メモリ装置、eは要素メモリ装置
、5はオーバーフロー情報記憶装置、21はリスト識別
アドレス、22はオーバーフローフラグ、23は補助ア
ドレス部、24は要素アドレス部であり、その項目数を
Nとする。さらに、26はバリュ一部である。
In FIG. 2, 1 is a main memory device, e is an element memory device, 5 is an overflow information storage device, 21 is a list identification address, 22 is an overflow flag, 23 is an auxiliary address field, and 24 is an element address field. Let the number be N. Furthermore, 26 is a value part.

第3図は深さ方向オーバーフローリストデータの例とし
て、8式で表記した場合 (((((((((λ B)))))))))となるリ
ストデータの表表現(1)、および、上記実施例のデー
タ処理装置における上記リストデータの要素データを示
すものである。
Figure 3 shows an example of depth-direction overflow list data, which is a table representation (1) of list data that becomes ((((((((λ B))))))))) when expressed using formula 8. , and element data of the list data in the data processing device of the embodiment.

リストを構成する複数の要素データのアドレス部が、全
て項目数の制限内に収まる場合には、オーバーフロー情
報メモリ6内のリスト識別アドレス21のオーバーフロ
ーフラグ22の値ば0であり、各要素メモリ装置6内の
リスト識別アドレス21に、要素データが記憶されてお
り、要素データの記憶方法、処理方法は従来例と同じで
ある。
If the address parts of the plurality of element data constituting the list all fall within the limit on the number of items, the value of the overflow flag 22 of the list identification address 21 in the overflow information memory 6 is 0, and each element memory device Element data is stored in the list identification address 21 in 6, and the storage method and processing method of the element data are the same as in the conventional example.

リストを構成する要素データのうち、そのアドレス部の
項目数が不足する要素データが存在する場合、オーバー
フロー情報メモリ5内のリスト識別アドレスのオーバー
フローフラグの値は1であり、各要素メモリ装置6内の
リスト識別アドレス21には、要素データのアドレスの
うち要素アドレス部の項目数Nに収まるアドレスと、要
素の情報をバリュ一部25に持つ。さらに、オーバーフ
ロー情報メモリ6内のリスト識別アドレス21の補助ア
ドレス部23には、要素データのアドレス部の続きの部
分を記憶する要素メモリ内のアドレスが書かれている。
Among the element data composing the list, if there is element data whose address field has an insufficient number of items, the value of the overflow flag of the list identification address in the overflow information memory 5 is 1, and the value of the overflow flag of the list identification address in the overflow information memory 5 is 1, The list identification address 21 has addresses that fit into the number of items N in the element address part among the addresses of the element data, and element information in the value part 25. Further, in the auxiliary address section 23 of the list identification address 21 in the overflow information memory 6, an address in the element memory that stores the continuation of the address section of the element data is written.

このアドレス値と同一の各要素メモリ装置のアドレスに
は、同じ要素メモリ装置の要素データのアドレス部の続
きが要素アドレス部に書かれている。例えば、Nが8の
場合、第3図(1)の表表現で示されるリストデータは
、本実施例のデータ処理装置では、第3図(2)のよう
に表現される。
At the address of each element memory device that is the same as this address value, the continuation of the address part of the element data of the same element memory device is written in the element address part. For example, when N is 8, the list data shown in the tabular representation of FIG. 3(1) is expressed as shown in FIG. 3(2) in the data processing apparatus of this embodiment.

したがって上記の構成によって、任意の深さのリストデ
ータを処理できる。
Therefore, with the above configuration, list data of arbitrary depth can be processed.

発明の効果 以上のように本発明は、リストデータの要素の格納位置
情報を記憶する主メモリ装置と、上記主メモリ装置に記
憶されたデータを転送して記憶する主レジスタ装置と、
上記主レジスタ装置に記憶されたデータを演算する主演
算装置とから構成される主データ処理部と、リストデー
タの各要素をノードの位置を示す要素アドレス部とデー
タ値の格納位置を示すバリュ一部とで構成して記憶する
要素メモリ装置と、上記要素メモリ装置に記憶された要
素を転送して記憶する要素レジスタ装置と、上記要素レ
ジスタ装置に記憶された要素を演算する要素演算装置と
から構成される複数の要素データ処理部と、要素アドレ
ス部の項目数が不足する要素データを含むリストデータ
のオーバーフロー情報を記憶するオーバーフロー情報記
憶装置と、制御装置とを具備し、任意の深さのリストデ
ータを処理できるようになる。
Effects of the Invention As described above, the present invention comprises: a main memory device that stores storage position information of elements of list data; a main register device that transfers and stores data stored in the main memory device;
A main data processing unit consisting of a main processing unit that operates on the data stored in the main register device; an element memory device that stores the elements stored in the element memory device; an element register device that transfers and stores the elements stored in the element memory device; and an element operation device that operates the elements stored in the element register device. It is equipped with a plurality of element data processing sections configured, an overflow information storage device that stores overflow information of list data including element data whose element address section has an insufficient number of items, and a control device. Be able to process list data.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例におけるデータ処理装置の構
成図、第2図は深さ方向にオーバーフローしているリス
トデータの表示方法を示す説明図、第3図(1)は本発
明の一実施例の説明に用いるリストデータの表表現を示
すデータ表図、第3図(2)は本発明の一実施例におけ
るデータ処理装置での表現を示す説明図、第4図はリス
トデータの表表現の一例を示すデータ対応図、第5図は
従来のデータ処理装置の構成図、第6図は主メモリ装置
と要素メモリ装置の関係を示す説明図である。 1・・・・・・主メモリ装置、2・・・・・・主レジス
タ装置、3・・・・・・主演算装置、4・・・・・・主
データ処理部、6・・・・・・オーバーフロー情報記憶
装置、6・・・・・・要素メモリ装置、7・・・・・・
要素レジスタ装置、8・・・・・・要素演算装置、9・
・・・・・要素データ処理部、1o・・・・・・制御装
置。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第4
図 (A  (B (C)) D)
FIG. 1 is a configuration diagram of a data processing device according to an embodiment of the present invention, FIG. 2 is an explanatory diagram showing a method of displaying list data overflowing in the depth direction, and FIG. FIG. 3 (2) is an explanatory diagram showing the representation in a data processing device in one embodiment of the present invention, and FIG. FIG. 5 is a data correspondence diagram showing an example of table representation, FIG. 5 is a configuration diagram of a conventional data processing device, and FIG. 6 is an explanatory diagram showing the relationship between a main memory device and an element memory device. DESCRIPTION OF SYMBOLS 1...Main memory device, 2...Main register device, 3...Main processing unit, 4...Main data processing unit, 6... ...Overflow information storage device, 6...Element memory device, 7...
Element register device, 8...Element operation device, 9.
...Element data processing unit, 1o...Control device. Name of agent: Patent attorney Toshio Nakao and 1 other person No. 4
Diagram (A (B (C)) D)

Claims (1)

【特許請求の範囲】[Claims] リストデータの要素の格納位置情報を記憶する主メモリ
装置と、上記主メモリ装置に記憶されたデータを転送し
て記憶する主レジスタ装置と、上記主レジスタ装置に記
憶されたデータを演算する主演算装置とから構成される
主データ処理部と、リストデータの各要素をノードの位
置を示す要素アドレス部とデータ値の格納位置を示すバ
リュー部とで構成して記憶する要素メモリ装置と、上記
要素メモリ装置に記憶された要素を転送して記憶する要
素レジスタ装置と、上記要素レジスタ装置に記憶された
要素を演算する要素演算装置とから構成される複数の要
素データ処理部と、要素アドレス部の項目数が不足する
要素データを含むリストデータのオーバーフロー情報を
記憶するオーバーフロー情報記憶装置と、制御装置とを
具備し、任意の深さのリストデータを処理することを特
徴とするデータ処理装置。
A main memory device that stores storage position information of elements of list data, a main register device that transfers and stores data stored in the main memory device, and a main operation that operates on the data stored in the main register device. an element memory device configured to store each element of list data by an element address field indicating a node position and a value field indicating a storage position of a data value; A plurality of element data processing sections each including an element register device that transfers and stores the elements stored in the memory device, and an element operation device that operates on the elements stored in the element register device, and an element address section. 1. A data processing device, comprising: an overflow information storage device that stores overflow information of list data including element data with insufficient number of items; and a control device, and is capable of processing list data of arbitrary depth.
JP63117258A 1988-05-13 1988-05-13 Data processor Pending JPH01287745A (en)

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