JPH01278063A - メモリセルおよびその動作方法 - Google Patents
メモリセルおよびその動作方法Info
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- JPH01278063A JPH01278063A JP63260689A JP26068988A JPH01278063A JP H01278063 A JPH01278063 A JP H01278063A JP 63260689 A JP63260689 A JP 63260689A JP 26068988 A JP26068988 A JP 26068988A JP H01278063 A JPH01278063 A JP H01278063A
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Classifications
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- G11C—STATIC STORES
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- G11C11/21—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements
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- G11C11/403—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements using semiconductor devices using transistors forming cells needing refreshing or charge regeneration, i.e. dynamic cells with charge regeneration common to a multiplicity of memory cells, i.e. external refresh
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-
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- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/40—Capacitors
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B12/00—Dynamic random access memory [DRAM] devices
- H10B12/30—DRAM devices comprising one-transistor - one-capacitor [1T-1C] memory cells
- H10B12/31—DRAM devices comprising one-transistor - one-capacitor [1T-1C] memory cells having a storage electrode stacked over the transistor
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- H10B53/00—Ferroelectric RAM [FeRAM] devices comprising ferroelectric memory capacitors
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- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、半導体メモリのメモリセルに用いる材料に関
するものである。特に、本発明はグイナミ・ンク・ラン
ダム・アクセス・メモリ(DRAM)のメモリセル中の
誘電体として用いる材料に関するものである。
するものである。特に、本発明はグイナミ・ンク・ラン
ダム・アクセス・メモリ(DRAM)のメモリセル中の
誘電体として用いる材料に関するものである。
DRAMメモリセルは過去15年以上に亘って一般に1
トランジスター1キヤパシタ型のものである。
トランジスター1キヤパシタ型のものである。
基本的には、しばしばアクセストランジスタと称するト
ランジスタのソース−ドレイン通路を経てビットライン
に選択的に結合されているメモリセルキャパシタに電荷
が蓄積される。アクセストランジスタのゲート電極はワ
ードラインに結合されている。トランジスタがターン・
オンすると、キャパシタに蓄積された電荷がソース−ド
レイン通路を経てビットラインに結合され、一般に他の
ある基準、代表的には擬憤のメモリセルと比較され、キ
ャパシタ内に蓄積された電荷によって表わされるメモリ
セルの状態が決定されている。例えば、米国特許第4,
363,111号明細書に、検出増幅器と一緒にDRA
Mセルのアレイに用いられるメモリセルおよび擬似セル
の構成が開示されている。
ランジスタのソース−ドレイン通路を経てビットライン
に選択的に結合されているメモリセルキャパシタに電荷
が蓄積される。アクセストランジスタのゲート電極はワ
ードラインに結合されている。トランジスタがターン・
オンすると、キャパシタに蓄積された電荷がソース−ド
レイン通路を経てビットラインに結合され、一般に他の
ある基準、代表的には擬憤のメモリセルと比較され、キ
ャパシタ内に蓄積された電荷によって表わされるメモリ
セルの状態が決定されている。例えば、米国特許第4,
363,111号明細書に、検出増幅器と一緒にDRA
Mセルのアレイに用いられるメモリセルおよび擬似セル
の構成が開示されている。
代表的に、各世代のDRAMのメモリ記憶容量が4倍ず
つ増大せしめられている。すなわち、早期のDRAMは
4にビットの記憶容量を有し、以下16にビットのDR
AM、64にビットのDRAM、256にビットのDR
AM、1MビットのDRAMが得られている。このよう
に新規な世代の記憶容量が増大せしめられている為に、
チップの全面積を調整するために個々のメモリセルの面
積を縮小せしめる傾向にある。このようにすると、セル
中のキャパシタの容量を減少せしめてしまう。メモリセ
ルを縮小せしめるというこの傾向に直面して、データを
表わす電荷を蓄積するのに充分な容量を保つことが重要
となってきた。現在、極めて大型のDRAMでは、小さ
な面積のメモリセルにおけるキャパシタ面積を増大せし
めるために溝(trench)構造を用いている。しか
しこの技術に対する製造処理は極めて複雑である。これ
らの溝構造はキャパシタプレート(電極板)の面積を増
大せしめるために三次元を用いており、深さ3ミクロン
、幅1ミクロン程度にすることができる。また二酸化珪
素誘電体が設けられ、上側のキャパシタプレートとして
多結晶層が設けられている。
つ増大せしめられている。すなわち、早期のDRAMは
4にビットの記憶容量を有し、以下16にビットのDR
AM、64にビットのDRAM、256にビットのDR
AM、1MビットのDRAMが得られている。このよう
に新規な世代の記憶容量が増大せしめられている為に、
チップの全面積を調整するために個々のメモリセルの面
積を縮小せしめる傾向にある。このようにすると、セル
中のキャパシタの容量を減少せしめてしまう。メモリセ
ルを縮小せしめるというこの傾向に直面して、データを
表わす電荷を蓄積するのに充分な容量を保つことが重要
となってきた。現在、極めて大型のDRAMでは、小さ
な面積のメモリセルにおけるキャパシタ面積を増大せし
めるために溝(trench)構造を用いている。しか
しこの技術に対する製造処理は極めて複雑である。これ
らの溝構造はキャパシタプレート(電極板)の面積を増
大せしめるために三次元を用いており、深さ3ミクロン
、幅1ミクロン程度にすることができる。また二酸化珪
素誘電体が設けられ、上側のキャパシタプレートとして
多結晶層が設けられている。
二酸化珪素の誘電定数は約4であり、可成り低い、 D
RAMメモリセルにおける容量(キャパシタンス)を高
める1つの方法は、誘電体として異なる材料、すなわち
二酸化珪素よりも高い誘電定数を有する材料を用いるこ
とである。容量は面積と誘電定数とに直接関連する為、
誘電定数を高くすることにより所定の面積に対する容量
を高めることになる。
RAMメモリセルにおける容量(キャパシタンス)を高
める1つの方法は、誘電体として異なる材料、すなわち
二酸化珪素よりも高い誘電定数を有する材料を用いるこ
とである。容量は面積と誘電定数とに直接関連する為、
誘電定数を高くすることにより所定の面積に対する容量
を高めることになる。
本発明の目的は、二酸化珪素とは異なるる誘電体を設け
ることによりDRAMメモリセルの動作を改善すること
にある。
ることによりDRAMメモリセルの動作を改善すること
にある。
本発明ではDRAMメモリセルキャパシタに誘電体とし
て強誘電体を用いる。強誘電体材料に固有の緩和(弛緩
)特性を用い、キャパシタプレートに電圧を印加した際
に生じる電界の方向と整列されない領域を用いることに
よりこの緩和特性を強調させる。この構成を通常のリフ
レッシュ動作と組合ねることにより、キャパシタに生ぜ
しめられる電荷の量を可成り増大せしめる。
て強誘電体を用いる。強誘電体材料に固有の緩和(弛緩
)特性を用い、キャパシタプレートに電圧を印加した際
に生じる電界の方向と整列されない領域を用いることに
よりこの緩和特性を強調させる。この構成を通常のリフ
レッシュ動作と組合ねることにより、キャパシタに生ぜ
しめられる電荷の量を可成り増大せしめる。
強誘電材料の緩和特性を用い、前述した領域を選択する
ことにより、キャパシタに生じる電荷の量が著しく増大
し、実際に誘電定数が表わす量を越える。要するに、誘
電体として強誘電材料を用い、この強誘電材料をその緩
和特性が促進されるように調整することにより、強誘電
材料内の双極子が外部電圧(例えば書込みパルス)の供
給中整列せしめられ、次に電圧を除去した際に緩和作用
ヲ受け、次に読出しパルスを(リフレッシュ中のように
)供給する度に再配向されるようにしうる。
ことにより、キャパシタに生じる電荷の量が著しく増大
し、実際に誘電定数が表わす量を越える。要するに、誘
電体として強誘電材料を用い、この強誘電材料をその緩
和特性が促進されるように調整することにより、強誘電
材料内の双極子が外部電圧(例えば書込みパルス)の供
給中整列せしめられ、次に電圧を除去した際に緩和作用
ヲ受け、次に読出しパルスを(リフレッシュ中のように
)供給する度に再配向されるようにしうる。
従って、メモリセルは単位面積当り、上述したようにし
ない場合に期待されるよりも多くの電荷をビットライン
から引込むことができる。この電荷がキャパシタプレー
トに存在するようになる。
ない場合に期待されるよりも多くの電荷をビットライン
から引込むことができる。この電荷がキャパシタプレー
トに存在するようになる。
以下図面につき説明する。
第1図に示す通常のダイナミック・ランダム・アクセス
・メモリ(DRAM )はp型珪素基板12に構成しう
る。この基板にはトランジスタおよびキャパシタが形成
されている。特に、n+型の第1および第2拡散領域1
4および16が形成されており、電界効果トランジスタ
のソースおよびドレイン領域として作用する。拡散領域
14よりも浅く、この拡散領域と交わる n−型の拡散
領域18は一方のキャパシタプレート(電極板)を構成
する。基板12の上側面上には二酸化珪素のような誘電
体20を形成し、その上に他方のキャパシタプレートと
してドーピングされた多結晶珪素層22aを形成しうる
。基板12の上方に示す他の多結晶珪素層22bはトラ
ンジスタのゲート電極を構成し、ソース領域14および
ドレイン領域16間に位置するゲート酸化物により基板
12の上側面から分離されている。多結晶珪素層22a
、 22bには二酸化珪素層24が被覆されており、こ
の二酸化珪素層24には、金属素子28、特にアルミニ
ウムを拡散領域16に接触せしめるための孔26があけ
られている。前述したようなりRAMセルのアレイでは
、金属素子28がビットラインを表わし、多結珪素層2
2bがワードラインを表わす。
・メモリ(DRAM )はp型珪素基板12に構成しう
る。この基板にはトランジスタおよびキャパシタが形成
されている。特に、n+型の第1および第2拡散領域1
4および16が形成されており、電界効果トランジスタ
のソースおよびドレイン領域として作用する。拡散領域
14よりも浅く、この拡散領域と交わる n−型の拡散
領域18は一方のキャパシタプレート(電極板)を構成
する。基板12の上側面上には二酸化珪素のような誘電
体20を形成し、その上に他方のキャパシタプレートと
してドーピングされた多結晶珪素層22aを形成しうる
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ンジスタのゲート電極を構成し、ソース領域14および
ドレイン領域16間に位置するゲート酸化物により基板
12の上側面から分離されている。多結晶珪素層22a
、 22bには二酸化珪素層24が被覆されており、こ
の二酸化珪素層24には、金属素子28、特にアルミニ
ウムを拡散領域16に接触せしめるための孔26があけ
られている。前述したようなりRAMセルのアレイでは
、金属素子28がビットラインを表わし、多結珪素層2
2bがワードラインを表わす。
導電性部材22a(多結晶珪素層)および18(拡散領
域)間の誘電体20は二酸化珪素であり、この二酸化珪
素は前述したように約4の誘電定数を有する。
域)間の誘電体20は二酸化珪素であり、この二酸化珪
素は前述したように約4の誘電定数を有する。
第2図は本発明によって構成したDRAMセルを示す。
この第2図ではMOS技術を用いているも、本発明はM
OS技術に型室されず、例えば砒化ガリウムにも拡張し
うることを理解すべきである。このDRAMセルは珪素
その他の基板材料のp型基板30を有し、この基板はn
+拡散領域32および34より成るソースおよびドレイ
ン領域を有している。例えば二酸化珪素より成る誘電体
絶縁領域36には孔38があけられ、導電部材40を拡
散領域32に接触せしめうる。この導電部材40は一方
のキャパシタプレートであり、各メモリセルに対して設
けられるものである。導電部材40上には強誘電材料4
2が設けられており、この強誘電材料42上には他方の
キャパシタプレートを構成する他の導電部材44が設け
られている。導電部材44は半導体メモリアレイ中の1
つの行或いは列に沿って延在する共通プレートラインと
することができる。導電部材40および44は金或いは
好ましくはプラチナ或いは他の導電部材のような金属を
以って構成しうる。
OS技術に型室されず、例えば砒化ガリウムにも拡張し
うることを理解すべきである。このDRAMセルは珪素
その他の基板材料のp型基板30を有し、この基板はn
+拡散領域32および34より成るソースおよびドレイ
ン領域を有している。例えば二酸化珪素より成る誘電体
絶縁領域36には孔38があけられ、導電部材40を拡
散領域32に接触せしめうる。この導電部材40は一方
のキャパシタプレートであり、各メモリセルに対して設
けられるものである。導電部材40上には強誘電材料4
2が設けられており、この強誘電材料42上には他方の
キャパシタプレートを構成する他の導電部材44が設け
られている。導電部材44は半導体メモリアレイ中の1
つの行或いは列に沿って延在する共通プレートラインと
することができる。導電部材40および44は金或いは
好ましくはプラチナ或いは他の導電部材のような金属を
以って構成しうる。
例えばドーピングされた多結晶珪素より成るゲート電極
46は誘電体絶縁領域36内で一般に拡散領域32およ
び34間に設けられるも、このゲート電極は通常のよう
にゲート酸化物により基板30の上側面から分離されて
いる。誘電体絶縁領域36にあけた他の孔48は例えば
、アルミニウムより成る他の導電部材50を拡散領域3
4に接触させる。この導電部材50は一行或いは一列の
DRAMセルに共通とすることができ、メモリアレイ中
の1つのビットラインとして作用する。
46は誘電体絶縁領域36内で一般に拡散領域32およ
び34間に設けられるも、このゲート電極は通常のよう
にゲート酸化物により基板30の上側面から分離されて
いる。誘電体絶縁領域36にあけた他の孔48は例えば
、アルミニウムより成る他の導電部材50を拡散領域3
4に接触させる。この導電部材50は一行或いは一列の
DRAMセルに共通とすることができ、メモリアレイ中
の1つのビットラインとして作用する。
第1および第2図は双方共、1つのキャパシタおよび1
つのトランジスタを有するメモリセルを断面で示してい
る。第1図の場合には、キャパシタプレー) 22aお
よび18の誘電体が二酸化珪素であるも、第2図ではキ
ャパシタプレート40および44間の誘電体は強誘電材
料42である。本発明で第1図の構造よりも第2図の構
造の方が好ましいとしている主な理由は、第1図の誘電
体20と珪素電極22aおよび18との間の界面におけ
る問題を第2図の構成では無くすることができるという
ことである。第2図では、強誘電材料42がキャパシタ
プレート40および44に対し界面を形成するも、これ
らキャパシタプレートのいずれも好適例では珪素を以っ
て構成していないこと明らかである。しかし、界面問題
が解決されるならば、第2図に示す構成以外の構成、例
えば、誘電体20を強誘電材料と仮定した第1図に示す
ような構成を用いることができる。
つのトランジスタを有するメモリセルを断面で示してい
る。第1図の場合には、キャパシタプレー) 22aお
よび18の誘電体が二酸化珪素であるも、第2図ではキ
ャパシタプレート40および44間の誘電体は強誘電材
料42である。本発明で第1図の構造よりも第2図の構
造の方が好ましいとしている主な理由は、第1図の誘電
体20と珪素電極22aおよび18との間の界面におけ
る問題を第2図の構成では無くすることができるという
ことである。第2図では、強誘電材料42がキャパシタ
プレート40および44に対し界面を形成するも、これ
らキャパシタプレートのいずれも好適例では珪素を以っ
て構成していないこと明らかである。しかし、界面問題
が解決されるならば、第2図に示す構成以外の構成、例
えば、誘電体20を強誘電材料と仮定した第1図に示す
ような構成を用いることができる。
強誘電材料の誘電定数は一般に10〜30.000の範
囲にある。理想的な強誘電材料は、印加電圧を分極に対
しプロットすると方形のヒステリシスを有する。一般に
誘電定数はこのヒステリシスの特性曲線の上側のライン
の勾配に比例する。本発明では単に誘電定数を高くする
ことを目的としているのではなく、単位面積当りで可成
り追加の電荷をキャパシタに生せしめることを目的とす
るものである。本発明によれば、この目的を達成するた
めに、強誘電材料の緩和特性を用いている。
囲にある。理想的な強誘電材料は、印加電圧を分極に対
しプロットすると方形のヒステリシスを有する。一般に
誘電定数はこのヒステリシスの特性曲線の上側のライン
の勾配に比例する。本発明では単に誘電定数を高くする
ことを目的としているのではなく、単位面積当りで可成
り追加の電荷をキャパシタに生せしめることを目的とす
るものである。本発明によれば、この目的を達成するた
めに、強誘電材料の緩和特性を用いている。
通常、スイッチング後の強誘電材料中の双極子の緩和に
より、強誘電状態に応じてデータを表わしているメモリ
に重大な問題を生ゼしめる。強誘電材料が所定の状態に
され、次に強誘電材料の両端間に適切な電圧の短いスイ
ッチングパルスを印加することにより反対の状態に切換
えた場合に、双極子の多くが緩和によりもとの状態に戻
る傾向にある。これが最終的にデータの破壊につながる
おそれがある。米国特許出願第184996号明細書に
は、データを保持する強誘電メモリに関して緩和問題を
解決する方法が開示されている。しかし本発明では緩和
を無くすのではなく促進させるものである。従って、本
発明は強誘電材料を驚くべきものに適用することにより
この強誘電材料の不所望な特性を利点としてとらえてい
るものである。
より、強誘電状態に応じてデータを表わしているメモリ
に重大な問題を生ゼしめる。強誘電材料が所定の状態に
され、次に強誘電材料の両端間に適切な電圧の短いスイ
ッチングパルスを印加することにより反対の状態に切換
えた場合に、双極子の多くが緩和によりもとの状態に戻
る傾向にある。これが最終的にデータの破壊につながる
おそれがある。米国特許出願第184996号明細書に
は、データを保持する強誘電メモリに関して緩和問題を
解決する方法が開示されている。しかし本発明では緩和
を無くすのではなく促進させるものである。従って、本
発明は強誘電材料を驚くべきものに適用することにより
この強誘電材料の不所望な特性を利点としてとらえてい
るものである。
好適例ではキャパシタの一方のプレート(電極板)を大
地のような固定電位に保持する。キャパシタプレート4
4が大地電位に保持されているものとすると、所定の供
給電位に対しヒステリシスループの一方の側のみが用い
られる。プレート44を接地するのが比較的便利である
。その理由は、このプレート44はアレイ中の多数のD
RAMセルに共通であり、一方、プレート40は各セル
にとって独自のものである為である。第3図の実線ルー
プは本発明に用いうる種類の強誘電材料に対するヒステ
リシスループを示す。この第3図を参照するに、縦軸は
電荷Qを表わし、横軸は電圧■を表わす。
地のような固定電位に保持する。キャパシタプレート4
4が大地電位に保持されているものとすると、所定の供
給電位に対しヒステリシスループの一方の側のみが用い
られる。プレート44を接地するのが比較的便利である
。その理由は、このプレート44はアレイ中の多数のD
RAMセルに共通であり、一方、プレート40は各セル
にとって独自のものである為である。第3図の実線ルー
プは本発明に用いうる種類の強誘電材料に対するヒステ
リシスループを示す。この第3図を参照するに、縦軸は
電荷Qを表わし、横軸は電圧■を表わす。
これらの座標軸には2つのヒステリシス曲線が示してあ
り、また一方のキャパシタプレートが接地されている為
、縦軸の正の側にある曲線部分のみが使用される。
り、また一方のキャパシタプレートが接地されている為
、縦軸の正の側にある曲線部分のみが使用される。
理想的な強誘電材料では、電圧を印加した際に、強誘電
材料を誘電体として用いたキャパシタに生じる電荷は強
誘電材料の誘電定数を表わすライン60の勾配に応じて
決定される。点62は印加電圧が零の際のヒステリシス
曲線の一方の安定分極状態を表わし、点64は印加電圧
が零の際の他方の安定分極状態を表わす。これらの点は
誘電体の強誘電特性をメモリセルの状態の決定に用いた
場合にメモリセルによって記憶しうる論理状態を表わす
。
材料を誘電体として用いたキャパシタに生じる電荷は強
誘電材料の誘電定数を表わすライン60の勾配に応じて
決定される。点62は印加電圧が零の際のヒステリシス
曲線の一方の安定分極状態を表わし、点64は印加電圧
が零の際の他方の安定分極状態を表わす。これらの点は
誘電体の強誘電特性をメモリセルの状態の決定に用いた
場合にメモリセルによって記憶しうる論理状態を表わす
。
しかし、本発明はメモリセルに記憶されるデータを安定
な強誘電状態に応じて決定するものではない。本発明は
キャパシタプレートに蓄積される電荷を用いるものであ
る。
な強誘電状態に応じて決定するものではない。本発明は
キャパシタプレートに蓄積される電荷を用いるものであ
る。
いずれにしても、キャパシタプレートにまたがって電圧
が印加され、これにより電荷が蓄積される。電圧が除去
されると直ちに、1トランジスタ・1キヤパシタ型のす
べてのDRAMセルにおけるように電荷が消失し始める
。従って、他のDRAMのように、メモリセルは周期的
にリフレッシュされる。
が印加され、これにより電荷が蓄積される。電圧が除去
されると直ちに、1トランジスタ・1キヤパシタ型のす
べてのDRAMセルにおけるように電荷が消失し始める
。従って、他のDRAMのように、メモリセルは周期的
にリフレッシュされる。
すなわち、データがセルから読出されると、次にこのセ
ルにデータを再書込みしうる。
ルにデータを再書込みしうる。
スイッチング電圧を印加し、次にこのスイッチング電圧
を除去した後に緩和作用を除去するのではなく促進する
ように強誘電材料を用いることにより、セルが(代表的
に4ミリ秒毎に)リフレッシュされると、緩和作用を受
けた双極子は第3図における点66に対応する電圧に矛
盾しないように再配向される。第3図における破線曲線
68は可成り大きな緩和特性を有する強誘電材料に対す
るヒステリシスループを示す。リフレッシュ中に双極子
が再配向される結果、誘電定数に印加電圧を乗じた値に
より表わされる電荷量よりも可成り多くの電荷がキャパ
シタプレートに生じる。例えば、ビットライン50が2
.5ボルトに予備帯電され、次に、ゲート電極46に電
圧を印加することによりキャパシタに結合される場合に
は、メモリセルにおける電圧は最後の書込み動作の時点
から零ボルトか或いは5ボルトとなる(ただし減衰がな
いものとする)。これらの電圧は均圧化する傾向にある
。
を除去した後に緩和作用を除去するのではなく促進する
ように強誘電材料を用いることにより、セルが(代表的
に4ミリ秒毎に)リフレッシュされると、緩和作用を受
けた双極子は第3図における点66に対応する電圧に矛
盾しないように再配向される。第3図における破線曲線
68は可成り大きな緩和特性を有する強誘電材料に対す
るヒステリシスループを示す。リフレッシュ中に双極子
が再配向される結果、誘電定数に印加電圧を乗じた値に
より表わされる電荷量よりも可成り多くの電荷がキャパ
シタプレートに生じる。例えば、ビットライン50が2
.5ボルトに予備帯電され、次に、ゲート電極46に電
圧を印加することによりキャパシタに結合される場合に
は、メモリセルにおける電圧は最後の書込み動作の時点
から零ボルトか或いは5ボルトとなる(ただし減衰がな
いものとする)。これらの電圧は均圧化する傾向にある
。
セルキャパシタにおける5ボルトをビットラインにおけ
る2、5ボルトと均圧化するために、強誘電材料中の多
数の双極子が緩和作用を受け、電荷が移送される。一方
、セルにおける電圧が零ボルトである場合も双極子が緩
和によりもとの状態に切換わる為に電荷が移送される。
る2、5ボルトと均圧化するために、強誘電材料中の多
数の双極子が緩和作用を受け、電荷が移送される。一方
、セルにおける電圧が零ボルトである場合も双極子が緩
和によりもとの状態に切換わる為に電荷が移送される。
ビットラインにおける2、5ボルトはセルキャパシタに
おける零ボルトと均圧化される傾向にあり、強誘電材料
中の双極子が切換ねる際に電荷がビットラインから引出
される。各双極子が動く (フリッピングする)と、あ
る単位の電荷が移送される。この双極子の動きおよびそ
の後の反転は単一極性のパルスがキャパシタプレートに
印加される場合でも生じる。ビットラインを接地し、零
ボルトを(ターン・オンした)アクセストランジスタを
経てキャパシタに伝達することにより論理値“0”がメ
モリセルに書込まれることが分かるであろう。論理値“
1゛は5ボルトのような供給電圧がメモリセルに伝達さ
れると書込まれる。
おける零ボルトと均圧化される傾向にあり、強誘電材料
中の双極子が切換ねる際に電荷がビットラインから引出
される。各双極子が動く (フリッピングする)と、あ
る単位の電荷が移送される。この双極子の動きおよびそ
の後の反転は単一極性のパルスがキャパシタプレートに
印加される場合でも生じる。ビットラインを接地し、零
ボルトを(ターン・オンした)アクセストランジスタを
経てキャパシタに伝達することにより論理値“0”がメ
モリセルに書込まれることが分かるであろう。論理値“
1゛は5ボルトのような供給電圧がメモリセルに伝達さ
れると書込まれる。
代表的に、強誘電材料が同じ方向(すなわち同じ極性)
で書込まれる、すなわちパルスが与えられる回数が多く
なればなる程、各反復後の緩和作用は少くなる。その理
由は、前記の米国特許第184996号明細書に説明さ
れているように補償電荷が最終的に移動し、従って緩和
作用が生じなくなる為である。従って、上述したように
して用いられた通常の強誘電材料の場合に生じるこの逐
次の劣化を無くすために、強誘電双極子領域を考慮する
。
で書込まれる、すなわちパルスが与えられる回数が多く
なればなる程、各反復後の緩和作用は少くなる。その理
由は、前記の米国特許第184996号明細書に説明さ
れているように補償電荷が最終的に移動し、従って緩和
作用が生じなくなる為である。従って、上述したように
して用いられた通常の強誘電材料の場合に生じるこの逐
次の劣化を無くすために、強誘電双極子領域を考慮する
。
これらの強誘電双極子領域は双極子のすべて或いはほぼ
すべてが同一方向にある領域である。ある強誘電材料で
は、緩和作用による向きは(キャパシタプレートに外部
から電圧を印加した際にこれらキャパシタプレート間に
生じる電界と整列された)以前の配向から180°とな
る。しかし、他の強誘電材料では、緩和作用による向き
は180°ではなく、実際に緩和作用による向が90°
となるある強誘電材料がある。このような材料では、例
えば+5ボルトの信号を供給すると、双極子がすべて一
方向に整列される。この信号を除去すると、この+5ボ
ルトが0ボルトに向けて減少し始め、双極子は緩和作用
によりある中間位置を向く。−5ボルトの信号を供給す
る場合には、双極子は+5ボルトの際に有するであろう
配向から180°の位置に整列される。この場合も信号
を除去し0ボルトに減少せしめると、双極子は緩和作用
により中間点に向く傾向にある。
すべてが同一方向にある領域である。ある強誘電材料で
は、緩和作用による向きは(キャパシタプレートに外部
から電圧を印加した際にこれらキャパシタプレート間に
生じる電界と整列された)以前の配向から180°とな
る。しかし、他の強誘電材料では、緩和作用による向き
は180°ではなく、実際に緩和作用による向が90°
となるある強誘電材料がある。このような材料では、例
えば+5ボルトの信号を供給すると、双極子がすべて一
方向に整列される。この信号を除去すると、この+5ボ
ルトが0ボルトに向けて減少し始め、双極子は緩和作用
によりある中間位置を向く。−5ボルトの信号を供給す
る場合には、双極子は+5ボルトの際に有するであろう
配向から180°の位置に整列される。この場合も信号
を除去し0ボルトに減少せしめると、双極子は緩和作用
により中間点に向く傾向にある。
このことは材料の物理的構造、すなわち材料内部の分子
配向から得られるものであり、処理中材料に与えられる
歪みによるものである。概念的には、例えばキャパシタ
プレート電界に対し90°の領域を有する強誘電材料を
用いることにより、双極子は電圧をキャパシタプレート
から除去した後緩和作用により最小歪みの位置に向く。
配向から得られるものであり、処理中材料に与えられる
歪みによるものである。概念的には、例えばキャパシタ
プレート電界に対し90°の領域を有する強誘電材料を
用いることにより、双極子は電圧をキャパシタプレート
から除去した後緩和作用により最小歪みの位置に向く。
この場合、二酸化珪素の場合のように緩和作用が生じな
い場合に必要とするよりも多くの電荷がビットラインか
ら取出され、キャパシタプレートに与えられる。
い場合に必要とするよりも多くの電荷がビットラインか
ら取出され、キャパシタプレートに与えられる。
従って、単位面積当り多くの電荷が移送される。
ある強誘電材料は“長軸”および“短軸°゛がある分子
構造を有している。長袖はしばしば“極軸(polar
oxis)”と称されている。極軸がキャパシタプレ
ート間の強誘電膜の平面内にあるようにすることにより
、これらキャパシタプレートに電圧を印加すると極軸は
得られる電界の方向に整列され、通常キャパシタプレー
トの平面に対し垂直となる。
構造を有している。長袖はしばしば“極軸(polar
oxis)”と称されている。極軸がキャパシタプレ
ート間の強誘電膜の平面内にあるようにすることにより
、これらキャパシタプレートに電圧を印加すると極軸は
得られる電界の方向に整列され、通常キャパシタプレー
トの平面に対し垂直となる。
本発明の好適例によれば、(電圧を印加しない際の)強
誘電材料の極軸が、電圧をキャパシタプレートに印加し
た際に得られる電界の方向と整列されないようにする。
誘電材料の極軸が、電圧をキャパシタプレートに印加し
た際に得られる電界の方向と整列されないようにする。
好ましくは、極軸を電界から90°の向きに配向させる
。電界が与えられると、極軸が歪み位置に移動し、電界
が除去されると、分子は歪みが少なくより安定な位置に
戻るように移動する。キャパシタプレート間の強誘電材
料に対しては多結晶或いはセラミック構造を用いるのが
好ましい。多結晶構造はPZT (チタン酸ジルコニ
ウム鉛)と称されている強誘電材料に優勢的に存在する
。この材料は例えば化合物Pb(Ti+ Zr)03に
おけるチタニウム対シルコウムの比率を52部対48部
としたものを用いている。PZTは通常スパッタリング
或いは蒸着により多結晶の形態で生ぜしめられる為、当
業者は困難なく好適な強誘電材料を得ることができるで
あろう。更に、1971年にアカデミツク・プレス社に
より発行された本“°ノン・メタリック・ソリッズ(N
on−Metallic 5olids) ”、特にそ
の第3巻の第76〜79頁および第154〜159頁を
参照しうる。この発明にとっては“方形パのヒステリシ
スループと対抗するものとしての°“傾斜”のヒステリ
シスループが好ましく、この後者のヒステリシスループ
は0位置空格子点を生じる緩和剤を用いて得ている(上
記の本の第158頁参照)。当業者はしばしば“′硬゛
強誘電体およびパ軟″強誘電体を用いている。パ硬″′
強誘電体は、緩和特性を有さず方形のヒステリシスルー
プを有する“軟”強誘電体と相違して著しい緩和特性を
有する為に本発明に用いるのに適している。
。電界が与えられると、極軸が歪み位置に移動し、電界
が除去されると、分子は歪みが少なくより安定な位置に
戻るように移動する。キャパシタプレート間の強誘電材
料に対しては多結晶或いはセラミック構造を用いるのが
好ましい。多結晶構造はPZT (チタン酸ジルコニ
ウム鉛)と称されている強誘電材料に優勢的に存在する
。この材料は例えば化合物Pb(Ti+ Zr)03に
おけるチタニウム対シルコウムの比率を52部対48部
としたものを用いている。PZTは通常スパッタリング
或いは蒸着により多結晶の形態で生ぜしめられる為、当
業者は困難なく好適な強誘電材料を得ることができるで
あろう。更に、1971年にアカデミツク・プレス社に
より発行された本“°ノン・メタリック・ソリッズ(N
on−Metallic 5olids) ”、特にそ
の第3巻の第76〜79頁および第154〜159頁を
参照しうる。この発明にとっては“方形パのヒステリシ
スループと対抗するものとしての°“傾斜”のヒステリ
シスループが好ましく、この後者のヒステリシスループ
は0位置空格子点を生じる緩和剤を用いて得ている(上
記の本の第158頁参照)。当業者はしばしば“′硬゛
強誘電体およびパ軟″強誘電体を用いている。パ硬″′
強誘電体は、緩和特性を有さず方形のヒステリシスルー
プを有する“軟”強誘電体と相違して著しい緩和特性を
有する為に本発明に用いるのに適している。
一般に、一般式ABO,iのペロブスカイト型構造の殆
どの強誘電体を用いうる。ペロブスカイト型構造は一般
に、立方体の8つの隅部に“A°°原子を有し、立方体
の6つの面の各々の真中に酸素原子を有し、立方体の中
心に1つのB“原子を有する立方晶系構造をしている。
どの強誘電体を用いうる。ペロブスカイト型構造は一般
に、立方体の8つの隅部に“A°°原子を有し、立方体
の6つの面の各々の真中に酸素原子を有し、立方体の中
心に1つのB“原子を有する立方晶系構造をしている。
プロブスカイト型構造にはチタン酸ジルコニウム鉛や、
チタン酸ストロンチウムや、チタン酸バリウムが含まれ
る。
チタン酸ストロンチウムや、チタン酸バリウムが含まれ
る。
使用する材料の構造は長年に亘って半導体工業で一般的
となっているX線回折技術および透過型電子顕微鏡技術
によって決定しうる。材料の構造を変更する種々の要因
には、アニーリング時間、温度、周囲雰囲気や、電極の
結晶構造、基板係数、熱膨張率が含まれる。好適例では
多結晶構造を用いる為、双極子は均一に配向されない。
となっているX線回折技術および透過型電子顕微鏡技術
によって決定しうる。材料の構造を変更する種々の要因
には、アニーリング時間、温度、周囲雰囲気や、電極の
結晶構造、基板係数、熱膨張率が含まれる。好適例では
多結晶構造を用いる為、双極子は均一に配向されない。
幾つかの双極子が、電圧をキャパシタプレート40.4
4に印加した際に生じる電界に対し平行にならない(整
列されない)限り、本発明が有効に成立する。しかし、
前述したようにできるだけ多くの双極子が整列されない
ようにするのが好ましい。
4に印加した際に生じる電界に対し平行にならない(整
列されない)限り、本発明が有効に成立する。しかし、
前述したようにできるだけ多くの双極子が整列されない
ようにするのが好ましい。
計算によれば、250人の厚さの強誘電膜を用い、強誘
電体の1平方センチメートル当り10マイクロクーロン
(すべての強誘電体双極子の約4分の1に相当)が緩和
作用を呈するものとし、二酸化珪素に対する誘電定数を
3.8とすると、本発明によれば単位面積当りの電荷は
337倍以上に改善される。
電体の1平方センチメートル当り10マイクロクーロン
(すべての強誘電体双極子の約4分の1に相当)が緩和
作用を呈するものとし、二酸化珪素に対する誘電定数を
3.8とすると、本発明によれば単位面積当りの電荷は
337倍以上に改善される。
従って、DRAMメモリセルにおけるキャパシタ誘電体
として強誘電材料を用い、この材料をその緩和作用がメ
モリセルの通常の読出し、リフレッシュおよび書込み動
作中に促進されるように調整することにより、読出し或
いはリフレッシュパルスが与えられるたびに強誘電材料
中の双極子を再配向する必要性を期待しうるようになる
。これによる正味の効果は、メモリセルが単位面積当り
多くの電荷をビットラインから取込むことができ、従っ
て追加の信号余裕度が得られるということである。従っ
て、メモリセルを“°電荷増倍”メモリセルと称するこ
とができる。これは、強誘電材料を用い、双極子をキャ
パシタプレートにより与えられる電界とは異なる(好ま
しくはこの電界に対し垂直な)緩和位置に配向させるこ
とにより達成される。多結晶強誘電材料およびペロブス
カイト型構造がこの特性を呈するものであり、好ましも
のである。
として強誘電材料を用い、この材料をその緩和作用がメ
モリセルの通常の読出し、リフレッシュおよび書込み動
作中に促進されるように調整することにより、読出し或
いはリフレッシュパルスが与えられるたびに強誘電材料
中の双極子を再配向する必要性を期待しうるようになる
。これによる正味の効果は、メモリセルが単位面積当り
多くの電荷をビットラインから取込むことができ、従っ
て追加の信号余裕度が得られるということである。従っ
て、メモリセルを“°電荷増倍”メモリセルと称するこ
とができる。これは、強誘電材料を用い、双極子をキャ
パシタプレートにより与えられる電界とは異なる(好ま
しくはこの電界に対し垂直な)緩和位置に配向させるこ
とにより達成される。多結晶強誘電材料およびペロブス
カイト型構造がこの特性を呈するものであり、好ましも
のである。
本発明は上述した実施例にのみ限定されず、幾多の変更
を加えうろこと勿論である。
を加えうろこと勿論である。
第1図は、通常のDRAMメモリセルを示す断面図、第
2図は、本発明により構成したDRAMメモリセルを示
す断面図、 第3図は、強誘電材料の常規の状態を実線曲線で、緩和
状態を破線曲線で示す2つのヒステリシス曲線を示す線
図である。 12、30・・・基板 14、32・・・第1拡散領域(ソース領域)16、3
4・・・第2拡散領域(ドレイン領域)18・・・拡散
領域(キャパシタプレート)20・・・誘電体
22a・・・多結晶珪素層22b・・・多結晶珪素層
(ゲート電極)24・・・二酸化珪素層 26.38
.48・・・孔28・・・金属素子 36・・・
誘電体絶縁領域40、44.50・・・導電部材 42・・・強誘電材料 46・・・ゲート電極特許
出11人 ラムトロン・コーポレーションflo、
/
2図は、本発明により構成したDRAMメモリセルを示
す断面図、 第3図は、強誘電材料の常規の状態を実線曲線で、緩和
状態を破線曲線で示す2つのヒステリシス曲線を示す線
図である。 12、30・・・基板 14、32・・・第1拡散領域(ソース領域)16、3
4・・・第2拡散領域(ドレイン領域)18・・・拡散
領域(キャパシタプレート)20・・・誘電体
22a・・・多結晶珪素層22b・・・多結晶珪素層
(ゲート電極)24・・・二酸化珪素層 26.38
.48・・・孔28・・・金属素子 36・・・
誘電体絶縁領域40、44.50・・・導電部材 42・・・強誘電材料 46・・・ゲート電極特許
出11人 ラムトロン・コーポレーションflo、
/
Claims (1)
- 【特許請求の範囲】 1、リフレッシュ作動をする型のダイナミック・ランダ
ム・アクセス・メモリに用いるメモリセルであって、キ
ャパシタプレート間に誘電材料を入れたキャパシタを具
える当該メモリセルにおいて、前記の誘電材料が、極軸
を有する双極子を持つ強誘電材料を具えており、前記の
極軸の少くとも数個が、緩和した状態で、前記のキャパ
シタプレート間に電位が印加された際に生じた電界の方
向と整列されていない配向を有するようになっているこ
とを特徴とするメモリセル。 2、請求項1に記載のメモリセルにおいて、前記の強誘
電材料の構造が多結晶であることを特徴とするメモリセ
ル。 3、請求項2に記載のメモリセルにおいて、前記の強誘
電材料に鉛、ジルコニウムおよびチタニウムが含まれて
いることを特徴とするメモリセル。 4、請求項1に記載のメモリセルにおいて、前記の強誘
電材料がペロブスカイト型構造を有していることを特徴
とするメモリセル。 5、請求項1に記載のメモリセルにおいて、少くとも数
個の双極子が、緩和された状態で、前記のキャパシタプ
レート間に電圧が印加された際に生じた電界の方向から
ほぼ90℃を成す極軸を有するように配向されるように
なっていることを特徴とするメモリセル。 6、請求項1に記載のメモリセルにおいて、少くとも数
個の双極子が、緩和された状態で、前記のキャパシタプ
レート間に設けられている強誘電膜の平面内に極軸を有
するように配向されるようになっていることを特徴とす
るメモリセル。 7、キャパシタプレートとこれらキャパシタプレート間
の強誘電材料とを有する型のダイナミック・ランダム・
アクセス・メモリセルを動作させるメモリセル動作方法
において、 前記のギヤバンクプレートの一方に結合さ れたビットラインを経て前記のキャパシタプレート間に
書込み電圧を印加し、これにより強誘電材料中の強誘電
双極子を前記の書込み電圧により生ぜしめられる前記の
キャパシタプレート間の電界に応じて配向させる工程と
、前記の書込み電圧を除去する工程を含み、 前記の双極子を緩和作用により前記の電界の方向と整列
されていない位置に向ける工程と、前記のキャパシタプ
レートの一方と前記の ビットラインとの間で電荷を交換することにより前記の
メモリセルを繰返しリフレッシュし、これによりキャパ
シタプレート間の強誘電双極子の整列および緩和作用を
繰返し用い、これらのリフレッシュ動作中に前記のキャ
パシタプレートにおける電荷の量を増大させることを特
徴とするメモリセル動作方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US18518588A | 1988-04-22 | 1988-04-22 | |
US185185 | 1988-04-22 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01278063A true JPH01278063A (ja) | 1989-11-08 |
Family
ID=22679954
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63260689A Pending JPH01278063A (ja) | 1988-04-22 | 1988-10-18 | メモリセルおよびその動作方法 |
Country Status (4)
Country | Link |
---|---|
EP (1) | EP0338157B1 (ja) |
JP (1) | JPH01278063A (ja) |
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