JPH0125074B2 - - Google Patents

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JPH0125074B2
JPH0125074B2 JP57106387A JP10638782A JPH0125074B2 JP H0125074 B2 JPH0125074 B2 JP H0125074B2 JP 57106387 A JP57106387 A JP 57106387A JP 10638782 A JP10638782 A JP 10638782A JP H0125074 B2 JPH0125074 B2 JP H0125074B2
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JP
Japan
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character
display
memory
code
control
Prior art date
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Application number
JP57106387A
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Japanese (ja)
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JPS58223179A (en
Inventor
Takane Ono
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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  • Document Processing Apparatus (AREA)
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Description

【発明の詳細な説明】 (a) 発明の技術分野 本発明は、デイスプレイ装置における表示文字
の配列を制御する文字表示制御方式に関する。
DETAILED DESCRIPTION OF THE INVENTION (a) Technical Field of the Invention The present invention relates to a character display control method for controlling the arrangement of displayed characters in a display device.

(b) 従来技術と問題点 日本語処理システム等のデイスプレイ装置にお
いて、処理装置からデイスプレイ装置へ文字コー
ドを送出して文字を表示させる際、句読点(「。」、
「、」)が次行(文字が表示されている行の次の行)
の先頭に表示される文字配列となることがある。
(b) Prior art and problems In display devices such as Japanese language processing systems, when displaying characters by sending character codes from the processing device to the display device, punctuation marks (“.”,
",") is the next line (the line following the line where the character is displayed)
This may be the character array displayed at the beginning of the .

これを防止するため従来は、表示画面の右端
(横方向表示のとき)に1文字分の空き表示領域
を設け、この部分を句読点の表示専用領域に用い
る方法を採用している。或は他の方法として、特
定の文字例えば、「る」、「た」、「て」、「け」等の
文字は、句読点付の文字(「る。」、「て、」…)と
して特定コードを登録し、必要に応じ、この特定
コードをデイスプレイ装置に供給することによ
り、表示行の末端処理を行つている。
To prevent this, a conventional method has been adopted in which a free display area for one character is provided at the right end of the display screen (when displayed horizontally) and this area is used as an area exclusively for displaying punctuation marks. Alternatively, certain characters such as ``ru'', ``ta'', ``te'', ``ke'', etc. can be specified as characters with punctuation marks (``ru.'', ``te''...). By registering the code and supplying this specific code to the display device as necessary, the end of the display line is processed.

このように従来方式では、句読点の表示処理の
ために、本来の表示領域が狭められたり、或は特
定文字に対する文字コードの登録を必要とする欠
点があつた。
As described above, the conventional system has the disadvantage that the original display area is narrowed due to the display processing of punctuation marks, or that character codes for specific characters must be registered.

(c) 発明の目的 本発明は上記の欠点を解決するためになされた
もので、表示文字の配列制御を容易とす文字表示
制御方式の提供を目的とする。
(c) Purpose of the Invention The present invention has been made to solve the above-mentioned drawbacks, and its purpose is to provide a character display control method that facilitates control of the arrangement of displayed characters.

(d) 発明の構成 本発明は、処理装置と、該処理装置から受信し
た文字コードに対応して発生させた表示用ドツト
パターンを表示するデイスプレイ装置を有するシ
ステムにおいて、該処理装置には、行頭に位置づ
けられる文字が所定の文字であることを検出した
場合に、該文字及び該文字の直前の文字の文字コ
ードに、それぞれ所要のシフト方向とシフト量を
指定した制御コードを付して該デイスプレイ装置
に送出する手段を有し、該デイスプレイ装置に
は、該制御コードを受信した場合に、該コードの
該表示用ドツトパターンに該制御コードに指定さ
れたシフトを行つたメモリパターンを生成する手
段と、相続いて受信する、該制御コードを付した
該文字コードから生成した該メモリパターンを重
畳して表示する手段を有することを特徴とする文
字表示制御方式である。
(d) Structure of the Invention The present invention provides a system that includes a processing device and a display device that displays a display dot pattern generated in response to a character code received from the processing device. When it is detected that a character positioned in and means for generating a memory pattern in which the display dot pattern of the code is shifted as specified by the control code when the display device receives the control code. This character display control system is characterized by having means for superimposing and displaying the memory pattern generated from the character code attached with the control code, which is successively received.

(e) 発明の実施例 以下、本発明を図面によつて説明する。第1図
は本発明を説明する表示例、第2図及び第3図は
本発明の一実施例を説明するメモリパタン図、第
4図は本発明の一実施例を説明するブロツク図で
あり、1は処理装置、2は切替部、3は文字発生
器、4は制御部、5,6,9,10,11はアド
レスカウンタ、7,8はレジスタ、12は表示制
御部、13は表示制御部、C1,C2は文字コード、
L2,R7は制御コード、l2,r7はシフトパルス、
M1,M2,M3,M4,m1,m2,m3,m4はメモ
リ、M5,m5は表示メモリ、Pはパルス信号、S
は切替信号、イ,ロは接点である。第1図は表示
画面を示し、第1図aのように第1行の最終位置
で「文」が終るとき、通常の方法では、句点「。」
が第2行の先頭位置に表示されることになる。こ
のような場合には、第1図bに示すように「文」
の最終文字の後尾に句点「。」を表示することが
望ましい。本発明は、ラスタスキヤン方式のデイ
スプレイ装置において、この表示制御を可能とし
たものである。
(e) Examples of the invention The present invention will be explained below with reference to the drawings. FIG. 1 is a display example for explaining the present invention, FIGS. 2 and 3 are memory pattern diagrams for explaining an embodiment of the present invention, and FIG. 4 is a block diagram for explaining an embodiment of the present invention. , 1 is a processing unit, 2 is a switching unit, 3 is a character generator, 4 is a control unit, 5, 6, 9, 10, 11 are address counters, 7, 8 are registers, 12 is a display control unit, 13 is a display Control part, C 1 and C 2 are character codes,
L 2 , R 7 are control codes, l 2 , R 7 are shift pulses,
M1 , M2 , M3 , M4 , m1, m2 , m3 , m4 are memories, M5 , m5 are display memories, P is a pulse signal, S
is a switching signal, and A and B are contacts. Figure 1 shows the display screen, and when a sentence ends at the final position of the first line as shown in Figure 1a, in the usual way, a full stop mark ``.'' is used.
will be displayed at the beginning of the second line. In such a case, as shown in Figure 1b, the ``sentence''
It is desirable to display a period "." at the end of the last character. The present invention enables this display control in a raster scan type display device.

周知のようにラスタスキヤン方式のデイスプレ
イ装置においては、文字発生器から出力された表
示用ドツトパタン信号は表示用のメモリに蓄えら
れたのち、これが表示部の輝度信号として用いら
れる。
As is well known, in a raster scan type display device, a display dot pattern signal output from a character generator is stored in a display memory, and then used as a brightness signal for the display section.

第2図は表示用ドツトパタン信号がメモリに格
納された状態の説明図であり、メモリm1及びm2
の斜線部分に黒レベルを示す信号「1」が書込ま
れ、その他の白地部分に、白レベルを示す信号
「0」が書込まれている。第2図におけるメモリ
m1には平仮名「た」の表示用ドツトパターン信
号、そしてメモリm2には句点「。」の表示用ドツ
トパタン信号が書込まれている。
FIG. 2 is an explanatory diagram of a state in which display dot pattern signals are stored in memories, and the memories m 1 and m 2
A signal "1" indicating the black level is written in the diagonally shaded area, and a signal "0" indicating the white level is written in the other white areas. Memory in Figure 2
A dot pattern signal for displaying the hiragana character "ta" is written in m1 , and a dot pattern signal for displaying the period mark "." is written in memory m2 .

なお1文字表示用(スペースを含む)のドツト
数は144(12×12)とし、従つてメモリm1及びm2
のメモリ容量は144(12×12)ビツトである。文字
「た」を句点「。」との双方を、1文字表示用ドツ
ト数144内に表示せしめるには、2つの表示用ド
ツトパタン信号を1つに合成すればよい。その実
現方法を示したのが第3図である。
The number of dots for displaying one character (including spaces) is 144 (12 x 12), so the memory capacity is m 1 and m 2.
The memory capacity of is 144 (12 x 12) bits. In order to display both the character "ta" and the period "." within the number of 144 display dots for one character, it is sufficient to combine the two display dot pattern signals into one. Figure 3 shows how to achieve this.

第3図において、メモリm3のメモリパタンは、
第2図に示したメモリm1内のテータを転送した
状態を示すが、転送の際、メモリm1から読出さ
れたデータを、左方向へ2ビツトシフトさせたの
ち、これをメモリm3に書込んだものである。同
様にメモリm4のメモリパタンは、第2図におけ
るメモリm2内のデータを転送した状態を示し、
転送の際、メモリm2から読出されたデータを右
方向へ7ビツトシフトさせたのち、これをメモリ
m4に書込んだものである。このメモリm3及びm4
の双方を論理和した重畳データを表示メモリm5
に書込めば、図示のように1文字用のメモリ
(144ビツト)内に、文字「た」と句「。」との双
方のドツトパタン(信号)が書込まれたことにな
る。従つてこの表示メモリm5から、そのドツト
パタン(信号)を読出して、これを表示部へ送出
すれば、第1図bに示したように、行末の最終文
字「た」の後尾に句点「。」を表示せしめること
ができる。
In FIG. 3, the memory pattern of memory m3 is
The state in which the data in memory m1 shown in Fig. 2 has been transferred is shown. During the transfer, the data read from memory m1 is shifted 2 bits to the left and then written to memory m3 . It's complicated. Similarly, the memory pattern of memory m4 shows the state in which the data in memory m2 in FIG. 2 has been transferred,
During transfer, the data read from memory m2 is shifted to the right by 7 bits, and then transferred to memory.
This is what I wrote in m4 . This memory m 3 and m 4
Displays the superimposed data obtained by logically adding both of the memory m5
, the dot patterns (signals) of both the character "ta" and the phrase "." are written in the memory for one character (144 bits) as shown in the figure. Therefore, if the dot pattern (signal) is read out from the display memory m5 and sent to the display section, as shown in FIG. ” can be displayed.

第4図におけるM1,M2,M3,M4及び表示メ
モリM5は144(12×12)ビツトの容量を有する。
このメモリ(M1〜M5)への書込み/読出しはア
ドレスカウンタ(5,6,9,10及び11)の
値で定まるアドレスシングにより行われる。な
お、これらのアドレスカウンタは、所定周期のパ
ルス信号Pにより駆動される。第4図において、
処理装置1は、表示文字の位置をズラす必要があ
る場合には、文字コード(C1,C2)に引続いて
制御コード(L2,R7)を送出する。
M 1 , M 2 , M 3 , M 4 and display memory M 5 in FIG. 4 have a capacity of 144 (12×12) bits.
Writing/reading to/from this memory (M 1 to M 5 ) is performed by addressing determined by the values of address counters (5, 6, 9, 10, and 11). Note that these address counters are driven by a pulse signal P having a predetermined period. In Figure 4,
If it is necessary to shift the position of a displayed character, the processing device 1 sends out a control code (L 2 , R 7 ) following the character code (C 1 , C 2 ).

実施例では、文字コードC1(文字「た」)の次
に制御コードL2、そして文字コードC2(句点
「。」)の次に制御コードR7を送出する。なお制御
コードL2は、メモリ内データの転送時に左方へ
2ビツトシフトせしめる指令であり、同様に制御
コードR7は右方へ7ビツトシフトせしめる指令
である。制御部4は受信データを識別し、文字コ
ードC1及びC2は文字発生器3へ入力すると共に
切替信号Sを発する。さらに制御コードL2に対
応してシフトパルスl2(2個のパルス信号)、また
制御コードR7に対応してシフトパルスr7(7個の
パルス信号)を出力する。文字発生器3からの文
字「た」の表示用ドツトパタン信号は切替部2の
接点イを経てメモリM1に書込まれ、一方句点
「。」の表示用ドツトパタン信号は接点ロを経てメ
モリM2に書込まれる(切替部2は切替信号Sに
より文字単位で切替えられる)。レジスタ7及び
8は12ビツトのレジスタであり、メモリM1及び
M2内のデータは12ビツト単位で読出されて、レ
ジスタ(7及び8)にセツトされる。第4図にお
けるメモリM1及びM2のメモリパタンは、第2図
に示したメモリm1及びm2のメモリパタンと同一
である。アドレスカウンタ5の駆動されるに伴い
メモリM1から読出された12ビツト単位のデータ
は、レジスタ7において、シフトパルスl2により
左方向へ2ビツトシフトされたのち、このデータ
がメモリM3に書込まれる。この読出・シフト・
書込の一連の動作が12回繰返されると、メモリ
M1からメモリM2へのデータ転送が完了する。メ
モリM3のメモリパタンは、第3図に示したメモ
リm3のメモリパタンと同一である。同様にメモ
リM2内のデータを12ビツト単位でレジスタ8に
読出し、このレジスタ8のデータを右方向へ7ビ
ツトシフトしたのち、メモリM4に書込んで転送
すれば、メモリM4内のメモリパタンは第3図に
示したメモリm4のメモリパタンと同一となる。
In the embodiment, the control code L 2 is sent after the character code C 1 (the character "ta"), and the control code R 7 is sent after the character code C 2 (the period "."). The control code L2 is a command to shift the data in the memory by 2 bits to the left, and the control code R7 is a command to shift the data by 7 bits to the right. The control unit 4 identifies the received data, inputs the character codes C 1 and C 2 to the character generator 3, and issues a switching signal S. Further, a shift pulse l 2 (two pulse signals) is output in response to the control code L 2 and a shift pulse r 7 (seven pulse signals) is output in response to the control code R 7 . The dot pattern signal for displaying the character "ta" from the character generator 3 is written into the memory M1 through the contact A of the switching unit 2, while the dot pattern signal for displaying the period point "." is written into the memory M2 through the contact B. (The switching unit 2 is switched character by character by the switching signal S.) Registers 7 and 8 are 12-bit registers, and memory M1 and
The data in M2 is read out in units of 12 bits and set in registers (7 and 8). The memory patterns of memories M 1 and M 2 in FIG. 4 are the same as the memory patterns of memories m 1 and m 2 shown in FIG. The 12-bit unit data read from the memory M1 as the address counter 5 is driven is shifted 2 bits to the left by the shift pulse l2 in the register 7, and then this data is written to the memory M3. It will be done. This read/shift/
When the series of write operations is repeated 12 times, the memory
Data transfer from M 1 to memory M 2 is completed. The memory pattern of memory M3 is the same as the memory pattern of memory m3 shown in FIG. Similarly, if you read the data in memory M2 to register 8 in units of 12 bits, shift the data in register 8 to the right by 7 bits, and then write and transfer it to memory M4 , the memory pattern in memory M4 will be changed. is the same as the memory pattern of memory m4 shown in FIG.

従つて、第4図におけるメモリM3及びM4内の
データを読出して、その論理和を表示メモリM5
に書込むことにより、表示メモリM5には、第3
図に示したメモリm5と同一のメモリパタンが得
られる。この表示メモリM5内のドツトパタン信
号を読出し、これを表示制御部12へ送出するこ
とにより、表示部13には、第1図bに示したよ
うに行末の文字「た」に引続き句点「。」を表示
せしめることができる。
Therefore, the data in the memories M3 and M4 in FIG. 4 are read out, and the logical sum thereof is displayed in the memory M5.
By writing to the display memory M5 , the third
The same memory pattern as the memory m5 shown in the figure is obtained. By reading out the dot pattern signal in the display memory M5 and sending it to the display control section 12, the display section 13 displays the character "ta" at the end of the line followed by the period "." as shown in FIG. 1b. ” can be displayed.

(f) 発明の効果 以上のように本発明は、行末における文字と共
に句読点を表示せしめることを可能としたもので
あり、文字表示制御が容易となる利点を有する。
(f) Effects of the Invention As described above, the present invention makes it possible to display punctuation marks together with characters at the end of a line, and has the advantage of facilitating character display control.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明を説明する表示部、第2図及び
第3図は本発明の一実施例を説明するメモリパタ
ーン図、第4図本発明の一実施例を説明するブロ
ツク図であり、図中に用いた符中は次の通りであ
る。 1は処理装置、2は切替部、3は文字発生器、
4は制御部、5,6,9,10,11はアドレス
カウンタ、7,8はレジスタ、12は表示制御
部、13は表示制御部、C1,C2は文字コード、
L2,R7は制御コード、l2,r7はシフトパルス、
M1,M2,M3,M4,m1,m2,m3,m4はメモ
リ、M5,m5は表示メモリ、Pはパルス信号、S
は切替信号、イ,ロは接点を示す。
FIG. 1 is a display section for explaining the present invention, FIGS. 2 and 3 are memory pattern diagrams for explaining an embodiment of the present invention, and FIG. 4 is a block diagram for explaining an embodiment of the present invention. The symbols used in the figure are as follows. 1 is a processing device, 2 is a switching unit, 3 is a character generator,
4 is a control unit; 5, 6, 9, 10, and 11 are address counters; 7 and 8 are registers; 12 is a display control unit; 13 is a display control unit; C 1 and C 2 are character codes;
L 2 , R 7 are control codes, l 2 , R 7 are shift pulses,
M1 , M2 , M3 , M4 , m1, m2 , m3 , m4 are memories, M5 , m5 are display memories, P is a pulse signal, S
indicates a switching signal, and A and B indicate contacts.

Claims (1)

【特許請求の範囲】 1 処理装置と、該処理装置から受信した文字コ
ードに対応して発生させた表示用ドツトパターン
を表示するデイスプレイ装置を有するシステムに
おいて、 該処理装置には、行頭に位置づけられる文字が
所定の文字であることを検出した場合、該文字及
び該文字の直前の文字の文字コードに、それぞれ
所要のシフト方向とシフト量を指定した制御コー
ドを付して該デイスプレイ装置に送出する手段を
有し、 該デイスプレイ装置には、該制御コードを受信
した場合に、該文字コードの該表示用ドツトパタ
ーンに該制御コードに指定されたシフトを行つた
メモリパターンを生成する手段と、 相続いて受信する、該制御コードを付した該文
字コードから生成した該メモリパターンを重畳し
て表示する手段を有することを特徴とする文字表
示制御方式。 2 少なくとも2個以上の文字コード及び制御コ
ードを前記デイスプレイ装置が受信したとき、前
記変更されたドツト構成を有する複数の表示用ド
ツトパタン信号を1つのドツトパタンに合成する
手段を備えたことを特徴とする特許請求の範囲第
1項記載の文字表示制御方式。
[Scope of Claims] 1. In a system comprising a processing device and a display device that displays a display dot pattern generated in response to a character code received from the processing device, the processing device includes: When it is detected that a character is a predetermined character, the character code of the character and the character immediately before the character is sent to the display device with a control code specifying the required shift direction and amount, respectively. means for generating a memory pattern in which the display dot pattern of the character code is shifted as specified by the control code when the display device receives the control code; 1. A character display control system comprising means for superimposing and displaying the memory pattern generated from the character code attached with the control code received by the character code. 2. The present invention is characterized by comprising means for combining a plurality of display dot pattern signals having the changed dot configuration into one dot pattern when the display device receives at least two or more character codes and control codes. A character display control method according to claim 1.
JP57106387A 1982-06-21 1982-06-21 Character display control system Granted JPS58223179A (en)

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JP57106387A JPS58223179A (en) 1982-06-21 1982-06-21 Character display control system

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JPS58223179A JPS58223179A (en) 1983-12-24
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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5732488A (en) * 1980-08-01 1982-02-22 Matsushita Electric Ind Co Ltd Kanji pattern generator

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5732488A (en) * 1980-08-01 1982-02-22 Matsushita Electric Ind Co Ltd Kanji pattern generator

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JPS58223179A (en) 1983-12-24

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