JPH01164552U - - Google Patents
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- Publication number
- JPH01164552U JPH01164552U JP6126488U JP6126488U JPH01164552U JP H01164552 U JPH01164552 U JP H01164552U JP 6126488 U JP6126488 U JP 6126488U JP 6126488 U JP6126488 U JP 6126488U JP H01164552 U JPH01164552 U JP H01164552U
- Authority
- JP
- Japan
- Prior art keywords
- unit
- bypass
- parallel bus
- information processing
- processing device
- Prior art date
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- Pending
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- 230000010365 information processing Effects 0.000 claims description 3
- 238000000034 method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Bus Control (AREA)
Description
図は本考案にかかる情報処理装置の一実施例の
構成図である。 １，１１〜１３…ユニツト、２…並列バス、３
…デージ・チエイン信号線、４，４１〜４３…バ
イパス路、５，５１〜５３…バイパス・スイツチ
、６…スイツチ開閉回路、７…アクセス制御回路
。
構成図である。 １，１１〜１３…ユニツト、２…並列バス、３
…デージ・チエイン信号線、４，４１〜４３…バ
イパス路、５，５１〜５３…バイパス・スイツチ
、６…スイツチ開閉回路、７…アクセス制御回路
。
Claims (1)
- 【実用新案登録請求の範囲】 デージ・チエイン方式でバス権の調停を行う並
列バスに、割込要求を行うユニツトを複数個接続
した情報処理装置において、 デージ・チエイン信号に前記ユニツトをバイパ
スさせるバイパス路に設けられたバイパス・スイ
ツチと、 前記ユニツトに設けられていて、ユニツトが前
記並列バスに接続されているときに前記バイパス
スイツチを開き、並列バスから切り離されている
ときにバイパススイツチを閉じるスイツチ開閉回
路と、 送られてくるデージ・チエイン信号に応じてユ
ニツトの並列バスに対するアクセスを制御するア
クセス制御回路、 を具備した情報処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6126488U JPH01164552U (ja) | 1988-05-10 | 1988-05-10 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6126488U JPH01164552U (ja) | 1988-05-10 | 1988-05-10 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01164552U true JPH01164552U (ja) | 1989-11-16 |
Family
ID=31286939
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6126488U Pending JPH01164552U (ja) | 1988-05-10 | 1988-05-10 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01164552U (ja) |
-
1988
- 1988-05-10 JP JP6126488U patent/JPH01164552U/ja active Pending
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