JPH01120250U - - Google Patents
Info
- Publication number
- JPH01120250U JPH01120250U JP1481588U JP1481588U JPH01120250U JP H01120250 U JPH01120250 U JP H01120250U JP 1481588 U JP1481588 U JP 1481588U JP 1481588 U JP1481588 U JP 1481588U JP H01120250 U JPH01120250 U JP H01120250U
- Authority
- JP
- Japan
- Prior art keywords
- microprocessor
- inputting
- input section
- reset
- reset signal
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Description
第１図はこの考案の一実施例を示すデータ処理
装置の構成図、第２図は従来のデータ処理装置の
構成図である。図において、１ａはマイクロプロ
セツサ、２はリセツトスイツチ、３はＲＡＭ、４
ａはリセツト入力部、５は割込入力部、６は遅延
回路を示す。なお、図中、同一符号は同一、また
は相当部分を示す。
装置の構成図、第２図は従来のデータ処理装置の
構成図である。図において、１ａはマイクロプロ
セツサ、２はリセツトスイツチ、３はＲＡＭ、４
ａはリセツト入力部、５は割込入力部、６は遅延
回路を示す。なお、図中、同一符号は同一、また
は相当部分を示す。
Claims (1)
- データを記憶あるいは記録する媒体と、この媒
体をアクセスしてデータ処理を行うマイクロプロ
セツサと、このマイクロプロセツサにリセツト信
号を割込信号として入力する割込入力部と、上記
リセツト信号をマイクロプロセツサに入力するリ
セツト入力部と、このリセツト入力部に入力され
るリセツト信号を、マイクロプロセツサの処理動
作終了まで遅らせて出力する遅延回路とを備えた
データ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1481588U JPH01120250U (ja) | 1988-02-06 | 1988-02-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1481588U JPH01120250U (ja) | 1988-02-06 | 1988-02-06 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01120250U true JPH01120250U (ja) | 1989-08-15 |
Family
ID=31226341
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1481588U Pending JPH01120250U (ja) | 1988-02-06 | 1988-02-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01120250U (ja) |
-
1988
- 1988-02-06 JP JP1481588U patent/JPH01120250U/ja active Pending