JP7407535B2 - 表示ドライバicチップ、表示モジュール及び表示パネルの駆動方法 - Google Patents
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Description
1、1A:表示パネル
1a :境界
1b :境界
1c :境界
2 :表示ドライバICチップ
21 :左チップ
22 :右チップ
23 :中間チップ
3 :表示領域
31 :左側領域
32 :右側領域
33 :中間領域
4 :ホスト
5 :バス
6 :画素
7 :副画素
7B :B副画素
7G :G副画素
7R :R副画素
11 :インターフェース回路部
12、12A:画像データ処理回路部
13 :駆動回路部
21 :ラインメモリ
22 :バッファメモリ
23 :画像処理IPコア
24 :IP制御回路部
25 :ラインラッチ
31 :フレーム画像データ
32 :左側画像データ
33 :右側画像データ
341、342:表示画像データ
351、352:処理後画像データ
36 :処理後左側画像データ
37 :処理後右境界画像データ
38 :処理後右側画像データ
39 :処理後左境界画像データ
41、41A:データ抽出回路部
42 :ラインメモリ
43 :バッファメモリ
44 :画像処理IPコア
45 :IP制御回路部
46 :ラインラッチ
51 :右境界画像データ
52 :左境界画像データ
53 :フレーム画像データ
54 :処理後画像データ
61 :フレーム画像データ
62 :左側画像データ
63 :右側画像データ
64 :中間画像データ
65 :第1右境界画像データ
66 :第1左境界画像データ
67 :第2左境界画像データ
68 :第2右境界画像データ
691、692、693:処理後画像データ
701、702、703:表示画像データ
71 :処理後左側画像データ
72 :第1処理後右境界画像データ
73 :処理後右側画像データ
74 :第1処理後左境界画像データ
75 :処理後中間画像データ
76 :第2処理後左境界画像データ
77 :第2処理後右境界画像データ
Claims (9)
- 第1フレーム画像に対応する第1フレーム画像データを受け取るように構成されたインターフェース回路部と、
前記第1フレーム画像データから、前記第1フレーム画像の第1画像領域について規定された第1画像領域画像データと第1境界画像データとを抽出し、前記第1画像領域画像データと前記第1境界画像データとに基づいて、ジグザグ画素配置を有する複数の画素を備える表示パネルの複数の表示領域のうちの第1表示領域に対応する第1表示画像データを供給するように構成された画像データ処理回路部と、
前記第1表示画像データに基づいて前記第1表示領域の副画素を駆動するように構成された駆動回路部と
を備え、
前記複数の画素の各画素は、第1種類、第2種類及び第3種類の副画素の組を備え、
前記ジグザグ画素配置では、前記複数の画素が、前記表示パネルにおいて、水平方向において直線状の複数行に配置され、かつ、垂直方向においてジグザグの複数列に、前記ジグザグの複数列のそれぞれにおいて前記第1種類の隣接する副画素の間で物理的に水平方向のオフセットがあるように配置され、
前記第1境界画像データは、前記第1フレーム画像の第2画像領域の第1部分に位置する前記複数の画素の第1サブセットに対応する画素データを備え、
前記第2画像領域は、前記第1画像領域に隣接しており、
前記第1部分が、前記第1画像領域と前記第2画像領域の間の境界に接している
表示ドライバICチップ。 - 前記画像データ処理回路部が、前記第1画像領域画像データと前記第1境界画像データとを格納するように構成されたバッファメモリを備える
請求項1に記載の表示ドライバICチップ。 - 前記バッファメモリが、複数の水平ラインに対応する前記第1画像領域画像データと前記第1境界画像データとを格納するように構成され、
前記画像データ処理回路部が、更に、ラインメモリを備え、
前記第1画像領域画像データを順次に格納し、
前記第1画像領域画像データと前記第1境界画像データとを前記ラインメモリから前記バッファメモリに転送するように構成された
請求項2に記載の表示ドライバICチップ。 - 前記画像データ処理回路部が、
前記バッファメモリに格納された前記第1画像領域画像データと前記第1境界画像データとに対して画像処理を行うことによって、それぞれ処理後第1画像領域画像データと処理後第1境界画像データとを生成し、
前記処理後第1画像領域画像データと前記処理後第1境界画像データとに基づいて前記第1表示画像データを前記駆動回路部に供給するように構成された
請求項2に記載の表示ドライバICチップ。 - 前記画像データ処理回路部は、当該表示ドライバICチップが第1動作モードに設定されたとき、
前記第1フレーム画像データから前記第1画像領域画像データと前記第1境界画像データとを抽出し、
前記第1画像領域画像データと前記第1境界画像データとを前記バッファメモリに格納し、
前記バッファメモリに格納された前記第1画像領域画像データと前記第1境界画像データとに基づいて前記第1表示画像データを前記駆動回路部に供給するように構成され、
前記画像データ処理回路部は、当該表示ドライバICチップが第2動作モードに設定されたとき、
前記第1フレーム画像データから第2画像領域画像データと第2境界画像データとを抽出し、
前記第2画像領域画像データと前記第2境界画像データとを前記バッファメモリに格納し、
前記バッファメモリに格納された前記第2画像領域画像データと前記第2境界画像データとに基づいて、前記複数の表示領域のうちの第2表示領域に対応する第2表示画像データを前記駆動回路部に供給するように構成され、
前記第2画像領域画像データが、前記第2画像領域に対応する画像データを備え、
前記第2境界画像データが前記第1画像領域の第2部分に位置する前記複数の画素の第2サブセットに対応する画素データを備え、
前記第2部分が、前記第1画像領域と前記第2画像領域との間の境界に接している
請求項2に記載の表示ドライバICチップ。 - 前記複数の表示領域の数が3以上であり、
前記第1画像領域が、前記第1フレーム画像の端に位置し、
前記第2画像領域が、前記第1フレーム画像の中間に位置し、
前記画像データ処理回路部は、当該表示ドライバICチップが第1動作モードに設定されたとき、
前記第1フレーム画像データから、前記第1画像領域画像データと前記第1境界画像データとを抽出し、
前記第1画像領域画像データと前記第1境界画像データとを前記バッファメモリに格納し、
前記バッファメモリに格納された前記第1画像領域画像データと前記第1境界画像データとに基づいて前記第1表示画像データを前記駆動回路部に供給するように構成され、
前記画像データ処理回路部は、当該表示ドライバICチップが第2動作モードに設定されたとき、
前記第1フレーム画像データから、第2画像領域画像データと第2境界画像データと第3境界画像データとを抽出し、
前記第2画像領域画像データと前記第2境界画像データと前記第3境界画像データとを前記バッファメモリに格納し、
前記バッファメモリに格納された前記第2画像領域画像データと前記第2境界画像データと前記第3境界画像データとに基づいて、前記複数の表示領域のうちの第2表示領域に対応する第2表示画像データを前記駆動回路部に供給するように構成され、
前記第2画像領域画像データは、前記第2画像領域に対応する画素データを備え、
前記第2境界画像データは、前記第1フレーム画像の前記第2画像領域に隣接する第3画像領域の第2部分に位置する前記複数の画素の第2サブセットに対応する画素データを備え、
前記第2部分は、前記第2画像領域と前記第3画像領域との間の境界に接しており、
前記第3境界画像データは、前記第1フレーム画像の前記第3画像領域と反対側で前記第2画像領域に隣接する第4画像領域の第3部分に位置する前記複数の画素の第3サブセットに対応する画素データを備え、
前記第3部分が前記第2画像領域と前記第4画像領域の間の境界に接している
請求項2に記載の表示ドライバICチップ。 - 表示ドライバICチップであって、
第1水平方向解像度を有する第1フレーム画像に対応する第1フレーム画像データを受け取るように構成されたインターフェース回路部と、
バッファメモリを備える画像データ処理回路部であって、
前記第1フレーム画像データから、前記第1フレーム画像の第1画像領域について規定された第1画像領域画像データと、第1境界画像データとを抽出し、
前記第1画像領域画像データと前記第1境界画像データとを前記バッファメモリに格納し、
前記バッファメモリに格納された前記第1画像領域画像データと前記第1境界画像データとに基づいて、ジグザグ画素配置を有する表示パネルの複数の表示領域のうちの第1表示領域に対応する第1表示画像データを供給するように構成された画像データ処理回路部と、
前記第1表示画像データに基づいて前記第1表示領域の表示素子を駆動するように構成された駆動回路部と、
を備え、
前記画像データ処理回路部は、
当該表示ドライバICチップが、前記第1フレーム画像の前記第1水平方向解像度の半分である第2水平方向解像度の第2フレーム画像を表示する単独動作モードに設定されたとき、前記第2フレーム画像に対応する第2フレーム画像データを受け取り、
当該表示ドライバICチップが前記単独動作モードに設定されたとき、前記インターフェース回路部が受け取った前記第2フレーム画像データの全部を前記バッファメモリに格納するように構成され、
前記駆動回路部は、当該表示ドライバICチップが前記単独動作モードに設定されたとき、前記バッファメモリに格納された前記第2フレーム画像データに基づいて第2の表示パネルを駆動するように構成された
表示ドライバICチップ。 - ジグザグ画素配置を有する複数の画素を備え、複数の表示領域を備える表示パネルと、
前記複数の表示領域を駆動するように構成された複数の表示ドライバICチップと
を備え、
前記複数の画素の各画素は、第1種類、第2種類及び第3種類の副画素の組を備え、
前記ジグザグ画素配置では、前記複数の画素が、前記表示パネルにおいて、水平方向において直線状の複数行に配置され、かつ、垂直方向においてジグザグの複数列に、前記ジグザグの複数列のそれぞれにおいて前記第1種類の隣接する副画素の間で物理的に水平方向のオフセットがあるように配置され、
前記複数の表示ドライバICチップのうちの第1表示ドライバICチップが、
第1フレーム画像に対応する第1フレーム画像データを受け取るように構成された第1インターフェース回路部と、
前記第1フレーム画像データから、前記第1フレーム画像の第1画像領域について規定された第1画像領域画像データと、第1境界画像データとを抽出し、前記第1画像領域画像データと前記第1境界画像データとに基づいて第1表示画像データを供給するように構成された第1画像データ処理回路部と、
前記第1表示画像データに基づいて、前記複数の表示領域のうちの第1表示領域の副画素を駆動するように構成された第1駆動回路部と
を備え、
前記第1境界画像データは、前記第1フレーム画像の前記第1画像領域に隣接する第2画像領域の第1部分に位置する前記複数の画素のサブセットに対応する画素データを備え、
前記第1部分が、前記第1画像領域と前記第2画像領域の間の境界に接している
表示モジュール。 - 複数の画素を備える表示パネルを駆動する方法であって、
第1フレーム画像に対応する第1フレーム画像データを第1表示ドライバICチップで受け取ることと、
前記第1表示ドライバICチップにより、前記第1フレーム画像データから、前記第1フレーム画像の第1画像領域について規定された第1画像領域画像データと、第1境界画像データとを抽出することと、
前記第1表示ドライバICチップにより、前記第1画像領域画像データと前記第1境界画像データとに基づいて、前記表示パネルの複数の表示領域のうちの第1表示領域に対応する第1表示画像データを生成することと、
前記第1表示ドライバICチップにより、前記第1表示画像データに基づいて前記第1表示領域の表示素子を駆動することと
を含み、
前記複数の画素の各画素は、第1種類、第2種類及び第3種類の副画素の組を備え、
前記表示パネルの前記複数の画素は、ジグザグ画素配置を有しており、
前記ジグザグ画素配置では、前記複数の画素が、前記表示パネルにおいて、水平方向において直線状の複数行に配置され、かつ、垂直方向においてジグザグの複数列に、前記ジグザグの複数列のそれぞれにおいて前記第1種類の隣接する副画素の間で物理的に水平方向のオフセットがあるように配置され、
前記第1境界画像データが、前記複数の画素のうちの、前記第1フレーム画像の前記第1画像領域に隣接する第2画像領域の第1部分に位置する画素に対応する画素データを備え、
前記第1部分が、前記第1画像領域と前記第2画像領域の間の境界に接している
方法。
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