JP7279118B2 - 無線通信システムにおけるデータブロック送信方法及び送信機 - Google Patents
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Description
(1)64-QAM、R=2/3、NSS=5、NES=5
(2)64-QAM、R=2/3、NSS=7、NES=7
(3)64-QAM、R=3/4、NSS=5、NES=5
(4)64-QAM、R=3/4、NSS=7、NES=7
Claims (4)
- 通信方法において、前記通信方法は、
データビットを生成するためにエンコーディングを実行するステップと、
前記データビットに基づいて、第1のシーケンス及び第2のシーケンスを生成するステップと、前記第1のシーケンスは、少なくとも二つの連続したビットの第1のグループと、少なくとも二つの連続したビットの第2のグループと、少なくとも二つの連続したビットの第3のグループと、少なくとも二つの連続したビットの第4のグループとを連続的に備え、前記第2のシーケンスは、少なくとも二つの連続したビットの第5のグループと、少なくとも二つの連続したビットの第6のグループと、少なくとも二つの連続したビットの第7のグループと、少なくとも二つの連続したビットの第8のグループとを連続的に備え、
前記第1のシーケンス及び前記第2のシーケンスに対して第1のパーシング操作を実行することによって、第3のシーケンス及び第4のシーケンスを生成するステップと、前記第3のシーケンスは、少なくとも二つの連続したビットの前記第1のグループと、少なくとも二つの連続したビットの前記第5のグループと、少なくとも二つの連続したビットの前記第3のグループと、少なくとも二つの連続したビットの前記第7のグループとを連続的に備え、前記第4のシーケンスは、少なくとも二つの連続したビットの前記第2のグループと、少なくとも二つの連続したビットの前記第6のグループと、少なくとも二つの連続したビットの前記第4のグループと、少なくとも二つの連続したビットの前記第8のグループとを連続的に備え、
前記第3のシーケンスに対して第2のパーシング操作を実行することによって、第5のシーケンス及び第6のシーケンスを生成するステップと、前記第5のシーケンスは、少なくとも二つの連続したビットの前記第1のグループと、少なくとも二つの連続したビットの前記第5のグループとを連続的に備え、前記第6のシーケンスは、少なくとも二つの連続したビットの前記第3のグループと、少なくとも二つの連続したビットの前記第7のグループとを連続的に備え、
前記第4のシーケンスに対して第3のパーシング操作を実行することによって、第7のシーケンス及び第8のシーケンスを生成するステップと、前記第7のシーケンスは、少なくとも二つの連続したビットの前記第2のグループと、少なくとも二つの連続したビットの前記第6のグループとを連続的に備え、前記第8のシーケンスは、少なくとも二つの連続したビットの前記第4のグループと、少なくとも二つの連続したビットの前記第8のグループとを連続的に備え、
前記第5のシーケンス、前記第6のシーケンス、前記第7のシーケンス及び前記第8のシーケンスを用いてデータブロックを生成するステップと、
インターリービング操作及びコンステレーションマッピング操作を実行した後、前記データブロックを送信するステップと、
を備え、
前記第1のパーシング操作は、エンコーダの数及びコンステレーションポイントの一軸に割り当てられたビット数に基づいて実行され、
前記第1のパーシング操作は、前記コンステレーションポイントの一軸に割り当てられた前記ビット数の連続したグループを、ラウンドロビン方式で他の空間ストリームに割り当てる操作を含み、
前記インターリービング操作は、データビットの隣接ビットを、コンステレーションの下位ビット又は上位ビット上にマッピングするために実行され、
前記エンコーダの数は、2つであり、
前記コンステレーションポイントの一軸に割り当てられた前記ビット数は2以上であることを特徴とする通信方法。 - 前記データブロックを生成するステップは、前記データブロックを生成するために、前記第5のシーケンス、前記第6のシーケンス、前記第7のシーケンス及び前記第8のシーケンスをインターリービングするステップを備えることを特徴とする請求項1に記載の通信方法。
- 通信装置において、
プロセッサと、
前記プロセッサに動作可能に結合されたメモリと、
を備え、
前記メモリ内に格納されたプログラム命令を実行するとき、前記プロセッサは、
前記通信装置に、データビットを生成するためにエンコーディングを実行させ、
前記通信装置に、前記データビットに基づいて、第1のシーケンス及び第2のシーケンスを生成させ、前記第1のシーケンスは、少なくとも二つの連続したビットの第1のグループと、少なくとも二つの連続したビットの第2のグループと、少なくとも二つの連続したビットの第3のグループと、少なくとも二つの連続したビットの第4のグループとを連続的に備え、前記第2のシーケンスは、少なくとも二つの連続したビットの第5のグループと、少なくとも二つの連続したビットの第6のグループと、少なくとも二つの連続したビットの第7のグループと、少なくとも二つの連続したビットの第8のグループとを連続的に備え、
前記通信装置に、前記第1のシーケンス及び前記第2のシーケンスに対して第1のパーシング操作を実行することによって、第3のシーケンス及び第4のシーケンスを生成させ、前記第3のシーケンスは、少なくとも二つの連続したビットの前記第1のグループと、少なくとも二つの連続したビットの前記第5のグループと、少なくとも二つの連続したビットの前記第3のグループと、少なくとも二つの連続したビットの前記第7のグループとを連続的に備え、前記第4のシーケンスは、少なくとも二つの連続したビットの前記第2のグループと、少なくとも二つの連続したビットの前記第6のグループと、少なくとも二つの連続したビットの前記第4のグループと、少なくとも二つの連続したビットの前記第8のグループとを連続的に備え、
前記通信装置に、前記第3のシーケンスに対して第2のパーシング操作を実行することによって、第5のシーケンス及び第6のシーケンスを生成させ、前記第5のシーケンスは、少なくとも二つの連続したビットの前記第1のグループと、少なくとも二つの連続したビットの前記第5のグループとを連続的に備え、前記第6のシーケンスは、少なくとも二つの連続したビットの前記第3のグループと、少なくとも二つの連続したビットの前記第7のグループとを連続的に備え、
前記通信装置に、前記第4のシーケンスに対して第3のパーシング操作を実行することによって、第7のシーケンス及び第8のシーケンスを生成させ、前記第7のシーケンスは、少なくとも二つの連続したビットの前記第2のグループと、少なくとも二つの連続したビットの前記第6のグループとを連続的に備え、前記第8のシーケンスは、少なくとも二つの連続したビットの前記第4のグループと、少なくとも二つの連続したビットの前記第8のグループとを連続的に備え、
前記通信装置に、前記第5のシーケンス、前記第6のシーケンス、前記第7のシーケンス及び前記第8のシーケンスを用いてデータブロックを生成させ、
インターリービング操作及びコンステレーションマッピング操作を実行した後、前記通信装置に、前記データブロックを送信させるように構成されており、
前記第1のパーシング操作は、エンコーダの数及びコンステレーションポイントの一軸に割り当てられたビット数に基づいて実行され、
前記第1のパーシング操作は、前記コンステレーションポイントの一軸に割り当てられた前記ビット数の連続したグループを、ラウンドロビン方式で他の空間ストリームに割り当てる操作を含み、
前記インターリービング操作は、データビットの隣接ビットを、コンステレーションの下位ビット又は上位ビット上にマッピングするために実行され、
前記エンコーダの数は、2つであり、
前記コンステレーションポイントの一軸に割り当てられた前記ビット数は2以上であることを特徴とする通信装置。 - 前記プロセッサは、
前記通信装置に、前記データブロックを生成するために、前記第5のシーケンス、前記第6のシーケンス、前記第7のシーケンス及び前記第8のシーケンスをインターリービングさせるようにさらに構成されていることを特徴とする請求項3に記載の通信装置。
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