JP7259592B2 - 発光サイリスタ、発光素子チップ、光プリントヘッド、及び画像形成装置 - Google Patents
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Description
《1-1》構成
図1は、第1の実施形態に係る発光サイリスタ10の構造を示す概略平面図である。図1には、複数の発光サイリスタ10を有する半導体装置1000が示されている。半導体装置1000は、基材部101上に配置されている。図1に示されるように、基材部101は、例えば、基材102と、その上に形成された平坦化層103とを有している。発光素子チップ100は、基材部101と、その上に配置された半導体装置1000とを有している。半導体装置1000は、「発光素子アレイ」又は「発光サイリスタアレイ」とも称される。また、発光素子チップ100は、「発光素子アレイチップ」又は「発光サイリスタアレイチップ」とも称される。なお、図1においては、半導体装置1000の構造を理解し易くするために、絶縁膜71(図2に示される。)を記載していない。
Nae≧Npg (1)
BGae≦BGng (2)
BGae≦BGpg (3)
T2>T3 (4)
Nng<Npg (5)
Cae≦Cng (6)
Cae≦Cpg (7)
Cae=Cpg=Cng<C11(又はC41) (8)
150nm≦Tpg(=T3)≦180nm (14)
270nm≦Tng(=T2)≦330nm (15)
1.2×1018cm-3≦Nk≦1.8×1018cm-3 (16)
8×1017cm-3≦Npg≦1.2×1018cm-3 (17)
4×1017cm-3≦Nng≦6×1017cm-3 (18)
1.2×1018cm-3≦Nae≦1.5×1019cm-3 (19)
Tpg<Tng (20)
Nng<Npg≦Nac (21)
第1の実施形態に係る発光サイリスタ10では、ゲート電極51からカソード電極41Kへ電流を流すことにより、アノード電極61Aとカソード電極41K間を導通させる。このとき、P型の活性層1012内で正孔と電子が再結合する。このとき、N型ゲート層1021とP型ゲート層1031内でも同様の再結合が発生するが、N型ゲート層1021における不純物濃度Nngを小さくしており、P型ゲート層1031では厚さTpgを薄くしているため、活性層1012内において高い確率で再結合が起こる。再結合により発光した光は、カソード層1041を通過して出射される。
第1の実施形態に係る発光サイリスタ10では、前述した計算によって十分な耐圧性能を確保しつつ、電流増幅率の合成関数βが大きくなることでブレークオーバー電圧Vbを低減できる。また、N型ゲート層1021及びP型ゲート層1031は活性層1012で発生した光を吸収する吸収層でもあるため、これらを薄くすることによって光の取り出し効率が向上する。以上より、第1の実施形態に係る発光サイリスタ10では、ブレークオーバー電圧Vbが低減し、発光効率が向上する。
図9は、第1の実施形態の第1変形例に係る発光サイリスタ11の断面構造を示す概略断面図である。図10は、発光サイリスタ11の各半導体層の不純物濃度[cm-3]、厚さ[nm]及びAl組成比の例を示す図である。発光サイリスタ11及び半導体装置1100は、第3の半導体層1030aがP型ゲート層1031aとエッチングストップ層1032aとを有し、ゲート電極51がN型ゲート層1021に接続されている点が、発光サイリスタ10及び半導体装置1000と相違する。他の点に関し、発光サイリスタ11及び半導体装置1100は、発光サイリスタ10及び半導体装置1000と同じである。
図11は、第1の実施形態の第2変形例に係る発光サイリスタ10aの各半導体層の不純物濃度[cm-3]、厚さ[nm]及びAl組成比の例を示す図である。発光サイリスタ10aは、P型ゲート層1031のAl組成比Cpg及びN型ゲート層1021のAl組成比Cngを活性層1012aのAl組成比Caeよりも高い点が、発光サイリスタ10と相違する。図11に示されるように、N型ゲート層1021及びP型ゲート層1031のAl組成比Cng、Cpgを活性層のAl組成比Caeより高くした場合であっても、各半導体層間のジャンクションにおけるビルトインポテンシャルVbi及び空乏層の幅Xn及びXpの変化は微小であり、上記条件(14)から(21)の各半導体層の厚さ及び各不純物濃度の範囲で耐圧を確保できる。加えて、Al組成比Cng、Cpgを大きくすることで光の透過率が大きくなるため、光の取り出し効率が向上し、更なる光量増加の効果が得られる。上記以外の点に関し、発光サイリスタ10aは、発光サイリスタ10と同じである。
図12は、第1の実施形態の第3変形例に係る発光サイリスタ12の断面構造を示す概略断面図である。図13は、発光サイリスタ12の各半導体層の不純物濃度[cm-3]、厚さ[nm]及びAl組成比の例を示す図である。発光サイリスタ12は、基材部101上に、基材部101側から第4の半導体層1040、第3の半導体層1030、第2の半導体層1020、及び第1の半導体層1010の順に積層されており、アノード電極41A、アノード配線42A、カソード電極61K、カソード配線62Kを備えている点が、発光サイリスタ10と相違する。発光サイリスタ12は、活性層1012の上部にアノード層1011だけが存在するので、上方向に進む光の吸収が少なくなり、光の取り出し効率が向上し、更なる光量増加の効果が得られる。上記以外の点に関し、発光サイリスタ12は、発光サイリスタ10と同じである。
《2-1》構成
図14は、本発明の第2の実施形態に係る発光サイリスタ20の構造を示す概略平面図である。図15は、発光サイリスタ20の構造を示す概略断面図である。図14及び図15に示されるように、発光サイリスタ20は、第1の導電型の第1の半導体層2010と、第1の半導体層2010に隣接して配置された第1の導電型と異なる第2の導電型の第2の半導体層2020と、第2の半導体層2020に隣接して配置された第1の導電型の第3の半導体層2030と、第3の半導体層2030に隣接して配置された第2の導電型の第4の半導体層2040とを有している。第2の実施形態では、第1の導電型はN型であり、第2の導電型はP型である。
Nae≧Nng (1a)
BGae≦BGng (2)
BGae≦BGpg (3)
T2>T3 (4)
Npg<Nng (5a)
Cae≦Cng (6)
Cae≦Cpg (7)
Cae=Cpg=Cng<C11(又はC41) (8)
180nm≦Tng(=T3)≦220nm (22)
270nm≦Tpg(=T2)≦330nm (23)
4×1018cm-3≦Na≦6×1018cm-3 (24)
7×1017cm-3≦Nng≦1×1018cm-3 (25)
4×1017cm-3≦Npg≦6×1017cm-3 (26)
1×1018cm-3≦Nae<1.5×1018cm-3 (27)
の範囲で耐圧を8V以上確保しつつ電流増幅率の合成関数βを従来よりも大きくすることができる。
Tng<Tpg (28)
Npg<Nng≦Nae (29)
第2の実施形態に係る発光サイリスタ20では、アノード電極41AからN型ゲート電極51へ電流を流すことにより、アノード電極41Aとカソード電極61K間を導通させる。このとき、N型活性層2012内で正孔と電子とが再結合する。
このとき、P型ゲート層2021とN型ゲート層2031内でも同様の再結合が発生するが、P型ゲート層2021における不純物濃度Npgを小さくしており、N型ゲート層2031では厚さTpg(=T3)を薄くしているため、活性層2012内において高い確率で再結合が起こる。再結合により発光した光は、アノード層2041を通過して出射される。
第2の実施形態に係る発光サイリスタ20では、前述した計算によって十分な耐圧性能を確保しつつ、電流増幅率の合成関数βが大きくなることでブレークオーバー電圧Vbを低減できる。また、P型ゲート層2021及びN型ゲート層2031は活性層2012で発生した光を吸収する吸収層でもあるため、これらを薄くすることによって光の取り出し効率が向上する。以上より、第2の実施形態に係る発光サイリスタ20では、ブレークオーバー電圧Vbが低減し、発光効率が向上する。
《3-1》構成
図17は、第3の実施形態に係る発光サイリスタ30の構造を示す概略断面図である。図18は、発光サイリスタ30の各半導体層の不純物濃度、厚さ及びAl組成比の例を示す図である。第3の実施形態に係る発光サイリスタ30は、アノード層及びカソード層よりもAl組成比の大きな正孔バリア層3021a及び電子バリア層3012aを設けている点が、第1の実施形態に係る発光サイリスタ10と相違する。発光サイリスタ30の第1から第4の半導体層3010、3020、3030、3040は、発光サイリスタ10の第1から第4の半導体層1010、1020、1030、1040に対応する。発光サイリスタ30のアノード層3011、活性層3012、N型ゲート層3021、エッチングストップ層3032、カソード層3041の構造は、発光サイリスタ10のアノード層1011、活性層1012、N型ゲート層1021、エッチングストップ層1032、カソード層1041の構造とそれぞれ同じである。
150nm≦Tpg(=T3)≦180nm (14)
270nm≦Tng(=T2)≦330nm (15)
1.2×1018cm-3≦Nk≦1.8×1018cm-3 (16)
8×1017cm-3≦Npg≦1.2×1018cm-3 (17)
4×1017cm-3≦Nng≦6×1017cm-3 (18)
1.2×1018cm-3≦Nae≦1.5×1019cm-3 (19)
の範囲で耐圧を8V以上確保しつつ電流増幅率の合成関数βを従来よりも大きくすることができる。
Tpg<Tng (20)
Nng<Npg≦Nac (21)
第3の実施形態に係る発光サイリスタ30は、第1の実施形態に係る発光サイリスタ10と同様に動作する。
第3の実施形態に係る発光サイリスタ30は、第1の実施形態に係る発光サイリスタ10と同様に、十分な耐圧性能を確保しつつ、電流増幅率の合成関数βが大きくなることでブレークオーバー電圧Vbを低減できる。
図19は、第4の実施形態に係る光プリントヘッドの要部の構造を示す略斜視図である。図19に示されるように、要部としての基板ユニットは、実装基板であるプリント配線板801と、アレイ状に配置された複数の発光素子チップ100とを有している。発光素子チップ100は、プリント配線板801上に熱硬化樹脂などにより固定されている。発光素子チップ100の外部接続用の電極パッド152とプリント配線板801の接続パッド802とは、ボンディングワイヤ803により電気的に接続されている。また、プリント配線板801には、各種配線パターン、電子部品、コネクタなどが搭載されてもよい。また、発光素子チップ100の代わりに、第1から第3の実施形態で説明された他の発光素子チップのいずれかが用いられてもよい。
図21は、第5の実施形態に係る画像形成装置900の構造を示す概略断面図である。画像形成装置900は、例えば、電子写真プロセスを用いるカラープリンタである。
上記第1から第3の実施形態の発光サイリスタを構成する半導体層の導電型を逆にした構造を採用することも可能である。
Claims (17)
- 第1の導電型の第1の半導体層と、
前記第1の半導体層と隣接して配置された第2の導電型の第2の半導体層と、
前記第2の半導体層と隣接して配置された第1の導電型の第3の半導体層と、
前記第3の半導体層と隣接して配置された第2の導電型の第4の半導体層と
を有し、
前記第1の半導体層の一部は、前記第2の半導体層に隣接する活性層であり、
前記活性層の不純物濃度は、前記第3の半導体層の不純物濃度以上であり、
前記第3の半導体層の厚さは、前記第2の半導体層の厚さより薄く、
前記第2の半導体層の不純物濃度は、前記第3の半導体層の不純物濃度より低い
ことを特徴とする発光サイリスタ。 - 前記活性層のバンドギャップは、前記第2の半導体層のバンドギャップ以下であり且つ前記第3の半導体層のバンドギャップ以下であることを特徴とする請求項1に記載の発光サイリスタ。
- 前記第3の半導体層は、第1の導電型のゲート層と、エッチングストップ層とを有することを特徴とする請求項1又は2に記載の発光サイリスタ。
- 前記第1の導電型はP型であり、前記第2の導電型はN型であることを特徴とする請求項1から3のいずれか1項に記載の発光サイリスタ。
- 前記第3の半導体層の厚さは、150nm以上180nm以下の範囲内であり、
前記第2の半導体層の厚さは、270nm以上330nm以下の範囲内である
ことを特徴とする請求項4に記載の発光サイリスタ。 - 前記第4の半導体層の不純物濃度は、1.2×1018cm-3以上1.8×1018cm-3以下の範囲内であり、
前記第3の半導体層の不純物濃度は、8×1017cm-3以上1.2×1018cm-3以下の範囲内であり、
前記第2の半導体層の不純物濃度は、4×1017cm-3以上6×1017cm-3以下の範囲内であり、
前記活性層の不純物濃度は、1.2×1018cm-3以上1.5×1019cm-3以下の範囲内である
ことを特徴とする請求項4又は5に記載の発光サイリスタ。 - 前記第1の導電型はN型であり、前記第2の導電型はP型であることを特徴とする請求項1から3のいずれか1項に記載の発光サイリスタ。
- 前記第3の半導体層の厚さは、180nm以上220nm以下の範囲内であり、
前記第2の半導体層の厚さは、270nm以上330nm以下の範囲内である
ことを特徴とする請求項7に記載の発光サイリスタ。 - 前記第4の半導体層の不純物濃度は、4×1018cm-3以上6×1018cm-3以下の範囲内であり、
前記第3の半導体層の不純物濃度は、7×1017cm-3以上1×1018cm-3以下の範囲内であり、
前記第2の半導体層の不純物濃度は、4×1017cm-3以上6×1017cm-3以下の範囲内であり、
前記活性層の不純物濃度は、1×1018cm-3以上1.5×1019cm-3以下の範囲内である
ことを特徴とする請求項7又は8に記載の発光サイリスタ。 - 前記第1の半導体層は、第1の層と、前記活性層と、前記第1の層と前記活性層との間に配置された第2の層とを有し、
前記第1の層のバンドギャップは、前記活性層のバンドギャップより大きく、
前記第2の層のバンドギャップは、前記第1の層のバンドギャップ及び前記第4の半導体層のバンドギャップのいずれよりも大きい
ことを特徴とする請求項1から9のいずれか1項に記載の発光サイリスタ。 - 前記第2の半導体層は、前記活性層に隣接する第3の層と、前記第3の層と前記第3の半導体層との間に配置される第4の層とを有し、
前記第3の層のバンドギャップは、前記第1の層のバンドギャップ及び前記第4の半導体層のバンドギャップより大きい
ことを特徴とする請求項10に記載の発光サイリスタ。 - 前記第1の半導体層と電気的に接続された第1の電極と、
前記第2の半導体層又は前記第3の半導体層と電気的に接続された第2の電極と、
前記第4の半導体層と電気的に接続された第3の電極と
を有することを特徴とする請求項1から11のいずれか1項に記載の発光サイリスタ。 - 基材部と、
前記基材部上に配置された請求項1から12のいずれか1項に記載の発光サイリスタと
を有することを特徴とする発光素子チップ。 - 前記第1の半導体層は、前記第4の半導体層よりも前記基材部に近い側に配置されることを特徴とする請求項13に記載の発光素子チップ。
- 前記第1の半導体層は、前記第4の半導体層よりも前記基材部から離れた側に配置されることを特徴とする請求項13に記載の発光素子チップ。
- 請求項13から15のいずれか1項に記載の発光素子チップを有することを特徴とする光プリントヘッド。
- 請求項16に記載の光プリントヘッドを有することを特徴とする画像形成装置。
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