JP7230909B2 - Method for manufacturing silicon carbide semiconductor device - Google Patents

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Description

本開示は、炭化珪素半導体装置の製造方法に関するものである。 The present disclosure relates to a method for manufacturing a silicon carbide semiconductor device.

本出願は、2018年5月30日出願の日本特許出願第2018-103115号に基づく優先権を主張し、前記日本特許出願に記載された全ての記載内容を援用するものである。 This application claims priority based on Japanese Patent Application No. 2018-103115 filed on May 30, 2018, and incorporates all the descriptions described in the Japanese Patent Application.

炭化珪素は、従来から半導体装置に幅広く用いられている珪素に比べてバンドギャップが広いことから、高耐圧の半導体装置等に用いられている。このような炭化珪素を用いた半導体装置を製造する際には、位置合わせを行いイオン注入やエッチング等の工程が行われる。 Silicon carbide has a wider bandgap than silicon, which has been widely used in semiconductor devices, and is therefore used in high-voltage semiconductor devices and the like. When manufacturing such a semiconductor device using silicon carbide, alignment is performed and processes such as ion implantation and etching are performed.

特開2015-2198号公報Japanese Patent Application Laid-Open No. 2015-2198

本実施形態の一観点によれば、凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜することにより、第1のアライメントマークの上の炭化珪素エピタキシャル膜の表面に凹状の第2のアライメントマークを形成する工程と、炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程とを有する。更に、第2のアライメントマークを含む領域の第1のフォトレジストを除去し、第1の開口部を形成する工程と、第1の開口部において露出している第2のアライメントマークを用いて位置合わせを行い、第1のフォトレジストに第2の開口部を形成する工程とを有する。 According to one aspect of the present embodiment, a silicon carbide epitaxial film is formed on a silicon carbide crystal substrate on which a concave first alignment mark is formed, thereby forming a silicon carbide epitaxial film on the first alignment mark. The method includes forming a concave second alignment mark on the surface of the film, and applying a first photoresist on the surface of the silicon carbide epitaxial film. removing the first photoresist in areas containing the second alignment marks to form first openings; aligning to form a second opening in the first photoresist.

図1は半導体装置におけるアライメントマークの説明図(1)である。FIG. 1 is an explanatory diagram (1) of alignment marks in a semiconductor device. 図2は半導体装置におけるアライメントマークの説明図(2)である。FIG. 2 is an explanatory diagram (2) of alignment marks in a semiconductor device. 図3は半導体装置におけるアライメントマークの説明図(3)である。FIG. 3 is an explanatory diagram (3) of alignment marks in a semiconductor device. 図4は半導体装置におけるアライメントマークの説明図(4)である。FIG. 4 is an explanatory diagram (4) of alignment marks in a semiconductor device. 図5は半導体装置におけるアライメントマークの説明図(5)である。FIG. 5 is an explanatory diagram (5) of alignment marks in a semiconductor device. 図6Aは本開示の第1の実施形態の半導体装置の製造方法の説明図(1)である。FIG. 6A is an explanatory diagram (1) of the method for manufacturing a semiconductor device according to the first embodiment of the present disclosure; 図6Bは本開示の第1の実施形態の半導体装置の製造方法の説明図(2)である。FIG. 6B is an explanatory diagram (2) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図7Aは本開示の第1の実施形態の半導体装置の製造方法の説明図(3)である。FIG. 7A is an explanatory diagram (3) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure; 図7Bは本開示の第1の実施形態の半導体装置の製造方法の説明図(4)である。FIG. 7B is an explanatory diagram (4) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図8Aは本開示の第1の実施形態の半導体装置の製造方法の説明図(5)である。FIG. 8A is an explanatory diagram (5) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図8Bは本開示の第1の実施形態の半導体装置の製造方法の説明図(6)である。FIG. 8B is an explanatory diagram (6) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図9Aは本開示の第1の実施形態の半導体装置の製造方法の説明図(7)である。FIG. 9A is an explanatory diagram (7) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図9Bは本開示の第1の実施形態の半導体装置の製造方法の説明図(8)である。FIG. 9B is an explanatory diagram (8) of the method for manufacturing the semiconductor device according to the first embodiment of the present disclosure. 図10Aは本開示の第2の実施形態の半導体装置の製造方法の説明図(1)である。FIG. 10A is an explanatory diagram (1) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図10Bは本開示の第2の実施形態の半導体装置の製造方法の説明図(2)である。FIG. 10B is an explanatory diagram (2) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図11Aは本開示の第2の実施形態の半導体装置の製造方法の説明図(3)である。FIG. 11A is an explanatory diagram (3) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図11Bは本開示の第2の実施形態の半導体装置の製造方法の説明図(4)である。FIG. 11B is an explanatory diagram (4) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図12Aは本開示の第2の実施形態の半導体装置の製造方法の説明図(5)である。FIG. 12A is an explanatory diagram (5) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図12Bは本開示の第2の実施形態の半導体装置の製造方法の説明図(6)である。FIG. 12B is an explanatory diagram (6) of the method for manufacturing a semiconductor device according to the second embodiment of the present disclosure. 図13Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(1)である。FIG. 13A is an explanatory diagram (1) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; 図13Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(2)である。FIG. 13B is an explanatory diagram (2) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; 図14Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(3)である。14A is an explanatory diagram (3) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; FIG. 図14Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(4)である。14B is an explanatory diagram (4) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; FIG. 図15Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(5)である。FIG. 15A is an explanatory diagram (5) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure. 図15Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(6)である。FIG. 15B is an explanatory diagram (6) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure. 図16Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(7)である。FIG. 16A is an explanatory diagram (7) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; 図16Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(8)である。FIG. 16B is an explanatory diagram (8) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; 図17Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(9)である。FIG. 17A is an explanatory diagram (9) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; 図17Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(10)である。17B is an explanatory diagram (10) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure; FIG. 図18Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(11)である。FIG. 18A is an explanatory diagram (11) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure. 図18Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(12)である。FIG. 18B is an explanatory diagram (12) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure. 図19Aは本開示の第3の実施形態の半導体装置の製造方法の説明図(13)である。FIG. 19A is an explanatory diagram (13) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure. 図19Bは本開示の第3の実施形態の半導体装置の製造方法の説明図(14)である。FIG. 19B is an explanatory diagram (14) of the method for manufacturing a semiconductor device according to the third embodiment of the present disclosure.

炭化珪素半導体装置の製造工程においては、アライメントマークを基準に位置合わせを行い様々な製造プロセスが行われる。このようなアライメントマークは、炭化珪素基板の表面に所定の形状の凹部や凸部により形成されているが、アライメントマークの上に炭化珪素膜等が成膜されると、アライメントマークの形が変化し、正確な位置合わせを行うことができない場合がある。 In a manufacturing process of a silicon carbide semiconductor device, alignment is performed using alignment marks as a reference, and various manufacturing processes are performed. Such alignment marks are formed on the surface of the silicon carbide substrate by recesses and protrusions having a predetermined shape. However, when a silicon carbide film or the like is formed on the alignment marks, the shape of the alignment marks changes. and may not be able to perform accurate alignment.

このため、炭化珪素半導体装置の製造工程において、アライメントマークを用いて正確に位置合わせをすることのできる炭化珪素半導体装置の製造方法が求められる。 Therefore, there is a need for a method of manufacturing a silicon carbide semiconductor device that can perform accurate alignment using alignment marks in the manufacturing process of the silicon carbide semiconductor device.

本開示によれば、炭化珪素半導体装置の製造工程において、アライメントマークを用いて正確に位置合わせをすることのできる炭化珪素半導体装置の製造方法を提供することができる。 According to the present disclosure, it is possible to provide a method for manufacturing a silicon carbide semiconductor device that enables accurate alignment using alignment marks in the manufacturing process of the silicon carbide semiconductor device.

実施するための形態について、以下に説明する。 The form for carrying out is demonstrated below.

[本開示の実施形態の説明]
最初に本開示の実施態様を列記して説明する。以下の説明では、同一または対応する要素には同一の符号を付し、それらについて同じ説明は繰り返さない。また本明細書の結晶学的記載においては、個別方位を[]、集合方位を<>、個別面を()、集合面を{}でそれぞれ示している。ここで結晶学上の指数が負であることは、通常、数字の上に”-”(バー)を付すことによって表現されるが、本明細書では数字の前に負の符号を付すことによって結晶学上の負の指数を表現している。また、本開示のエピタキシャル成長は、ホモエピタキシャル成長である。
[Description of Embodiments of the Present Disclosure]
First, the embodiments of the present disclosure are listed and described. In the following description, the same or corresponding elements are given the same reference numerals and the same descriptions thereof are not repeated. In the crystallographic description of this specification, [ ] indicates an individual orientation, <> indicates an aggregate orientation, ( ) indicates an individual plane, and { } indicates an aggregate plane. Here, the fact that the crystallographic index is negative is usually expressed by attaching a "-" (bar) above the number, but in this specification, by attaching a negative sign in front of the number It represents the crystallographic negative exponent. Also, the epitaxial growth of the present disclosure is homoepitaxial growth.

〔1〕 本開示の一態様に係る半導体装置は、凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜することにより、前記第1のアライメントマークの上の前記炭化珪素エピタキシャル膜の表面に凹状の第2のアライメントマークを形成する工程と、前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、前記第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、を有する。 [1] A semiconductor device according to an aspect of the present disclosure is provided by forming a silicon carbide epitaxial film on a silicon carbide crystal substrate in which a concave first alignment mark is formed, thereby forming a silicon carbide epitaxial film on the first alignment mark. forming a concave second alignment mark on the surface of the silicon carbide epitaxial film above; applying a first photoresist to the surface of the silicon carbide epitaxial film; and forming the second alignment mark. removing the first photoresist in a region to form a first opening; performing alignment using the second alignment mark exposed in the first opening; and forming a second opening in the first photoresist.

本願発明者は、炭化珪素半導体装置を製造する際、凹状のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜し、更に、フォトレジストを塗布すると、アライメントマークが認識されにくくなることを知見として得た。また、このような炭化珪素エピタキシャル膜の表面に現れるアライメントマークは、フォトレジストが塗布されてる状態よりも、フォトレジストが塗布されていない状態の方が認識されやすい。 When manufacturing a silicon carbide semiconductor device, the inventor of the present application forms a silicon carbide epitaxial film on a silicon carbide crystal substrate having a concave alignment mark formed thereon, and further coats a photoresist, whereby the alignment mark is recognized. As a result, we learned that it would be difficult for Further, the alignment marks appearing on the surface of such a silicon carbide epitaxial film are easier to recognize when the photoresist is not applied than when the photoresist is applied.

本願は、このように発明者により得られた知見に基づくものである。具体的には、凹状のアライメントマークが形成されている炭化珪素結晶基板にフォトレジストを塗布した後、凹状のアライメントマークが形成されている領域のフォトレジストを除去することにより第1の開口部を形成し、アライメントマークを露出させる。この後の露光等においては、第1の開口部において露出している前記第1のアライメントマークを基準に位置合わせを行う。これにより、正確な位置にフォトレジストの第2の開口部を形成することができる。このように形成された第2の開口部を用いて、新たなアライメントマークを形成したり、炭化珪素エピタキシャル膜を加工することにより、炭化珪素半導体装置を高い歩留まりで製造することが可能となる。 The present application is based on the knowledge thus obtained by the inventor. Specifically, after applying a photoresist to the silicon carbide crystal substrate on which the concave alignment mark is formed, the first opening is formed by removing the photoresist in the region where the concave alignment mark is formed. forming and exposing the alignment marks. In subsequent exposure or the like, alignment is performed with reference to the first alignment mark exposed in the first opening. Thereby, the second opening of the photoresist can be formed at an accurate position. By forming a new alignment mark or processing the silicon carbide epitaxial film using the second opening thus formed, it is possible to manufacture silicon carbide semiconductor devices with a high yield.

〔2〕 前記第2の開口部を形成する工程の後、前記第2の開口部における前記炭化珪素エピタキシャル膜の一部を除去し、第3のアライメントマークを形成する工程と、前記第1のフォトレジストを除去する工程と、を有する。 [2] after the step of forming the second opening, removing part of the silicon carbide epitaxial film in the second opening to form a third alignment mark; and removing the photoresist.

〔3〕 前記第1のフォトレジストを除去する工程の後、前記炭化珪素エピタキシャル膜の表面に第2のフォトレジストを塗布する工程と、前記第3のアライメントマークを用いて位置合わせを行い、前記第2のフォトレジストに第3の開口部を形成する工程と、を有する。 [3] After the step of removing the first photoresist, applying a second photoresist to the surface of the silicon carbide epitaxial film; and forming a third opening in the second photoresist.

〔4〕 凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜する工程と、前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、前記第1のアライメントマークの上の炭化珪素エピタキシャル膜の表面に形成された第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、前記第2の開口部における前記炭化珪素エピタキシャル膜を加工する工程と、前記第1のフォトレジストを除去する工程と、を有する。 [4] A step of forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed, and a step of applying a first photoresist to the surface of the silicon carbide epitaxial film. removing the first photoresist in a region including a second alignment mark formed on the surface of the silicon carbide epitaxial film above the first alignment mark to form a first opening; performing alignment using the second alignment mark exposed in the first opening to form a second opening in the first photoresist; The method includes processing the silicon carbide epitaxial film and removing the first photoresist.

〔5〕 前記加工は、前記炭化珪素エピタキシャル膜のエッチングである。 [5] The processing is etching of the silicon carbide epitaxial film.

〔6〕 前記加工は、前記炭化珪素エピタキシャル膜へのイオン注入である。 [6] The processing is ion implantation into the silicon carbide epitaxial film.

〔7〕 前記第1のフォトレジストは、ポジ型である。 [7] The first photoresist is positive type.

〔8〕 前記第1の開口部及び前記第2の開口部は、前記第1のフォトレジストを露光する工程と、露光された前記第1のフォトレジストを現像する工程と、により形成される。 [8] The first opening and the second opening are formed by exposing the first photoresist and developing the exposed first photoresist.

〔9〕 凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜することにより、前記第1のアライメントマークの上の前記炭化珪素エピタキシャル膜の表面に凹状の第2のアライメントマークを形成する工程と、前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、前記第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、を有し、前記第2の開口部を形成する工程の後、前記第2の開口部における前記炭化珪素エピタキシャル膜の一部を除去し、第3のアライメントマークを形成する工程と、前記第1のフォトレジストを除去する工程と、を有し、前記第1のフォトレジストを除去する工程の後、前記炭化珪素エピタキシャル膜の表面に第2のフォトレジストを塗布する工程と、前記第3のアライメントマークを用いて位置合わせを行い、前記第2のフォトレジストに第3の開口部を形成する工程と、を有し、前記第1のフォトレジストは、ポジ型であって、前記第1の開口部及び前記第2の開口部は、前記第1のフォトレジストを露光する工程と、露光された前記第1のフォトレジストを現像する工程と、により形成される。 [9] By forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed, the surface of the silicon carbide epitaxial film above the first alignment marks is concave. forming a second alignment mark; applying a first photoresist to the surface of the silicon carbide epitaxial film; and removing the first photoresist in a region including the second alignment mark. forming a first opening; and performing alignment using the second alignment mark exposed in the first opening to form a second opening in the first photoresist. and, after the step of forming the second opening, removing a portion of the silicon carbide epitaxial film in the second opening to form a third alignment mark. and removing the first photoresist, after the step of removing the first photoresist, applying a second photoresist to the surface of the silicon carbide epitaxial film; aligning using the third alignment mark to form a third opening in the second photoresist, wherein the first photoresist is positive, The first opening and the second opening are formed by exposing the first photoresist and developing the exposed first photoresist.

〔10〕 凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜する工程と、前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、前記第1のアライメントマークの上の炭化珪素エピタキシャル膜の表面に形成された第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、前記第2の開口部における前記炭化珪素エピタキシャル膜を加工する工程と、前記第1のフォトレジストを除去する工程と、を有し、前記第1のフォトレジストは、ポジ型であって、前記第1の開口部及び前記第2の開口部は、前記第1のフォトレジストを露光する工程と、露光された前記第1のフォトレジストを現像する工程と、により形成される。 [10] A step of forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed, and a step of applying a first photoresist to the surface of the silicon carbide epitaxial film. removing the first photoresist in a region including a second alignment mark formed on the surface of the silicon carbide epitaxial film above the first alignment mark to form a first opening; performing alignment using the second alignment mark exposed in the first opening to form a second opening in the first photoresist; processing the silicon carbide epitaxial film; and removing the first photoresist, wherein the first photoresist is a positive type, and the first opening and the first 2 openings are formed by exposing the first photoresist and developing the exposed first photoresist.

[本開示の実施形態の詳細]
以下、本開示の一実施形態(以下「本実施形態」と記す)について詳細に説明するが、本実施形態はこれらに限定されるものではない。
[Details of the embodiment of the present disclosure]
An embodiment of the present disclosure (hereinafter referred to as "the present embodiment") will be described in detail below, but the present embodiment is not limited thereto.

最初に、炭化珪素半導体装置の製造工程において形成されるアライメントマークについて説明する。半導体装置を製造する際のアライメントマークには、図1に示される炭化珪素単結晶基板10の主面10aに対し凸となる凸状のアライメントマーク11や、図2に示される炭化珪素単結晶基板10の主面10aに対し凹となる凹状のアライメントマーク12がある。 First, an alignment mark formed in a manufacturing process of a silicon carbide semiconductor device will be described. Alignment marks for manufacturing a semiconductor device include convex alignment mark 11 projecting from main surface 10a of silicon carbide single crystal substrate 10 shown in FIG. 1 and silicon carbide single crystal substrate shown in FIG. There is a concave alignment mark 12 which is concave with respect to the main surface 10a of 10 .

炭化珪素半導体装置を製造する際には、炭化珪素単結晶基板10の主面10aに、炭化珪素エピタキシャル膜等をエピタキシャル成長により成膜する場合があるが、この場合、アライメントマークの形状が変化する場合がある。具体的には、図1に示されるような断面が矩形の凸状のアライメントマーク11が形成されている炭化珪素単結晶基板10の主面10aに、炭化珪素エピタキシャル膜20を成膜する。この場合、図3に示されるように、炭化珪素エピタキシャル膜20の表面20aには、凸状のアライメントマーク11が形成されていた領域にアライメントマーク21が現れる。このアライメントマーク21は、断面形状が傾斜面21aを有する山形であり、図1に示されるようなアライメントマーク11とは形状が異なる。 When manufacturing a silicon carbide semiconductor device, a silicon carbide epitaxial film or the like may be formed by epitaxial growth on main surface 10a of silicon carbide single-crystal substrate 10. In this case, the shape of the alignment mark may change. There is Specifically, silicon carbide epitaxial film 20 is formed on main surface 10a of silicon carbide single crystal substrate 10 on which convex alignment mark 11 having a rectangular cross section as shown in FIG. 1 is formed. In this case, as shown in FIG. 3, on surface 20a of silicon carbide epitaxial film 20, alignment mark 21 appears in the region where convex alignment mark 11 was formed. The alignment mark 21 has a mountain-shaped cross section with an inclined surface 21a, and is different in shape from the alignment mark 11 shown in FIG.

また、図2に示されるような断面が矩形の凹状のアライメントマーク12が形成されている炭化珪素単結晶基板10の主面10aに、炭化珪素エピタキシャル膜20を成膜する。この場合、図4に示されるように、炭化珪素エピタキシャル膜20の表面20aには、凹状のアライメントマーク12が形成されていた領域にアライメントマーク22が現れる。このアライメントマーク22は、断面形状が主面10aに対し垂直ではない傾斜面22a、22bを有する形状であり、図2に示されるようなアライメントマーク12とは形状が異なる。 A silicon carbide epitaxial film 20 is formed on main surface 10a of silicon carbide single crystal substrate 10 on which concave alignment mark 12 having a rectangular cross section as shown in FIG. 2 is formed. In this case, as shown in FIG. 4, on surface 20a of silicon carbide epitaxial film 20, alignment mark 22 appears in the region where concave alignment mark 12 was formed. The alignment mark 22 has a cross-sectional shape with inclined surfaces 22a and 22b that are not perpendicular to the main surface 10a, and is different in shape from the alignment mark 12 shown in FIG.

検討の結果、ステッパー等の露光装置においては、アライメントマーク21は認識することはできない場合であっても、アライメントマーク22は認識することが可能である場合がある。従って、アライメントマーク21よりも、アライメントマーク22は認識されやすい。このため、炭化珪素単結晶基板10の主面10aに形成されるアライメントマークは、図1に示されるような凸状のアライメントマーク11よりも、図2に示されるような凹状のアライメントマーク12が好ましい。 As a result of examination, it is possible to recognize the alignment mark 22 even if the alignment mark 21 cannot be recognized by an exposure apparatus such as a stepper. Therefore, the alignment marks 22 are easier to recognize than the alignment marks 21 . Therefore, alignment marks formed on main surface 10a of silicon carbide single-crystal substrate 10 are concave alignment marks 12 as shown in FIG. 2 rather than convex alignment marks 11 as shown in FIG. preferable.

ところで、このようなアライメントマーク22において、図5に示すように、炭化珪素エピタキシャル膜20の表面20aにフォトレジスト30等を塗布した場合には、アライメントマーク22が認識されなくなる場合がある。このようにアライメントマーク22が認識されなくなると、位置合わせをすることができず、炭化珪素半導体装置を製造することができない。このようにフォトレジスト30を塗布した場合に、アライメントマーク22が認識されなくなるのは、アライメント光が傾斜面22a、22bのような緩やかな傾斜部とフォトレジスト30の表面とにおける干渉することによるものと推察される。傾斜面22a、22bのような緩やかな傾斜部とフォトレジスト30の表面とにおける干渉では、アライメント光の光量が広い範囲で徐々に連続的に変化するからである。 By the way, in such an alignment mark 22, when a photoresist 30 or the like is applied to the surface 20a of the silicon carbide epitaxial film 20 as shown in FIG. 5, the alignment mark 22 may not be recognized. If alignment mark 22 is not recognized in this manner, alignment cannot be performed, and a silicon carbide semiconductor device cannot be manufactured. When the photoresist 30 is applied in this manner, the alignment marks 22 are not recognized because the alignment light interferes with the surface of the photoresist 30 and the gently inclined portions such as the inclined surfaces 22a and 22b. It is speculated that This is because interference between the surface of the photoresist 30 and the gently inclined portions such as the inclined surfaces 22a and 22b causes the light amount of the alignment light to change gradually and continuously over a wide range.

尚、ステッパー等の露光装置によるアライメントマークを用いたアライメントには、大凡の位置合わせを行うためのラフアライメント機能と、正確な位置合わせを行うファインアライメント機能とが存在しているものがある。ラフアライメントでは、大凡の位置合わせしかできないが、アライメント条件が緩く、図5に示すような炭化珪素エピタキシャル膜20の表面20aにフォトレジスト30等を塗布した場合であっても、アライメントマークを認識し位置合わせが可能である。一方、ファインアライメントでは、正確な位置合わせのため、アライメント条件が厳しく、図5に示すような炭化珪素エピタキシャル膜20の表面20aにフォトレジスト30等を塗布した場合は、アライメントマークが認識されず位置合わせをすることができない。 Alignment using alignment marks by an exposure apparatus such as a stepper includes a rough alignment function for performing rough alignment and a fine alignment function for performing accurate alignment. In the rough alignment, only rough alignment can be performed, but even if the alignment conditions are loose and the photoresist 30 or the like is applied to the surface 20a of the silicon carbide epitaxial film 20 as shown in FIG. 5, the alignment marks cannot be recognized. Alignment is possible. On the other hand, in fine alignment, alignment conditions are strict for accurate alignment. cannot match.

実際の炭化珪素半導体装置の製造工程においては、ラフアライメントを行い大凡の位置合わせを行った後、更に、ファインアライメントによる微調整を行い、正確な位置合わせを行って露光を行う。従って、一般的には、炭化珪素半導体装置を製造する際には、ファインアライメントまで行うため、本願において、単にアライメントと記載する場合には、ファインアライメントを意味する場合がある。 In an actual manufacturing process of a silicon carbide semiconductor device, rough alignment is performed and rough alignment is performed, then fine adjustment is performed by fine alignment, accurate alignment is performed, and exposure is performed. Therefore, in general, when a silicon carbide semiconductor device is manufactured, fine alignment is performed. Therefore, in the present application, simply describing alignment may mean fine alignment.

よって、凹状のアライメントマーク12が形成されている炭化珪素単結晶基板10に炭化珪素エピタキシャル膜20が成膜され、フォトレジストが塗布されていても、アライメントによる位置合わせが可能な炭化珪素半導体装置の製造方法が求められている。 Therefore, even if the silicon carbide epitaxial film 20 is formed on the silicon carbide single crystal substrate 10 having the concave alignment mark 12 formed thereon and the photoresist is applied, the silicon carbide semiconductor device can be positioned by alignment. A manufacturing method is needed.

〔第1の実施の形態〕
次に、第1の実施の形態における炭化珪素半導体装置の製造方法について、図6Aから図9Bに基づき説明する。
[First Embodiment]
Next, a method for manufacturing the silicon carbide semiconductor device according to the first embodiment will be described with reference to FIGS. 6A to 9B.

最初に、図6Aに示すように、炭化珪素単結晶基板110の主面110aに凹状の第1のアライメントマーク111を形成する。具体的には、炭化珪素単結晶基板110の主面110aにフォトレジストを塗布し、露光装置による露光、現像を行うことにより、凹状の第1のアライメントマーク111が形成される領域に開口部を有する不図示のレジストパターンを形成する。この後、RIE(Reactive Ion Etching)等のドライエッチングによりレジストパターンの形成されていない領域の炭化珪素単結晶基板110を除去することにより、凹状の第1のアライメントマーク111を形成する。この後、不図示のレジストパターンを除去する。このように形成される凹状の第1のアライメントマーク111は、底部までの深さdが約1μmである。 First, as shown in FIG. 6A , concave first alignment mark 111 is formed on main surface 110 a of silicon carbide single crystal substrate 110 . Specifically, a photoresist is applied to main surface 110a of silicon carbide single-crystal substrate 110, and exposure and development are performed by an exposure apparatus, thereby forming openings in regions where concave first alignment marks 111 are formed. A resist pattern (not shown) is formed. After that, silicon carbide single crystal substrate 110 is removed from a region where the resist pattern is not formed by dry etching such as RIE (Reactive Ion Etching) to form concave first alignment mark 111 . After that, the resist pattern (not shown) is removed. The concave first alignment mark 111 formed in this manner has a depth d to the bottom of about 1 μm.

炭化珪素単結晶基板110をドライエッチングにより除去する際には、エッチングガスとしてSF+Oを用い、印加パワー:800W、バイアスパワー:40W、ドライエッチング装置のチャンバー内の圧力:1Paの条件で行う。また、レジストパターンの除去する際には、酸素アッシングによりレジストパターンを除去した後、SPM洗浄、RCA洗浄を行う。When the silicon carbide single crystal substrate 110 is removed by dry etching, SF 6 +O 2 is used as an etching gas, applied power is 800 W, bias power is 40 W, and the pressure in the chamber of the dry etching apparatus is 1 Pa. . When removing the resist pattern, after removing the resist pattern by oxygen ashing, SPM cleaning and RCA cleaning are performed.

炭化珪素単結晶基板110は、所定の結晶面からオフ角θだけ傾斜した主面110aを有している。所定の結晶面は、(0001)面または(000-1)面が好ましい。炭化珪素単結晶基板110における炭化珪素のポリタイプは4Hである。4Hのポリタイプの炭化珪素は、電子移動度、絶縁破壊電界強度等が、他のポリタイプよりも優れているからである。炭化珪素単結晶基板110の径は、150mm以上(たとえば6インチ以上)である。径が大きい程、半導体装置の製造コスト削減に有利であるからである。炭化珪素単結晶基板110は、主面110aが{0001}面に対し、<11-20>方位に4°のオフ角θで傾斜している。尚、本実施形態においては、オフ角θは、0°を越え、6°以下であってもよい。 Silicon carbide single-crystal substrate 110 has main surface 110a inclined by off angle θ from a predetermined crystal plane. The predetermined crystal plane is preferably the (0001) plane or the (000-1) plane. The polytype of silicon carbide in silicon carbide single crystal substrate 110 is 4H. This is because 4H polytype silicon carbide is superior to other polytypes in terms of electron mobility, dielectric breakdown field strength, and the like. Silicon carbide single crystal substrate 110 has a diameter of 150 mm or more (for example, 6 inches or more). This is because the larger the diameter, the more advantageous it is for reducing the manufacturing cost of the semiconductor device. Silicon carbide single crystal substrate 110 has main surface 110a inclined in the <11-20> orientation at an off angle θ of 4° with respect to the {0001} plane. Incidentally, in the present embodiment, the off angle θ may exceed 0° and may be 6° or less.

次に、図6Bに示すように、炭化珪素単結晶基板110の主面110aに、エピタキシャル成長により、炭化珪素エピタキシャル膜120を形成する。成膜される炭化珪素エピタキシャル膜120の膜厚は1μm~3μmである。これにより炭化珪素エピタキシャル膜120の表面120aには、凹状の第1のアライメントマーク111が形成されていた領域に第2のアライメントマーク121が現れる。この第2のアライメントマーク121は、断面形状が表面120aに対し傾斜した傾斜面を有する形状である。 Next, as shown in FIG. 6B, silicon carbide epitaxial film 120 is formed on main surface 110a of silicon carbide single crystal substrate 110 by epitaxial growth. The film thickness of silicon carbide epitaxial film 120 to be formed is 1 μm to 3 μm. As a result, on surface 120a of silicon carbide epitaxial film 120, second alignment mark 121 appears in the region where concave first alignment mark 111 was formed. The second alignment mark 121 has a cross-sectional shape with an inclined surface that is inclined with respect to the surface 120a.

次に、図7Aに示すように、炭化珪素エピタキシャル膜120の表面120aに第1のフォトレジスト130を塗布する。第1のフォトレジスト130は、膜厚が約2μmとなるように、スピンコーター等により塗布する。これにより、炭化珪素エピタキシャル膜120の表面120aに現れる第2のアライメントマーク121は、第1のフォトレジスト130に埋め込まれ、第1のフォトレジスト130の表面は平坦になる。尚、必要に応じてベーキング等を行う。本願においては、第1のフォトレジスト130は、ポジ型のフォトレジストが用いられる。 Next, as shown in FIG. 7A, first photoresist 130 is applied to surface 120a of silicon carbide epitaxial film 120 . The first photoresist 130 is applied by a spin coater or the like so as to have a film thickness of about 2 μm. Thereby, second alignment marks 121 appearing on surface 120a of silicon carbide epitaxial film 120 are embedded in first photoresist 130, and the surface of first photoresist 130 is flattened. In addition, baking etc. are performed as needed. In the present application, a positive photoresist is used for the first photoresist 130 .

次に、図7Bに示すように、炭化珪素エピタキシャル膜120の表面120aの第2のアライメントマーク121の全体を含む領域に、第1のフォトレジスト130の第1の開口部131を形成する。具体的には、露光装置による露光、現像を行うことにより、第1のフォトレジスト130の第1の開口部131を形成する。露光装置には、波長365nm(i線)のステッパーが用いられ、現像液には、例えば、TMAH(テトラメチルアンモニウムハイドロオキサイド)等のアルカリ溶液が用いられる。第1の開口部131は、第2のアライメントマーク121の外形よりも約10μm程広く形成されている。従って、第1の開口部131を形成することにより、第1の開口部131において、炭化珪素エピタキシャル膜120の表面120aの第2のアライメントマーク121が露出する。尚、第1の開口部131を形成する際には、位置合わせを行う必要があるが、この位置合わせは、ステッパーのラフアライメントや目視等により行う。 Next, as shown in FIG. 7B, a first opening 131 of first photoresist 130 is formed in a region including the entirety of second alignment mark 121 on surface 120a of silicon carbide epitaxial film 120. Next, as shown in FIG. Specifically, the first opening 131 of the first photoresist 130 is formed by performing exposure and development using an exposure device. A stepper with a wavelength of 365 nm (i-line) is used as the exposure device, and an alkaline solution such as TMAH (tetramethylammonium hydroxide) is used as the developer. The first opening 131 is wider than the outline of the second alignment mark 121 by about 10 μm. Therefore, by forming first opening 131 , second alignment mark 121 on surface 120 a of silicon carbide epitaxial film 120 is exposed in first opening 131 . It should be noted that, when forming the first opening 131, it is necessary to perform alignment, and this alignment is performed by rough alignment of a stepper, visual inspection, or the like.

次に、図8Aに示すように、後述する凹状の第3のアライメントマーク122が形成される領域に、第1のフォトレジスト130の第2の開口部132を形成する。具体的には、第1のフォトレジスト130の第1の開口部131において露出している第2のアライメントマーク121を用いて、位置合わせを行い露光装置による露光、現像を行う。これにより、所定の位置に第1のフォトレジスト130の第2の開口部132を形成する。露光装置には、波長365nmのステッパーが用いられ、現像液には、例えば、TMAH等のアルカリ溶液が用いられる。この工程においては、第1のフォトレジスト130の第1の開口部131において露出している第2のアライメントマーク121を用いることができるため、ファインアライメントにより正確な位置合わせを行うことができる。これにより、第1のフォトレジスト130の所望の位置に正確に第2の開口部132を形成することができる。 Next, as shown in FIG. 8A, a second opening 132 is formed in the first photoresist 130 in a region where a concave third alignment mark 122 to be described later is to be formed. Specifically, alignment is performed using the second alignment marks 121 exposed in the first openings 131 of the first photoresist 130, and exposure and development are performed by an exposure device. Thereby, a second opening 132 of the first photoresist 130 is formed at a predetermined position. A stepper with a wavelength of 365 nm is used as the exposure device, and an alkaline solution such as TMAH is used as the developer. In this step, since the second alignment marks 121 exposed in the first openings 131 of the first photoresist 130 can be used, accurate alignment can be performed by fine alignment. Thereby, the second opening 132 can be accurately formed in the desired position of the first photoresist 130 .

次に、図8Bに示すように、第1のフォトレジスト130の第2の開口部132において露出している炭化珪素エピタキシャル膜120の一部を除去することにより、凹状の第3のアライメントマーク122を形成する。具体的には、RIE等のドライエッチングにより、第1のフォトレジスト130の第2の開口部132において露出している炭化珪素エピタキシャル膜120を除去することにより、凹状の第3のアライメントマーク122を形成する。このように形成される凹状の第3のアライメントマーク122の底部までの深さは約0.5μm~1.0μmである。このような凹状の第3のアライメントマーク122は、炭化珪素半導体装置を製造する際のダイシングソーにより切断されるスクライブラインとなる領域に形成してもよい。炭化珪素エピタキシャル膜120を除去する際には、エッチングガスとしてSF+Oを用い、印加パワー:800W、バイアスパワー:40W、ドライエッチング装置のチャンバー内の圧力:1Paの条件で行う。この際、第1のフォトレジスト130の第1の開口部131において露出している第2のアライメントマーク121が形成されている領域の炭化珪素エピタキシャル膜120も同時に一部除去されるが、炭化珪素半導体装置の製造に支障をきたすことはない。Next, as shown in FIG. 8B, a concave third alignment mark 122 is formed by removing a portion of the silicon carbide epitaxial film 120 exposed in the second opening 132 of the first photoresist 130 . to form Specifically, the silicon carbide epitaxial film 120 exposed in the second opening 132 of the first photoresist 130 is removed by dry etching such as RIE, thereby forming the concave third alignment mark 122 . Form. The depth to the bottom of the concave third alignment mark 122 formed in this manner is about 0.5 μm to 1.0 μm. Such concave third alignment mark 122 may be formed in a region that will be a scribe line cut by a dicing saw when manufacturing a silicon carbide semiconductor device. When removing the silicon carbide epitaxial film 120, SF 6 +O 2 is used as an etching gas, applied power: 800 W, bias power: 40 W, pressure in the chamber of the dry etching apparatus: 1 Pa. At this time, silicon carbide epitaxial film 120 in the region where second alignment mark 121 is formed and exposed in first opening 131 of first photoresist 130 is also partially removed at the same time. This does not interfere with the manufacture of semiconductor devices.

次に、図9Aに示すように、第1のフォトレジスト130を除去する。第1のフォトレジスト130の除去する際には、酸素アッシングにより第1のフォトレジスト130を除去した後、SPM洗浄、RCA洗浄を行う。この後の炭化珪素半導体装置の製造工程においては、形成された凹状の第3のアライメントマーク122を用いて位置合わせを行うことにより、正確な位置合わせを行うことができ、所望の炭化珪素半導体装置を高い歩留まりで製造することができる。 Next, as shown in FIG. 9A, the first photoresist 130 is removed. When removing the first photoresist 130, after removing the first photoresist 130 by oxygen ashing, SPM cleaning and RCA cleaning are performed. In subsequent manufacturing steps of the silicon carbide semiconductor device, alignment is performed using the formed concave third alignment marks 122, whereby accurate alignment can be performed, and the desired silicon carbide semiconductor device can be obtained. can be manufactured with high yield.

具体的には、凹状の第3のアライメントマーク122は矩形の凹状のアライメントマークであり、この後、図9Bに示すように、第2のフォトレジスト140が塗布されている場合であっても、露光装置によるファインアライメントによる位置合わせが可能である。従って、凹状の第3のアライメントマーク122を用いて位置合わせを行い、露光することにより、炭化珪素半導体装置を高い歩留まりで製造することができる。 Specifically, the concave third alignment mark 122 is a rectangular concave alignment mark, and then, as shown in FIG. 9B, even if the second photoresist 140 is applied, Alignment by fine alignment by an exposure apparatus is possible. Therefore, by performing alignment using concave third alignment mark 122 and performing exposure, silicon carbide semiconductor devices can be manufactured with a high yield.

〔第2の実施の形態〕
次に、第2の実施の形態における炭化珪素半導体装置の製造方法について、図10Aから図12Bに基づき説明する。
[Second embodiment]
Next, a method for manufacturing a silicon carbide semiconductor device according to the second embodiment will be described with reference to FIGS. 10A to 12B.

最初に、図10Aに示すように、炭化珪素単結晶基板110の主面110aに凹状の第1のアライメントマーク111を形成する。 First, as shown in FIG. 10A , concave first alignment mark 111 is formed on main surface 110 a of silicon carbide single crystal substrate 110 .

次に、図10Bに示すように、炭化珪素単結晶基板110の主面110aに、エピタキシャル成長により、炭化珪素エピタキシャル膜120を形成する。 Next, as shown in FIG. 10B, silicon carbide epitaxial film 120 is formed on main surface 110a of silicon carbide single crystal substrate 110 by epitaxial growth.

次に、図11Aに示すように、炭化珪素エピタキシャル膜120の表面120aに第1のフォトレジスト130を塗布する。 Next, as shown in FIG. 11A , first photoresist 130 is applied to surface 120a of silicon carbide epitaxial film 120 .

次に、図11Bに示すように、第2のアライメントマーク121の全体を含む領域の炭化珪素エピタキシャル膜120の表面120aに、第1のフォトレジスト130の第1の開口部131を形成する。 Next, as shown in FIG. 11B , first opening 131 of first photoresist 130 is formed in surface 120 a of silicon carbide epitaxial film 120 in a region including second alignment mark 121 entirely.

次に、図12Aに示すように、後述する炭化珪素エピタキシャル膜120のn領域221が形成される領域に、第1のフォトレジスト130の第2の開口部232を形成する。具体的には、第1のフォトレジスト130の第1の開口部131において露出している第2のアライメントマーク121を用いて、位置合わせを行い露光装置による露光、現像を行う。これにより、所定の位置に第1のフォトレジスト130の第2の開口部232を形成する。この工程においては、第1のフォトレジスト130の第1の開口部131において露出している第2のアライメントマーク121を用いることができるため、ファインアライメントにより正確な位置合わせを行うことができる。これにより、第1のフォトレジスト130の所望の位置に正確に第2の開口部232を形成することができる。Next, as shown in FIG. 12A, a second opening 232 is formed in first photoresist 130 in a region where n + region 221 of silicon carbide epitaxial film 120 to be described later is to be formed. Specifically, alignment is performed using the second alignment marks 121 exposed in the first openings 131 of the first photoresist 130, and exposure and development are performed by an exposure device. Thereby, a second opening 232 of the first photoresist 130 is formed at a predetermined position. In this step, since the second alignment marks 121 exposed in the first openings 131 of the first photoresist 130 can be used, accurate alignment can be performed by fine alignment. Thereby, the second opening 232 can be accurately formed in the desired position of the first photoresist 130 .

次に、図12Bに示すように、第1のフォトレジスト130の第2の開口部232において露出している炭化珪素エピタキシャル膜120に、n型となる不純物元素をイオン注入することにより、n領域221を形成する。n型となる不純物元素としてはPを用い、加速エネルギー:10keV~900keV、ドーズ量:1×1011cm-2~1×1016cm-2の条件でイオン注入を行う。尚、炭化珪素エピタキシャル膜120にn領域221に代えて、p領域を形成する場合には、イオン注入する不純物元素をAlにする。この後、第1のフォトレジスト130を除去する。Next, as shown in FIG. 12B, an n-type impurity element is ion-implanted into the silicon carbide epitaxial film 120 exposed in the second opening 232 of the first photoresist 130 to obtain an n + A region 221 is formed. P is used as an n-type impurity element, and ion implantation is performed under the conditions of acceleration energy of 10 keV to 900 keV and dose of 1×10 11 cm −2 to 1×10 16 cm −2 . Incidentally, when forming a p + region instead of the n + region 221 in the silicon carbide epitaxial film 120, the impurity element to be ion-implanted is Al. After that, the first photoresist 130 is removed.

本実施の形態における炭化珪素半導体装置を製造方法においては、第1のフォトレジスト130の第2の開口部232は、いわゆる素子領域に形成される。また、本実施の形態は、第1のフォトレジスト130の第2の開口部232が形成されている領域の炭化珪素エピタキシャル膜120をエッチングにより除去することによりトレンチ等を形成するものであってもよい。 In the method for manufacturing a silicon carbide semiconductor device in the present embodiment, second opening 232 of first photoresist 130 is formed in a so-called element region. Further, in the present embodiment, trenches and the like are formed by removing by etching the silicon carbide epitaxial film 120 in the region where the second opening 232 of the first photoresist 130 is formed. good.

尚、上記以外の内容については、第1の実施の形態と同様である。 Contents other than the above are the same as in the first embodiment.

〔第3の実施の形態〕
次に、第3の実施の形態における炭化珪素半導体装置の製造方法について、図13Aから図19Bに基づき説明する。
[Third Embodiment]
Next, a method for manufacturing a silicon carbide semiconductor device according to the third embodiment will be described with reference to FIGS. 13A to 19B.

最初に、図13Aに示すように、炭化珪素単結晶基板110の主面110aに凹状の第1のアライメントマーク111を形成する。 First, as shown in FIG. 13A , concave first alignment mark 111 is formed on main surface 110 a of silicon carbide single crystal substrate 110 .

次に、図13Bに示すように、炭化珪素単結晶基板110の主面110aに、エピタキシャル成長により、炭化珪素エピタキシャル膜120を形成する。 Next, as shown in FIG. 13B, silicon carbide epitaxial film 120 is formed on main surface 110a of silicon carbide single crystal substrate 110 by epitaxial growth.

次に、図14Aに示すように、炭化珪素エピタキシャル膜120の表面120aに第1のフォトレジスト130を塗布する。 Next, as shown in FIG. 14A , first photoresist 130 is applied to surface 120a of silicon carbide epitaxial film 120 .

次に、図14Bに示すように、炭化珪素エピタキシャル膜120の表面120aの第2のアライメントマーク121の全体を含む領域に、第1のフォトレジスト130の第1の開口部131を形成する。 Next, as shown in FIG. 14B, a first opening 131 of first photoresist 130 is formed in a region including the entirety of second alignment mark 121 on surface 120a of silicon carbide epitaxial film 120. Next, as shown in FIG.

次に、図15Aに示すように、後述する凹状の第3のアライメントマーク122が形成される領域に、第1のフォトレジスト130の第2の開口部132を形成する。 Next, as shown in FIG. 15A, a second opening 132 is formed in the first photoresist 130 in a region where a concave third alignment mark 122 to be described later is to be formed.

次に、図15Bに示すように、第1のフォトレジスト130の第2の開口部132において露出している炭化珪素エピタキシャル膜120を除去することにより、凹状の第3のアライメントマーク122を形成する。 Next, as shown in FIG. 15B, the silicon carbide epitaxial film 120 exposed in the second opening 132 of the first photoresist 130 is removed to form a concave third alignment mark 122. .

次に、図16Aに示すように、第1のフォトレジスト130を除去する。 Next, as shown in FIG. 16A, the first photoresist 130 is removed.

次に、図16Bに示すように、炭化珪素エピタキシャル膜120の表面120aに、膜厚が約2μmの酸化シリコン膜350を成膜する。 Next, as shown in FIG. 16B, a silicon oxide film 350 having a thickness of about 2 μm is formed on the surface 120a of the silicon carbide epitaxial film 120. Next, as shown in FIG.

次に、図17Aに示すように、酸化シリコン膜350の上にフォトレジスト360を塗布する。塗布されるフォトレジスト360の厚さは、約2.5μmである。 Next, as shown in FIG. 17A, a photoresist 360 is applied on the silicon oxide film 350 . The thickness of the applied photoresist 360 is approximately 2.5 μm.

次に、図17Bに示すように、炭化珪素エピタキシャル膜120においてn領域321が形成される領域に、フォトレジスト360の第3の開口部361を形成する。具体的には、炭化珪素エピタキシャル膜120に形成されている凹状の第3のアライメントマーク122を用いて位置合わせを行い、露光装置による露光、現像を行うことにより、フォトレジスト360に第3の開口部361を形成する。この工程においては、炭化珪素エピタキシャル膜120の表面120aに対し略垂直な側面を有する凹状の第3のアライメントマーク122を用いることができる。従って、凹状の第3のアライメントマーク122の上に酸化シリコン膜350が成膜されていても、凹状の第3のアライメントマーク122は、露光装置において認識可能である。よって、凹状の第3のアライメントマーク122を用いてファインアライメントにより正確な位置合わせを行うことができる。これにより、フォトレジスト360の所望の位置に正確に第3の開口部361を形成することができる。Next, as shown in FIG. 17B, a third opening 361 of photoresist 360 is formed in a region of silicon carbide epitaxial film 120 where n + region 321 is to be formed. Specifically, alignment is performed using concave third alignment marks 122 formed in silicon carbide epitaxial film 120 , and exposure and development are performed by an exposure device to form a third opening in photoresist 360 . A portion 361 is formed. In this step, concave third alignment mark 122 having a side surface substantially perpendicular to surface 120a of silicon carbide epitaxial film 120 can be used. Therefore, even if the silicon oxide film 350 is formed on the concave third alignment mark 122, the concave third alignment mark 122 can be recognized by the exposure apparatus. Therefore, accurate alignment can be performed by fine alignment using the concave third alignment mark 122 . Thereby, the third opening 361 can be accurately formed in the desired position of the photoresist 360 .

次に、図18Aに示すように、フォトレジスト360の第3の開口部361における酸化シリコン膜350をRIE等のドライエッチングにより除去することにより開口部351を形成する。これにより、残存する酸化シリコン膜350によりイオン注入マスクが形成される。酸化シリコン膜350を除去する際には、エッチングガスとして、CF、CHF、Arの混合ガスを用い、印加パワー:500W、バイアスパワー:50W、ドライエッチング装置のチャンバー内の圧力:1Paの条件で行う。これにより、フォトレジスト360の第3の開口部361における酸化シリコン膜350を炭化珪素エピタキシャル膜120の表面120aが露出するまで除去し、酸化シリコン膜350に開口部351を形成し、イオン注入マスクを形成する。Next, as shown in FIG. 18A, an opening 351 is formed by removing the silicon oxide film 350 in the third opening 361 of the photoresist 360 by dry etching such as RIE. As a result, the remaining silicon oxide film 350 forms an ion implantation mask. When removing the silicon oxide film 350, a mixed gas of CF 4 , CHF 3 and Ar was used as an etching gas, applied power: 500 W, bias power: 50 W, pressure in the chamber of the dry etching apparatus: 1 Pa. do in As a result, silicon oxide film 350 in third opening 361 of photoresist 360 is removed until surface 120a of silicon carbide epitaxial film 120 is exposed, opening 351 is formed in silicon oxide film 350, and an ion implantation mask is used. Form.

次に、図18Bに示すように、フォトレジスト360を除去する。フォトレジスト360の除去する際には、酸素アッシングによりフォトレジスト360を除去した後、SPM洗浄、RCA洗浄を行う。 Next, as shown in FIG. 18B, the photoresist 360 is removed. When removing the photoresist 360, after removing the photoresist 360 by oxygen ashing, SPM cleaning and RCA cleaning are performed.

次に、図19Aに示すように、開口部351を有する酸化シリコン膜350をイオン注入マスクとして、領域の炭化珪素エピタキシャル膜120に、n型となる不純物元素をイオン注入することにより、n領域321を形成する。n型となる不純物元素としてはPを用い、加速エネルギー:10keV~900keV、ドーズ量:1×1011cm-2~1×1016cm-2の条件でイオン注入を行う。尚、炭化珪素エピタキシャル膜120にn領域321に代えて、p領域を形成する場合には、不純物元素をPからAlに代えてイオン注入する。Next, as shown in FIG. 19A, using the silicon oxide film 350 having the opening 351 as an ion implantation mask, an n-type impurity element is implanted into the silicon carbide epitaxial film 120 in the region to form an n + region. 321 is formed. P is used as an n-type impurity element, and ion implantation is performed under the conditions of acceleration energy of 10 keV to 900 keV and dose of 1×10 11 cm −2 to 1×10 16 cm −2 . Incidentally, when forming a p + region instead of the n + region 321 in the silicon carbide epitaxial film 120, ions are implanted instead of P as an impurity element to Al.

次に、図19Bに示すように、酸化シリコン膜350をウェットエッチングにより除去する。酸化シリコン膜350を除去する際には、エッチング液としてHF(フッ酸)またはBHF(バッファードフッ酸)を用いる。 Next, as shown in FIG. 19B, the silicon oxide film 350 is removed by wet etching. When removing the silicon oxide film 350, HF (hydrofluoric acid) or BHF (buffered hydrofluoric acid) is used as an etchant.

尚、上記以外の内容については、第1の実施の形態と同様である。 Contents other than the above are the same as in the first embodiment.

以上、実施形態について詳述したが、特定の実施形態に限定されるものではなく、請求の範囲に記載された範囲内において、種々の変形及び変更が可能である。 Although the embodiment has been described in detail above, it is not limited to a specific embodiment, and various modifications and changes are possible within the scope described in the claims.

10 炭化珪素単結晶基板
10a 主面
11 凸状のアライメントマーク
12 凹状のアライメントマーク
20 炭化珪素エピタキシャル膜
20a 表面
21 アライメントマーク
21a 傾斜面
22 アライメントマーク
22a、22b 傾斜面
30 フォトレジスト
110 炭化珪素単結晶基板
110a 主面
111 第1のアライメントマーク
120 炭化珪素エピタキシャル膜
120a 表面
121 第2のアライメントマーク
122 第3のアライメントマーク
130 第1のフォトレジスト
131 第1の開口部
132 第2の開口部
140 第2のフォトレジスト
221 n領域
232 第2の開口部
321 n領域
350 酸化シリコン膜
351 開口部
360 フォトレジスト
361 第3の開口部
10 silicon carbide single crystal substrate 10a main surface 11 convex alignment mark 12 concave alignment mark 20 silicon carbide epitaxial film 20a surface 21 alignment mark 21a inclined surface 22 alignment marks 22a, 22b inclined surface 30 photoresist 110 silicon carbide single crystal substrate 110a Main surface 111 First alignment mark 120 Silicon carbide epitaxial film 120a Surface 121 Second alignment mark 122 Third alignment mark 130 First photoresist 131 First opening 132 Second opening 140 Second opening Photoresist 221 n + region 232 Second opening 321 n + region 350 Silicon oxide film 351 Opening 360 Photo resist 361 Third opening

Claims (10)

凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜することにより、前記第1のアライメントマークの上の前記炭化珪素エピタキシャル膜の表面に凹状の第2のアライメントマークを形成する工程と、
前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、
前記第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、
前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、
を有する炭化珪素半導体装置の製造方法。
By forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed, concave second alignment marks are formed on the surface of the silicon carbide epitaxial film above the first alignment marks. a step of forming an alignment mark of
applying a first photoresist to the surface of the silicon carbide epitaxial film;
removing the first photoresist in a region containing the second alignment mark to form a first opening;
aligning using the second alignment mark exposed in the first opening to form a second opening in the first photoresist;
A method for manufacturing a silicon carbide semiconductor device having
前記第2の開口部を形成する工程の後、
前記第2の開口部における前記炭化珪素エピタキシャル膜の一部を除去し、第3のアライメントマークを形成する工程と、
前記第1のフォトレジストを除去する工程と、
を有する請求項1に記載の炭化珪素半導体装置の製造方法。
After the step of forming the second opening,
removing a portion of the silicon carbide epitaxial film in the second opening to form a third alignment mark;
removing the first photoresist;
The method for manufacturing a silicon carbide semiconductor device according to claim 1, having
前記第1のフォトレジストを除去する工程の後、
前記炭化珪素エピタキシャル膜の表面に第2のフォトレジストを塗布する工程と、
前記第3のアライメントマークを用いて位置合わせを行い、前記第2のフォトレジストに第3の開口部を形成する工程と、
を有する請求項2に記載の炭化珪素半導体装置の製造方法。
After removing the first photoresist,
applying a second photoresist to the surface of the silicon carbide epitaxial film;
aligning using the third alignment mark to form a third opening in the second photoresist;
3. The method for manufacturing a silicon carbide semiconductor device according to claim 2, comprising:
凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜する工程と、
前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、
前記第1のアライメントマークの上の炭化珪素エピタキシャル膜の表面に形成された第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、
前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、
前記第2の開口部における前記炭化珪素エピタキシャル膜を加工する工程と、
前記第1のフォトレジストを除去する工程と、
を有する炭化珪素半導体装置の製造方法。
forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed;
applying a first photoresist to the surface of the silicon carbide epitaxial film;
removing the first photoresist in a region including a second alignment mark formed on the surface of the silicon carbide epitaxial film above the first alignment mark to form a first opening;
aligning using the second alignment mark exposed in the first opening to form a second opening in the first photoresist;
processing the silicon carbide epitaxial film in the second opening;
removing the first photoresist;
A method for manufacturing a silicon carbide semiconductor device having
前記加工は、前記炭化珪素エピタキシャル膜のエッチングである請求項4に記載の炭化珪素半導体装置の製造方法。 5. The method of manufacturing a silicon carbide semiconductor device according to claim 4, wherein said processing is etching of said silicon carbide epitaxial film. 前記加工は、前記炭化珪素エピタキシャル膜へのイオン注入である請求項4に記載の炭化珪素半導体装置の製造方法。 5. The method of manufacturing a silicon carbide semiconductor device according to claim 4, wherein said processing is ion implantation into said silicon carbide epitaxial film. 前記第1のフォトレジストは、ポジ型である請求項1から請求項6のいずれか1項に記載の炭化珪素半導体装置の製造方法。 7. The method of manufacturing a silicon carbide semiconductor device according to claim 1, wherein said first photoresist is positive type. 前記第1の開口部及び前記第2の開口部は、
前記第1のフォトレジストを露光する工程と、
露光された前記第1のフォトレジストを現像する工程と、
により形成される請求項1から請求項7のいずれか1項に記載の炭化珪素半導体装置の製造方法。
The first opening and the second opening are
exposing the first photoresist;
developing the exposed first photoresist;
The method for manufacturing a silicon carbide semiconductor device according to any one of claims 1 to 7, formed by:
凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜することにより、前記第1のアライメントマークの上の前記炭化珪素エピタキシャル膜の表面に凹状の第2のアライメントマークを形成する工程と、
前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、
前記第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、
前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、
を有し、
前記第2の開口部を形成する工程の後、
前記第2の開口部における前記炭化珪素エピタキシャル膜の一部を除去し、第3のアライメントマークを形成する工程と、
前記第1のフォトレジストを除去する工程と、
を有し、
前記第1のフォトレジストを除去する工程の後、
前記炭化珪素エピタキシャル膜の表面に第2のフォトレジストを塗布する工程と、
前記第3のアライメントマークを用いて位置合わせを行い、前記第2のフォトレジストに第3の開口部を形成する工程と、
を有し、
前記第1のフォトレジストは、ポジ型であって、
前記第1の開口部及び前記第2の開口部は、
前記第1のフォトレジストを露光する工程と、
露光された前記第1のフォトレジストを現像する工程と、
により形成される炭化珪素半導体装置の製造方法。
By forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed, concave second alignment marks are formed on the surface of the silicon carbide epitaxial film above the first alignment marks. a step of forming an alignment mark of
applying a first photoresist to the surface of the silicon carbide epitaxial film;
removing the first photoresist in a region containing the second alignment mark to form a first opening;
aligning using the second alignment mark exposed in the first opening to form a second opening in the first photoresist;
has
After the step of forming the second opening,
removing a portion of the silicon carbide epitaxial film in the second opening to form a third alignment mark;
removing the first photoresist;
has
After removing the first photoresist,
applying a second photoresist to the surface of the silicon carbide epitaxial film;
aligning using the third alignment mark to form a third opening in the second photoresist;
has
The first photoresist is positive type,
The first opening and the second opening are
exposing the first photoresist;
developing the exposed first photoresist;
A method for manufacturing a silicon carbide semiconductor device formed by
凹状の第1のアライメントマークが形成されている炭化珪素結晶基板に、炭化珪素エピタキシャル膜を成膜する工程と、
前記炭化珪素エピタキシャル膜の表面に第1のフォトレジストを塗布する工程と、
前記第1のアライメントマークの上の炭化珪素エピタキシャル膜の表面に形成された第2のアライメントマークを含む領域の前記第1のフォトレジストを除去し、第1の開口部を形成する工程と、
前記第1の開口部において露出している前記第2のアライメントマークを用いて位置合わせを行い、前記第1のフォトレジストに第2の開口部を形成する工程と、
前記第2の開口部における前記炭化珪素エピタキシャル膜を加工する工程と、
前記第1のフォトレジストを除去する工程と、
を有し、
前記第1のフォトレジストは、ポジ型であって、
前記第1の開口部及び前記第2の開口部は、
前記第1のフォトレジストを露光する工程と、
露光された前記第1のフォトレジストを現像する工程と、
により形成される炭化珪素半導体装置の製造方法。
forming a silicon carbide epitaxial film on a silicon carbide crystal substrate on which concave first alignment marks are formed;
applying a first photoresist to the surface of the silicon carbide epitaxial film;
removing the first photoresist in a region including a second alignment mark formed on the surface of the silicon carbide epitaxial film above the first alignment mark to form a first opening;
aligning using the second alignment mark exposed in the first opening to form a second opening in the first photoresist;
processing the silicon carbide epitaxial film in the second opening;
removing the first photoresist;
has
The first photoresist is positive type,
The first opening and the second opening are
exposing the first photoresist;
developing the exposed first photoresist;
A method for manufacturing a silicon carbide semiconductor device formed by
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* Cited by examiner, † Cited by third party
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Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006278657A (en) 2005-03-29 2006-10-12 Seiko Epson Corp Process for fabricating semiconductor device
JP2006278658A (en) 2005-03-29 2006-10-12 Seiko Epson Corp Process for fabricating semiconductor device
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Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008053363A (en) * 2006-08-23 2008-03-06 Matsushita Electric Ind Co Ltd Semiconductor substrate, and its manufacturing method
JP2013021040A (en) * 2011-07-08 2013-01-31 Mitsubishi Electric Corp Silicon carbide semiconductor device manufacturing method and silicon carbide semiconductor device

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006278657A (en) 2005-03-29 2006-10-12 Seiko Epson Corp Process for fabricating semiconductor device
JP2006278658A (en) 2005-03-29 2006-10-12 Seiko Epson Corp Process for fabricating semiconductor device
JP2013183064A (en) 2012-03-02 2013-09-12 Toshiba Corp Method of manufacturing semiconductor device
JP2015126110A (en) 2013-12-26 2015-07-06 住友電気工業株式会社 Silicon carbide semiconductor device manufacturing method

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