JP7148205B1 - 電源回路、制御方法およびプログラム - Google Patents
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Abstract
Description
特許文献1には、関連する技術として、コンバータ回路に関する技術が開示されている。
そのため、電源回路において、スイッチスナバー回路を設けなくても、チョークコイルの両端のサージ電圧を抑制することのできる技術が求められている。
<第1実施形態>
図1は、第1実施形態による電源回路1の構成の一例を示す図である。電源回路1は、図1に示すように、直流電圧源Ei、チョークコイルL1、ダイオードD1(第1ダイオードの一例)、D2(第3ダイオードの一例)、D3(第2ダイオードの一例)、D4(第4ダイオードの一例)、D5、D6、D7、D8、スイッチング素子Q1(第1スイッチング素子の一例)、Q2(第1スイッチング素子の一例)、Q3(第2スイッチング素子の一例)、Q4(第2スイッチング素子の一例)、コンデンサC1(第1コンデンサの一例)、C2(第1コンデンサの一例)、C3(第2コンデンサの一例)、C4(第2コンデンサの一例)、C5、トランスT1、T2を備える。直流電圧源Eiの第1端子は、チョークコイルL1の第1端子に接続される。直流電圧源Eiの第2端子は、ダイオードD2のカソードおよびダイオードD4のカソードに接続される。チョークコイルL1の第2端子は、ダイオードD1のアノードおよびダイオードD3のアノードに接続される。ダイオードD1のカソードは、コンデンサC1の第1端子およびスイッチング素子Q1の第1端子に接続される。ダイオードD2のアノードは、コンデンサC2の第1端子およびスイッチング素子Q2の第1端子に接続される。ダイオードD3のカソードは、コンデンサC3の第1端子およびスイッチング素子Q3の第1端子に接続される。ダイオードD4のアノードは、コンデンサC4の第1端子およびスイッチング素子Q4の第1端子に接続される。ダイオードD5のアノードはトランスT1の第1端子に接続される。ダイオードD5のカソードは、コンデンサC5の第1端子、ダイオードD6のカソード、ダイオードD7のカソード、およびダイオードD8のカソードに接続される。ダイオードD6のアノードは、トランスT1の第2端子に接続される。ダイオードD7のアノードは、トランスT2の第1端子に接続される。ダイオードD8のアノードは、トランスT2の第2端子に接続される。コンデンサC1の第2端子は、コンデンサC2の第2端子およびトランスT1の第3端子に接続される。コンデンサC3の第2端子は、コンデンサC4の第2端子およびトランスT2の第3端子に接続される。コンデンサC5の第2端子は、トランスT1の第4端子およびトランスT2の第4端子に接続される。スイッチング素子Q1の第2端子は、スイッチング素子Q2の第2端子、スイッチング素子Q3の第2端子、スイッチング素子Q4の第2端子、トランスT1の第5端子、およびトランスT2の第5端子に接続される。なお、コンデンサC5の第1端子および第2端子間に負荷LDが接続される。また、トランスT1の第4端子は、トランスT1の2次巻線のセンタータップである。また、トランスT2の第4端子は、トランスT2の2次巻線のセンタータップである。また、スイッチング素子Q1、Q2、Q3、Q4それぞれの第3端子は、各スイッチング素子Q1、Q2、Q3、Q4のオン状態からオフ状態またはオフ状態からオン状態への切り替わりを制御するために用いられる端子である。スイッチング素子Q1、Q2、Q3、Q4のそれぞれは、例えば、NMOS(Negative-channel Metal Oxide Semiconductor)トランジスタである。
図3は、第2実施形態による電源回路1の構成の一例を示す図である。第2実施形態による電源回路1は、第1実施形態による電源回路1における直流電圧源Eiの代わりに、交流電圧源Viと、整流回路BD1とを備え、さらに、電流検出部DTと、制御部CT(生成部の一例、制御部の一例)とを備える回路である。
図10は、少なくとも1つの実施形態に係るコンピュータの構成を示す概略ブロック図である。
コンピュータ5は、図8に示すように、CPU6、メインメモリ7、ストレージ8、インターフェース9を備える。
例えば、上述の電源回路1、その他の制御装置のそれぞれは、コンピュータ5に実装される。そして、上述した各処理部の動作は、プログラムの形式でストレージ8に記憶されている。CPU6は、プログラムをストレージ8から読み出してメインメモリ7に展開し、当該プログラムに従って上記処理を実行する。また、CPU6は、プログラムに従って、上述した各記憶部に対応する記憶領域をメインメモリ7に確保する。
5・・・コンピュータ
6・・・CPU
7・・・メインメモリ
8・・・ストレージ
9・・・インターフェース
10、L1・・・チョークコイル
20a・・・第1ダイオード
20b・・・第2ダイオード
30a・・・第1回路
30b・・・第2回路
40a・・・第3ダイオード
40b・・・第4ダイオード
50、CT・・・制御部
BD1・・・整流回路
C1~C5・・・コンデンサ
D1~D8・・・ダイオード
DT・・・電流検出部
Ei・・・直流電圧源
LD・・・負荷
Q1~Q4・・・スイッチング素子
T1、T2・・・トランス
Vi・・・交流電圧源
Claims (6)
- チョークコイル、第1ダイオード、第2ダイオード、第3ダイオード、第4ダイオード、第1スイッチング素子、第2スイッチング素子、第3スイッチング素子、第4スイッチング素子、第1コンデンサ、第2コンデンサ、第3コンデンサ、第4コンデンサ、第1トランス、および第2トランスを備え、
前記チョークコイルの第1端子は、直流電圧源の正電圧側の端子に接続され、前記チョークコイルの第2端子は、前記第1ダイオードのアノードおよび前記第3ダイオードのアノードに接続され、前記第1ダイオードのカソードは、前記第1コンデンサの第1端子および前記第1スイッチング素子の第1端子に接続され、前記第2ダイオードのアノードは、前記第2コンデンサの第1端子および前記第2スイッチング素子の第1端子に接続され、前記第3ダイオードのカソードは、前記第3コンデンサの第1端子および前記第3スイッチング素子の第1端子に接続され、前記第4ダイオードのアノードは、前記第4コンデンサの第1端子および前記第4スイッチング素子の第1端子に接続され、前記第1コンデンサの第2端子は、前記第2コンデンサの第2端子および前記第1トランスの第1端子に接続され、前記第3コンデンサの第2端子は、前記第4コンデンサの第2端子および前記第2トランスの第1端子に接続され、前記第1スイッチング素子の第2端子は、前記第2スイッチング素子の第2端子、前記第3スイッチング素子の第2端子、前記第4スイッチング素子の第2端子、前記第1トランスの第2端子、および前記第2トランスの第2端子に接続され、前記第2ダイオードのカソードは、前記第4ダイオードのカソードおよび前記直流電圧源の負電圧側の端子に接続される
電源回路。 - 前記直流電圧源は、
交流電圧を出力する交流電圧源と、
前記交流電圧を直流電圧に整流する整流回路と、
を備える請求項1に記載の電源回路。 - 前記第1スイッチング素子、前記第2スイッチング素子、前記第3スイッチング素子、および前記第4スイッチング素子それぞれをオン状態またはオフ状態に制御する制御部、
を備える請求項1または請求項2に記載の電源回路。 - 前記第1スイッチング素子、前記第2スイッチング素子、前記第3スイッチング素子、および前記第4スイッチング素子それぞれをオン状態またはオフ状態に制御する電圧を生成する生成部、
を備え、
前記制御部は、
前記生成部が生成した前記電圧を用いて、前記第1スイッチング素子、前記第2スイッチング素子、前記第3スイッチング素子、および前記第4スイッチング素子それぞれをオン状態またはオフ状態に制御する、
請求項3に記載の電源回路。 - チョークコイル、第1ダイオード、第2ダイオード、第3ダイオード、第4ダイオード、第1スイッチング素子、第2スイッチング素子、第3スイッチング素子、第4スイッチング素子、第1コンデンサ、第2コンデンサ、第3コンデンサ、第4コンデンサ、第1トランス、および第2トランスを備え、前記チョークコイルの第1端子は、直流電圧源の正電圧側の端子に接続され、前記チョークコイルの第2端子は、前記第1ダイオードのアノードおよび前記第3ダイオードのアノードに接続され、前記第1ダイオードのカソードは、前記第1コンデンサの第1端子および前記第1スイッチング素子の第1端子に接続され、前記第2ダイオードのアノードは、前記第2コンデンサの第1端子および前記第2スイッチング素子の第1端子に接続され、前記第3ダイオードのカソードは、前記第3コンデンサの第1端子および前記第3スイッチング素子の第1端子に接続され、前記第4ダイオードのアノードは、前記第4コンデンサの第1端子および前記第4スイッチング素子の第1端子に接続され、前記第1コンデンサの第2端子は、前記第2コンデンサの第2端子および前記第1トランスの第1端子に接続され、前記第3コンデンサの第2端子は、前記第4コンデンサの第2端子および前記第2トランスの第1端子に接続され、前記第1スイッチング素子の第2端子は、前記第2スイッチング素子の第2端子、前記第3スイッチング素子の第2端子、前記第4スイッチング素子の第2端子、前記第1トランスの第2端子、および前記第2トランスの第2端子に接続され、前記第2ダイオードのカソードは、前記第4ダイオードのカソードおよび前記直流電圧源の負電圧側の端子に接続される電源回路を制御する制御方法であって、
前記第1スイッチング素子、前記第2スイッチング素子、前記第3スイッチング素子、および前記第4スイッチング素子それぞれをオン状態またはオフ状態に制御すること、
を含む制御方法。 - コンピュータに、
チョークコイル、第1ダイオード、第2ダイオード、第3ダイオード、第4ダイオード、第1スイッチング素子、第2スイッチング素子、第3スイッチング素子、第4スイッチング素子、第1コンデンサ、第2コンデンサ、第3コンデンサ、第4コンデンサ、第1トランス、および第2トランスを備え、前記チョークコイルの第1端子は、直流電圧源の正電圧側の端子に接続され、前記チョークコイルの第2端子は、前記第1ダイオードのアノードおよび前記第3ダイオードのアノードに接続され、前記第1ダイオードのカソードは、前記第1コンデンサの第1端子および前記第1スイッチング素子の第1端子に接続され、前記第2ダイオードのアノードは、前記第2コンデンサの第1端子および前記第2スイッチング素子の第1端子に接続され、前記第3ダイオードのカソードは、前記第3コンデンサの第1端子および前記第3スイッチング素子の第1端子に接続され、前記第4ダイオードのアノードは、前記第4コンデンサの第1端子および前記第4スイッチング素子の第1端子に接続され、前記第1コンデンサの第2端子は、前記第2コンデンサの第2端子および前記第1トランスの第1端子に接続され、前記第3コンデンサの第2端子は、前記第4コンデンサの第2端子および前記第2トランスの第1端子に接続され、前記第1スイッチング素子の第2端子は、前記第2スイッチング素子の第2端子、前記第3スイッチング素子の第2端子、前記第4スイッチング素子の第2端子、前記第1トランスの第2端子、および前記第2トランスの第2端子に接続され、前記第2ダイオードのカソードは、前記第4ダイオードのカソードおよび前記直流電圧源の負電圧側の端子に接続される電源回路における前記第1スイッチング素子、前記第2スイッチング素子、前記第3スイッチング素子、および前記第4スイッチング素子それぞれをオン状態またはオフ状態に制御すること、
を実行させるプログラム。
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JPS57196877A (en) * | 1981-05-29 | 1982-12-02 | Meidensha Electric Mfg Co Ltd | High frequency inverter |
JPH07308066A (ja) * | 1994-05-11 | 1995-11-21 | Nec Corp | スイッチング電源回路 |
JP2020156133A (ja) * | 2019-03-18 | 2020-09-24 | Tdk株式会社 | 電源装置および医療システム |
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