JP7038227B2 - ハイブリッドメモリシステム - Google Patents
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Description
Claims (13)
- 装置であって、
ハイブリッドメモリシステムと、
前記ハイブリッドメモリシステムに結合されたコントローラと、を備え、前記コントローラは、
データに伴う例外が発生したとの判定に応答して、前記ハイブリッドメモリシステムに前記データを選択的に記憶させるように構成されており、
前記例外が発生したとの前記判定は、リードアヘッド機構が前記装置によって呼び出されたとの判定の少なくとも一部に基づき、
前記例外は、ページ誤りを含む、
装置。 - 前記コントローラは、前記ハイブリッドメモリシステムの論理ブロックアドレス(LBA)範囲に前記データを選択的にマッピングさせるように更に構成されている、
請求項1に記載の装置。 - 前記コントローラは、
前記リードアヘッド機構が前記装置によって呼び出されたと前記判定させ、
前記リードアヘッド機構が呼び出されたとの前記判定に応答して、前記ハイブリッドメモリシステムの連続した部分に、前記リードアヘッド機構と関連付けられたデータに対応する論理ブロックアドレス(LBA)範囲をマッピングさせ、
前記データが前記ハイブリッドメモリシステムに記憶されるときに、前記データを使用して演算を実行することと関連付けられた時間が減少するとの判定に応答して、前記ハイブリッドメモリシステムに前記データを選択的に記憶させるように更に構成されている、請求項1~2のいずれか1項に記載の装置。 - 前記コントローラは、前記ハイブリッドメモリシステムに前記データを選択的に記憶することによって、前記データの実行速度を最適化するように更に構成されている、請求項1~3のいずれか1項に記載の装置。
- 前記装置は、前記ハイブリッドメモリシステムに結合するメインメモリを更に備え、
前記メインメモリは、前記ハイブリッドメモリシステムに結合されたホストコンピューティングデバイスのメインメモリリソースであり、
前記ハイブリッドメモリシステムは、第1のメモリリソース及び第2のメモリリソースを含む、請求項1~4のいずれか1項に記載の装置。 - 前記データは、メモリのページ、メモリのブロック、メモリの論理ブロックアドレス、またはそれらの組み合わせに対応する、請求項1~5のいずれか1項に記載の装置。
- 装置であって、
ホストに結合するハイブリッドメモリシステムと、
前記ハイブリッドメモリシステムに結合されたコントローラと、を備え、前記コントローラは、
コードページング動作における使用のために前記ハイブリッドメモリシステムの一部分を割り当てさせ、
論理ブロックアドレス指定(LBA)範囲に、前記ホストと関連付けられたメモリの一部分をマッピングさせ、
前記ハイブリッドメモリシステムの前記割り当てられた部分に前記LBA範囲をマッピングさせ、
データに伴う例外が発生したとの判定に応答して、前記ハイブリッドメモリシステムに前記データを選択的に記憶させる、
ように構成されており、
前記例外が発生したとの前記判定は、リードアヘッド機構が前記装置によって呼び出されたとの判定の少なくとも一部に基づき、
前記例外は、ページ誤りを含む、
装置。 - 前記コントローラは、
コード読み出しのコンテンツを前記コードページング動作の一部として判定することと、
前記コードページング動作における使用のため割り当てられた前記ハイブリッドメモリシステムの前記部分に、前記判定された前記コード読み出しのコンテンツを包含する前記ホストと関連付けられた前記メモリの一部分を前記コードページング処理の一部としてマッピングすることであって、
前記ハイブリッドメモリシステムの前記部分は、特定のLBA範囲を含み
前記コードページング動作は、例外が発生したとの判定に応答して実行される、
前記マッピングすること、
を行わせるように更に構成されている、請求項7に記載の装置。 - 前記ハイブリッドメモリシステムの前記部分は、前記ハイブリッドメモリシステムのページ、前記ハイブリッドメモリシステムのブロック、前記ハイブリッドメモリシステムの論理ブロックアドレス、またはそれらの組み合わせに対応する、請求項7~8のいずれか1項に記載の装置。
- 前記ハイブリッドメモリシステムは、第1のメモリリソース及び第2のメモリリソースを含み、
前記第1のメモリリソース及び前記第2のメモリリソースのうちの少なくとも1つは、不揮発性メモリリソースであり、
前記ハイブリッドメモリシステムの前記割り当てられた部分は、前記ハイブリッドメモリシステムの別の部分よりも低いアクセス待ち時間によって特徴付けられる前記ハイブリッドメモリシステムの部分に対応する、請求項7~9のいずれか1項に記載の装置。 - コードページング動作における使用のためにハイブリッドメモリシステムの一部分を割り当てることと、
ホストが誤り例外に遭遇したと判定することに応答して、前記コードページング動作を実行することであって、前記ホストが誤り例外に遭遇したと判定することは、リードアヘッド動作が前記ホストによって実行されたと判定することを含む、前記コードページング動作を実行することと、
前記コードページング動作の実行に応答して、前記ホストから前記ハイブリッドメモリシステムの前記割り当てられた部分にデータを選択的に転送することと、
を備えた、方法。 - 前記ホストから前記ハイブリッドメモリシステムの前記割り当てられた部分にデータを選択的に転送することは、前記ハイブリッドメモリシステムと関連付けられた特定の論理ブロックアドレス範囲に前記データを選択的に転送することを更に含む、請求項11に記載の方法。
- 前記ホストによるコード読み出しのコンテンツを前記コードページング動作の一部として判定することと、
前記ハイブリッドメモリシステムの前記割り当てられた部分に前記ホストのメモリの一部分を選択的にマッピングすることであって、前記ハイブリッドメモリシステムは、第1のメモリリソース及び第2のメモリリソースを含む、前記選択的にマッピングすることと、
前記ホストが前記データを参照していると判定したことに応答して、前記ハイブリッドメモリシステムの前記割り当てられた部分から前記ホストに再度前記データを転送することと、
を更に備えた、請求項11~12のいずれか1項に記載の方法。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US15/927,530 | 2018-03-21 | ||
US15/927,530 US10705963B2 (en) | 2018-03-21 | 2018-03-21 | Latency-based storage in a hybrid memory system |
PCT/US2019/022665 WO2019182931A1 (en) | 2018-03-21 | 2019-03-18 | Hybrid memory system |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2021516402A JP2021516402A (ja) | 2021-07-01 |
JP7038227B2 true JP7038227B2 (ja) | 2022-03-17 |
Family
ID=67983587
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020550729A Active JP7038227B2 (ja) | 2018-03-21 | 2019-03-18 | ハイブリッドメモリシステム |
Country Status (6)
Country | Link |
---|---|
US (2) | US10705963B2 (ja) |
EP (1) | EP3769202B1 (ja) |
JP (1) | JP7038227B2 (ja) |
KR (1) | KR102443593B1 (ja) |
CN (1) | CN111868679B (ja) |
WO (1) | WO2019182931A1 (ja) |
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2018
- 2018-03-21 US US15/927,530 patent/US10705963B2/en active Active
-
2019
- 2019-03-18 JP JP2020550729A patent/JP7038227B2/ja active Active
- 2019-03-18 KR KR1020207027307A patent/KR102443593B1/ko active IP Right Grant
- 2019-03-18 EP EP19770408.3A patent/EP3769202B1/en active Active
- 2019-03-18 WO PCT/US2019/022665 patent/WO2019182931A1/en unknown
- 2019-03-18 CN CN201980020231.XA patent/CN111868679B/zh active Active
-
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- 2020-06-05 US US16/893,982 patent/US11327892B2/en active Active
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Also Published As
Publication number | Publication date |
---|---|
EP3769202A1 (en) | 2021-01-27 |
JP2021516402A (ja) | 2021-07-01 |
EP3769202B1 (en) | 2023-09-13 |
EP3769202A4 (en) | 2021-12-15 |
US10705963B2 (en) | 2020-07-07 |
US11327892B2 (en) | 2022-05-10 |
US20190294547A1 (en) | 2019-09-26 |
KR102443593B1 (ko) | 2022-09-16 |
CN111868679A (zh) | 2020-10-30 |
KR20200117032A (ko) | 2020-10-13 |
CN111868679B (zh) | 2024-05-14 |
US20200301841A1 (en) | 2020-09-24 |
WO2019182931A1 (en) | 2019-09-26 |
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