JP6982235B2 - 送受信システム、送受信システムの制御方法、及び中継装置 - Google Patents

Description

本発明は、送受信システム、送受信システムの制御方法、及び中継装置に関する。

サーバ等のホスト（情報処理装置）とＩ／Ｏ装置（入出力装置）は、電気ケーブルを使用するＢＭＣ（Block Multiplexer Channel）接続では１００ｍ程度、光ファイバーケーブルを使用するＯＣＬＩＮＫ（Optical Channel LINK）接続では数ｋｍ以内の距離に設置する必要がある。それに対して、延長装置（中継装置）を用いてホスト（情報処理装置）とＩ／Ｏ装置（入出力装置）との間の通信路を延長することで、遠距離拠点間での運用を可能にするシステムがある。

このようなシステムにおいて、ホストと延長装置との間はＴＣＰ／ＩＰ（Transmission Control Protocol/Internet Protocol）を用いる距離制限のない広域イーサネット（登録商標）等のネットワークを介して接続され、延長装置とＩ／Ｏ装置との間は距離制限があるＦＣＬＩＮＫ接続等で接続される。ＦＣＬＩＮＫ接続は、ＦＣ（Fibre Channel）−ＳＢ（Single Byte）−２規格に準拠した接続方式である。これにより、ホストとＩ／Ｏ装置とを遠距離に配置した遠距離拠点間での運用を可能にしている。

特開２００４−１６４４９０号公報 特開２００７−１１５１３８号公報

一般に、ＦＣＬＩＮＫ接続したホストとＩ／Ｏ装置との間で通信を行う場合、論理パスの情報を用いることにより、ホストとＩ／Ｏ装置との物理的な通信経路の上に論理的なパスを確立して通信を行っている。前述したようなホストと延長装置とをネットワークを介して接続し、延長装置とＩ／Ｏ装置とをＦＣＬＩＮＫ接続で接続したシステムでは、ホストとＩ／Ｏ装置との間の通信を確立するためには、延長装置とＩ／Ｏ装置との間の通信も確立する必要があるが、論理パスの確立状況がホストからの要求と一致せず、論理パスの確立状況に不整合が生じることがある。論理パスの不整合が生じると、ホストとＩ／Ｏ装置との間の通信が確立しないため、正常な運用ができなくなってしまう。１つの側面では、本発明の目的は、ホスト（情報処理装置）とＩ／Ｏ装置（入出力装置）とを延長装置（中継装置）を介して接続する送受信システムにて、通信に係る論理パスの不整合を解消できるようにすることにある。

送受信システムの一態様は、情報処理装置と入出力装置とを中継装置を介して接続し、情報処理装置と入出力装置との物理的な通信経路の上に論理的な論理パスを確立して通信を行う。中継装置は、情報処理装置と入出力装置との間の通信に係る論理パスの情報を記憶する記憶部と、中継装置と入出力装置との間の論理パスを制御する論理パス制御部とを有する。記憶部は、情報処理装置で動作する論理的なプログラムを識別するための第１のアドレスと、情報処理装置の物理的な入出力ポートに割り振られる第２のアドレスと、入出力装置で動作する論理的なプログラムを識別するための第３のアドレスと、入出力装置の物理的な入出力ポートに割り振られる第４のアドレスとを含む、論理パスの情報を記憶する。論理パス制御部は、情報処理装置から指示される情報処理装置と入出力装置との間の通信に係る論理パスの情報と、記憶部が記憶している現在の論理パスの情報との不整合を検出した場合、情報処理装置からの論理パスの情報に基づいて中継装置と入出力装置との間の論理パスを制御する。

発明の一態様においては、情報処理装置と入出力装置とを中継装置を介して接続する送受信システムにて、通信に係る論理パスの不整合を解消することが可能となる。

図１は、本発明の実施形態における送受信システムの構成例を示す図である。 図２（Ａ）は、本実施形態における送受信システムでの論理パスを説明する図であり、図２（Ｂ）は、論理パス管理テーブルの例を示す図である。 図３は、本実施形態における送受信システムの動作の例を示す図である。 図４（Ａ）〜図４（Ｇ）は、本実施形態における論理パス制御に係るフレームを説明する図である。 図５は、本実施形態における初期化処理の処理シーケンスの例を示す図である。 図６は、本実施形態における初期化処理の例を示すフローチャートである。 図７は、本実施形態におけるリセット・終了処理の処理シーケンスの例を示す図である。 図８は、本実施形態におけるリセット・終了処理の例を示すフローチャートである。 図９は、本実施形態における論理パス制御処理の処理シーケンスの例を示す図である。 図１０は、本実施形態における論理パス制御処理の例を示すフローチャートである。 図１１は、本実施形態における論理パス制御部の動作例を示すフローチャートである。 図１２は、本実施形態におけるシステムリセット要求受信処理の例を示すフローチャートである。 図１３は、本実施形態における論理パス確立通知受信処理又は論理パス削除通知受信処理の例を示すフローチャートである。 図１４は、本実施形態における論理パス状態受信通知受信処理の例を示すフローチャートである。 図１５は、本実施形態におけるシステム停止受信処理の例を示すフローチャートである。 図１６は、本実施形態における論理パス制御要求受信処理の例を示すフローチャートである。 図１７は、本実施形態における全論理パス削除処理の例を示すフローチャートである。 図１８（Ａ）〜図１８（Ｃ）は、本実施形態における送受信システムの動作例を説明する図である。

以下、本発明の実施形態を図面に基づいて説明する。
本実施形態における送受信システムは、ホスト側延長装置をサーバ等のホスト（情報処理装置）に内蔵し、Ｉ／Ｏ装置（入出力装置）をＩ／Ｏ側延長装置（中継装置）に接続し、ホスト側延長装置とＩ／Ｏ側延長装置とを広域イーサネット等のネットワークで接続したリモートチャネル方式のシステムである。なお、ホストにホスト側延長装置を内蔵した構成を例に説明するが、ホスト側延長装置をホストの外部に配置してホストとホスト側延長装置とを接続する構成としてもよい。

図１は、本実施形態における送受信システムの構成例を示す図である。図１に示す送受信システムは、サーバ等のホスト１０がホスト側延長装置２０を内蔵する。Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０とが、例えばＦＣ（Fibre Channel）−ＳＢ（Single Byte）−２規格に準拠した接続方式であるＦＣＬＩＮＫ接続で接続され、ホスト側延長装置２０とＩ／Ｏ側延長装置３０とがＴＣＰ／ＩＰ（Transmission Control Protocol/Internet Protocol）を用いて通信を行う広域イーサネット等のネットワーク５０を介して接続される。

情報処理装置としてのホスト１０は、処理部１１、記憶部１２、及びホスト側延長装置２０とを有する。処理部１１は、ソフトウェア等を実行するＣＰＵ（Central Processing Unit）等である。処理部１１は、例えばＩ／Ｏ装置４０の入出力操作等を指示したり、Ｉ／Ｏ装置４０を使用するか否かの切り替えを要求したりする。記憶部１２は、ホスト１０での処理に係る各種データを記憶する。記憶部１２は、例えばホスト１０とＩ／Ｏ装置４０との間の通信に係る論理パスの情報を保持する論理パス管理テーブル１３を記憶する。ホスト側延長装置２０は、ネットワーク制御部２１を有する。ネットワーク制御部２１は、Ｉ／Ｏ側延長装置３０と通信するため、ネットワーク５０におけるＴＣＰのセッション管理等のネットワーク通信を制御する。

中継装置としてのＩ／Ｏ側延長装置３０は、制御処理部３１、ネットワーク制御部３３、Ｉ／Ｏ通信制御部３４、及び記憶部３５を有する。制御処理部３１は、ホスト１０からの要求に応じたＩ／Ｏ装置４０に対する処理の実行等の制御処理を実行する。制御処理部３１は、ホストからの要求に基づいて、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の論理パスの制御等を行う論理パス制御部３２を有する。論理パス制御部３２は、ホスト１０からの要求等に応じてＩ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の論理パスを制御する。論理パス制御部３２は、ホスト１０から要求される論理パスと、論理パス管理テーブル３６が示す論理パスとの不整合を検出した場合、整合するように論理パスを確立したり削除したりする。

ネットワーク制御部３３は、ネットワーク制御部２１と同様に、ネットワーク５０におけるネットワーク通信を制御する。Ｉ／Ｏ通信制御部３４は、Ｉ／Ｏ装置４０との通信を行い、Ｉ／Ｏ装置４０にコマンドを発行したり、Ｉ／Ｏ装置４０からのステータスを通知したりする。記憶部３５は、Ｉ／Ｏ側での処理に係る各種データを記憶する。記憶部３５は、例えばホスト１０とＩ／Ｏ装置４０との間の通信に係る論理パスの情報を保持する論理パス管理テーブル３６を記憶する。Ｉ／Ｏ装置４０は、ホスト１０からの指示に応じた入出力操作等を実行する。

図２（Ａ）は、本実施形態における送受信システムでの論理パスを説明する図である。ホスト２１０では、複数のオペレーティングシステム（ＯＳ）２１１−１〜２１１−Ｎの処理が仮想マシン（ＶＭ）２１２−１〜２１２−Ｎでそれぞれ実行される。各仮想マシン（ＶＭ）２１２−１〜２１２−Ｎは、ホスト側延長装置のチャネルポート２１３及びＩ／Ｏ側延長装置２２０を介してＩ／Ｏ装置２３０と接続可能となっている。Ｉ／Ｏ装置２３０では、Ｉ／Ｏポート２３１を介してコントロールユニット２３２がホスト２１０からの入出力操作等の指示を受け、デバイス２３３−１〜２３３−Ｎを制御する。

このような送受信システムにおいては、ホスト２１０上の仮想マシン（ＶＭ）２１２−１〜２１２−ＮとＩ／Ｏ装置２３０のコントロールユニット２３２との間に論理パス２４０−１〜２４０−Ｎを確立し通信を行っている。各仮想マシン（ＶＭ）２１２−１〜２１２−ＮにはアドレスＣＨＬＡ（ChannelLogicalAddress）が割り振られ、チャネルポート２１３にはアドレスＣＨＬＫ（ChannelLinkAddress）が割り振られる。また、コントロールユニット２３１にはアドレスＣＵＬＡ（CULogicalAddress）が割り振られ、Ｉ／Ｏポート２３２にはアドレスＣＵＬＫ（ChannelLinkAddress）が割り振られる。ここで、アドレスＣＨＬＡは、チャネル上で動作する論理的なプログラムを識別するためのアドレスであり、アドレスＣＨＬＫは、チャネルの物理的なポートに割り振られるアドレスである。また、アドレスＣＵＬＡは、コントロールユニット上で動作する論理的なプログラムを識別するためのアドレスであり、アドレスＣＵＬＫは、コントロールユニットの物理的なポートに割り振られるアドレスである。

そして、ホスト２１０は、例えば図２（Ｂ）に示すような論理パス管理テーブルとして有する論理パスの情報に基づいて、ホスト２１０の仮想マシン（ＶＭ）２１２−１〜２１２−ＮとＩ／Ｏ装置２３０のコントロールユニット２３２との間に論理パス２４０−１〜２４０−Ｎを確立し通信を行う。論理パス管理テーブルは、例えば論理パスをそれぞれ示す論理パス番号、アドレスＣＨＬＡ、ＣＨＬＫ、ＣＵＬＫ、ＣＵＬＡ、及び論理パス有効フラグの情報を論理パス毎に保持する。このような論理パス管理テーブルが、図１に示したホスト１０の記憶部１２やＩ／Ｏ側延長装置３０の記憶部３５に記憶される。なお、論理パス有効フラグは、その論理パスが存在しているか否かを示すフラグであり、論理パス有効フラグが有効であれば、その論理パスが存在していることを示す。

ここで、共有するＩ／Ｏ装置を使用する仮想マシン（ホスト）の切り替え時等、仮想マシン（ホスト）が指示するＩ／Ｏ装置との通信に係る論理パスと、Ｉ／Ｏ側延長装置とＩ／Ｏ装置との間の論理パスとが一致せず、仮想マシン（ホスト）とＩ／Ｏ装置との間の通信に係る論理パスに不整合が生じることがある。このとき、本実施形態では、図３に示すようにしてＩ／Ｏ側延長装置とＩ／Ｏ装置との間の論理パスを修正して、論理パスの不整合を解消する。図３は、本実施形態における送受信システムの動作の例を示す図である。図３には、共有するＩ／Ｏ装置を、ある仮想マシン（ホスト）が使用している状態から別の仮想マシン（ホスト）が使用する状態にする共有Ｉ／Ｏ装置の切り替え時の動作例を示している。

ステップＳ３０１にて、ホスト側延長装置２０及びＩ／Ｏ側延長装置３０は、ホスト１０からの共有Ｉ／Ｏ装置の切り替えが発生したか否かを判定し、共有Ｉ／Ｏ装置の切り替えが発生したと判定するとステップＳ３０２へ進む。ステップＳ３０２にて、ホスト１０は、共有Ｉ／Ｏ装置の切り替えに応じて、処理を一時保留する。

次に、ステップＳ３０３にて、Ｉ／Ｏ側延長装置３０は、ホスト１０からの論理パスの情報と、論理パス管理テーブル３６に保持された論理パスの情報とを比較し、ホスト１０とＩ／Ｏ装置４０との間の通信に係る論理パスに整合性があるか否かを判定する。ホスト１０とＩ／Ｏ装置４０との間の通信に係る論理パスに整合性がないと判定した場合、ステップ３０４へ進み、そうでない場合、ステップ３０９へ進む。ステップＳ３０４にて、Ｉ／Ｏ側延長装置３０は、ホスト１０からの論理パスの情報に基づいて、Ｉ／Ｏ装置４０に対する論理パス確立要求を発行して論理パスを確立し、論理パスの整合性の修正を促す。この論理パス確立要求に応じて、ステップＳ３０５にて、Ｉ／Ｏ装置側では、論理パスを確立するための処理を行う。

次に、ステップＳ３０６にて、Ｉ／Ｏ側延長装置３０は、整合性を有する論理パスの確立が成功したか否かを判定し、論理パスが確立していると判定した場合、ステップＳ３０７へ進み、論理パスが確立していないと判定した場合、ステップＳ３１０へ進む。ステップＳ３０７にて、ホスト側の処理を処理再開の状態に遷移する要求を発行する。その後、ネットワーク通信におけるタイムアウト等のネットワークの接続状態の監視を行い、支障がなければ（Ｓ３０８のＹｅｓ）、ステップＳ３０９へ進み、そうでない場合にはステップＳ３１０へ進む。ステップＳ３０９にて、送受信システムでは、ホスト１０の処理を再開する。一方、ステップＳ３１０へ進んだ場合には、ハードウェア的なエラーであると判断してエラー処理を実行し処理を終了する。

次に、本実施形態におけるＩ／Ｏ側延長装置３０による論理パス制御について説明する。まず、本実施形態における論理パス制御の動作において用いるフレームについて説明する。本実施形態における論理パス制御の動作では、システムリセット要求、論理パス制御要求、システム停止通知、論理パス状態受信通知、論理パス状態通知、及びシステムリセット応答のフレームを使用する。

システムリセット要求（SYSTEMRESET_REQ）は、システムの開始要求であり、ホスト側延長装置２０からＩ／Ｏ側延長装置３０へ送信される。システムリセット要求は、ホスト側延長装置２０の立ち上げやホスト側延長装置２０とＩ／Ｏ側延長装置３０との間のＴＣＰ／ＩＰ通信上の運用セッションの再接続に伴って、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のＦＣＬＩＮＫインタフェースをリセットするために使用する。図４（Ａ）に、システムリセット要求（SYSTEMRESET_REQ）のフレームのフォーマット例を示す。

共通ヘッダのフィールドＴＹＰＥには、システムリセット要求であることを示す情報が格納される。また、フィールドＬＰＡＴＨ ｎｕｍには、このフレームが有する論理パスエントリの数を示す情報が格納される。論理パス（ＬＰＡＴＨ）エントリの各々は、図４（Ｂ）に示す情報を有する。図４（Ｂ）において、ビットＯＲは、その論理パスエントリに示される論理パスの削除を行うべきであるが、まだ論理パスの削除が実行されていない場合に値“１”が設定される。ビットＬＤは、その論理パスエントリに示される論理パスが構成上定義されている場合に値“１”が設定される。また、ビットＶは、その論理パスエントリが有効である場合に値“１”が設定される。フィールドＣＨＬＡにはホスト側のアドレスＣＨＬＡが格納され、フィールドＣＵＬＡにはＩ／Ｏ装置側のアドレスＣＵＬＡが格納される。

ホスト側延長装置２０は、ＴＣＰセッションの接続（再接続）を契機としてシステムリセット要求をＩ／Ｏ側延長装置３０に送信する。Ｉ／Ｏ側延長装置３０は、ホスト側延長装置２０からのシステムリセット要求を受信すると、仕掛中のＩ／Ｏ装置を終了させてＩ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のすべての論理パスを削除（リセット）する。論理パスの削除（リセット）の終了後に、Ｉ／Ｏ側延長装置３０は、リセット結果を示すシステムリセット応答をホスト側延長装置２０に送信する。なお、ホスト側延長装置２０は、システムリセット要求を送信した後、システムリセット応答を受信するまでは他のデータを送信しない。また、ホスト側延長装置２０は、システムリセット要求に係るタイムアウト検出を行い、システムリセット要求を送信した後、所定の期間が経過してもシステムリセット応答が返ってこない場合、タイムアウトであると判定して運用セッションを切断する。

論理パス制御要求（REBUILDLPATH_REQ）は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の論理パスの確立や削除を指示するために使用し、ホスト側延長装置２０からＩ／Ｏ側延長装置３０へ送信される。Ｉ／Ｏ側延長装置３０は、論理パス制御要求に応じた論理パスの制御を実施する。図４（Ｃ）に、論理パス制御要求（REBUILDLPATH_REQ）のフレームのフォーマット例を示す。

共通ヘッダのフィールドＴＹＰＥには、論理パス制御要求であることを示す情報が格納される。また、フィールドｎｕｍには、このフレームが有する論理パスエントリの数を示す情報が格納される。論理パス（ＬＰＡＴＨ）エントリの各々は、図４（Ｂ）に示した情報を有する。

ホスト側延長装置２０は、ホスト側延長装置２０とＩ／Ｏ側延長装置３０との間の運用セッションの接続（再接続を含む）時、あるいはホスト１０上で動作するソフトウェアとホスト側延長装置２０との間でコマンドやデータ等の入出力を制御する入出力制御部（ＩＯＰ）から指示があった場合、論理パス制御要求をＩ／Ｏ側延長装置３０に送信する。なお、論理パス制御要求は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の状態によらず送信可能である。Ｉ／Ｏ側延長装置３０は、ホスト側延長装置２０からの論理パス制御要求を受信すると、論理パス制御要求により指示される論理パス制御を行う。Ｉ／Ｏ側延長装置３０は、論理パス制御の結果を、論理パス状態通知を使用してホスト側延長装置２０に送信する。

システム停止通知（SYSTEMSTOP）は、チャネルオフラインやクラスタ切り替えに伴って、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の処理を停止するために使用し、ホスト側延長装置２０からＩ／Ｏ側延長装置３０へ送信される。なお、チャネルオフラインは、ホスト側延長装置２０とＩ／Ｏ側延長装置３０との間の通信を切断する動作であり、クラスタ切り替えは、Ｉ／Ｏ側延長装置３０と接続するホスト側延長装置２０（ホスト１０）を切り替える動作である。図４（Ｄ）に、システム停止通知（SYSTEMSTOP）のフレームのフォーマット例を示す。共通ヘッダのフィールドＴＹＰＥには、システム停止通知であることを示す情報が格納される。フィールドｆａｃｔｏｒには、システム停止要因を示す情報が格納される。

ホスト側延長装置２０は、ホスト１０の図示しない装置管理部からのチャネルオフライン、又はクラスタ切断の通知を契機としてシステム停止通知をＩ／Ｏ側延長装置３０に送信する。Ｉ／Ｏ側延長装置３０は、ホスト側延長装置２０からのシステム停止通知を受信すると、仕掛中のＩ／Ｏ装置を終了させてＩ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のすべての論理パスを削除する。

論理パス状態受信通知（LPATH_STSCHG_ACPT）は、Ｉ／Ｏ側延長装置３０から送信される論理パス状態通知の応答として使用し、ホスト側延長装置２０からＩ／Ｏ側延長装置３０へ送信される。図４（Ｅ）に、論理パス状態受信通知（LPATH_STSCHG_ACPT）のフレームのフォーマット例を示す。共通ヘッダのフィールドＴＹＰＥには、論理パス状態受信通知であることを示す情報が格納される。フィールドＣＨＬＡにはホスト側のアドレスＣＨＬＡが格納され、フィールドＣＵＬＡにはＩ／Ｏ装置側のアドレスＣＵＬＡが格納される。

論理パス状態通知（LPATH_STSCHG_REP）は、論理パスの状態に変化が発生した場合に、それを報告するために使用し、Ｉ／Ｏ側延長装置３０からホスト側延長装置２０へ送信される。図４（Ｆ）に、論理パス状態通知（LPATH_STSCHG_REP）のフレームのフォーマット例を示す。共通ヘッダのフィールドＴＹＰＥには、論理パス状態通知であることを示す情報が格納される。フィールドＬＰＳＴＡは、論理パス確立処理のシーケンスが成功していれば最下位ビットに値“１”が設定される。フィールドＣＨＬＡにはホスト側のアドレスＣＨＬＡが格納され、フィールドＣＵＬＡにはＩ／Ｏ装置側のアドレスＣＵＬＡが格納される。

システムリセット応答（SYSTEMRESET_RESP）は、ホスト側延長装置２０から送信されるシステムリセット要求の応答として使用し、Ｉ／Ｏ側延長装置３０からホスト側延長装置２０へ送信される。図４（Ｇ）に、システムリセット応答（SYSTEMRESET_RESP）のフレームのフォーマット例を示す。共通ヘッダのフィールドＴＹＰＥには、システムリセット応答であることを示す情報が格納される。

フィールドＦＣＬＩＮＫ Ｓｔａｔｕｓには、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の接続状態を示す情報が格納される。接続状態としては、例えばＩ／Ｏ装置の電源断等で論理パスの確立が不可能なオフライン状態、論理パスの確立が可能なオンライン状態、及びシステムリセット要求に係る一連の処理で異常が検出されたエラー終了状態があり、それぞれの状態に対応して異なる値が格納される。また、システムリセット応答には、フィールドＦＣＬＩＮＫ Ｓｔａｔｕｓの内容に応じた付加情報が格納される。

Ｉ／Ｏ側延長装置３０は、システムリセット要求に応じた制御を行った後、システムリセット応答をホスト側延長装置２０に送信する。ホスト側延長装置２０は、Ｉ／Ｏ側延長装置３０からのシステムリセット応答を受信するまではオフライン状態として処理を行う。

次に、本実施形態における送受信システムでの論理パス制御に係る動作について説明する。本実施形態において、初期化処理、リセット・終了処理、及び論理パス制御処理で論理パス制御が実行される。以下、各処理での論理パス制御について説明する。

図５は、本実施形態における送受信システムでの初期化処理の処理シーケンスの例を示す図である。初期化処理は、ホスト１０の起動の際、ホスト側延長装置２０とＩ／Ｏ側延長装置３０との間でのＴＣＰセッションの接続後に、ホスト側延長装置２０がシステムリセット要求を送信することで実行される。

ホスト１０（ホスト側延長装置２０）は、システムリセット要求（SYSTEMRESET_REQ）をＩ／Ｏ側延長装置３０へ送信し（５０１）、Ｉ／Ｏ側延長装置３０は、それに対する応答としてシステムリセット応答（SYSTEMRESET_RESP）をホスト１０へ送信する（５０２）。ホスト１０（ホスト側延長装置２０）は、システムリセット要求（SYSTEMRESET_REQ）を送信してから、その応答を監視しており（５１１）、所定の期間が経過するまでにシステムリセット応答（SYSTEMRESET_RESP）を受信しない場合にはタイムアウトと判定してセッションを切断する。

Ｉ／Ｏ側延長装置３０は、ホスト１０（ホスト側延長装置２０）からのシステムリセット要求（SYSTEMRESET_REQ）を受けると、システムリセット要求の論理パスエントリに指示された論理パスを確立するための論理パス確立要求（ＥＬＰ：EstablishLogicalPath）をＩ／Ｏ装置４０へ送信する（５０３）。Ｉ／Ｏ装置４０は、論理パス確立要求（ＥＬＰ）により要求された論理パスを確立すると、論理パス確立通知（ＬＰＥ：LogicalPathEstablished）をＩ／Ｏ側延長装置３０へ送信する（５０４）。

Ｉ／Ｏ側延長装置３０は、Ｉ／Ｏ装置４０からの論理パス確立通知（ＬＰＥ）を受信すると、論理パスの状態を示す論理パス状態通知（LPATH_STSCHG_REP）をホスト１０へ送信し（５０５）、ホスト１０（ホスト側延長装置２０）は、それに対する応答として論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０へ送信する（５０６）。Ｉ／Ｏ側延長装置３０は、論理パス状態通知（LPATH_STSCHG_REP）を送信してから、その応答を監視しており（５１２）、所定の期間が経過するまでに論理パス状態受信通知（LPATH_STSCHG_ACPT）を受信しない場合にはタイムアウトと判定してセッションを切断する。

図６は、本実施形態における送受信システムでの初期化処理の例を示すフローチャートである。ステップＳ６０１にて、ホスト１０（ホスト側延長装置２０）が、システムリセット要求（SYSTEMRESET_REQ）をＩ／Ｏ側延長装置３０に送信する。システムリセット要求（SYSTEMRESET_REQ）の送信が成功した場合（Ｓ６０２のＹｅｓ）、ステップＳ６０３にて、Ｉ／Ｏ側延長装置３０が、システムリセット応答（SYSTEMRESET_RESP）をホスト１０に送信する。システムリセット応答（SYSTEMRESET_RESP）の送信が成功した場合（Ｓ６０４のＹｅｓ）、ステップＳ６０５にて、Ｉ／Ｏ側延長装置３０が、システムリセット要求により指示された論理パスを確立するための論理パス確立要求（ＥＬＰ）をＩ／Ｏ装置４０に送信する。

次に、ステップＳ６０６にて、Ｉ／Ｏ装置４０が、論理パス確立要求（ＥＬＰ）により要求された論理パス確立処理が成功したか否かを判定する。論理パス確立処理が成功したと判定した場合（Ｓ６０６のＹｅｓ）、ステップＳ６０７にて、Ｉ／Ｏ装置４０が、論理パス確立通知（ＬＰＥ）をＩ／Ｏ側延長装置３０に送信し、論理パス確立処理が成功したことを通知する。一方、論理パス確立処理が成功しなかったと判定した場合（Ｓ６０６のＮｏ）、ステップＳ６０８にて、Ｉ／Ｏ装置４０が、論理パス削除通知（ＬＰＲ：LogicalPathRemoved）をＩ／Ｏ側延長装置３０に送信し、論理パス確立処理が失敗したことを通知する。

論理パス確立通知（ＬＰＥ）又は論理パス削除通知（ＬＰＲ）の送信が成功した場合（Ｓ６０９のＹｅｓ）、ステップＳ６１０にて、Ｉ／Ｏ側延長装置３０が、論理パス状態通知（LPATH_STSCHG_REP）をホスト１０に送信する。そして、ステップＳ６１１にて、ホスト１０が、論理パス状態通知に基づいてリンクリポートを作成して上位に通知する。また、ステップＳ６１２にて、ホスト１０（ホスト側延長装置２０）が、論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０に送信する。論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功した場合（Ｓ６１３のＹｅｓ）、初期化処理を終了する。

なお、システムリセット要求（SYSTEMRESET_REQ）又はシステムリセット応答（SYSTEMRESET_RESP）の送信が成功しなかった場合（Ｓ６０２又はＳ６０４のＮｏ）、ホスト１０（ホスト側延長装置２０）がタイムアウトを検出する（Ｓ６１４）。タイムアウトを検出すると、ホスト１０が、運用セッションを切断して（Ｓ６１５）、初期化処理を終了する。

また、論理パス確立通知（ＬＰＥ）、論理パス削除通知（ＬＰＲ）、又は論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功しなかった場合（Ｓ６０９又はＳ６１３のＮｏ）、Ｉ／Ｏ側延長装置３０がタイムアウトを検出する（Ｓ６１６）。タイムアウトを検出すると、Ｉ／Ｏ側延長装置３０が、運用セッションを切断して（Ｓ６１７）、初期化処理を終了する。

図７は、本実施形態における送受信システムでのリセット・終了処理の処理シーケンスの例を示す図である。ここで、リセットは、通電状態からハードリセットを伴わないソフト的なリセットであり、例えばクラスタ切り替え等によるホスト側延長装置２０とＩ／Ｏ側延長装置３０との間のＴＣＰセッションを切断した後の再接続等が該当する。また、終了は、チャネルをオフラインとする動作である。リセット・終了処理は、これらリセットが発生した時や終了時に実行される。

ホスト１０（ホスト側延長装置２０）は、システム停止通知（SYSTEMSTOP）をＩ／Ｏ側延長装置３０へ送信する（７０１）。Ｉ／Ｏ側延長装置３０は、ホスト１０（ホスト側延長装置２０）からのシステム停止通知（SYSTEMSTOP）を受けると、論理パスを削除するための論理パス削除要求（ＲＬＰ：RemoveLogicalPath）をＩ／Ｏ装置４０へ送信する（７０２）。Ｉ／Ｏ装置４０は、論理パス削除要求（ＲＬＰ）により要求された論理パスを削除すると、論理パス削除通知（ＬＰＲ）をＩ／Ｏ側延長装置３０へ送信する（７０３）。

Ｉ／Ｏ側延長装置３０は、Ｉ／Ｏ装置４０からの論理パス削除通知（ＬＰＲ）を受信すると、論理パスの状態を示す論理パス状態通知（LPATH_STSCHG_REP）をホスト１０へ送信し（７０４）、ホスト１０（ホスト側延長装置２０）は、それに対する応答として論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０へ送信する（７０５）。Ｉ／Ｏ側延長装置３０は、論理パス状態通知（LPATH_STSCHG_REP）を送信してから、その応答を監視しており（７１１）、所定の期間が経過するまでに論理パス状態受信通知（LPATH_STSCHG_ACPT）を受信しない場合にはタイムアウトと判定してセッションを切断する。

図８は、本実施形態における送受信システムでのリセット・終了処理の例を示すフローチャートである。ステップＳ８０１にて、ホスト１０（ホスト側延長装置２０）が、システム停止通知（SYSTEMSTOP）をＩ／Ｏ側延長装置３０に送信する。次に、ステップＳ８０２にて、Ｉ／Ｏ側延長装置３０が、論理パスを削除するための論理パス削除要求（ＲＬＰ）をＩ／Ｏ装置４０へ送信する。次に、ステップＳ８０３にて、Ｉ／Ｏ装置４０が、論理パス削除要求（ＲＬＰ）により要求された論理パスを削除し、論理パス削除通知（ＬＰＲ）をＩ／Ｏ側延長装置３０に送信する。

論理パス削除通知（ＬＰＲ）の送信が成功した場合（Ｓ８０４のＹｅｓ）、ステップＳ８０５にて、Ｉ／Ｏ側延長装置３０が、論理パス状態通知（LPATH_STSCHG_REP）をホスト１０に送信する。そして、ステップＳ８０６にて、ホスト１０が、論理パス状態通知に基づいてリンクリポートを作成して上位に通知する。また、ステップＳ８０７にて、ホスト１０（ホスト側延長装置２０）が、論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０に送信する。論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功した場合（Ｓ８０８のＹｅｓ）、ステップＳ８０９にて、Ｉ／Ｏ側延長装置３０が、運用セッションを切断して（Ｓ８０９）、リセット・終了処理を終了する。

なお、論理パス削除通知（ＬＰＲ）又は論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功しなかった場合（Ｓ８０４又はＳ８０８のＮｏ）、Ｉ／Ｏ側延長装置３０がタイムアウトを検出する（Ｓ８１０）。タイムアウトを検出すると、Ｉ／Ｏ側延長装置３０が、運用セッションを切断して（Ｓ８１１）、リセット・終了処理を終了する。

図９は、本実施形態における送受信システムでの論理パス制御処理の処理シーケンスの例を示す図である。論理パス制御処理は、例えばホストにおける仮想マシンの立ち上げ時や終了時に実行される処理であり、論理パス制御要求を送信することで実行される。論理パス制御処理では、Ｉ／Ｏ側延長装置３０は、論理パス制御要求に基づいて、論理パスの不整合を検出し、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間の論理パスの確立や削除を行って整合がとれるように修正する。

ホスト１０（ホスト側延長装置２０）は、論理パス制御要求（REBUILDLPATH_REQ）をＩ／Ｏ側延長装置３０へ送信する（９０１）。Ｉ／Ｏ側延長装置３０は、ホスト１０（ホスト側延長装置２０）からの論理パス制御要求（REBUILDLPATH_REQ）を受けると、保持している論理パス管理テーブルを参照して、論理パス制御要求により指示される論理パスと現在の論理パスとの不整合を検出し、整合させるために論理パス確立要求（ＥＬＰ）又は論理パス削除要求（ＲＬＰ）をＩ／Ｏ装置４０へ送信する（９０２）。

Ｉ／Ｏ側延長装置３０から論理パス確立要求（ＥＬＰ）が送信されると、Ｉ／Ｏ装置４０は、論理パス確立要求（ＥＬＰ）により要求された論理パスを確立し、論理パス確立通知（ＬＰＥ）をＩ／Ｏ側延長装置３０へ送信する（９０３）。また、Ｉ／Ｏ側延長装置３０から論理パス削除要求（ＲＬＰ）が送信されると、Ｉ／Ｏ装置４０は、論理パス削除要求（ＲＬＰ）により要求された論理パスを削除し、論理パス削除通知（ＬＰＲ）をＩ／Ｏ側延長装置３０へ送信する（９０３）。

Ｉ／Ｏ側延長装置３０は、Ｉ／Ｏ装置４０からの論理パス確立通知（ＬＰＥ）又は論理パス削除通知（ＬＰＲ）を受信すると、論理パスの状態を示す論理パス状態通知（LPATH_STSCHG_REP）をホスト１０へ送信し（９０４）、ホスト１０（ホスト側延長装置２０）は、それに対する応答として論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０へ送信する（９０５）。Ｉ／Ｏ側延長装置３０は、論理パス状態通知（LPATH_STSCHG_REP）を送信してから、その応答を監視しており（９１１）、所定の期間が経過するまでに論理パス状態受信通知（LPATH_STSCHG_ACPT）を受信しない場合にはタイムアウトと判定してセッションを切断する。

図１０は、本実施形態における送受信システムでの論理パス制御処理の例を示すフローチャートである。ステップＳ１００１にて、ホスト１０（ホスト側延長装置２０）が、論理パス制御要求（REBUILDLPATH_REQ）をＩ／Ｏ側延長装置３０に送信する。ホスト１０（ホスト側延長装置２０）からの論理パス制御要求（REBUILDLPATH_REQ）を受信すると、Ｉ／Ｏ側延長装置３０は、論理パス制御要求（REBUILDLPATH_REQ）が有する論理パスエントリを１つずつ順次選択してステップＳ１００２〜Ｓ１０１１の処理を行い、論理パスエントリ数（論理パス定義数）分、ステップＳ１００２〜Ｓ１０１１の処理を繰り返し実行する。このステップＳ１００２〜Ｓ１０１１のループ処理により、論理パスの不整合が修正（解消）される。

ステップＳ１００３にて、Ｉ／Ｏ側延長装置３０が、選択した論理パスエントリに指示されている論理パスが、必要ではあるが確立していない論理パスであるか否かを判定する。必要ではあるが確立していない論理パスであると判定した場合（Ｓ１００３のＹｅｓ）、ステップＳ１００４へ進み、そうでない場合（Ｓ１００３のＮｏ）、ステップＳ１００７へ進む。

ステップＳ１００４にて、Ｉ／Ｏ側延長装置３０が、選択した論理パスエントリに指示された論理パスを確立するための論理パス確立要求（ＥＬＰ）をＩ／Ｏ装置４０に送信する。次に、ステップＳ１００５にて、Ｉ／Ｏ装置４０が、論理パス確立要求（ＥＬＰ）により要求された論理パス確立処理が成功したか否かを判定する。論理パス確立処理が成功したと判定した場合（Ｓ１００５のＹｅｓ）、ステップＳ１００６にて、Ｉ／Ｏ装置４０が、論理パス確立通知（ＬＰＥ）をＩ／Ｏ側延長装置３０に送信し、ステップＳ１０１０へ進む。一方、論理パス確立処理が成功しなかったと判定した場合（Ｓ１００５のＮｏ）、ステップＳ１００９にて、Ｉ／Ｏ装置４０が、論理パス削除通知（ＬＰＲ）をＩ／Ｏ側延長装置３０に送信し、ステップＳ１０１０へ進む。

ステップＳ１００７にて、Ｉ／Ｏ側延長装置３０が、選択した論理パスエントリに指示されている論理パスが、不要ではあるが確立している論理パスであるか否かを判定する。不要ではあるが確立している論理パスであると判定した場合（Ｓ１００７のＹｅｓ）、ステップＳ１００８へ進み、そうでない場合（Ｓ１００７のＮｏ）、ステップＳ１０１０へ進む。

ステップＳ１００８にて、Ｉ／Ｏ側延長装置３０が、選択した論理パスエントリに指示された論理パスを削除するための論理パス削除要求（ＲＬＰ）をＩ／Ｏ装置４０に送信する。次に、ステップＳ１００９にて、Ｉ／Ｏ装置４０が、論理パス削除要求（ＥＬＰ）により要求された論理パスを削除して、論理パス削除通知（ＬＰＲ）をＩ／Ｏ側延長装置３０に送信し、ステップＳ１０１０へ進む。

ステップＳ１０１０にて、Ｉ／Ｏ側延長装置３０が、Ｉ／Ｏ装置４０からの完了通知（論理パス確立通知（ＬＰＥ）又は論理パス削除通知（ＬＰＲ）を受信する。論理パス制御要求（REBUILDLPATH_REQ）が有する論理パスエントリ数分、ステップＳ１００２〜Ｓ１０１１の処理を繰り返し実行した後、ステップＳ１０１２へ進む。

ステップＳ１０１２にて、Ｉ／Ｏ側延長装置３０が、論理パス状態通知（LPATH_STSCHG_REP）をホスト１０に送信する。論理パス状態通知（LPATH_STSCHG_REP）の送信が成功した場合（Ｓ１０１３のＹｅｓ）、ステップＳ１０１４にて、ホスト１０が、論理パス状態通知に基づいてリンクリポートを作成して上位に通知する。また、ステップＳ１０１５にて、ホスト１０（ホスト側延長装置２０）が、論理パス状態受信通知（LPATH_STSCHG_ACPT）をＩ／Ｏ側延長装置３０に送信する。論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功した場合（Ｓ１０１６のＹｅｓ）、論理パス制御処理を終了する。

なお、論理パス状態通知（LPATH_STSCHG_REP）又は論理パス状態受信通知（LPATH_STSCHG_ACPT）の送信が成功しなかった場合（Ｓ１０１３又はＳ１０１６のＮｏ）、Ｉ／Ｏ側延長装置３０がタイムアウトを検出する（Ｓ１０１７）。タイムアウトを検出すると、Ｉ／Ｏ側延長装置３０が、運用セッションを切断して（Ｓ１０１８）、論理パス制御処理を終了する。

このようにして、Ｉ／Ｏ側延長装置３０は、論理パス制御要求（REBUILDLPATH_REQ）において必要とされる論理パスが確立されていないと判定した場合、論理パス確立要求をＩ／Ｏ装置４０に送信して、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間にその論理パスを確立する。つまり、ホスト１０が有する論理パス管理テーブル１３では論理パスが必要であるとされているが、Ｉ／Ｏ側延長装置３０が有する論理パス管理テーブルではＩ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間において論理パスが確立されていない場合、Ｉ／Ｏ側延長装置３０は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間に、その論理パスを確立する。

また、Ｉ／Ｏ側延長装置３０は、論理パス制御要求（REBUILDLPATH_REQ）において不要とされる論理パスが確立されていると判定した場合、論理パス削除要求をＩ／Ｏ装置４０に送信して、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のその論理パスを削除する。つまり、ホスト１０が有する論理パス管理テーブルでは論理パスが不要であるとされているが、Ｉ／Ｏ側延長装置３０が有する論理パス管理テーブルではＩ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間において論理パスが確立されている場合、Ｉ／Ｏ側延長装置３０は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のその論理パスを削除する。

これにより、ホスト１０が要求するＩ／Ｏ装置４０との間の通信に係る論理パスと、Ｉ／Ｏ側延長装置とＩ／Ｏ装置との間の論理パスとで不整合が生じた場合、整合するようにＩ／Ｏ側延長装置とＩ／Ｏ装置との間の論理パスを修正して、論理パスの不整合を解消することができ、論理パスの整合性を確保することが可能となる。例えば、Ｉ／Ｏ側延長装置とＩ／Ｏ装置との間の論理パスを修正して論理パスの不整合を解消することで、ホスト１０とＩ／Ｏ装置４０との間の通信が確立しなくなることを防止でき、Ｉ／Ｏ装置４０に対する入出力操作や共有Ｉ／Ｏ装置の切り替え等、正常な運用ができる。

また、前述した論理パス制御の動作では、システムリセット応答（SYSTEMRESET_RESP）や論理パス状態受信通知（LPATH_STSCHG_ACPT）など、応答が必要なフレームに対しては、応答フレームを送信している。このように応答が必要なフレームに対して応答フレームを送信することで、情報が伝わり、それを受け付けていることを通信相手に通知することができ、情報の相違が生じたままシステムが動作することを防止できる。

また、応答があるフレームについては、その応答を監視するとともに、応答フレームを受信する前は、新たなフレームを送信することを禁止している。このようにすることで、応答フレームを受信する前に他のフレームを受信し、ホスト１０（ホスト側延長装置２０）、Ｉ／Ｏ側延長装置３０、Ｉ／Ｏ装置４０の間で、機器の状態等の情報が相違したままシステムが動作してしまい、誤動作やシステムダウン等が引き起こされることを防止できる。

次に、本実施形態における論理パス制御部３２の動作について説明する。図１１は、本実施形態におけるフレーム受信時の論理パス制御部の動作例を示すフローチャートである。Ｉ／Ｏ側延長装置３０の論理パス制御部３２は、ネットワーク又はＦＣＬＩＮＫを介してフレームを受信すると、受信フレームを取り出す（Ｓ１１０１）。次に、ステップＳ１１０２にて、論理パス制御部３２は、受信フレームが、ネットワークからのフレームであるか、ＦＣＬＩＮＫからのフレームであるかを判定する。

ステップＳ１１０２において、ネットワークからのフレームであると論理パス制御部３２が判定した場合、ステップＳ１１０３にて、論理パス制御部３２は、さらに受信したフレームが、システムリセット要求、論理パス制御要求、システム停止通知、論理パス状態受信通知、及びそれ以外のフレームであるかを判定する。

論理パス制御部３２は、受信したフレームが、システムリセット要求であると判定した場合、図１２に示すシステムリセット要求受信処理（Ｓ１１０４）を実行し、論理パス制御要求であると判定した場合、図１６に示す論理パス制御要求受信処理（Ｓ１１０５）を実行する。また、論理パス制御部３２は、受信したフレームが、システム停止通知であると判定した場合、図１５に示すシステム停止通知受信処理（Ｓ１１０６）を実行し、論理パス状態受信通知であると判定した場合、図１４に示す論理パス状態受信通知受信処理（Ｓ１１０７）を実行し、それ以外の要求や通知であると判定した場合、受信した要求や通知に応じた受信処理（Ｓ１１０８）を実行する。

ステップＳ１１０２において、ＦＣＬＩＮＫからのフレームであると論理パス制御部３２が判定した場合、ステップＳ１１０９にて、論理パス制御部３２は、さらに受信したフレームが、論理パス確立通知、論理パス削除通知、及びそれ以外のフレームであるかを判定する。

論理パス制御部３２は、受信したフレームが、論理パス確立通知であると判定した場合、図１３に示す論理パス確立通知受信処理（Ｓ１１１０）を実行し、論理パス削除通知であると判定した場合、図１３に示す論理パス削除通知処理（Ｓ１１１１）を実行する。また、論理パス制御部３２は、受信したフレームが、それ以外の要求や通知であると判定した場合、受信した要求や通知に応じた受信処理（Ｓ１１１２）を実行する。

前述した各処理を実行した後、論理パス制御部３２は、残っている受信フレームがあるか否かを判定し、残っている受信フレームがあればステップ１１０１に戻り、残っている受信フレームがなければ処理を終了する。

次に、論理パス制御部３２における各処理について説明する。
＜システムリセット要求受信処理＞
図１２は、本実施形態におけるシステムリセット受信処理の例を示すフローチャートである。論理パス制御部３２は、ホスト１０からのシステムリセット要求を受信すると、システムリセット要求受信処理を開始する。システムリセット要求受信処理を開始すると、ステップＳ１２０１にて、論理パス制御部３２は、Ｉ／Ｏ装置４０に対して処理の仕掛中であるか否かを判定する。その結果、Ｉ／Ｏ装置４０に対して処理の仕掛中であると判定した場合、ステップＳ１２０２にて、論理パス制御部３２は、Ｉ／Ｏ装置４０に該処理のキャンセルフレームを送信してＩ／Ｏ装置４０での処理を終了させる。

次に、ステップＳ１２０３にて、論理パス制御部３２は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のすべての論理パスを削除する全論理パス削除処理を実行する。そして、ステップＳ１２０４にて、論理パス制御部３２は、ホスト１０と同期をとるためにホスト１０に対してシステムリセット応答を返信する。次に、ステップＳ１２０５にて、論理パス制御部３２は、システムリセット要求が有する論理パスエントリ数分だけ論理パスの制御に係る処理を実行したか否かを判定する。その結果、論理パスエントリ数分だけ論理パスの制御に係る処理を実行したと判定した場合、システムリセット要求受信処理を終了する。

一方、システムリセット要求が有する論理パスエントリ数分だけ論理パスの制御に係る処理を実行していないと判定した場合、論理パス制御部３２は、ステップＳ１２０６にて、処理する論理パスエントリにおけるビットＶの値が“１”であるか否かを判定する。その結果、論理パスエントリのビットＶの値が“１”である場合、ステップＳ１２０７にて、論理パス制御部３２は、論理パスエントリのビットＬＤの値が“１”であるか否かを判定する。その結果、論理パスエントリのビットＬＤの値が“１”である場合、ステップＳ１２０８にて、論理パス制御部３２は、論理パスエントリに指定された論理パスが確立されていないと判定し、その論理パスの確立を依頼する。論理パス制御部３２は、ＦＣＬＩＮＫプロトコルにホスト側の論理アドレスＣＨＬＡを渡して論理パス確立要求を送信し、ステップＳ１２０５へ戻る。

＜論理パス確立通知受信処理、論理パス削除通知受信処理＞
図１３は、本実施形態における論理パス確立通知受信処理、論理パス削除通知受信処理の例を示すフローチャートである。論理パス制御部３２は、Ｉ／Ｏ装置４０からの論理パス確立通知又は論理パス削除通知を受信すると、論理パス確立通知受信処理、論理パス削除通知受信処理を開始する。論理パス確立通知受信処理、論理パス削除通知受信処理を開始すると、ステップ１３０１にて、論理パス制御部３２は、受信した論理パス確立通知、論理パス削除通知に従って、記憶部３５が保持している論理パス管理テーブル３６を更新する。

次に、ステップＳ１３０２にて、論理パス制御部３２は、更新した論理パス管理テーブル３６に基づいて、論理パスの状態、Ｉ／Ｏ装置側のアドレスＣＵＬＡ、及びホスト側のアドレスＣＨＬＡ等を示す論理パス状態通知をホスト１０に送信する。そして、論理パス制御部３２は、論理パス状態通知がホスト１０まで届いたことの確認を行うために、通知に係る応答確認タイマーの動作を開始して論理パス確立通知受信処理、論理パス削除通知受信処理を終了する。

＜論理パス状態受信通知受信処理＞
図１４は、本実施形態における論理パス状態受信通知受信処理の例を示すフローチャートである。論理パス制御部３２は、ホスト１０からの論理パス状態受信通知を受信すると、論理パス状態受信通知受信処理を開始する。論理パス状態受信通知受信処理を開始すると、ステップＳ１４０１にて、論理パス制御部３２は、論理パス確立通知受信処理、論理パス削除通知受信処理において動作を開始した応答確認タイマーの動作を停止して論理パス状態受信通知受信処理を終了する。

＜システム停止通知受信処理＞
図１５は、本実施形態におけるシステム停止通知受信処理の例を示すフローチャートである。論理パス制御部３２は、ホスト１０からのシステム停止通知を受信すると、システム停止通知受信処理を開始する。システム停止通知受信処理を開始すると、ステップ１５０１にて、Ｉ／Ｏ装置４０に対して処理の仕掛中であるか否かを判定する。その結果、Ｉ／Ｏ装置４０に対して処理の仕掛中であると判定した場合、ステップＳ１５０２にて、論理パス制御部３２は、Ｉ／Ｏ装置４０に該処理のキャンセルフレームを送信してＩ／Ｏ装置４０での処理を終了させる。次に、ステップＳ１５０３にて、論理パス制御部３２は、Ｉ／Ｏ側延長装置３０とＩ／Ｏ装置４０との間のすべての論理パスを削除する全論理パス削除処理を実行し、システム停止通知受信処理を終了する。

＜論理パス制御要求受信処理＞
図１６は、本実施形態における論理パス制御要求受信処理の例を示すフローチャートである。論理パス制御部３２は、ホスト１０からの論理パス制御要求を受信すると、論理パス制御要求受信処理を開始する。論理パス制御要求受信処理を開始すると、ステップＳ１６０１にて、論理パス制御部３２は、受信した論理パス制御要求に含まれる論理パスエントリ数分だけ論理パスの制御に係る処理を実行したか否かを判定する。その結果、論理パスエントリ数分だけ論理パスの制御に係る処理を実行したと判定した場合、論理パス制御要求受信処理を終了する。

一方、論理パス制御要求に含まれる論理パスエントリ数分だけ論理パスの制御に係る処理を実行していないと判定した場合、論理パス制御部３２は、ステップＳ１６０２にて、処理する論理パスエントリのビットＶの値が“１”であるか否かを判定する。その結果、論理パスエントリのビットＶの値が“１”である場合、ステップＳ１６０３にて、論理パス制御部３２は、論理パス管理テーブル３６の対応する論理パスの論理パス有効フラグが有効であることを示し、かつ論理パスエントリのビットＬＤの値が“０”であるか否かを判定する。その結果、論理パス有効フラグが有効であり、かつ論理パスエントリのビットＬＤの値が“０”である場合、ステップＳ１６０４にて、論理パス制御部３２は、論理パスエントリに指定された論理パスが削除されていないと判定し、その論理パスの削除を依頼する。論理パス制御部３２は、ＦＣＬＩＮＫプロトコルにホスト側のアドレスＣＨＬＡを渡して論理パス削除要求を送信した後、ステップＳ１６０１に戻る。

一方、ステップＳ１６０３での判定の結果、論理パス有効フラグが有効でなく、又は論理パスエントリのビットＬＤの値が“０”でない場合、論理パス制御部３２は、ステップＳ１６０５にて、論理パス管理テーブル３６の論理パス有効フラグが無効であることを示し、かつ論理パスエントリのビットＬＤの値が“１”であるか否かを判定する。その結果、論理パス有効フラグが無効であり、かつ論理パスエントリのビットＬＤの値が“１”である場合、ステップＳ１６０６にて、論理パス制御部３２は、論理パスエントリに指定された論理パスが確立されていないと判定し、その論理パスの確立を依頼する。論理パス制御部３２は、ＦＣＬＩＮＫプロトコルにホスト側のアドレスＣＨＬＡを渡して論理パス確立要求を送信した後、ステップＳ１６０１に戻る。また、ステップＳ１６０５での判定の結果、論理パス有効フラグが無効でなく、又は論理パスエントリのビットＬＤの値が“１”でない場合、その論理パスエントリに係る制御は行わずにステップＳ１６０１に戻る。

＜全論理パス削除処理＞
図１７は、図１２に示したステップＳ１２０３、図１５に示したステップＳ１５０３にて実行される全論理パス削除処理の例を示すフローチャートである。全論理パス削除処理では、ステップＳ１７０１にて、論理パス制御部３２は、Ｉ／Ｏ側延長装置３０が保持する論理パス管理テーブル３６の項目分、すなわち論理パス管理テーブル３６に規定されている論理パス数分の論理パスの削除に係る処理を実行したか否かを判定する。その結果、論理パス管理テーブル３６の項目分だけ論理パスの削除に係る処理を実行したと判定した場合、全論理パス削除処理を終了する。

一方、論理パス管理テーブル３６の項目分だけ論理パスの削除に係る処理を実行していないと判定した場合、論理パス制御部３２は、ステップＳ１７０２にて、論理パス管理テーブルの内の処理する論理パスの有効フラグが有効を示すか否かを判定する。その結果、論理パスの有効フラグが有効でないと判定した場合、ステップＳ１７０１に戻る。ステップＳ１７０２での判定の結果、論理パスの有効フラグが有効であると判定した場合、ステップＳ１７０３にて、論理パス制御部３２は、ＦＣＬＩＮＫプロトコルにホスト側のアドレスＣＨＬＡを渡して論理パス削除要求を送信した後、ステップＳ１７０１に戻る。

図１８（Ａ）〜図１８（Ｃ）は、本実施形態における論理パス制御を適用したクラスタ切り替え機能の例を示す図である。クラスタ切り替え機能は、１つのＩ／Ｏ装置を複数のホストで共有するシステムにおいて、ホストとＩ／Ｏ装置との間の接続を切り替えるための機能である。図１８（Ａ）〜図１８（Ｃ）において、ホスト１８１０−０、１８１０−１とＩ／Ｏ側延長装置１８３０とが広域イーサネット等のネットワークを介して接続され、Ｉ／Ｏ側延長装置１８３０とＩ／Ｏ装置１８４０とがＦＣＬＩＮＫ接続で接続されているものとする。

図１８（Ａ）に示すように、ホスト＃０（１８１０−０）が、共有するＩ／Ｏ装置１８４０を運用しているとき、Ｉ／Ｏ側延長装置１８３０とＩ／Ｏ装置１８４０との間にはホスト＃０用の論理パス１８５０−０が確立している。図１８（Ａ）に示した状態でクラスタ切り替えが発生し、共有するＩ／Ｏ装置１８４０を運用するホストが、ホスト＃０（１８１０−０）からホスト＃１（１８１０−１）に切り替わり、図１８（Ｂ）に示すようにホストとＩ／Ｏ側延長装置３０とのパスがホスト＃１（１８１０−１）側に切り替わったとする。Ｉ／Ｏ側延長装置１８３０とＩ／Ｏ装置１８４０との間にはホスト＃０用の論理パス１８５０−０が確立しているので論理パスの不整合が生じる。

このとき、Ｉ／Ｏ側延長装置３０は、その論理パスの不整合を修正（解消）ために、Ｉ／Ｏ側延長装置１８３０とＩ／Ｏ装置１８４０との間において、ホスト＃０用の論理パス１８５０−０を削除するとともに、ホスト＃１用の論理パス１８５０−１を確立する。このように論理パスの制御を行うことで、図１８（Ｃ）に示すようにホスト＃１が要求する論理パスと、Ｉ／Ｏ側延長装置１８３０とＩ／Ｏ装置１８４０との間の論理パスの不整合を解消して、論理パスの整合性を確保しＩ／Ｏ装置４０の安全な運用が可能となる。

なお、前記実施形態は、何れも本発明を実施するにあたっての具体化のほんの一例を示したものに過ぎず、これらによって本発明の技術的範囲が限定的に解釈されてはならないものである。すなわち、本発明はその技術思想、またはその主要な特徴から逸脱することなく、様々な形で実施することができる。
本実施形態に関し、さらに以下の付記を開示する。

（付記１）
情報処理装置と入出力装置とを中継装置を介して接続する送受信システムにおいて、
前記中継装置は、
前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報を記憶する記憶部と、
前記情報処理装置から要求される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶した前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御する論理パス制御部とを有することを特徴とする送受信システム。
（付記２）
前記論理パス制御部は、前記情報処理装置からの要求で必要とされる前記論理パスが確立していないと判定した場合、前記中継装置と前記入出力装置との間に該論理パスを確立することを特徴とする付記１記載の送受信システム。
（付記３）
前記論理パス制御部は、前記情報処理装置からの要求で不要とされる前記論理パスが確立していると判定した場合、前記中継装置と前記入出力装置との間の該論理パスを削除することを特徴とする付記２記載の送受信システム。
（付記４）
前記論理パス制御部は、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御した後、制御後の前記論理パスの状態に基づいて前記記憶部が記憶する前記論理パスの情報を更新することを特徴とする付記１〜３の何れか１項に記載の送受信システム。
（付記５）
前記論理パス制御部は、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御した後、制御後の前記論理パスの状態を前記情報処理装置に通知することを特徴とする付記１〜４の何れか１項に記載の送受信システム。
（付記６）
前記中継装置と前記入出力装置とは、ＦＣ−ＳＢ−２規格に準拠した接続方式で接続されていることを特徴とする付記１〜５の何れか１項に記載の送受信システム。
（付記７）
情報処理装置と入出力装置とを、前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報を記憶する記憶部を有する中継装置を介して接続する送受信システムの制御方法において、
前記中継装置の論理パス制御部が、前記情報処理装置から要求される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶した前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御することを特徴とする送受信システムの制御方法。
（付記８）
情報処理装置と入出力装置とに接続する中継装置において、
前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報を記憶する記憶部と、
前記情報処理装置から要求される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶した前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御する論理パス制御部とを有することを特徴とする中継装置。

１０ ホスト（情報処理装置）
１１ 処理部
１２ 記憶部
１３ 論理パス管理テーブル
２０ ホスト側延長装置
２１ ネットワーク制御部
３０ Ｉ／Ｏ側延長装置（中継装置）
３１ 制御処理部
３２ 論理パス制御部
３３ ネットワーク制御部
３４ Ｉ／Ｏ通信制御部
３５ 記憶部
３６ 論理パス管理テーブル
４０ Ｉ／Ｏ装置（入出力装置）

Claims (7)

1. 情報処理装置と入出力装置とを中継装置を介して接続し、前記情報処理装置と前記入出力装置との物理的な通信経路の上に論理的な論理パスを確立して通信を行う送受信システムにおいて、
   前記中継装置は、
   前記情報処理装置で動作する論理的なプログラムを識別するための第１のアドレスと、前記情報処理装置の物理的な入出力ポートに割り振られる第２のアドレスと、前記入出力装置で動作する論理的なプログラムを識別するための第３のアドレスと、前記入出力装置の物理的な入出力ポートに割り振られる第４のアドレスとを含む、前記論理パスの情報を記憶する記憶部と、
   前記情報処理装置から指示される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶している現在の前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御する論理パス制御部とを有することを特徴とする送受信システム。
2. 前記論理パス制御部は、前記情報処理装置から指示される前記論理パスが、必要ではあるが確立していない論理パスであると判定した場合、前記中継装置と前記入出力装置との間に該論理パスを確立することを特徴とする請求項１記載の送受信システム。
3. 前記論理パス制御部は、前記情報処理装置から指示される前記論理パスが、不要ではあるが確立している論理パスであると判定した場合、前記中継装置と前記入出力装置との間の該論理パスを削除することを特徴とする請求項２記載の送受信システム。
4. 前記論理パス制御部は、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御した後、制御後の前記論理パスの状態に基づいて前記記憶部が記憶する前記論理パスの情報を更新することを特徴とする請求項１〜３の何れか１項に記載の送受信システム。
5. 前記論理パス制御部は、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御した後、制御後の前記論理パスの状態を前記情報処理装置に通知することを特徴とする請求項１〜４の何れか１項に記載の送受信システム。
6. 情報処理装置と入出力装置とを中継装置を介して接続し、前記情報処理装置と前記入出力装置との物理的な通信経路の上に論理的な論理パスを確立して通信を行う送受信システムの制御方法において、
   前記中継装置が有する記憶部に、前記情報処理装置で動作する論理的なプログラムを識別するための第１のアドレスと、前記情報処理装置の物理的な入出力ポートに割り振られる第２のアドレスと、前記入出力装置で動作する論理的なプログラムを識別するための第３のアドレスと、前記入出力装置の物理的な入出力ポートに割り振られる第４のアドレスとを含む、前記論理パスの情報を記憶し、
   前記中継装置の論理パス制御部が、前記情報処理装置から指示される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶している現在の前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御することを特徴とする送受信システムの制御方法。
7. 情報処理装置と入出力装置との物理的な通信経路の上に論理的な論理パスを確立して通信を行う送受信システムにおいて、前記情報処理装置と前記入出力装置との間に接続する中継装置であって、
   前記情報処理装置で動作する論理的なプログラムを識別するための第１のアドレスと、前記情報処理装置の物理的な入出力ポートに割り振られる第２のアドレスと、前記入出力装置で動作する論理的なプログラムを識別するための第３のアドレスと、前記入出力装置の物理的な入出力ポートに割り振られる第４のアドレスとを含む、前記論理パスの情報を記憶する記憶部と、
   前記情報処理装置から指示される前記情報処理装置と前記入出力装置との間の通信に係る論理パスの情報と、前記記憶部が記憶している現在の前記論理パスの情報との不整合を検出した場合、前記情報処理装置からの前記論理パスの情報に基づいて前記中継装置と前記入出力装置との間の論理パスを制御する論理パス制御部とを有することを特徴とする中継装置。

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