JP6967639B1 - 情報処理装置、及び制御方法 - Google Patents
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Abstract
Description
フラッシュメモリ41は、例えば、NANDフラッシュメモリであり、書き換え可能な不揮発性メモリの一例である。
図2は、本実施形態によるノートPC1の機能構成の一例を示すブロック図である。
図2に示すように、ノートPC1は、ホスト部50と、SSD40とを備える。なお、図2において、本実施形態の発明に関する主要な機能構成のみを記載している。
また、SSD40は、メインシステム70と、サブシステム80とを備える。また、SSD40は、フラッシュメモリ41にデータを入出力するインタフェースIF1(第1のインタフェース)と、SSD40を管理するためのインタフェースIF2(第2のインタフェース)とを備える。
図3は、本実施形態におけるPERST#の信号線の接続例を示す図である。
図3に示すように、PERST#の信号線は、OR回路16(論理和回路)を介して、SSD40に接続されている。OR回路16は、ホスト部50(PCIeI/F部15)から出力されるBIOS_RST信号と、ノートPC1の全体をリセットするCPU_RST信号とを入力として、BIOS_RST信号と、CPU_RST信号とを論理和した出力信号を、PERST#信号として出力する。
また、ドライブ制御部60は、SSD40の機能停止を検出した場合に、現在実行待ちの全てのIOキュー及びOS51のコマンドを一時停止させ、SSD40が再起動して正常に動作する状態になった場合に、一時停止させている現在実行待ちの全てのIOキューを消去し、停止していたOS51のコマンドを再開させる。
図4は、本実施形態によるノートPC1の動作の一例を示す図である。この図により、SSD40の異常検出及びSSD40の復帰処理について説明する。
なお、SSDリセットアプリケーション62は、SSD40のリセットに関する処理を行うアプリケーションプログラムにより実現される機能部であり、ドライブ制御部60に含まれるものとする。
また、BIOS52は、SSD40の初期化要求をSSD40に送信する(ステップS109)。BIOS52は、PCIeI/F部15を介して、インタフェースIF1により、SSD40を初期化するコマンド(初期化要求)をSSD40に送信する。
これにより、ノートPC1は、SSD40がハングアップした場合であっても、迅速に復帰させることができる。
これにより、本実施形態によるノートPC1は、SSD40の異常停止後に、適切に、SSD40を復帰させることができる。
これにより、本実施形態によるノートPC1は、メインシステム70と独立したサブシステム80により、SSD40の異常による機能停止を適切に検出することができる。
これにより、本実施形態によるノートPC1は、既存の仕様であるCFSを利用することで、迅速かつ確実に、SSD40の異常による機能停止を検出することができる。
これにより、本実施形態による制御方法は、上述したノートPC1と同様の効果を奏し、例えば、SSD40がハングアップ(異常による機能停止)した場合に、システム(OS51)を機能停止させずに、復帰させることができる。
例えば、上記の実施形態において、情報処理装置がノートPC1である例を説明したが、これに限定されるものではなく、例えば、タブレット端末装置や、デスクトップ型PCなどの他の情報処理装置であってもよい。
また、「コンピュータシステム」は、インターネットやWAN、LAN、専用回線等の通信回線を含むネットワークを介して接続された複数のコンピュータ装置を含んでもよい。また、「コンピュータ読み取り可能な記録媒体」とは、フレキシブルディスク、光磁気ディスク、ROM、CD−ROM等の可搬媒体、コンピュータシステムに内蔵されるハードディスク等の記憶装置のことをいう。このように、プログラムを記憶した記録媒体は、CD−ROM等の非一過性の記録媒体であってもよい。
10 ホスト制御部
11 CPU
12 メインメモリ
13 ビデオサブシステム
14 表示部
15 PCIeI/F部
16 OR回路
21 チップセット
22 BIOSメモリ
31 エンベデッドコントローラ(EC)
32 入力部
33 電源回路
40 SSD
41 フラッシュメモリ
42 メモリコントローラ
43 サブコントローラ
50 ホスト部
51 OS
52 BIOS
60 ドライブ制御部
61 ストレージドライバ
70 メインシステム
80 サブシステム
IF1、IF2 インタフェース
Claims (8)
- 書き換え可能な不揮発性メモリを内蔵し、前記不揮発性メモリにデータを入出力する第1のインタフェースと、メモリドライブ装置を管理するための第2のインタフェースとを備えるメモリドライブ装置と、
前記メモリドライブ装置へのデータの入出力を伴う情報処理を実行するホスト制御部と、
前記第2のインタフェースにより、前記メモリドライブ装置の異常による機能停止を検出した場合に、前記第1のインタフェースにより、前記メモリドライブ装置を再起動させるドライブ制御部と
を備える情報処理装置。 - 前記メモリドライブ装置は、前記メモリドライブ装置の異常による前記機能停止を検出した場合に、前記第2のインタフェースにより、前記メモリドライブ装置が前記機能停止の状態であることを示す停止検出情報を送信し、
前記ドライブ制御部は、前記停止検出情報に基づいて、前記機能停止を検出する
請求項1に記載の情報処理装置。 - 前記ホスト制御部と独立して動作する組み込み制御部であって、前記メモリドライブ装置から前記第2のインタフェースにより前記停止検出情報を受信した場合に、前記停止検出情報を受信したことを、前記ドライブ制御部に通知する組み込み制御部を備え、
前記ドライブ制御部は、前記組み込み制御部を介して、前記機能停止を検出する
請求項2に記載の情報処理装置。 - 前記ドライブ制御部は、
前記メモリドライブ装置との間の前記第1のインタフェースを制御し、前記機能停止を検出した場合に、前記メモリドライブ装置を再起動させる再起動要求を、前記第1のインタフェースにより送信するBIOS(Basic Input Output System)と、
前記BIOSを介して、前記メモリドライブ装置へのデータの入出力を制御し、前記機能停止を検出した場合に、前記入出力の要求の実行を一時停止させ、前記メモリドライブ装置が再起動して正常に動作する状態になった場合に、前記入出力の要求の実行を再開させるデバイスドライバ部と
を備える請求項1から請求項3のいずれか一項に記載の情報処理装置。 - 前記デバイスドライバ部は、前記BIOSが前記メモリドライブ装置を再起動させた後に、前記メモリドライブ装置を初期化する初期化要求を前記メモリドライブ装置に送信する
請求項4に記載の情報処理装置。 - 前記メモリドライブ装置は、
前記第1のインタフェースを制御するメインシステムと、
前記第2のインタフェースを制御するとともに、前記メモリドライブ装置の異常による機能停止を検出可能なサブシステムと
を備える請求項1から請求項5のいずれか一項に記載の情報処理装置。 - 前記第1のインタフェースは、PCIe(Peripheral Component Interconnect Express)バスのNVMe(Non Volatile Memory Express)プロトコルによるインタフェースであり、
前記第2のインタフェースは、SMBus(System Management Bus)のNVMe−MI(NVM Express Management Interface)である
請求項1から請求項6のいずれか一項に記載の情報処理装置。 - 書き換え可能な不揮発性メモリを内蔵し、前記不揮発性メモリにデータを入出力する第1のインタフェースと、メモリドライブ装置を管理するための第2のインタフェースとを備えるメモリドライブ装置と、前記メモリドライブ装置へのデータの入出力を伴う情報処理を実行するホスト制御部とを備える情報処理装置の制御方法であって、
ドライブ制御部が、前記第2のインタフェースにより、前記メモリドライブ装置の異常による機能停止を検出した場合に、前記第1のインタフェースにより、前記メモリドライブ装置を再起動させる
制御方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2020152809A JP6967639B1 (ja) | 2020-09-11 | 2020-09-11 | 情報処理装置、及び制御方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2020152809A JP6967639B1 (ja) | 2020-09-11 | 2020-09-11 | 情報処理装置、及び制御方法 |
Publications (2)
Publication Number | Publication Date |
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JP6967639B1 true JP6967639B1 (ja) | 2021-11-17 |
JP2022047084A JP2022047084A (ja) | 2022-03-24 |
Family
ID=78509606
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2020152809A Active JP6967639B1 (ja) | 2020-09-11 | 2020-09-11 | 情報処理装置、及び制御方法 |
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2020
- 2020-09-11 JP JP2020152809A patent/JP6967639B1/ja active Active
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Publication number | Publication date |
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JP2022047084A (ja) | 2022-03-24 |
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