JP6965322B2 - 情報処理装置、暗号装置、情報処理装置の制御方法、およびプログラム - Google Patents
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Description
以下、本発明を実施するための形態について図面を用いて説明する。
本発明は、上述の実施形態の1以上の機能を実現するプログラムを、ネットワーク又は記憶媒体を介してシステム又は装置に供給し、そのシステム又は装置のコンピュータにおける1つ以上のプロセッサーがプログラムを読出し実行する処理でも実現可能である。また、1以上の機能を実現する回路(例えば、ASIC)によっても実現可能である。
13 CPU
20 フラッシュメモリ
22 暗号ユニット
23 HDD
Claims (12)
- 情報処理装置であって、
第1の鍵を用いてデータを暗号化する第1暗号処理手段と、
前記第1暗号処理手段によって暗号化されたデータを記憶する第1記憶手段と、
前記第1記憶手段と異なる第2記憶手段と、
第1の鍵を第2の鍵で暗号化し、暗号化された第1の鍵を前記第2記憶手段に記憶させる第1制御手段と、を有し、
前記第1暗号処理手段と前記第1制御手段を含む第1回路から、第3の鍵を用いてデータを暗号化する第2暗号処理手段と前記暗号化された第1の鍵を前記第2記憶手段から読み出させる第2制御手段とを含む第2回路に取り換えられた状態で、所定の条件を満たすことによって、前記第2制御手段は、前記第2記憶手段から読み出された前記暗号化された第1の鍵を前記第2回路に保持することを特徴とする情報処理装置。 - 前記第2回路は前記第2の鍵に対応する第4の鍵を取得する取得手段を有し、
前記第2制御手段は、前記第2回路に保持した前記暗号化された第1の鍵を前記第4の鍵で復号化することを特徴とする請求項1に記載の情報処理装置。 - 前記第2回路にコマンドを送信する第3制御手段を有し、
前記取得手段は、前記第3制御手段から鍵の生成に関するコマンドを受け付けることによって、前記第4の鍵を取得することを特徴とする請求項2に記載の情報処理装置。 - 前記所定の条件は、前記第1記憶手段に記憶された所定のデータを読み出すことに基づいて実行される処理の処理結果であることを特徴とする請求項1乃至3のいずれか1項に記載の情報処理装置。
- 前記第2回路は、前記第3の鍵が前記第1記憶手段に記憶された暗号化されたデータを復号し、前記復号化されたデータと前記第2回路に予め記憶されたデータが一致するか否かを判定する判定手段を有し、
前記所定の条件は、前記判定手段による判定結果が一致しないことを示すことであることを特徴とする請求項1乃至4のいずれか1項に記載の情報処理装置。 - 前記第2回路は、前記第3の鍵を暗号化する第3暗号処理手段を有し、
前記判定手段による判定の結果が一致を示すことによって、前記第2制御手段は、前記第3暗号処理手段によって暗号化された第3の鍵を前記第2記憶手段に記憶させることを特徴とする請求項5に記載の情報処理装置。 - 第1の鍵を用いてデータを暗号化する第1暗号処理手段と、前記第1暗号処理手段によって暗号化されたデータを記憶する第1記憶手段と、前記第1記憶手段と異なる第2記憶手段と、第1の鍵を第2の鍵で暗号化し、暗号化された第1の鍵を前記第2記憶手段に記憶させる第1制御手段と、を有する情報処理装置の制御手段であって、を有し、
前記第1暗号処理手段と前記第1制御手段を含む第1回路から、第3の鍵を用いてデータを暗号化する第2暗号処理手段と前記暗号化された第1の鍵を前記第2記憶手段から読み出させる第2制御手段とを含む第2回路に取り換えられた状態で、所定の条件を満たすか否かを確認するステップと、
前記所定の条件を満たすことによって、前記第2制御手段が、前記第2記憶手段から読み出された前記暗号化された第1の鍵を前記第2回路に保持するステップと、を有することを特徴とする情報処理装置の制御方法。 - 前記第2回路は前記第2の鍵に対応する第4の鍵を取得する取得手段を有し、
前記第2制御手段が前記第2回路に保持した前記暗号化された第1の鍵を前記第4の鍵で復号化するステップを有することを特徴とする請求項7に記載の情報処理装置の制御方法。 - 前記第2回路にコマンドを送信する第3制御手段を有し、
前記第3制御手段から鍵の生成に関するコマンドを受け付けることによって、前記第4の鍵を前記取得手段が取得するステップを有することを特徴とする請求項8に記載の情報処理装置の制御方法。 - 前記所定の条件は、前記第1記憶手段に記憶された所定のデータを読み出すことに基づいて実行される処理の処理結果であることを特徴とする請求項7乃至9のいずれか1項に記載の情報処理装置の制御方法。
- 前記第2回路は、前記第3の鍵が前記第1記憶手段に記憶された暗号化されたデータを復号し、前記復号化されたデータと前記第2回路に予め記憶されたデータが一致するか否かを判定する判定手段を有し、
前記所定の条件は、前記判定手段による判定結果が一致しないことを示すことであることを特徴とする請求項7乃至10のいずれか1項に記載の情報処理装置の制御方法。 - 前記第2回路は、前記第3の鍵を暗号化する第3暗号処理手段を有し、
前記判定手段による判定の結果が一致を示すことによって、前記第2制御手段が、前記第3暗号処理手段によって暗号化された第3の鍵を前記第2記憶手段に記憶させるステップを有することを特徴とする請求項11に記載の情報処理装置の制御方法。
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