JP6737024B2 - 半導体装置の製造方法及び半導体装置 - Google Patents
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Description
まず、半導体装置について、図1及び図2を用いて説明する。
図1は、実施の形態の半導体装置の側面図であり、図2は、実施の形態の半導体装置の要部の上面図である。なお、図2は、図1に示す半導体装置10の要部の上面図であって、外部接続端子51a,51bと、金属ベース基板52と、ケース53と、蓋54と、封止材55との記載は省略している。
絶縁板21は、高い電気絶縁性を有し、熱伝導率が高い材料により構成されている。このような材料として、例えば、酸化アルミニウム、窒化アルミニウム、窒化シリコンが挙げられる。特に、高耐圧用としては、電気絶縁性と熱伝導率とが高い材料が好ましく、例えば、窒化アルミニウム、窒化シリコンを用いることができる。絶縁板21の厚さは、例えば、1mm程度である。
回路パターン23aには、半導体素子31がはんだを介して配置されており、また、外部接続端子51aが電気的に接合されている。なお、はんだは、鉛フリーはんだを用いることが好ましく、例えば、錫−銀−銅系、錫−アンチモン系、錫−アンチモン−銀系、錫−銅系、錫−アンチモン−銀−銅系、錫−銅−ニッケル系、錫−銀系等を用いることができる。
封止材55は、ケース53内に充填されて、積層基板20と、半導体素子31,32a〜32dと、ワイヤ41,42a〜42dとを封止するものであり、例えば、エポキシ樹脂、シリコーンゲル等を用いることができる。
図3は、実施の形態の別の半導体装置の要部の上面図である。
図4は、参考例の半導体装置の要部の上面図である。
但し、半導体装置100では、半導体装置10のワイヤ41に代わって、ワイヤ410が、半導体素子31のゲート電極312と、回路パターン23cとを電気的に接続している。
なお、半導体装置10,10aでは、ワイヤ41,41aは、ワイヤ42a,42bを適切に迂回するように曲げ癖411,412がそれぞれ付加される必要がある。このためには、ワイヤ41,41aは、ゲート電極312または回路パターン23cに対する接合箇所から、ワイヤ42a,42bまでの間に曲げ癖411,412が付加されることが好ましい。例えば、半導体装置10では、ワイヤ41は、その一端部がゲート電極312に接合されてから、当該接合箇所からワイヤ42aの図2中左端部に至るまでの間に、曲げ癖411が付加される。なお、図2中左端部とは、ワイヤ42aと半導体素子31のエミッタ電極311の接合部のことである。このようにして曲げ癖411が付加されたワイヤ41は、ワイヤ42a,42bを適切に迂回して、回路パターン23cと電気的に接続することができる。また、半導体装置10aでは、ワイヤ41aは、その一端部が回路パターン23cに接合されてから、当該接合箇所からワイヤ42bの図3中右端部に至るまでの間に、曲げ癖412が付加される。このようにして曲げ癖412が付加されたワイヤ41aは、ワイヤ42b,42aを適切に迂回して、ゲート電極312と電気的に接続することができる。
図5は、実施の形態の半導体装置の製造方法の製造フローを示す図である。
[ステップS1] 積層基板20、半導体素子31,32a〜32dを用意する。
また、半導体素子32a,32cのアノード電極32a1,32c1と、半導体素子32b,32dのアノード電極32b1,32d1とをワイヤ42b,42dで接続する。
図6は、実施の形態のワイヤボンディング装置の要部を示す図である。
ワイヤボンディング装置60は、半導体素子31,32a〜32d及び回路パターン23cといった接合予定箇所に対してワイヤ41,42a〜42dをそれぞれ接合する際に用いることができる。ワイヤボンディング装置60は、その先端部に、ボンディングツール61と、ワイヤガイド62と、カッター63と、クランプ機構64とを備える。ワイヤボンディング装置60は、さらに、ワイヤ支持部66とワイヤ押圧部67とを備える。ワイヤ支持部66とワイヤ押圧部67とについては後述する。
カッター63は、ボンディングツール61とは独立して、矢印Y2に沿って図6中上下方向に移動して、接続対象物のワイヤ41,42a〜42dによる接続終了後、余分なワイヤ41,42a〜42dをカットする。
ボンディングツール61を降下して、超音波振動子65から超音波振動を受けながら、ワイヤ42aの一端部をエミッタ電極311に押圧する。
ワイヤボンディング装置60ではワイヤ42aの一端部がエミッタ電極311に接合した状態で、ワイヤガイド62からワイヤ42aを供給しながら、先端部を上昇させ、半導体素子32aに移動すると共にアノード電極32a1に位置合わせする。先端部を下降させ、これにより、ワイヤ42aの他端部を半導体素子32aのアノード電極32a1にセットする。
これにより、ワイヤ42aの他端部が半導体素子32aのアノード電極32a1に接合する。
ワイヤ41の一端部を半導体素子31のゲート電極312に接合することについて図7を用いて説明する。
なお、図7では、ワイヤボンディング装置60の図示を省略している。
これにより、図7に示されるように、ワイヤ41の一端部が半導体素子31のゲート電極312に接合する。
ワイヤ41に対する曲げ癖の付加について、図8〜図11を用いて説明する。
図9は、実施の形態のワイヤボンディング装置によりワイヤを支持している場合を示す図であり、図10は、実施の形態のワイヤボンディング装置によりワイヤに曲げ癖を付加する場合を示す図である。なお、図9及び図10は、図8において矢視Xから見た図をそれぞれ示している。
なお、図11でも、ワイヤボンディング装置60の図示を省略している。
この際、ワイヤ支持部66は、ワイヤ41の曲げ癖により曲げられる側を支持する。また、ワイヤ41の一端部から、ワイヤ支持部66により支持される支持点までの第1距離は、ワイヤ41の径の1倍以上、6倍以下であることが好ましく、例えば、3mmであるとする。
なお、ワイヤ支持部66、ワイヤ押圧部67の形状は、円柱状でも、断面形状が三角形や四角形等の多角形の角柱状でもよい。また、ワイヤ支持部66、ワイヤ押圧部67の直径は、第2距離の条件を満たす大きさであればよい。より好ましくは、第2距離の条件を満たす範囲で、ワイヤ径の1/2から2倍の範囲である。この範囲であれば良好に屈曲させることができる。
これにより、ワイヤ41の他端部が回路パターン23cに接合する。
蓋54をケース53の開口を覆って固定して、外部接続端子51a,51bを外部に突出させる。
以上の製造フローにより、図1及び図2に示した半導体装置10が製造される。
なお、実施の形態では、ワイヤ41,41aに曲げ癖411,412を付加して、ゲート電極312と回路パターン23cとの間を電気的に接続する際に、ゲート電極312と回路パターン23cとの間に配置するワイヤ42a,42cを迂回するものである。
図12は、実施の形態のワイヤの別の配線工程を説明するための図である。
20 積層基板
21 絶縁板
22 金属板
23 回路板
23a〜23c 回路パターン
31,32a〜32d 半導体素子
32a1〜32d1 アノード電極
41,41a,42a〜42d ワイヤ
51a,51b 外部接続端子
52 金属ベース基板
53 ケース
54 蓋
55 封止材
60 ワイヤボンディング装置
61 ボンディングツール
62 ワイヤガイド
63 カッター
64 クランプ機構
65 超音波振動子
66 ワイヤ支持部
67 ワイヤ押圧部
311 エミッタ電極
312 ゲート電極
411,412 曲げ癖
Claims (9)
- 基板上に、第1接続端子と、前記第1接続端子に対向する第2接続端子と、前記第1接続端子と前記第2接続端子との間に配線接続部とをそれぞれ配置する配置工程と、
前記第1接続端子または前記第2接続端子の一方にワイヤの一端部を接合し、前記第1接続端子または前記第2接続端子の接合面に平行であり、前記配線接続部から前記ワイヤが離間するように屈曲する屈曲方向に、前記ワイヤの接合箇所近傍に曲げ癖を付加して、前記ワイヤの他端部を、前記第1接続端子または前記第2接続端子の他方に接合する配線工程と、
を有し、
前記配線工程にて、
前記ワイヤにおいて、前記一端部から第1距離だけ離れた、前記屈曲方向側の支持点を支持しながら、前記支持点からさらに第2距離だけ離れた、前記屈曲方向の反対側の押圧点を前記屈曲方向に押圧して、前記ワイヤに前記曲げ癖を付加する、
半導体装置の製造方法。 - 前記第1距離は、前記ワイヤの径の1倍以上、6倍以下である、
請求項1に記載の半導体装置の製造方法。 - 前記第2距離は、前記ワイヤの径以上である、
請求項1または2に記載の半導体装置の製造方法。 - 絶縁板と、前記絶縁板のおもて面に形成される回路板とを備える積層基板と、
おもて面に制御電極及び第1主電極を備え、前記回路板上に配置される第1半導体素子と、
おもて面に第2主電極を備え、前記回路板上に前記第1半導体素子から離間した配置領域に配置される第2半導体素子と、
前記配置領域から前記第1半導体素子の反対側に離間して配置される配線部と、
前記第1主電極と前記第2主電極とを電気的に接続する配線接続部と、
一端部が前記制御電極または前記配線部の一方に接合され、前記制御電極または前記配線部の接合面に平行であり、前記配線接続部から離間する離間方向に、接合箇所近傍に曲げ癖が付加され、他端部が前記制御電極または前記配線部の他方に接合されるワイヤと、
を有する半導体装置。 - 前記ワイヤと前記配線接続部とは隙間が空いている、
請求項4に記載の半導体装置。 - 前記制御電極は、前記第1半導体素子の前記離間方向側の外縁部に設けられている、
請求項4または5に記載の半導体装置。 - 前記配置領域に、前記第2半導体素子が複数配置されている、
請求項4乃至6のいずれかに記載の半導体装置。 - 前記第1半導体素子は、シリコンにより構成されている、
請求項4乃至7のいずれかに記載の半導体装置。 - 前記第2半導体素子は、炭化シリコンにより構成されている、
請求項4乃至7のいずれかに記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016141484A JP6737024B2 (ja) | 2016-07-19 | 2016-07-19 | 半導体装置の製造方法及び半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016141484A JP6737024B2 (ja) | 2016-07-19 | 2016-07-19 | 半導体装置の製造方法及び半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018014354A JP2018014354A (ja) | 2018-01-25 |
JP6737024B2 true JP6737024B2 (ja) | 2020-08-05 |
Family
ID=61019538
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016141484A Active JP6737024B2 (ja) | 2016-07-19 | 2016-07-19 | 半導体装置の製造方法及び半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP6737024B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE112020000131T5 (de) | 2019-06-12 | 2021-07-15 | Fuji Electric Co., Ltd. | Halbleitervorrichtung |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07235634A (ja) * | 1994-02-22 | 1995-09-05 | Sansha Electric Mfg Co Ltd | 電力用半導体モジュール |
JP2007073937A (ja) * | 2005-08-12 | 2007-03-22 | Kaijo Corp | ボンディングワイヤのループ形状及びそのループ形状を備えた半導体装置並びにボンディング方法 |
JP2007194470A (ja) * | 2006-01-20 | 2007-08-02 | Kaijo Corp | ボンディングワイヤのループ形状及びそのループ形状を備えた半導体装置並びにボンディング方法 |
JP2013065770A (ja) * | 2011-09-20 | 2013-04-11 | Toshiba Corp | 電力用半導体装置 |
JP5805513B2 (ja) * | 2011-12-14 | 2015-11-04 | 三菱電機株式会社 | 電力用半導体装置 |
-
2016
- 2016-07-19 JP JP2016141484A patent/JP6737024B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
JP2018014354A (ja) | 2018-01-25 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190613 |
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