JP6564250B2 - Oscillator - Google Patents
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Description
本発明は、例えばGPS(Global Positioning System)等の外部からのクロック信号を用いて発振出力(周波数信号)を得る発振装置に関する。 The present invention relates to an oscillation device that obtains an oscillation output (frequency signal) using an external clock signal such as a GPS (Global Positioning System).
例えば携帯電話の移動体通信や地上放送システムなどの基地局などにおいては、高い周波数安定性が求められる。そのため例えば特許文献1に示すようなセシウム周波数標準発振器やルビジウム標準発振器等により発振された基準信号となる外部クロック信号を受信し、PLL(Phase Locked Loop)回路により、外部クロック信号の周波数と発振周波数の周波数とを同期させて周波数を安定させる発振装置が知られている。
更にまた例えば特許文献2に記載されているように基準周波数として例えばGPSから送信される周波数信号を外部クロック信号として用いた発振装置が知られている。
For example, high frequency stability is required in base stations for mobile phone mobile communications and terrestrial broadcasting systems. Therefore, for example, an external clock signal serving as a reference signal oscillated by a cesium frequency standard oscillator or a rubidium standard oscillator as shown in
Furthermore, as described in
ところでこのような外部クロック信号に基づいて動作する発振装置においては、環境条件の変化等により機器あるいは伝送路に不具合が生じた場合などに外部クロック信号が受信できなくなることがあり、外部クロック信号の通信が途絶えたときに、発振装置から出力する周波数信号を安定させる必要があった。 By the way, in an oscillation device that operates based on such an external clock signal, the external clock signal may not be received when a failure occurs in a device or a transmission line due to a change in environmental conditions or the like. When communication was interrupted, it was necessary to stabilize the frequency signal output from the oscillation device.
本発明はこのような事情の下になされたものであり、その目的は外部から供給される外部クロック信号に基づいて動作する発振回路を含む発振装置において、外部クロック信号が途絶えたときにも周波数が安定している周波数信号を出力することができる発振装置を提供することにある。 The present invention has been made under such circumstances, and an object of the present invention is to provide an oscillation device including an oscillation circuit that operates based on an external clock signal supplied from the outside. It is an object to provide an oscillation device that can output a frequency signal that is stable.
本発明の発振装置は、基準信号に基づいてPLLにより周波数信号を出力する第1の発振回路と、
周波数設定値に応じた周波数で内部クロック信号である周波数信号を出力する第2の発振回路と、
外部から送られる外部クロック信号と前記内部クロック信号との間で前記基準信号を切り替えるために設けられ、外部クロック信号が送られているときには当該外部クロック信号を前記第1の発振回路に入力し、外部クロック信号が途絶えたときには前記内部クロック信号を前記第1の発振回路に入力する切り替え部と、
前記外部クロック信号と前記第2の発振回路から出力された周波数信号との周波数差に対応する差分値を求める周波数差検出部と、
前記周波数差検出部により求められた差分値の時系列データを記憶する記憶部と、
前記記憶部に記憶された差分値の時系列データ及び予め決めた基準時からの経過時間に基づいて、前記第2の発振回路から出力される周波数信号の周波数の経時変化を予測し、当該周波数の経時変化を相殺するための周波数設定信号の補正値を求める補正値算出部と、
前記外部クロック信号が途絶えたときに、前記周波数設定値に補正値を加えるための加算部と、を備えたことを特徴とする。
The oscillation device of the present invention includes a first oscillation circuit that outputs a frequency signal by a PLL based on a reference signal;
A second oscillation circuit that outputs a frequency signal that is an internal clock signal at a frequency according to a frequency setting value;
Provided to switch the reference signal between an external clock signal sent from outside and the internal clock signal, and when the external clock signal is sent, the external clock signal is input to the first oscillation circuit, A switching unit for inputting the internal clock signal to the first oscillation circuit when the external clock signal is interrupted;
A frequency difference detection unit for obtaining a difference value corresponding to a frequency difference between the external clock signal and the frequency signal output from the second oscillation circuit;
A storage unit for storing time-series data of difference values obtained by the frequency difference detection unit;
Based on the time-series data of the difference value stored in the storage unit and the elapsed time from a predetermined reference time, a change with time of the frequency of the frequency signal output from the second oscillation circuit is predicted, and the frequency A correction value calculation unit for obtaining a correction value of the frequency setting signal for canceling the change with time,
And an addition unit for adding a correction value to the frequency setting value when the external clock signal is interrupted.
また本発明の発振装置は、前記補正値算出部は、前記時系列データに基づいて前記周波数の経時変化を指数関数を含む関数として近似し、近似された前記関数と予め決めた基準時からの経過時間とに基づいて前記周波数信号の周波数を予測し、前記補正値を算出してもよく、前記周波数の経時変化の予測は、予め決められた時間の長さ分の前記差分値の時系列データが順次用いられてもよい。更に前記第2の発振回路は、周波数設定信号に応じた周波数で周波数信号を出力するDDSを備え、前記DDSの出力に基づいて生成されるパルスを参照パルスとしてPLLにより内部クロック信号を出力するように構成されていることを特徴としてもよい。
Further, in the oscillation device of the present invention, the correction value calculation unit approximates the change with time of the frequency as a function including an exponential function based on the time-series data, and the approximated function and a predetermined reference time are compared. The frequency of the frequency signal may be predicted based on the elapsed time, and the correction value may be calculated. The prediction of the frequency change with time is a time series of the difference values for a predetermined length of time. Data may be used sequentially. Further, the second oscillation circuit includes a DDS that outputs a frequency signal at a frequency corresponding to a frequency setting signal, and outputs an internal clock signal by a PLL using a pulse generated based on the output of the DDS as a reference pulse. It is good also as being characterized by being comprised.
本発明は、外部から供給される外部クロック信号、例えばGPSから送信される外部クロック信号に同期させて周波数信号を出力する発振回路(第1の発振回路)を含む発振装置において、外部クロック信号が途絶えたときに代わりに用いる内部クロック信号を発生させる発振回路(第2の発振回路)を設けている。そして、外部クロック信号と前記第2の発振回路から出力された周波数信号との周波数差に対応する差分値の時系列データを取得して予測した、第2の発振回路から出力される周波数信号の周波数の経時変化に基づいて第2の発振回路の周波数設定値を補正している。従って外部クロック信号が途絶えた場合においても周波数が安定した周波数信号(発振装置の出力信号)が得られる。 The present invention provides an oscillation device including an oscillation circuit (first oscillation circuit) that outputs a frequency signal in synchronization with an external clock signal supplied from the outside, for example, an external clock signal transmitted from GPS. An oscillation circuit (second oscillation circuit) is provided that generates an internal clock signal to be used instead when it is interrupted. Then, the time series data of the difference value corresponding to the frequency difference between the external clock signal and the frequency signal output from the second oscillation circuit is acquired and predicted, and the frequency signal output from the second oscillation circuit The frequency setting value of the second oscillation circuit is corrected based on the change with time of the frequency. Therefore, even when the external clock signal is interrupted, a frequency signal (output signal of the oscillation device) having a stable frequency can be obtained.
図1は本発明の発振装置の実施形態を示すブロック図である。発振装置は、基準信号に従って、発振周波数を出力するように構成された第1の発振回路1を備えている。図2に示すように第1の発振回路1は、例えば周波数を出力するための電圧制御発振器(VCO:Voltage Controlled Oscillator)10と、VCO10の発振出力を分周、例えば分周比が1/(4.0×107)に設定された分周回路11と、切り替え部30を介して入力される周波数信号と分周回路11からの周波数信号の位相とを比較して差分を取り出す位相比較回路12と、チャージポンプ13と、ループフィルタ14と、を備えている。第1の発振回路1は、VCO10の出力を分周回路11にて分周した後、位相比較回路12にて位相差信号を求め、位相差信号をチャージポンプ13を介して、ループフィルタ14により積分し、VCO10に入力するPLL回路として構成されている。
FIG. 1 is a block diagram showing an embodiment of the oscillation device of the present invention. The oscillation device includes a
また図1に示すように第1の発振回路1に入力される基準信号は、GPSから受信される外部クロック信号である1Hzの周波数信号と、第2の発振回路2から出力される40MHzの周波数信号を分周回路31により1/(4.0×107)に変換した周波数信号と、の間で切り替え部30により切り替えられるように構成されている。
図3に示すように第2の発振回路2は、第1の発振回路1と同様に、位相比較回路22、チャージポンプ23、ループフィルタ24、VCO20及び分周回路21で構成されるPLL回路を構成しており、後述する加算部6から出力される周波数設定信号(周波数設定値)をDDS(Direct Digital Synthesizer)回路部25に入力し、DDS回路部25から出力された周波数信号が、位相比較回路22に参照信号(上記の基準信号との混同を避けるため「参照信号」という用語を用いる)として入力される。
As shown in FIG. 1, the reference signal input to the
As shown in FIG. 3, the
GPSから受信される1Hzの周波数信号(GPS信号)は、逓倍回路部32にて40MHzに逓倍された後、周波数差検出部3に入力される。周波数差検出部3は、GPSから受信される1Hzの周波数信号を例えば40MHzに逓倍した周波数信号f1と第2の発振回路2の周波数信号f2とを各々カウントするカウンタと、周波数信号f1の周波数と周波数信号f2の周波数との差分値に対応する値である周波数の変化率を計測する計測部と、により構成されている。ここで周波数の変化率とは、(f1−f2)/f1の値であり、f1は経時変化を伴わないことから、この値はf1に対するf2の変化率ということができる。しかしながら説明の便宜上、以後の記載において、(f1−f2)/f1の値を「周波数差」と称して説明する場合がある。なお記載の煩雑化を避けるために周波数信号f1の周波数及び周波数信号f2の周波数をf1、f2と記載する場合がある。周波数差検出部3にて求められた周波数差は、補正値算出部である経時変化補正部4に入力される。
A frequency signal (GPS signal) of 1 Hz received from GPS is multiplied to 40 MHz by the
また発振装置は、GPSから送信されているGPS信号が受信できているか否かを検出し、GPS信号の受信の有無を示す1ビットの信号を経時変化補正部4に出力するGPS検出部5を備えている。GPS検出部5は、GPS信号を受信しているときには、例えば論理「1」の1ビットの信号を出力し、GPS信号を受信していないときには、論理「0」の1ビットの信号を出力する。
既述の切り替え部30は、GPS検出部5からの検出信号が論理「1」のときには、GPS信号の信号ラインに切り替えられ、GPS検出部5からの検出信号が論理「0」のときには、第2の発振回路2の出力側に切替えられるように構成されている。切り替えるための回路構成としては、GPS検出部5からの検出信号が後述の制御部(コンピュータ)に送られてこの制御部から切り替え信号が切り替え部30に出力されるように構成してもよいし、あるいはGPS検出部5からの検出信号により直接切り替え部30が切り替えられるように構成してもよい。
The oscillation device detects whether or not the GPS signal transmitted from the GPS is received, and outputs a 1-bit signal indicating whether or not the GPS signal is received to the time-dependent
The
経時変化補正部4は、例えばコンピュータから構成される制御部の一部として構成され、第2の発振回路2の発振開始後の発振の経過時間を計測する経過時間計測部41と、経時変化補正値を求めるための補正値算出プログラム42と、補正値算出プログラム42(詳しくは、補正値算出プログラム42を格納したプログラム格納部を備えているが、便宜上補正値算出プログラム42として記載する)を実行するためのCPU43と、記憶部であるメモリ44と、を備えている。40は、バスである。
The temporal
メモリ44は、周波数差検出部3において算出された、既述の(f1−f2)/f1の周波数差のデータを例えば30分おきに24時間分書き込めるように構成されている。またメモリ44は、24時間分の周波数差のデータを書き込んだ以後は、古いデータを順に削除し、最新のデータから24時間前のデータまでを記録しておくように構成されている。
The
続いて補正値算出プログラム42について説明する。GPS信号の周波数は正確に1Hzであるため、周波数差検出部3にて求められる周波数差は、第2の発振回路2の発振周波数の経時変化に起因しているということができる。図4は、第2の発振回路2から出力される周波数信号の周波数f2の経時変化を補正しない場合において、第2の発振回路2の電源を投入した後の経過時間と既述の周波数差((f1−f2)/f1)との関係をイメージとして示すものである。この関係は、上記の経過時間をtとすると、(1)式で近似される。
((f1−f2)/f1)=A1×(1−exp(−t/τ1))+A2×(1−exp(−t/τ2))+A3×t・・・(1)式
Next, the correction
((F1−f2) / f1) = A1 × (1−exp (−t / τ1)) + A2 × (1−exp (−t / τ2)) + A3 × t (1)
そして補正値算出プログラム42は、例えば電源投入時(t=0)から24時間が経過した後、メモリ44に記憶されている24時間分の差分値のデータに基づいて指数関数を求める。具体的には、(1)式の定数A1〜A3、τ1及びτ2を求め、求めた定数A1〜A3、τ1及びτ2を当てはめた(1)式がメモリ44に記憶される。上述のように周波数差検出部3にて求められる周波数差は、第2の発振回路2の発振周波数の経時変化に起因するため、第2の発振回路2の発振周波数の経時変化を指数関数を含む関数で近似することと、周波数差((f1−f2)/f1)を指数関数を含む関数で近似することと、は、実質的に同じであると言える。
The correction
さらにGPS検出部5から経時変化補正部4にGPS信号が途切れたことを伝える1ビットの信号が入力されると、補正値算出プログラム42は、メモリ44に記憶された(1)式と、経過時間計測部41により計測された経過時間とにより、当該経過時間における周波数差を演算する。
周波数差は経過時間に伴って大きくなっていくことから、この例では第2の発振回路2から出力される周波数信号の周波数f2は経時変化に伴って小さくなっている。そこでDDS回路部25から出力される、第2の発振回路2のPLLにおける参照信号の周波数を高くするように、DDS回路部25に入力される周波数設定値を大きくするように補正することにより、補正後におけるf2は高くなる。周波数f2が40MHzよりどれだけ低い時に、DDS回路部25に入力される周波数設定値をどれだけ大きくすればよいかは事前に分かっているので、補正値算出プログラム42は、周波数差検出部3において検出された周波数差に基づいて、周波数設定値の補正値(経時変化補正値)を求めることができ、求めた補正値が加算部6に出力される。
Further, when a 1-bit signal indicating that the GPS signal has been interrupted is input from the GPS detection unit 5 to the temporal
Since the frequency difference increases with the elapsed time, in this example, the frequency f2 of the frequency signal output from the
加算部6は、経時変化補正部4から出力される経時変化補正値を、例えば外部のパーソナルコンピュータによりレジスタに設定された周波数設定値に加算し、補正された周波数設定信号を第2の発振回路2のPLLの参照信号を生成するDDS回路部25に出力する。周波数設定値は、例えば第2の発振回路2から出力される周波数信号の周波数に対応した設定値であり、例えばDDS回路部25から出力されるパルスの周波数を設定するための電圧値である。
The adding unit 6 adds the aging correction value output from the aging
続いて上述の実施形態の作用について説明する。今発振装置がGPS信号を受信しているとすると、GPS検出部5からGPS信号の受信に相当する論理「1」の1ビットの信号が出力される。従って切り替え部30は図1の状態になっており、GPS信号である1Hzの外部クロックが第1の発振回路1に基準信号として供給され、分周回路11の分周比が1/(4.0×107)に設定されているため、40MHzの周波数信号を出力する。
Then, the effect | action of the above-mentioned embodiment is demonstrated. Assuming that the oscillation device is receiving a GPS signal, a 1-bit signal of logic “1” corresponding to reception of the GPS signal is output from the GPS detection unit 5. Accordingly, the switching
この時経時変化補正部4からは、経時変化補正値は出力されないため、加算部6に入力された周波数設定値が、第2の発振回路2に入力され、例えば40MHzの周波数信号f1を出力する。そして周波数差検出部3において、GPS信号を4.0×107に逓倍した周波数信号の周波数f1と、第2の発振回路2から出力される周波数信号の周波数f2と、の周波数差((f1−f2)/f1)が演算され、例えば24ビットの信号として経時変化補正部4に入力される。経時変化補正部4においては、既述の周波数差が例えば30分ごとにメモリ44に書き込まれ、発振装置の電源投入時からの経過時間と対応させた24時間分の時系列データが作成される。そして周波数差が書き込まれる度に、周波数差の経時変化を示す既述の(1)式である近似式を求めてメモリ44に記憶する。さらに例えば図4中の時刻t0にて、GPS信号が途絶えたとすると、GPS検出部5から論理「0」の1ビットの信号が出力される。これにより経時変化補正部4は、基準時、例えば発振装置の電源投入時からの現在の経過時間を(1)式に代入して、図4のグラフにおけるt0における周波数差((f1−f2)/f1)の予測値を求める。更に当該周波数差の予測値から経時変化補正値を演算し、加算部6に出力して、周波数設定値を補正する。
At this time, since the aging correction value is not output from the aging
例えば周波数差の予測値からt0における((f1−f2)/f1)の予測値を求め、この予測値の符号を正負逆にした値に所定の係数を掛けて経時変化補正値が算出される。更に論理「0」の1ビットの信号を受信したことから、切り替え部30が図1の状態から第2の発振回路2の出力側に切り替えられる。従って、第1の発振回路1には、第2の発振回路2から出力される周波数信号の周波数f2が分周回路31により1/(4.0×107)に分周されて1Hzの周波数信号となって入力される。そして第1の発振回路1から40MHzの周波数信号を出力する。
For example, a predicted value of ((f1-f2) / f1) at t0 is obtained from the predicted value of the frequency difference, and a time-dependent change correction value is calculated by multiplying a value obtained by inverting the sign of this predicted value with a predetermined coefficient. . Further, since the 1-bit signal of logic “0” is received, the switching
その後、GPS信号が途絶えている間は、例えば1時間ごとに、(1)式から予測される、その時の時刻における周波数差が求められ、この周波数差に基づいて周波数設定値の補正値が算出されて加算部6に出力される。そしてGPS信号が回復すると、GPS検出部5からGPS信号の受信に相当する論理「1」の1ビットの信号が出力される。従って切り替え部30は図1の状態に戻り、GPS信号である1Hzの外部クロック信号が第1の発振回路1に基準信号として供給される。
After that, while the GPS signal is interrupted, for example, every hour, a frequency difference predicted from the equation (1) is obtained at that time, and a correction value for the frequency setting value is calculated based on this frequency difference. And output to the adder 6. When the GPS signal is recovered, a 1-bit signal of logic “1” corresponding to reception of the GPS signal is output from the GPS detection unit 5. Accordingly, the switching
上述の実施の形態によれば、GPSから送信される外部クロック信号に周波数を同期させた周波数信号を出力する発振装置において、GPS信号が途絶えたときに代わりに用いる内部クロック信号を発生させる第2の発振回路2を設けている。そして、GPS信号と第2の発振回路2から出力された周波数信号との周波数差に対応する差分値の時系列データを取得して近似式を求め、当該近似式と経過時間とにより、第2の発振回路2から出力される周波数信号の周波数の経時変化を予測し、第2の発振回路2の周波数設定値を補正している。従ってGPS信号が途絶えた場合において、第2の発振回路2から出力された周波数信号を第1の発振回路1の内部クロック信号として用いたときに、第2の発振回路2の経時変化による内部クロック信号の誤差が相殺されるため、第1の発振回路1の出力する周波数信号が安定する。
According to the above-described embodiment, in the oscillation device that outputs a frequency signal whose frequency is synchronized with the external clock signal transmitted from the GPS, the second internal clock signal used instead is generated when the GPS signal is interrupted. The
また第2の発振回路2は、制御電圧あるいは電源電圧を調整することにより発振周波数を制御することができる回路、例えば水晶振動子を用いたコルピッツ回路であってもよい。この場合には、制御電圧等が周波数設定値に相当する。
またDDS回路部25の周波数設定値がアナログ電圧値である場合には、加算部6の後段にA/D変換器を設ければよい。さらに外部クロック信号は、セシウム周波数標準発振器やルビジウム標準発振器であってもよい。
またメモリ44は、30分ごとに取得した30日分のデータを記憶してもよく、30日分のデータを用いて(1)式を求めるようにしてもよい。
The
When the frequency setting value of the
In addition, the
1 第1の発振回路
2 第2の発振回路
3 周波数差検出部
4 経時変化補正部
5 GPS検出部
6 加算部
25 DDS回路部
42 補正値算出プログラム
44 メモリ
DESCRIPTION OF
Claims (4)
周波数設定値に応じた周波数で内部クロック信号である周波数信号を出力する第2の発振回路と、
外部から送られる外部クロック信号と前記内部クロック信号との間で前記基準信号を切り替えるために設けられ、外部クロック信号が送られているときには当該外部クロック信号を前記第1の発振回路に入力し、外部クロック信号が途絶えたときには前記内部クロック信号を前記第1の発振回路に入力する切り替え部と、
前記外部クロック信号と前記第2の発振回路から出力された周波数信号との周波数差に対応する差分値を求める周波数差検出部と、
前記周波数差検出部により求められた差分値の時系列データを記憶する記憶部と、
前記記憶部に記憶された差分値の時系列データ及び予め決めた基準時からの経過時間に基づいて、前記第2の発振回路から出力される周波数信号の周波数の経時変化を予測し、当該周波数の経時変化を相殺するための周波数設定信号の補正値を求める補正値算出部と、
前記外部クロック信号が途絶えたときに、前記周波数設定値に補正値を加えるための加算部と、を備えたことを特徴とする発振装置。 A first oscillation circuit that outputs a frequency signal by a PLL based on a reference signal;
A second oscillation circuit that outputs a frequency signal that is an internal clock signal at a frequency according to a frequency setting value;
Provided to switch the reference signal between an external clock signal sent from outside and the internal clock signal, and when the external clock signal is sent, the external clock signal is input to the first oscillation circuit, A switching unit for inputting the internal clock signal to the first oscillation circuit when the external clock signal is interrupted;
A frequency difference detection unit for obtaining a difference value corresponding to a frequency difference between the external clock signal and the frequency signal output from the second oscillation circuit;
A storage unit for storing time-series data of difference values obtained by the frequency difference detection unit;
Based on the time-series data of the difference value stored in the storage unit and the elapsed time from a predetermined reference time, a change with time of the frequency of the frequency signal output from the second oscillation circuit is predicted, and the frequency A correction value calculation unit for obtaining a correction value of the frequency setting signal for canceling the change with time,
An oscillating device comprising: an adder for adding a correction value to the frequency set value when the external clock signal is interrupted.
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