JP6556823B2 - 自己完結型時分割複信(tdd)サブフレーム構造のためのスケーリングされたシンボル - Google Patents
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Description
本出願は、2015年5月15日に米国特許商標庁に提出された仮出願第62/162,557号、および2016年1月29日に米国特許商標庁に提出された非仮出願第15/011,304号の優先権および利益を主張し、それらの内容全体が参照により本明細書に組み込まれる。
DL/UL切替えオーバーヘッド=RF切替え時間+2*OTA遅延 (式1)
上式で、DL/UL切替えオーバーヘッドはスケジューリングエンティティ202の実際のDL/UL切替え期間を表し、RF切替え時間はスケジューリングエンティティ202がRFアンテナ方向を変更するのに必要な期間を表し、OTA遅延はスケジューリングエンティティ202と下位エンティティ204との間の伝播遅延を表す。たとえば、スケジューリングエンティティ202のRF切替え時間が5.0μsであり、スケジューリングエンティティ202から1.0kmの下位エンティティ204に対するOTA遅延値が3.3μsである場合、スケジューリングエンティティ202のためのDL/UL切替えオーバーヘッドは、11.3μs(たとえば、5.0μs+2(3.3μs))であると決定され得る。「2*OTA遅延」という用語は、信号の往復時間(RTT)を表す点に留意されたい。したがって、従来のTDDフレーム構造で行われたように、1つのフルOFDMシンボル(たとえば、70.0μsまたは31.25μs)の期間を有するGP部分の割振りは、実際のDL/UL切替えオーバーヘッド(たとえば、11.3μs)よりも実質的に多い場合がある。追加データは、名目上のシンボルのスケーリングされたシンボル(たとえば1/2)で送信され得る。拡張されたCP(たとえば、より大きなセル半径のための)が実装される場合にも、同じ技法を適用する。
102 セルラー領域
102 セル
104 基地局
106 別のユーザ機器(UE)
108 低電力クラスの基地局
110 セルラー領域
112 セルラー領域
112 メッシュネットワーク
116 サービングゲートウェイ
202 スケジューリングエンティティ
204 下位エンティティ
206 ダウンリンクデータ
208 制御チャネル
210 アップリンクデータ
212 制御チャネル
214 フィードバックチャネル
300 無線フレーム
302 期間
304 期間
400 サブフレーム
402 制御情報部分
404 DLデータ部分
406 ガード期間(GP)部分
408 ACK部分
410 GP期間
500 DL中心のサブフレーム
502 制御情報部分
504 DLデータ部分
506 GP部分
508 ACK部分
510 第2のGP部分
512 GP期間
512 第1の期間
514 第2の期間
600 自己完結型サブフレーム
602 制御情報部分
604 DLデータ部分
606 第1のGP部分
608 ACK部分
609 第2のGP部分
610 GP部分
612 巡回プレフィックス(CP)部分
614 パイロットおよびACK部分
616 GP部分
620 第1の期間
621 第3の期間
622 第2の期間
624 第1のGP部分
625 第1のスケーリングされたシンボル
626 CP部分
628 パイロット信号部分
629 第2のスケーリングされたシンボル
630 CP部分
632 ACK部分
634 第2のGP部分
636 第1の期間
638 第3の期間
640 第4の期間
644 第5の期間
701 DL中心のサブフレーム
702 CRS部分
703 DL中心のサブフレーム
704 制御情報部分
706 DLデータ部分
708 ガード期間(GP)部分
710 パイロット信号部分
712 ACK部分
714 GP部分
716 CRS部分
718 制御情報部分
801 自己完結型サブフレーム
802 パイロットおよびACK部分
803 自己完結型サブフレーム
804 第1のシンボル
806 GP部分
808 CP
810 CRSおよび制御情報部分
816 GP部分
817 第1のスケーリングされたシンボル
818 CP部分
820 CRS部分
820 基準信号部分
821 第2のスケーリングされたシンボル
822 CP部分
824 制御部分
824 制御情報部分
825 GP期間
826 第1の期間
828 第2の期間
902 通常の巡回プレフィックス(NCP)
904 フルOFDMシンボル
908 スケーリングされたシンボル
910 スケーリングされたシンボル
1002 NCP
1004 フルOFDMシンボル
1102 装置
1103 バス
1104 プロセッサ
1105 メモリ
1106 コンピュータ可読媒体
1108 バスインターフェース
1110 トランシーバ
1112 ユーザインターフェース
1114 処理システム
1140 制御情報送信回路
1142 データ情報送信回路
1144 パイロット信号受信回路
1146 ACK/NACK信号受信回路
1148 基準信号送信回路
1150 ACK/NACK信号処理回路
1152 切替え期間決定回路
1154 伝播遅延決定回路
1156 シンボル分割回路
1158 他の回路
1160 制御情報送信命令
1162 データ情報送信命令
1164 パイロット信号受信命令
1166 ACK/NACK信号受信命令
1168 基準信号送信命令
1170 ACK/NACK信号処理命令
1172 切替え期間決定命令
1174 伝播遅延決定命令
1176 シンボル分割命令
1178 他のコンピュータ実行可能命令
1502 装置
1503 バス
1504 プロセッサ
1505 メモリ
1506 コンピュータ可読媒体
1508 バスインターフェース
1510 トランシーバ
1512 ユーザインターフェース
1514 処理システム
1540 制御情報受信回路
1542 データ情報受信回路
1544 パイロット信号送信回路
1546 データ情報処理回路
1548 ACK/NACK信号送信回路
1550 他の回路
1552 制御情報受信命令
1554 データ情報受信命令
1556 パイロット信号送信命令
1558 データ情報処理命令
1560 ACK/NACK信号送信命令
1562 他のコンピュータ実行可能命令
Claims (33)
- 複数のサブフレームを含む時分割複信(TDD)キャリア上でスケジューリングエンティティと通信するための下位エンティティにおいて動作可能なワイヤレス通信の方法であって、前記方法は、
サブフレームの制御部分において制御情報を受信するステップであって、前記制御情報が前記サブフレーム内のデータ情報に対応する、ステップと、
前記サブフレームのデータ部分において前記データ情報を受信するステップと、
前記データ情報を誤り検査したことに基づいて肯定応答(ACK)/否定応答(NACK)情報を決定するステップと、
前記サブフレームのACK部分において前記ACK/NACK情報を送信するステップと
を備え、
前記制御部分、前記データ部分、および前記ACK部分が、同じサブフレームに含まれる、方法。 - 前記サブフレームのパイロット部分においてパイロット信号を送信するステップをさらに備え、
前記ACK部分が、前記サブフレームの前記パイロット部分の後にある、請求項1に記載の方法。 - 前記サブフレームの前記パイロット部分の期間、および前記サブフレームの前記ACK部分の期間は、各々が、前記サブフレーム内のフルシンボルの期間よりも短く、前記サブフレームの前記パイロット部分の期間が、前記サブフレームの前記ACK部分の期間とは異なる、請求項2に記載の方法。
- 前記データ部分内の前記データ情報の少なくとも一部が、前記サブフレーム内のフルシンボルの期間を有するシンボルを利用する、請求項3に記載の方法。
- 前記パイロット部分が第1の巡回プレフィックス(CP)を備え、前記ACK部分が第2のCPを備える、請求項2に記載の方法。
- 前記サブフレームが、前記データ部分の後かつ前記パイロット部分の前にガード期間部分を備え、
前記ガード期間部分と前記パイロット部分との合計期間が、前記サブフレーム内のフルシンボルの概算期間以上である、
前記ガード期間部分の期間が、前記下位エンティティと前記スケジューリングエンティティとの間のover-the-air(OTA)遅延に基づく、または、
前記ガード期間部分の期間が、前記サブフレーム内のフルシンボル期間よりも短い
うちの少なくとも1つである、請求項2に記載の方法。 - 複数のサブフレームを含む時分割複信(TDD)キャリア上でスケジューリングエンティティと通信するための下位エンティティにおいて動作可能なワイヤレス通信の方法であって、前記方法は、
第1のサブフレームのACK部分において第1の肯定応答(ACK)/否定応答(NACK)情報を前記第1のサブフレームにおいて受信されたデータ情報を誤り検査したことに基づいて送信するステップと、
第2のサブフレームの基準信号部分において基準信号を受信するステップであって、前記基準信号部分の期間が、前記第2のサブフレーム内のフルシンボルの期間よりも短い、ステップと、
前記第2のサブフレームの前記基準信号部分の後にある前記第2のサブフレームの制御情報部分において制御情報を受信するステップであって、前記制御情報部分の期間が、前記第2のサブフレーム内のフルシンボルの前記期間よりも短い、ステップと
を備える、方法。 - 前記第2のサブフレームの前記基準信号部分の期間が、前記第2のサブフレームの前記制御情報部分の期間とは異なる、請求項7に記載の方法。
- 前記第2のサブフレームの前記基準信号部分が第1の巡回プレフィックス(CP)を備え、前記第2のサブフレームの前記制御情報部分が第2のCPを備える、請求項7に記載の方法。
- 前記制御情報が、前記第2のサブフレーム内のデータ情報に対応し、前記方法は、
前記第2のサブフレームのデータ部分において前記データ情報を受信するステップと、
前記第2のサブフレームのACK部分において第2のACK/NACK情報を送信するステップと
をさらに備え、
前記基準信号部分、前記制御情報部分、前記データ部分、および前記ACK部分が、同じ第2のサブフレームに含まれる、請求項7に記載の方法。 - 前記データ部分内の前記データ情報の少なくとも一部が、前記第2のサブフレーム内の前記フルシンボルの期間を有するシンボルを利用する、請求項10に記載の方法。
- 複数のサブフレームを含む時分割複信(TDD)キャリア上で、下位エンティティとスケジューリングエンティティとの間で通信するための、コンピュータ実行可能コードを記憶するコンピュータ可読記憶媒体であって、前記コンピュータ可読記憶媒体が、前記下位エンティティに、
サブフレームの制御部分において制御情報を受信することであって、前記制御情報が前記サブフレーム内のデータ情報に対応する、受信することと、
前記サブフレームのデータ部分において前記データ情報を受信することと、
前記データ情報を誤り検査したことに基づいて肯定応答(ACK)/否定応答(NACK)情報を決定することと、
前記サブフレームのACK部分において前記ACK/NACK情報を送信すること
をさせるための命令を含み、
前記制御部分、前記データ部分、および前記ACK部分が、同じサブフレームに含まれる、コンピュータ可読記憶媒体。 - 前記コンピュータ可読記憶媒体が、前記下位エンティティに、
前記サブフレームのパイロット部分においてパイロット信号を送信すること
をさせるための命令をさらに含み、
前記ACK部分が、前記サブフレームの前記パイロット部分の後にある、請求項12に記載のコンピュータ可読記憶媒体。 - 前記サブフレームの前記パイロット部分の期間、および前記サブフレームの前記ACK部分の期間は、各々が、前記サブフレーム内のフルシンボルの期間よりも短く、前記サブフレームの前記パイロット部分の期間が、前記サブフレームの前記ACK部分の期間とは異なる、請求項13に記載のコンピュータ可読記憶媒体。
- 前記データ部分内の前記データ情報の少なくとも一部が、前記サブフレーム内のフルシンボルの期間を有するシンボルを利用する、請求項14に記載のコンピュータ可読記憶媒体。
- 前記パイロット部分が第1の巡回プレフィックス(CP)を備え、前記ACK部分が第2のCPを備える、請求項13に記載のコンピュータ可読記憶媒体。
- 前記サブフレームが、前記データ部分の後かつ前記パイロット部分の前にガード期間部分を備え、
前記ガード期間部分と前記パイロット部分との合計期間が、前記サブフレーム内のフルシンボルの概算期間以上である、
前記ガード期間部分の期間が、前記下位エンティティと前記スケジューリングエンティティとの間のover-the-air(OTA)遅延に基づく、または、
前記ガード期間部分の期間が、前記サブフレーム内のフルシンボル期間よりも短い
うちの少なくとも1つである、請求項13に記載のコンピュータ可読記憶媒体。 - 複数のサブフレームを含む時分割複信(TDD)キャリア上で、下位エンティティとスケジューリングエンティティとの間で通信するための、コンピュータ実行可能コードを記憶するコンピュータ可読記憶媒体であって、前記コンピュータ可読記憶媒体が、前記下位エンティティに、
第1のサブフレームのACK部分において第1の肯定応答(ACK)/否定応答(NACK)情報を前記第1のサブフレームにおいて受信されたデータ情報を誤り検査したことに基づいて送信することと、
第2のサブフレームの基準信号部分において基準信号を受信することであって、前記基準信号部分の期間が、前記第2のサブフレーム内のフルシンボルの期間よりも短い、受信することと、
前記第2のサブフレームの前記基準信号部分の後にある前記第2のサブフレームの制御情報部分において制御情報を受信することであって、前記制御情報部分の期間が、前記第2のサブフレーム内のフルシンボルの前記期間よりも短い、受信することと
をさせるための命令を含む、コンピュータ可読記憶媒体。 - 前記第2のサブフレームの前記基準信号部分の期間が、前記第2のサブフレームの前記制御情報部分の期間とは異なる、請求項18に記載のコンピュータ可読記憶媒体。
- 前記第2のサブフレームの前記基準信号部分が第1の巡回プレフィックス(CP)を備え、前記第2のサブフレームの前記制御情報部分が第2のCPを備える、請求項18に記載のコンピュータ可読記憶媒体。
- 前記制御情報が、前記第2のサブフレーム内のデータ情報に対応し、前記コンピュータ実行可能コードが、前記下位エンティティに、
前記第2のサブフレームのデータ部分において前記データ情報を受信することと、
前記第2のサブフレームのACK部分において第2のACK/NACK情報を送信することと
をさせるための命令をさらに含み、
前記基準信号部分、前記制御情報部分、前記データ部分、および前記ACK部分が、同じ第2のサブフレームに含まれる、請求項18に記載のコンピュータ可読記憶媒体。 - 前記データ部分内の前記データ情報の少なくとも一部が、前記第2のサブフレーム内の前記フルシンボルの期間を有するシンボルを利用する、請求項21に記載のコンピュータ可読記憶媒体。
- 複数のサブフレームを含む時分割複信(TDD)キャリア上でのスケジューリングエンティティとのワイヤレス通信のために構成される、下位エンティティであって、前記下位エンティティは、
プロセッサと、
前記プロセッサに通信可能に結合されたメモリと、
前記プロセッサに通信可能に結合されたトランシーバと
を備え、
前記プロセッサが、
サブフレームの制御部分において制御情報を受信することであって、前記制御情報が前記サブフレーム内のデータ情報に対応する、受信することと、
前記サブフレームのデータ部分において前記データ情報を受信することと、
前記データ情報を誤り検査したことに基づいて肯定応答(ACK)/否定応答(NACK)情報を決定することと、
前記サブフレームのACK部分において前記ACK/NACK情報を送信すること
を行うように構成され、
前記制御部分、前記データ部分、および前記ACK部分が、同じサブフレームに含まれる、下位エンティティ。 - 前記プロセッサが、
前記サブフレームのパイロット部分においてパイロット信号を送信すること
を行うようにさらに構成され、
前記ACK部分が、前記サブフレームの前記パイロット部分の後にある、請求項23に記載の下位エンティティ。 - 前記サブフレームの前記パイロット部分の期間、および前記サブフレームの前記ACK部分の期間は、各々が、前記サブフレーム内のフルシンボルの期間よりも短く、前記サブフレームの前記パイロット部分の期間が、前記サブフレームの前記ACK部分の期間とは異なる、請求項24に記載の下位エンティティ。
- 前記データ部分内の前記データ情報の少なくとも一部が、前記サブフレーム内のフルシンボルの期間を有するシンボルを利用する、請求項25に記載の下位エンティティ。
- 前記パイロット部分が第1の巡回プレフィックス(CP)を備え、前記ACK部分が第2のCPを備える、請求項24に記載の下位エンティティ。
- 前記サブフレームが、前記データ部分の後かつ前記パイロット部分の前にガード期間部分を備え、
前記ガード期間部分と前記パイロット部分との合計期間が、前記サブフレーム内のフルシンボルの概算期間以上である、
前記ガード期間部分の期間が、前記下位エンティティと前記スケジューリングエンティティとの間のover-the-air(OTA)遅延に基づく、または、
前記ガード期間部分の期間が、前記サブフレーム内のフルシンボル期間よりも短い
うちの少なくとも1つである、請求項24に記載の下位エンティティ。 - 複数のサブフレームを含む時分割複信(TDD)キャリア上でのスケジューリングエンティティとのワイヤレス通信のために構成される、下位エンティティであって、前記下位エンティティは、
プロセッサと、
前記プロセッサに通信可能に結合されたメモリと、
前記プロセッサに通信可能に結合されたトランシーバと
を備え、
前記プロセッサが、
第1のサブフレームのACK部分において第1の肯定応答(ACK)/否定応答(NACK)情報を前記第1のサブフレームにおいて受信されたデータ情報を誤り検査したことに基づいて送信することと、
第2のサブフレームの基準信号部分において基準信号を受信することであって、前記基準信号部分の期間が、前記第2のサブフレーム内のフルシンボルの期間よりも短い、受信することと、
前記第2のサブフレームの前記基準信号部分の後にある前記第2のサブフレームの制御情報部分において制御情報を受信することであって、前記制御情報部分の期間が、前記第2のサブフレーム内のフルシンボルの前記期間よりも短い、受信することと
を行うように構成される、下位エンティティ。 - 前記第2のサブフレームの前記基準信号部分の期間が、前記第2のサブフレームの前記制御情報部分の期間とは異なる、請求項29に記載の下位エンティティ。
- 前記第2のサブフレームの前記基準信号部分が第1の巡回プレフィックス(CP)を備え、前記第2のサブフレームの前記制御情報部分が第2のCPを備える、請求項29に記載の下位エンティティ。
- 前記制御情報が、前記第2のサブフレーム内のデータ情報に対応し、前記プロセッサが
前記第2のサブフレームのデータ部分において前記データ情報を受信することと、
前記第2のサブフレームのACK部分において第2のACK/NACK情報を送信することとを行うようにさらに構成され、
前記基準信号部分、前記制御情報部分、前記データ部分、および前記ACK部分が、同じ第2のサブフレームに含まれる、請求項29に記載の下位エンティティ。 - 前記データ部分内の前記データ情報の少なくとも一部が、前記第2のサブフレーム内の前記フルシンボルの期間を有するシンボルを利用する、請求項32に記載の下位エンティティ。
Applications Claiming Priority (4)
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