JP6433966B2 - Information processing apparatus, information processing method, and program - Google Patents

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Description

本発明は、情報処理装置、情報処理方法、およびプログラムに関する。   The present invention relates to an information processing apparatus, an information processing method, and a program.

近年、パーソナルコンピュータ(PC)を始めとする情報処理装置では、装置そのものに音楽を録音、再生することができる機能、ゲームをすることができる機能など多種多様な機能が備えられている。また、情報処理装置のコストダウンを目的として、搭載部品自体の形状変更が進み、M/B(マザーボード)上のハードウェアの構成自体も実に多様に変化している。   In recent years, information processing apparatuses such as personal computers (PCs) are provided with various functions such as a function for recording and reproducing music and a function for playing games. In addition, for the purpose of reducing the cost of the information processing apparatus, the shape of the mounted component itself has been changed, and the hardware configuration itself on the M / B (motherboard) has also changed in various ways.

M/B上に多種多様なハードウェアを備える情報処理装置の開発試作において、新たなハードウェアをM/B上に搭載される時には、予めコンピュータに備えられているCPU(Central Processing Unit)、メモリ、キーボードやマウス等の入出力装置等との動作を制御するためのプログラムであるBIOS(Basic Input / Output System)に基づいた動作確認作業が欠かせない。この動作確認作業は、情報処理装置の電源投入時に起動されるBIOSが、接続デバイスにアクセスすることで機能の初期化をするPOST(Power On Self Test)を実行することで実現される。   In the development and prototyping of an information processing apparatus having a variety of hardware on the M / B, when new hardware is installed on the M / B, a CPU (Central Processing Unit) and memory provided in the computer in advance In addition, an operation confirmation work based on BIOS (Basic Input / Output System) which is a program for controlling operations with input / output devices such as a keyboard and a mouse is indispensable. This operation check operation is realized by executing a POST (Power On Self Test) in which the BIOS activated when the information processing apparatus is powered on initializes the function by accessing the connected device.

POSTを実行することで、ハードウェアとコンピュータの組み合わせに問題が無いかを処理内容に関連する情報としてユーザが目視できる形で出力される。この時に出力される情報をBIOS POST CODEと呼び、開発者はこのBIOS POST CODEの出力を確認することで、どのような問題が生じているかを確認することが可能となる。   By executing POST, whether or not there is a problem in the combination of hardware and computer is output in a form that can be visually recognized by the user as information related to the processing content. The information output at this time is called BIOS POST CODE, and the developer can confirm what kind of problem is occurring by confirming the output of the BIOS POST CODE.

従来、このBIOS POST CODEを確認する方法として、特許文献1に記載されているように、M/B上にCPUとチップセットとに接続された7セグメントユニットにBIOS POST CODEを出力させる方法が公開されている。更に7セグメントユニットに代わって専用のデバックカードなどを接続させてBIOS POST CODEを出力させるなどの方法も提案されており、上記2つの方法のいずれかでBIOSの処理内容を確認することが一般的であった。   Conventionally, as a method for confirming the BIOS POST CODE, as disclosed in Patent Document 1, a method of outputting the BIOS POST CODE to a 7-segment unit connected to a CPU and a chip set on an M / B is disclosed. Has been. In addition, a method has been proposed in which a dedicated debug card is connected in place of the 7-segment unit and BIOS POST CODE is output, and it is common to check the BIOS processing contents by one of the above two methods. Met.

しかし、従来のように7セグメントユニット、もしくは専用のデバックカードなどで確認するためには、7セグメントユニット、もしくは専用のデバックカードをM/Bを配置するためのスペースの確保が必要となる。近年ではパーソナルコンピュータを始めとする情報処理装置は小型化、そして上記に記したよう機能の多様化が求められている中で、7セグメントユニット、もしくは専用のデバックカードを配置するためのスペースを確保することは難しくなっている。   However, in order to confirm with a 7-segment unit or a dedicated debug card as in the prior art, it is necessary to secure a space for arranging the M / B on the 7-segment unit or the dedicated debug card. In recent years, as information processing devices such as personal computers are required to be downsized and diversified in function as described above, a space for arranging a 7-segment unit or a dedicated debug card is secured. It's getting harder to do.

特開2001−331342号公報JP 2001-331342 A

本発明は、このような実情に鑑みてなされたものであって、専用のデバイスを備えること無しに、BIOSの処理内容の確認を行うことを可能とさせる情報処理装置、および埋め込みコントローラを提供することを目的とする。   The present invention has been made in view of such circumstances, and provides an information processing apparatus and an embedded controller that enable confirmation of the processing contents of a BIOS without providing a dedicated device. For the purpose.

本発明に係る情報処理装置は、CPU(Central Processing Unit)と、CPUに接続されたチップセットと、CPUがBIOS(Basic Input / Output System)に基づいてPOST(Power On Self Test)を実行し、逐次出力される処理結果を、チップセットに接続されたバスを介して取得する埋め込みコントローラ(EC)と、埋め込みコントローラと接続されている入力デバイスと、を備え、埋め込みコントローラは、逐次出力される処理結果のうち、直近の処理結果を記憶する第1の記憶手段と、入力デバイスに対する所定の入力操作により発せられた信号を検出するトリガー検出手段と、信号の検出に基づいて、直近の処理結果を不揮発に記憶する第2の記憶手段と、を有する、ことを特徴とする。   An information processing apparatus according to the present invention includes a CPU (Central Processing Unit), a chip set connected to the CPU, and the CPU executes POST (Power On Self Test) based on BIOS (Basic Input / Output System). The embedded controller includes an embedded controller (EC) that acquires processing results that are sequentially output via a bus connected to the chipset, and an input device that is connected to the embedded controller. Of the results, the first storage means for storing the latest processing result, the trigger detection means for detecting a signal generated by a predetermined input operation on the input device, and the latest processing result based on the detection of the signal. And second storage means for storing in a nonvolatile manner.

本発明に係る情報処理を実現させるための方法は、CPU(Central Processing Unit)がBIOS(Basic Input / Output System)に基づいてPOST(Power On Self Test)を実行し、逐次出力される処理結果を取得し、逐次出力される処理結果のうち、直近の処理結果を記憶するステップと、外部の入力デバイスにより発せられた信号を検出するステップと、信号の検出に基づいて、直近の処理結果を不揮発に記憶するステップと、を有する、ことを特徴とする。   In the method for realizing information processing according to the present invention, a CPU (Central Processing Unit) executes POST (Power On Self Test) based on BIOS (Basic Input / Output System), and sequentially outputs processing results. Of the processing results obtained and sequentially output, the step of storing the latest processing result, the step of detecting a signal emitted by an external input device, and the non-volatile processing result of the latest processing based on the detection of the signal And storing the data in a memory.

本発明に係る情報処理を実現させるためのプログラムは、CPU(Central Processing Unit)がBIOS(Basic Input / Output System)に基づいてPOST(Power On Self Test)を実行し、逐次出力される処理結果を取得し、逐次出力される処理結果のうち、直近の処理結果を記憶する処理と、外部の入力デバイスにより発せられた信号を検出する処理と、信号の検出に基づいて、直近の処理結果を不揮発に記憶する処理と、をコンピュータに実行させる、ことを特徴とする。   A program for realizing information processing according to the present invention is a CPU (Central Processing Unit) that executes POST (Power On Self Test) based on BIOS (Basic Input / Output System), and displays processing results that are sequentially output. Of the processing results that are acquired and output sequentially, the most recent processing result is stored, the processing that detects the signal emitted by the external input device, and the detection of the most recent processing result based on the signal detection And storing the data in a computer.

本発明によれば、確認用のデバイスを備えること無しに、BIOSの処理内容の確認を行うことが可能となる。   According to the present invention, it is possible to confirm the processing contents of the BIOS without providing a confirmation device.

本発明の実施形態にかかる情報処理装置1のハードウェア構成図である。It is a hardware block diagram of the information processing apparatus 1 concerning embodiment of this invention. 本発明の実施形態にかかる情報処理装置1の機能ブロック図である。It is a functional block diagram of information processor 1 concerning an embodiment of the present invention. 本発明の実施形態にかかるBIOS処理内容、およびBIOS POST CODEの一例である。It is an example of the BIOS processing content and BIOS POST CODE concerning embodiment of this invention. 本発明の実施形態にかかるBIOS POST CODE確認の一例である。It is an example of BIOS POST CODE confirmation concerning embodiment of this invention. 本発明の実施形態にかかるフローチャートの一例である。It is an example of the flowchart concerning embodiment of this invention.

以下、本発明の実施の形態について詳細に説明する。   Hereinafter, embodiments of the present invention will be described in detail.

まず、本実施形態の情報処理装置1のハードウェア構成について図1を用いて説明する。ここでの情報処理装置とは、例えばパーソナルコンピュータ、タブレット端末、スマートフォンなどのネットワークに接続が可能な情報端末、プリンター、FAXなどの画像形成装置などM/B(マザーボード)上に制御機能を有するコンピュータ全般が対象となる。また、複数のコンピュータにネットワークを通じて処理要求を行うホストコンピュータやサーバなどであっても良い。尚、情報処理装置1の構成は、図1に示したものと必ずしも同じである必要はなく、本実施形態を実現できるハードウェアを備えていればそれで十分である。例えば、埋め込みコントローラ13に内蔵されているメモリ1301、および通信I/F17は必須の構成ではない。更にCD、もしくはDVDなどに記憶されているデータを読み書きする光学ドライブなどを追加で備えていてもよい。   First, the hardware configuration of the information processing apparatus 1 according to the present embodiment will be described with reference to FIG. Here, the information processing apparatus is a computer having a control function on an M / B (mother board) such as an information terminal that can be connected to a network such as a personal computer, a tablet terminal, or a smartphone, an image forming apparatus such as a printer, a FAX, or the like. General. Further, it may be a host computer or a server that requests processing to a plurality of computers through a network. Note that the configuration of the information processing apparatus 1 is not necessarily the same as that shown in FIG. 1, and it is sufficient if it has hardware capable of realizing the present embodiment. For example, the memory 1301 and the communication I / F 17 built in the embedded controller 13 are not essential components. Furthermore, an optical drive that reads and writes data stored on a CD or DVD may be additionally provided.

情報処理装置1は、所定のプログラムを実行することにより、情報処理装置1の全体の制御を実現するためのCPU10と、情報処理装置1の電源が投入されたときにCPU10が読出すプログラムを記憶する読出専用の不揮発メモリであるマスクROM、EPROM、またはSSDなどと、CPU10がプログラムを読み出し、演算処理等により生成したデータを一時的に書き込む作業用の揮発メモリであるSRAMやDRAMなどから構成されるメインメモリ11、CPU10と接続され、コンピュータの機能の動作を制御するチップセット12、情報処理装置1固有のシーケンスや機能を制御する埋め込みコントローラ13、マウスや入力キーで構成されるキーボードなどの入力デバイス14、プロジェクター、もしくは液晶、および有機ELなどのパネルを用いたディスプレイを備えた表示装置15、情報処理装置1の電源が切断されたときに種々のデータの記録を保持することが可能なHDD16と、を備えており、これらはチップセット12と接続されている。   The information processing apparatus 1 stores a program that is read by the CPU 10 when the power of the information processing apparatus 1 is turned on by executing a predetermined program to realize overall control of the information processing apparatus 1. It consists of mask ROM, EPROM, SSD, etc., which are read-only non-volatile memories, and SRAM, DRAM, etc., which are volatile memories for work in which the CPU 10 reads the program and temporarily writes data generated by arithmetic processing, etc. Main memory 11 connected to CPU 10, chipset 12 that controls the operation of the functions of the computer, embedded controller 13 that controls the sequence and functions unique to information processing device 1, input such as a keyboard composed of a mouse and input keys Device 14, projector or liquid crystal, and A display device 15 having a display using a panel such as a machine EL, and an HDD 16 capable of holding various data records when the information processing device 1 is powered off. It is connected to the chip set 12.

また、情報処理装置1は、通信I/F17を更に備えている。情報処理装置1は通信I/F17を介してネットワーク200に接続されている。通信I/F17は、CPU10の動作に基づいてネットワーク200経由でアクセス可能な各種情報にアクセスするものであり、通信I/F17の具体的としてUSBポートやLANポート、無線LANポートなどがあり、外部の機器とデータの送受信が行えればどのようなものでも構わない。   The information processing apparatus 1 further includes a communication I / F 17. The information processing apparatus 1 is connected to the network 200 via the communication I / F 17. The communication I / F 17 accesses various types of information accessible via the network 200 based on the operation of the CPU 10. Specific examples of the communication I / F 17 include a USB port, a LAN port, and a wireless LAN port. Any device can be used as long as data can be transmitted / received to / from the device.

CPU10とチップセット12との接続方式の一例としてDMI
(Direct Media Interface)があるが、この限りではない。また、チップセット12の構成に関しても、ノースブリッジとサウスブリッジを有する2チップ構成に限定されず、1チップの構成であってもよい。
DMI as an example of a connection method between the CPU 10 and the chipset 12
(Direct Media Interface), but not limited to this. Further, the configuration of the chip set 12 is not limited to the two-chip configuration having the north bridge and the south bridge, and may be a one-chip configuration.

不揮発メモリ18にBIOSが格納されており、CPU10の動作に基づいてBIOSが読み出される。BIOSの処理内容の一例を図3として示す。BIOSは図3のように実行処理内容にそれぞれコード(以下、BIOS POST CODEと表記)が関連付けられている。例えばBIOS POST CODEが「32」であれば、その処理内容は「CPUポストメモリー初期化が開始される。」であり、処理を実行し、問題無ければ次のコード「33」の処理を実行する。   The BIOS is stored in the nonvolatile memory 18, and the BIOS is read based on the operation of the CPU 10. An example of the processing contents of the BIOS is shown in FIG. As shown in FIG. 3, the BIOS is associated with a code (hereinafter referred to as BIOS POST CODE) in association with the execution processing contents. For example, if the BIOS POST CODE is “32”, the processing content is “CPU post-memory initialization is started”, and the processing is executed. If there is no problem, the processing of the next code “33” is executed. .

埋め込みコントローラ13は、情報処理装置1固有のシーケンスや機能の制御、および情報処理装置1に備えられている各デバイスへの電力供給制御等も行う。本実施形態では、CPU10とチップセット12によるBIOSの実行(POST)によりチップセット12から出力された処理結果を、LPC Bus20を介して取得して記憶する機能も有する。   The embedded controller 13 also performs control of sequences and functions unique to the information processing apparatus 1 and control of power supply to each device provided in the information processing apparatus 1. In the present embodiment, the CPU 10 and the chip set 12 also have a function of acquiring and storing the processing result output from the chip set 12 through the BIOS execution (POST) via the LPC Bus 20.

図2は、本発明の実施形態にかかる情報処理装置1の機能ブロック図である。図2に示すように、本発明にかかる情報処理装置1は、第1の記憶手段100と、トリガー検出手段101と、第2の記憶手段102と、を備えている。   FIG. 2 is a functional block diagram of the information processing apparatus 1 according to the embodiment of the present invention. As shown in FIG. 2, the information processing apparatus 1 according to the present invention includes a first storage unit 100, a trigger detection unit 101, and a second storage unit 102.

情報処理装置1の第1の記憶手段100は、埋め込みコントローラ13により、チップセット12から出力されたBIOSの実行(POST)による処理結果を取得し、取得した処理結果を、一時的に記憶する。埋め込みコントローラ13は、自身が備えている制御装置(図示せず)に基づいて、CPU10とチップセット12によるBIOSの実行をモニターし、チップセット12よりBIOSの処理結果が逐次出力され、出力された処理結果をLPC Bus20を介して取得する。取得した処理結果のうち、直近の処理結果を揮発性のメモリに記憶する。揮発性のメモリは埋め込みコントローラ13自身が備えているものでもよいし、埋め込みコントローラ13がアクセス可能であればその他のメモリでもよい。データ量の都合上、直近の処理結果を記憶するために、所定の時間間隔を設け、その
時間間隔の中で取得した処理結果のうち、最新の処理結果を常時上書きするよう処理をすることが好ましい。
The first storage unit 100 of the information processing apparatus 1 acquires the processing result by the BIOS execution (POST) output from the chipset 12 by the embedded controller 13 and temporarily stores the acquired processing result. The embedded controller 13 monitors the execution of the BIOS by the CPU 10 and the chipset 12 based on a control device (not shown) provided therein, and the BIOS processing results are sequentially output from the chipset 12 and output. The processing result is acquired via the LPC Bus 20. Of the acquired processing results, the latest processing result is stored in a volatile memory. The volatile memory may be provided in the embedded controller 13 itself, or may be another memory as long as the embedded controller 13 can access it. Due to the amount of data, a predetermined time interval may be provided to store the latest processing result, and the latest processing result among the processing results obtained during the time interval may be overwritten at all times. preferable.

情報処理装置1の第1の記憶手段100は、埋め込みコントローラ13が取得したBIOSの実行による処理結果を、埋め込みコントローラ13が所定の揮発性メモリに記憶するよう処理することで実現が可能である。   The first storage unit 100 of the information processing apparatus 1 can be realized by processing the processing result obtained by executing the BIOS acquired by the embedded controller 13 so that the embedded controller 13 stores the result in a predetermined volatile memory.

情報処理装置1のトリガー検出手段101は、埋め込みコントローラ13により、入力デバイス14に対する所定の入力操作により発せられた信号を検出する。入力デバイス14は、例えばマウスや入力キーで構成されるキーボードであり、埋め込みコントローラ13と接続可能であれば、スイッチ、ゲームコントローラなどでもよい。   The trigger detection unit 101 of the information processing apparatus 1 detects a signal generated by a predetermined input operation on the input device 14 by the embedded controller 13. The input device 14 is a keyboard composed of, for example, a mouse and input keys, and may be a switch, a game controller, or the like as long as it can be connected to the embedded controller 13.

ユーザが入力デバイス14に対して所定の入力操作を行う。所定の入力操作は、入力デバイス14ごとにそれぞれ定めることができる。例えばマウスであれば「右クリック1回と左クリック2回」など、キーボードであれば「1♯4%6¥を同時に入力」などを一例として設定することができる。   The user performs a predetermined input operation on the input device 14. The predetermined input operation can be determined for each input device 14. For example, “right click once and left click twice” can be set for a mouse, and “1 # 4% 6 ¥ can be input simultaneously” can be set as an example.

情報処理装置1がCPU10とチップセット12によりBIOSを実行(POST)している場合、ユーザである開発者が現在のBIOSの実行状況を確認したい時などに上記のように入力デバイス14に対して入力操作を行う。入力デバイス14に所定の入力操作が実行されると、入力デバイス14から出力された信号を埋め込みコントローラ13がトリガーとして検出する。   When the information processing apparatus 1 executes the BIOS by the CPU 10 and the chipset 12 (POST), when the developer as a user wants to check the current execution status of the BIOS, the input device 14 is as described above. Perform input operations. When a predetermined input operation is performed on the input device 14, the embedded controller 13 detects a signal output from the input device 14 as a trigger.

尚、トリガーとして検出する所定の入力操作は、予め埋め込みコントローラ13の制御装置に格納されているプログラムで規定するか、もしくは情報処理装置1のメインメモリ11に格納されているプログラムで規定されていてもよい。   The predetermined input operation detected as a trigger is defined by a program stored in the control device of the embedded controller 13 in advance or by a program stored in the main memory 11 of the information processing device 1. Also good.

情報処理装置1のトリガー検出手段101は、入力デバイス14に入力操作されることで出力された信号を、埋め込みコントローラ13が自身の入出力I/Fを介して受信することで実現が可能である。   The trigger detection unit 101 of the information processing apparatus 1 can be realized when the embedded controller 13 receives a signal output by an input operation of the input device 14 via its input / output I / F. .

情報処理装置1の第2の記憶手段102は、埋め込みコントローラ13により、入力デバイス14から受信した信号の検出に基づいて、BIOSの実行による直近の処理結果を不揮発に記憶する。ここでは、埋め込みコントローラ13が自身で備える不揮発メモリであるメモリ1301にBIOSの実行による直近の処理結果を記憶する場合を考える。   The second storage unit 102 of the information processing apparatus 1 stores the latest processing result by the execution of the BIOS in a nonvolatile manner based on the detection of the signal received from the input device 14 by the embedded controller 13. Here, a case is considered in which the latest processing result obtained by executing the BIOS is stored in the memory 1301, which is a nonvolatile memory included in the embedded controller 13 itself.

埋め込みコントローラ13は、チップセット12から出力されたBIOSの実行処理を取得し、取得した処理結果のうち、直近の処理結果を所定の揮発性メモリに記憶することは上述した通りである。トリガー検出手段101により、入力デバイス14から信号を検出したときに、埋め込みコントローラ13は、信号をトリガーとして検出した時点での揮発性メモリに記憶されているBIOSの直近の処理結果を読み出し、読み出した処理結果を不揮発性のメモリであるメモリ1301に記憶する。このようにBIOSの処理結果を不揮発に記憶することで、ユーザ、つまり開発者が確認を行いたいタイミングでBIOSの実行処理状況を記憶することが可能となる。   As described above, the embedded controller 13 acquires the execution processing of the BIOS output from the chipset 12 and stores the latest processing result in the predetermined volatile memory among the acquired processing results. When the trigger detection unit 101 detects a signal from the input device 14, the embedded controller 13 reads and reads the latest processing result of the BIOS stored in the volatile memory when the signal is detected as a trigger. The processing result is stored in the memory 1301 which is a nonvolatile memory. By storing the BIOS processing result in a nonvolatile manner in this way, it is possible to store the execution processing status of the BIOS at a timing when the user, that is, the developer wants to confirm.

尚、埋め込みコントローラ13は、自身がアクセス可能な不揮発性メモリを外部に備えていれば、自身がBIOSの直近の処理結果を記憶するための不揮発性メモリを備えていなくてもよい。   Note that the embedded controller 13 may not include a nonvolatile memory for storing the latest processing result of the BIOS as long as the embedded controller 13 includes a nonvolatile memory accessible to the embedded controller 13 outside.

情報処理装置1の第2の記憶手段102は、埋め込みコントローラ13により、入力デバイス14から受信したトリガーとしての信号の検出に基づいて、BIOSの実行による直近の処理結果を所定の不揮発性メモリに記憶することで実現が可能である。   The second storage unit 102 of the information processing apparatus 1 stores the latest processing result by the execution of the BIOS in a predetermined nonvolatile memory based on the detection of a signal as a trigger received from the input device 14 by the embedded controller 13. This is possible.

以上のような構成により、ユーザ、つまり開発者が、自身がBIOSの実行処理を確認したいタイミングでのBIOSの処理結果を記憶することが可能となる。不揮発に記憶されたBIOSの処理結果は、例えば一度情報処理装置1の電源を落としても記憶されているため、ユーザが確認したいタイミングで読み出して確認することが可能となる。   With the configuration as described above, the user, that is, the developer, can store the BIOS processing result at the timing at which the user wants to confirm the BIOS execution processing. Since the BIOS processing result stored in the nonvolatile manner is stored even if the information processing apparatus 1 is turned off, for example, it can be read and confirmed at a timing that the user wants to confirm.

ユーザが不揮発に記憶したBIOSの直近の処理結果を読み出して確認する場合を考えてみる。BIOSの処理結果の表示は、例えば表示装置15を用いることができる。情報処理装置1が例えばパーソナルコンピュータなどの通信端末とした場合、OSに埋め込みコントローラ13を動作させるツールとしてのアプリケーションを備えておき、アプリケーションの表示画面を表示装置15などに表示し、表示画面内での操作に基づいて出力表示を実行することで、記憶したBIOSの直近の処理結果を読み出す。   Consider a case where the user reads and confirms the latest processing result of the BIOS stored in a nonvolatile manner. For example, the display device 15 can be used to display the BIOS processing result. When the information processing apparatus 1 is a communication terminal such as a personal computer, an application as a tool for operating the embedded controller 13 is provided in the OS, and a display screen of the application is displayed on the display device 15 or the like. By executing the output display based on the above operation, the latest processing result of the stored BIOS is read out.

表示装置15により読み出されたBIOSの処理結果を図4として示す。図4は図3と同様に、実行処理内容にそれぞれBIOS POST CODEが関連付けられたものであり、「実行フラグ」としてそれぞれ〇、×として評価したものである。ここでは、BIOS POST CODEが「33」の処理に問題があり、実行フラグが×と評価されたBIOSの直近の処理結果を読み出されたものとしている。このようにして、ユーザは問題の発生した処理内容を確認することが可能となる。尚、問題の発生したBIOS POST CODEの表記は、上記のような実行フラグによる判定に限定されず、例えばBIOS POST CODEの文字の色や形を変えて表記したり、ポップアップなどで「エラーが発生しました BIOS POST CODE「△△」」などとしてもよい。ユーザが、「どの処理でエラーが発生している」かの確認ができれば表記はどのようにしてもよい。   FIG. 4 shows a BIOS processing result read by the display device 15. FIG. 4 is similar to FIG. 3 in which the BIOS POST CODE is associated with the execution process contents, and evaluated as “O” and “X” as “execution flags”. Here, it is assumed that there is a problem in the process with the BIOS POST CODE “33” and the latest process result of the BIOS whose execution flag is evaluated as “x” has been read. In this way, the user can confirm the processing content in which the problem has occurred. The BIOS POST CODE in which the problem has occurred is not limited to the determination by the execution flag as described above. For example, the BIOS POST CODE may be described by changing the color or shape of the character of the BIOS POST CODE, or a pop-up etc. It is good also as BIOS POST CODE "△△". As long as the user can confirm “in which process an error has occurred”, the notation may be changed.

図5は、本発明の実施形態にかかるフローチャートの一例である。   FIG. 5 is an example of a flowchart according to the embodiment of the present invention.

まず、チップセット12より逐次出力されるBIOSの処理結果を取得する(ステップ1)。   First, a BIOS processing result sequentially output from the chipset 12 is acquired (step 1).

取得されたBIOSの処理結果のうち、直近の処理結果を揮発性のメモリに記憶する(ステップ2)。入力デバイス14からトリガー信号が検出されたか否かを確認する(ステップ3)。入力デバイス14からトリガー信号が検出された場合、直近の処理結果を不揮発性のメモリに記憶する(ステップ4)。入力デバイス14からトリガー信号が検出されなければステップ2からの処理を引き続き行う。   Of the obtained BIOS processing results, the latest processing results are stored in a volatile memory (step 2). It is confirmed whether or not a trigger signal is detected from the input device 14 (step 3). When a trigger signal is detected from the input device 14, the latest processing result is stored in a nonvolatile memory (step 4). If no trigger signal is detected from the input device 14, the processing from step 2 is continued.

以上のように、本実施形態では、予め備えられている埋め込みコントローラ13の動作に基づいて、7セグメントユニットや専用のデバックカードを備えることなく、BIOSの実行による処理結果を記憶することが可能となる。7セグメントユニットや専用のデバックカードを用いる必要が無いため、コスト面で非常にメリットがある。そして、M/B上に上記パーツを備えるスペースを必要としないため、装置自体の小型化、およびM/Bのスペースの有効活用に繋げることが可能となる。   As described above, in the present embodiment, based on the operation of the embedded controller 13 provided in advance, it is possible to store the processing result by the execution of the BIOS without providing a 7-segment unit or a dedicated debug card. Become. Since there is no need to use a 7-segment unit or a dedicated debug card, there is a great merit in terms of cost. And since the space provided with the said parts on M / B is not required, it becomes possible to lead to size reduction of an apparatus itself and effective utilization of the space of M / B.

また、本実施形態では、チップセット12と埋め込みコントローラ13がLPC Bus
20を介して接続されているため、埋め込みコントローラ13以外のデバイスなどの影響による動作の不具合が発生している場合であっても、埋め込みコントローラ13がチップセット12より逐次出力されるBIOSの処理結果を、他のデバイスにより生じた動作の不具合の影響を受けることなく取得できる構成を実現している。
In this embodiment, the chip set 12 and the embedded controller 13 are connected to the LPC Bus.
20, the BIOS processing result that the embedded controller 13 sequentially outputs from the chipset 12 even when an operation failure due to the influence of devices other than the embedded controller 13 occurs. Can be obtained without being affected by malfunctions in operation caused by other devices.

尚、本実施形態の他の実施形態として、埋め込みコントローラ13により不揮発に記憶されたBIOSの直近の処理結果を、自身の情報処理装置1だけでなく、ネットワーク200により接続されており、埋め込みコントローラ13にアクセスできるよう接続されていれば他の装置から読み出し出力表示するような構成も可能である。従来のように自身の装置の7セグメントユニットや専用のデバックカードなどで表示するものではなく、BIOSの処理結果をデータとして記憶するため、自装置以外の他の装置からでも確認できる点でも有用であると言える。   As another embodiment of the present embodiment, the latest processing result of the BIOS stored in a nonvolatile manner by the embedded controller 13 is connected not only by the information processing apparatus 1 but also by the network 200, and the embedded controller 13 If it is connected so that it can be accessed, it can be configured to read out and display from another device. It is not displayed on the 7-segment unit of its own device or a dedicated debugging card as in the past, but is also useful in that it can be confirmed from other devices other than its own device because the BIOS processing result is stored as data. It can be said that there is.

本願発明を実現できるような構成であれば、用いる装置の具備する内容、および装置の数量などは本実施形態に限定されない。   As long as the present invention can be realized, the content of the device used, the number of devices, and the like are not limited to the present embodiment.

100 第1の記憶手段
101 トリガー検出手段
102 第2の記憶手段
100 First storage means 101 Trigger detection means 102 Second storage means

Claims (7)

CPU(Central Processing Unit)と、
前記CPUに接続されたチップセットと、
前記CPUがBIOS(Basic Input / Output System)に基づいてPOST(Power On Self Test)を実行し、逐次出力される処理結果を、前記チップセットに接続されたバスを介して取得する埋め込みコントローラ(EC)と、
前記埋め込みコントローラと接続されている入力デバイスと、
を備え、
前記埋め込みコントローラは、
前記逐次出力される処理結果のうち、直近の処理結果を記憶する第1の記憶手段と、
前記入力デバイスに対する所定の入力操作により発せられた信号を検出するトリガー検出手段と、
前記信号の検出に基づいて、前記第1の記憶手段で記憶された前記直近の処理結果を読み出し、読み出した処理結果を不揮発に記憶する第2の記憶手段と、
を有する、
ことを特徴とする情報処理装置。
CPU (Central Processing Unit),
A chipset connected to the CPU;
The CPU executes POST (Power On Self Test) based on BIOS (Basic Input / Output System), and obtains processing results output sequentially through a bus connected to the chipset (EC )When,
An input device connected to the embedded controller;
With
The embedded controller is
A first storage means for storing the latest processing result among the processing results sequentially output;
Trigger detection means for detecting a signal emitted by a predetermined input operation on the input device;
Based on the detection of the signal, a second storage means for reading the latest processing result stored in the first storage means, and storing the read processing result in a nonvolatile manner;
Having
An information processing apparatus characterized by that.
前記第1の記憶手段は、前記直近の処理結果を、該EC自身が有する揮発性の第1のメモリに記憶する、
ことを特徴とする請求項1に記載の情報処理装置。
The first storage means stores the latest processing result in a volatile first memory included in the EC itself.
The information processing apparatus according to claim 1.
前記第2の記憶手段は、前記信号の検出に基づいて、前記直近の処理結果を、該EC自身が有する不揮発性の第2のメモリに記憶する、
ことを特徴とする請求項1、又は2に記載の情報処理装置。
The second storage means stores the most recent processing result in a nonvolatile second memory included in the EC itself based on the detection of the signal.
The information processing apparatus according to claim 1 or 2.
前記不揮発に記憶された直近の処理結果を、所定のアクセスに基づいて読み出して出力する処理結果出力手段と、
前記読み出された直近の処理結果を、BIOS POST CODEと共に表示する表示手段と、
を更に備える、
ことを特徴とする請求項1から3のいずれか1項に記載の情報処理装置。
Processing result output means for reading out and outputting the latest processing result stored in the nonvolatile manner based on a predetermined access;
Display means for displaying the latest processing result read out together with the BIOS POST CODE;
Further comprising
The information processing apparatus according to claim 1, wherein the information processing apparatus is an information processing apparatus.
前記入力デバイスは、マウス、又はキーボードである、
ことを特徴とする請求項1から4のいずれか1項に記載の情報処理装置。
The input device is a mouse or a keyboard.
The information processing apparatus according to claim 1, wherein the information processing apparatus is an information processing apparatus.
埋め込みコントローラ(EC)を有する情報処理装置の情報処理方法であって、
前記埋め込みコントローラが、
CPU(Central Processing Unit)によりPOST(Power On Self Test)されたBIOS(Basic Input / Output System)の、逐次出力される処理結果を、バスを介して取得し、前記逐次出力される処理結果のうち、直近の処理結果を記憶する第1の記憶ステップと、
外部の入力デバイスにより発せられた信号を検出する検出ステップと、
前記信号の検出に基づいて、前記第1の記憶ステップで記憶された前記直近の処理結果を読み出し、読み出した処理結果を不揮発に記憶する第2の記憶ステップと、
を有する、
ことを特徴とする情報処理方法。
An information processing method for an information processing apparatus having an embedded controller (EC),
The embedded controller is
A serial output result of a BIOS (Basic Input / Output System) that is POST (Power On Self Test) by a CPU (Central Processing Unit) is acquired via the bus. A first storage step for storing the latest processing result;
A detection step for detecting a signal emitted by an external input device;
Based on the detection of the signal, the read out first of the last operation result stored in the storage step, a second storage step of storing the read processing result in a non-volatile,
Having
An information processing method characterized by the above.
情報処理装置に備えられた埋め込みコントローラ(EC)が実行するプログラムであって、
CPU(Central Processing Unit)によりPOST(Power On Self Test)されたBIOS(Basic Input / Output System)の、逐次出力される処理結果を、バスを介して取得し、前記逐次出力される処理結果のうち、直近の処理結果を記憶する第1の記憶処理と、
外部の入力デバイスにより発せられた信号を検出する検出処理と、
前記信号の検出に基づいて、前記第1の記憶処理で記憶された前記直近の処理結果を読み出し、読み出した処理結果を不揮発に記憶する第2の記憶処理と、
をコンピュータに実行させる、
ことを特徴とするプログラム。
A program executed by an embedded controller (EC) provided in the information processing apparatus,
A serial output result of a BIOS (Basic Input / Output System) that is POST (Power On Self Test) by a CPU (Central Processing Unit) is acquired via the bus. A first storage process for storing the latest processing result;
A detection process for detecting a signal emitted by an external input device;
Based on the detection of the signal, reads out the latest processing result stored in the first storing process, a second storage process of storing the read processing result in a non-volatile,
To run on a computer,
A program characterized by that.
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