JP6173603B2 - フラッシュメモリにおけるコマンド完了の確認 - Google Patents
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Description
本出願は、その全体が参照により本明細書に組み込まれる、2013年9月10日に出願した「SYSTEMS AND METHODS FOR ASCERTAINING COMMAND COMPLETION IN FLASH MEMORY」と題する米国仮特許出願第61/875,907号の優先権を主張する。
12 デバイス
14 導体
16 ホストコントローラ
18 通信インターフェース
20 ホストソフトウェア
22 コントローラ
24 通信インターフェース
26 メモリユニット
28 タスクキュー
30 ドアベルレジスタ
34 プロセス
52 プロセス
66 送信要求コンテキスト
68 要求完了コンテキスト
108 送信要求コンテキスト
110 要求完了コンテキスト
140 プロセッサベースのシステム
142 中央処理装置、CPU
144 プロセッサ
146 キャッシュメモリ
148 システムバス
150 メモリシステム
152 入力デバイス
154 出力デバイス
156 ネットワークインターフェースデバイス
158 ディスプレイコントローラ
160 ネットワーク
162 ディスプレイ
164 ビデオプロセッサ
Claims (17)
- ユニバーサルフラッシュストレージ(UFS)システムであって、
UFS転送プロトコル(UTP)転送要求リスト(UTRL)に対応するいくつかのビットを有するドアベルレジスタと、
同数のビットを有する完了通知レジスタと、
前記ドアベルレジスタおよび前記完了通知レジスタに動作可能に結合される制御システムであって、
転送要求開始のために前記ドアベルレジスタにおいてドアベルビットを設定し、
転送要求完了時に前記完了通知レジスタにおいて完了ビットを設定し、
前記転送要求完了時に前記ドアベルビットをクリアする
ように構成された制御システムと
を備えるUFSシステム。 - 前記制御システムが転送要求をデバイスに発行するようにさらに構成される、請求項1に記載のUFSシステム。
- 前記転送要求開始が前記転送要求に関連付けられる、請求項2に記載のUFSシステム。
- ホストをデバイスに結合するように構成された通信インターフェースをさらに備える、請求項1に記載のUFSシステム。
- 前記制御システムが、前記設定された完了ビットに対応する処理を実行した後に、前記完了ビットをクリアするようにさらに構成される、請求項2に記載のUFSシステム。
- 前記制御システムが、前記完了ビットをクリアした後に、前記完了ビットに関連付けられたスロットを再利用するようにさらに構成される、請求項5に記載のUFSシステム。
- 前記転送要求が、データを前記デバイスに書き込むための書込みコマンドを含む、請求項2に記載のUFSシステム。
- 前記転送要求が、データを前記デバイスから読み取るための読取りコマンドを含む、請求項2に記載のUFSシステム。
- セットトップボックス、エンターテインメントユニット、ナビゲーションデバイス、通信デバイス、固定ロケーションデータユニット、モバイルロケーションデータユニット、モバイルフォン、セルラーフォン、コンピュータ、ポータブルコンピュータ、デスクトップコンピュータ、携帯情報端末(PDA)、モニタ、コンピュータモニタ、テレビジョン、チューナー、ラジオ、衛星ラジオ、音楽プレーヤ、デジタル音楽プレーヤ、ポータブル音楽プレーヤ、デジタルビデオプレーヤ、ビデオプレーヤ、デジタルビデオディスク(DVD)プレーヤ、およびポータブルデジタルビデオプレーヤから成る群から選択されるデバイスに統合される、請求項1に記載のUFSシステム。
- 組み込みマルチメディアコントローラ(eMMC)メモリシステムであって、
eMMCタスク記述子リスト(TDL)に対応するいくつかのビットを有するドアベルレジスタと、
同数のビットを有する完了通知レジスタと、
前記ドアベルレジスタおよび前記完了通知レジスタに動作可能に結合される制御システムであって、
転送要求開始のために前記ドアベルレジスタにおいてドアベルビットを設定し、
転送要求完了時に前記完了通知レジスタにおいて完了ビットを設定し、
前記転送要求完了時に前記ドアベルビットをクリアする
ように構成された制御システムと
を備えるeMMCメモリシステム。 - 前記制御システムが転送要求をデバイスに発行するようにさらに構成される、請求項10に記載のeMMCメモリシステム。
- 前記転送要求開始が前記転送要求に関連付けられる、請求項11に記載のeMMCメモリシステム。
- ホストをデバイスに結合するように構成された通信インターフェースをさらに備える、請求項10に記載のeMMCメモリシステム。
- 前記制御システムが、前記設定された完了ビットに対応する処理を実行した後に、前記完了ビットをクリアするようにさらに構成される、請求項11に記載のeMMCメモリシステム。
- 前記制御システムが、前記完了ビットをクリアした後に、前記完了ビットに関連付けられたスロットを再利用するようにさらに構成される、請求項14に記載のeMMCメモリシステム。
- 前記転送要求が、データを前記デバイスに書き込むための書込みコマンドを含む、請求項11に記載のeMMCメモリシステム。
- 前記転送要求が、データを前記デバイスから読み取るための読取りコマンドを含む、請求項11に記載のeMMCメモリシステム。
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