JP6096845B2 - 表示パネル及びこれを含む液晶表示装置 - Google Patents
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Description
図1は、本発明の1実施形態に係る液晶表示装置を説明するための平面図である。図2は、図1のI-I’線に沿った断面図である。
図3、図5及び図7は、図1及び2に示した液晶表示装置の製造方法を説明するための平面図である。図4、図6及び図8は、それぞれ図3、図5及び図7のI-I’線に沿った断面図である。
図1及び図2、図15及び図16の液晶表示装置は、それぞれ図9〜図12の液晶表示装置の回路図の一例を示している。したがって、図9〜図12の液晶表示装置の回路図に示した接続関係を備えていれば、液晶表示装置の配置図は多様に変更することが可能である。
図13は、図1及び図2で説明した液晶表示装置において、第1画素電極が形成されたハイ領域と、第2画素電極が形成されたロー領域における輝度差をシミュレーションした結果である。
図14は、図1及び図で説明した液晶表示装置に含まれているハイ領域の第1画素電極と、ロー領域の第2画素電極との間の電圧差として、正極性電圧が印加される時と、負極性電圧が印加される時とをシミュレーションした結果である。
2 上部表示パネル
3 液晶
121 ゲート線
124a 第1ゲート電極
124b 第2ゲート電極
124c 第3ゲート電極
131 維持電極線
140a 第1ゲート絶縁層
140b 第2ゲート絶縁層
140c 第3ゲート絶縁層
150 半導体層パターン
150a 第1半導体パターン
150b 第2半導体パターン
150c 第3半導体パターン
160 オーミックコンタクト層パターン
160a 第1オーミックコンタクトパターン
160b 第2オーミックコンタクトパターン
160c 第3オーミックコンタクトパターン
171 データ線
173a 第1ソース電極
173b 第2ソース電極
173c 第3ソース電極
175a 第1ドレイン電極
175b 第2ドレイン電極
175c 第3ドレイン電極
191a 第1画素電極
191b 第2画素電極
270 共通電極
600 制御部
610 映像処理部
620 表示パネル制御部
630 回折レンズ制御部
700 保存装置
Claims (15)
- 共通電極を有する上部表示パネルに対向して配置される液晶表示装置用の表示パネルであって、
ゲート線と、
前記ゲート線と交差するデータ線と、
前記ゲート線及び前記データ線と接続される第1トランジスタと、
前記ゲート線及び前記データ線と接続される第2トランジスタと、
前記ゲート線と離間して配置され、前記共通電極と独立して一定の大きさの電圧が印加される維持電極線と、
前記維持電極線及び前記第2トランジスタと接続される第3トランジスタと、
前記第1トランジスタと接続される第1画素電極と、
前記第2トランジスタ及び前記第3トランジスタと接続される第2画素電極と、
前記第3トランジスタに接続される第1キャパシタと、
を含み、
前記第1トランジスタは、前記ゲート線と接続される第1ゲート電極、前記データ線と接続される第1ソース電極、及び前記第1ソース電極と離間する第1ドレイン電極を含み、
前記第2トランジスタは、前記ゲート線と接続される第2ゲート電極、前記データ線と接続される第2ソース電極、及び前記第2ソース電極と離間する第2ドレイン電極を含み、
前記第3トランジスタは、前記維持電極線と接続される第3ゲート電極、前記第2ドレイン電極と接続される第3ドレイン電極、及び前記第3ドレイン電極と離間する第3ソース電極を含み、
前記第1画素電極は前記第1ドレイン電極と接続され、
前記第2画素電極は前記第2ドレイン電極及び前記第3ドレイン電極と接続され、
前記第1キャパシタの一側端子は前記第3ゲート電極に接続され、
前記第1キャパシタの他側端子は前記第3ソース電極に接続され
る、
表示パネル。 - 前記第3ゲート電極は前記維持電極線と一体である、請求項1に記載の表示パネル。
- 前記第3ゲート電極は前記維持電極線の幅が拡張された部分である、請求項2に記載の表示パネル。
- 前記表示パネルは前記第3トランジスタに接続される第2キャパシタをさらに含み、前記第2キャパシタの一側端子は前記第1画素電極に接続され、前記第2キャパシタの他側端子は前記第3ソース電極に接続される、請求項3に記載の表示パネル。
- 前記第3ソース電極は凹所が形成された一側部を有し、前記第3ドレイン電極は、前記第3ソース電極との間隔を維持しながら前記凹所に挿入されている、請求項3に記載の表示パネル。
- 前記第3ソース電極は、前記第3ゲート電極の外周に沿って形成される他側部を有する、請求項5に記載の表示パネル。
- 前記第1ソース電極の一側部には凹状の第1凹所が形成され、前記第2ソース電極の一側部には凹状の第2凹所が形成され、前記第3ソース電極の一側部には凹状の第3凹所が形成され、
前記第1ドレイン電極は前記第1ソース電極との間隔を維持しながら前記第1凹所に挿入され、前記第2ドレイン電極は前記第2ソース電極との間隔を維持しながら前記第2凹所に挿入され、前記第3ドレイン電極は前記第3ソース電極との間隔を維持しながら前記第3凹所に挿入されている、請求項1〜6のいずれかに記載の表示パネル。 - 前記第1ソース電極と前記第2ソース電極は互いに一体である、請求項7に記載の表示パネル。
- 前記第3ソース電極は、前記第3ゲート電極の外周に沿って形成される他側部を有する、請求項7に記載の表示パネル。
- 前記表示パネルは、前記第3トランジスタに接続される第2キャパシタをさらに含み、前記第2キャパシタの一側端子は前記第1画素電極に接続され、前記第2キャパシタの他側端子は前記第3ソース電極に接続される、請求項1〜3及び5〜9のいずれかに記載の表示パネル。
- 前記第2ドレイン電極と前記第3ドレイン電極は互いに一体に形成され、前記第2ドレイン電極と前記第3ドレイン電極はコンタクトホールによって前記第2画素電極と接続される、請求項1〜9のいずれかに記載の表示パネル。
- ゲート線、前記ゲート線と交差するデータ線、前記ゲート線及び前記データ線と接続される第1トランジスタ、前記ゲート線及び前記データ線と接続される第2トランジスタ、前記ゲート線と離間して位置する維持電極線、前記維持電極線及び前記第2トランジスタと接続される第3トランジスタ、前記第1トランジスタと接続される第1画素電極、前記第2トランジスタ及び前記第3トランジスタと接続される第2画素電極、並びに前記第3トランジスタに接続される第1キャパシタを含む下部表示パネルと、
前記下部表示パネルの上に位置する液晶層と、
前記液晶層上に位置し、共通電極を有する上部表示パネルと、
を含み、
前記第1トランジスタは、前記ゲート線と接続される第1ゲート電極、前記データ線と接続される第1ソース電極、及び前記第1ソース電極と離間する第1ドレイン電極を含み、
前記第2トランジスタは、前記ゲート線と接続される第2ゲート電極、前記データ線と接続される第2ソース電極、及び前記第2ソース電極と離間する第2ドレイン電極を含み、
前記第3トランジスタは、前記維持電極線と接続される第3ゲート電極、前記第2ドレイン電極と接続される第3ドレイン電極、及び前記第3ドレイン電極と離間する第3ソース電極を含み、
前記第1画素電極は前記第1ドレイン電極と接続され、
前記第2画素電極は前記第2ドレイン電極及び前記第3ドレイン電極と接続され、
前記維持電極線は、前記共通電極と独立して一定の大きさの電圧が印加され、
前記第1キャパシタの一側端子は前記第3ゲート電極に接続され、
前記第1キャパシタの他側端子は前記第3ソース電極に接続される、
液晶表示装置。 - 前記第1ゲート電極と前記第2ゲート電極は前記ゲート線に接続し、前記第3ゲート電極は前記維持電極線に接続される、請求項12に記載の液晶表示装置。
- 前記第3トランジスタに接続される第2キャパシタをさらに含み、前記第2キャパシタの一側端子は前記第1画素電極に接続され、前記第2キャパシタの他側端子は前記第3ソース電極に接続される、請求項13に記載の液晶表示装置。
- 前記第3ソース電極は、前記第3ゲート電極の外周に沿って形成される少なくとも一側部を含む、請求項14に記載の液晶表示装置。
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