JP5784656B2 - マイクロプロセッサ - Google Patents
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Description
図1は、実施形態のマイクロプロセッサの構成の例を示すブロック図である。
また、本発明の実施形態を説明したが、この実施形態は、例として提示したものであり、発明の範囲を限定することは意図していない。この新規な実施形態は、その他の様々な形態で実施されることが可能であり、発明の要旨を逸脱しない範囲で、種々の省略、置き換え、変更を行うことができる。これら実施形態やその変形は、発明の範囲や要旨に含まれるとともに、特許請求の範囲に記載された発明とその均等の範囲に含まれる。
2 プログラムメモリー
21 ROMエリア
22 RAMエリア
3 アプリケーション情報メモリー
4 諾否情報メモリー
5 スイッチ
6 判定部
Claims (5)
- プロセッサコアと、
ROMエリアにアプリケーションソフトウェアが格納されたプログラムメモリーと、
使用制限対象のアプリケーションソフトウェアの前記プログラムメモリー上のアドレス範囲が記載されたアプリケーション情報メモリーと、
前記使用制限対象のアプリケーションソフトウェアの使用に関する諾否情報が書き込まれた諾否情報メモリーと、
入力信号を前記プロセッサコアへ印加するかしないかを切り替えるスイッチと、
前記プロセッサコアのプログラムカウンタ値が前記アプリケーション情報メモリーに記載された前記アドレス範囲に該当するかどうかを判定し、該当の場合は前記諾否情報メモリーに書き込まれた前記諾否情報にもとづいて前記スイッチの切り替えを制御する判定部と
を備えることを特徴とするマイクロプロセッサ。 - 前記判定部は、前記諾否情報が諾であるときは前記入力信号を前記プロセッサコアへ印加し、前記諾否情報が否であるときは前記入力信号を前記プロセッサコアへ印加しないように、前記スイッチを切り替える
ことを特徴とする請求項1に記載のマイクロプロセッサ。 - 前記アプリケーション情報メモリーおよび前記諾否情報メモリーは、ユーザーによる書き換えが不可能である
ことを特徴とする請求項1または2に記載のマイクロプロセッサ。 - 前記諾否情報メモリーは、
前記使用制限対象のアプリケーションソフトウェアが複数あるときは、それぞれのアプリケーションソフトウェアごとに前記諾否情報が書き込まれている
ことを特徴とする請求項1乃至3のいずれか1項に記載のマイクロプロセッサ。 - 前記プロセッサコアが、ROMコレクション機能を有する
ことを特徴とする請求項1乃至4のいずれか1項に記載のマイクロプロセッサ。
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