JP5778459B2 - 暗号機能を実行するための装置及び方法 - Google Patents
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Description
a)第1のデジタル/アナログ変換器(DA1)を利用して、前記少なくとも1つの第1のデジタル値(XD)を少なくとも1つの第1のアナログ値(XA)に変換するステップと、
b)第2のデジタル/アナログ変換器(DA2)を利用して、前記少なくとも1つの第2のデジタル値(KD)を少なくとも1つのアナログ鍵値(KA)に変換するステップと、
c)ハードウェアを利用して、前記少なくとも1つの第1のアナログ値(XA)及び前記少なくとも1つのアナログ鍵値(KA)上で、少なくとも1つのアナログ出力値(RA)を与えるためにアナログ機能(F)を実行するステップと、
d)アナログ/デジタル変換器(AD)を利用して、前記デジタル暗号機能の前記結果を表わすデジタル出力値(RD)を与えるために前記アナログ出力値(RA)を変換するステップと、
を含むことを特徴とする方法である。
前記少なくとも1つの第1のデジタル値(XD)を少なくとも1つの第1のアナログ値(XA)に変換する手段と、
前記少なくとも1つの第2のデジタル値(KSD)を少なくとも1つのアナログ鍵値(KA)に変換する手段と、
アナログ結果(RA)を与えるために前記第1のアナログ値及び前記アナログ鍵値上でアナログ機能(F)を実行する手段と、
前記デジタル暗号機能の前記結果を表わすデジタル出力値(RD)を与えるために前記アナログ結果をデジタル値に変換する手段と、
を備えることを特徴とする装置である。
図1は、その中で本発明の実施形態が展開される、デジタル情報を暗号化(又は復号化)するためのシステムの一部の概略図を示している。この概略図に示されるブロックは、暗号化(又は復号化)される入力としての第1のデジタル値(XD)と、暗号化(又は復号化)の鍵として第2のデジタル値(KD)とを得て、出力として暗号化(又は復号化)されたデジタル値(RD)を与える。従って、言いかえれば、このブロックは、デジタル結果(RD)を出力するために第1のデジタルオペランド(XD)及び第2のデジタルオペランド(KD)上でデジタル暗号機能を実行する。
図1は、その中で本発明の実施形態が展開される、デジタル情報を暗号化(又は復号化)するためのシステムの一部の概略図を示している。この概略図に示されるブロックは、暗号化(又は復号化)される入力としての第1のデジタル値(XD)と、暗号化(又は復号化)の鍵として第2のデジタル値(KD)とを得て、出力として暗号化(又は復号化)されたデジタル値(RD)を与える。従って、言いかえれば、このブロックは、デジタル結果(RD)を出力するために第1のデジタルオペランド(XD)及び第2のデジタルオペランド(KD)上でデジタル暗号機能を実行する。
Claims (15)
- 少なくとも1つの第1のデジタル値(XD)、及び少なくとも1つの第2のデジタル値(KD)上でデジタル暗号機能を実行する方法であって、前記デジタル暗号機能は少なくとも1つのデジタル結果を有し、
a)第1のデジタル/アナログ変換器(DA1)を利用して、前記少なくとも1つの第1のデジタル値(XD)を少なくとも1つの第1のアナログ値(XA)に変換するステップと、
b)第2のデジタル/アナログ変換器(DA2)を利用して、前記少なくとも1つの第2のデジタル値(KD)を少なくとも1つのアナログ鍵値(KA)に変換するステップと、
c)ハードウェアを利用して、前記少なくとも1つの第1のアナログ値(XA)及び前記少なくとも1つのアナログ鍵値(KA)上で、少なくとも1つのアナログ出力値(RA)を与えるためにアナログ機能(F)を実行するステップと、
d)アナログ/デジタル変換器(AD)を利用して、前記デジタル暗号機能の前記結果を表わすデジタル出力値(RD)を与えるために前記アナログ出力値(RA)を変換するステップと、
を含むことを特徴とする方法。 - 前記少なくとも1つの第1のデジタル値(XD)は、入力値(XIN)の少なくともすべて又は一部に対して実行された第1の前処理動作(PREX)から生じることを特徴とする請求項1記載の方法。
- 前記少なくとも1つの第2のデジタル値(KD)は、鍵値(KIN)の少なくともすべて又は一部に対して実行された第2の前処理動作(PREK)から生じることを特徴とする請求項1又は2のいずれかに記載の方法。
- 前記第2の前処理動作(PREK)は、前処理の鍵値(KPRE)を更に生成することを特徴とする請求項3記載の方法。
- 前記第1の前処理動作(PREX)は、前記前処理の鍵値(KPRE)に更に従って動作することを特徴とする請求項4記載の方法。
- 後処理されたデジタル出力値(RPD)を与えるために、前記デジタル出力値(RD)の少なくともすべて又は一部には、後処理動作(POST)が実行されることを特徴とする請求項1ないし5のいずれか1項に記載の方法。
- 前記第2の前処理動作(PREK)は、後処理の鍵値(KPOST)を更に生成することを特徴とする請求項6記載の方法。
- 前記後処理動作(POST)は、前記後処理の鍵値(KPOST)に更に従って動作することを特徴とする請求項7記載の方法。
- 前記第1の前処理動作(PREX)又は前記第2の前処理動作(PREK)のいずれかは、複数の第1のデジタル値(XD1、XD2)又は複数の第2のデジタル値(KD1、KD2)を生成することを含み、前記複数の第1のデジタル値(XD1、XD2)は複数の第1のアナログ値(XA1、XA2)に変換され、前記複数の第2のデジタル値(KD1、KD2)は複数のアナログ鍵値(KA1、KA2)に変換されることを特徴とする請求項3ないし8のいずれか1項に記載の方法。
- 前記アナログ機能(F)は、複数のアナログサブ機能(SF1、SF2、CA)に分割され、前記アナログサブ機能(SF1、SF2、CA)の少なくとも2つは、複数の部分的なアナログ結果(RAP1、RAP2)を与えるために、前記少なくとも1つの第1のアナログ値(XA1、XA2)の少なくとも1つと前記少なくとも1つのアナログ鍵値(KA1、KA2)の少なくとも1つとに従って動作し、前記複数の部分的なアナログ結果(RAP1、RAP2)には、アナログ出力値(RA)をもたらすために結合サブ機能(CA)が実行されることを特徴とする請求項1ないし9のいずれか1項に記載の方法。
- 前記アナログ機能(F)は、複数のアナログサブ機能(SF1、SF2)に分割され、前記アナログサブ機能(SF1、SF2)の各々は、複数の部分的なアナログ結果(RAP1、RAP2)を与えるために、前記少なくとも1つの第1のアナログ値(XA1、XA2)の少なくとも1つと、前記少なくとも1つのアナログ鍵値(KA1、KA2)の少なくとも1つとに従って動作し、前記複数の部分的なアナログ結果(RAP1、RAP2)は、複数の部分的なデジタル結果(RDP1、RDP2)に変換され、前記複数の部分的なデジタル結果(RDP1、RDP2)は、前記デジタル出力値(RD)をもたらすために組み合わせられる(CD)ことを特徴とする請求項1ないし9のいずれか1項に記載の方法。
- 前記少なくとも1つの第1のデジタル値又は前記少なくとも1つの第2のデジタル値の前記変換は、電圧から電流、電圧から電荷、又は電圧から周波数への各変換のいずれかを選択し、前記アナログ出力値の前記変換は、電流から電圧、電荷から電圧、又は周波数から電圧への各変換のいずれかを選択することを特徴とする請求項1ないし11のいずれか1項に記載の方法。
- 前記入力値(XIN)又は前記鍵値(KIN)のいずれかは、nビット又はmビットをそれぞれ含み、前記第1のデジタル値(XD、XD1、XD2)又は前記デジタル値(KD、KD1、KD2)のいずれかは、nビット又はmビット未満であるビット数をそれぞれ含むことを特徴とする請求項3ないし12のいずれか1項に記載の方法。
- 前記デジタル出力値(RD)又は前記後処理されたデジタル出力値(RPD)は、請求項6ないし8のいずれかに記載のデジタル暗号機能により少なくとも1度更に処理されることを特徴とする請求項6ないし8のいずれか1項に記載の方法。
- 少なくとも1つの第1のデジタル値(XD)及び少なくとも1つの第2のデジタル値(KD)上でデジタル暗号機能を実行するための装置であって、前記デジタル暗号機能は少なくとも1つのデジタル結果を有しており、
前記少なくとも1つの第1のデジタル値(XD)を少なくとも1つの第1のアナログ値(XA)に変換するための少なくとも1つの第1のデジタル/アナログ変換器(DA1)と、
前記少なくとも1つの第2のデジタル値(KSD)を少なくとも1つのアナログ鍵値(KA)に変換するための少なくとも1つの第2のデジタル/アナログ変換器(DA2)と、
アナログ結果(RA)を与えるための前記第1のアナログ値(XA)及び前記アナログ鍵値(KA)に従って動作する、アナログ機能(F)を実現するのに適しているハードウェアと、
前記アナログ結果(RA)を、前記デジタル暗号機能の前記結果を表わすデジタル出力値(RD)を与えるためのデジタル値に変換するための少なくとも1つのアナログ/デジタル変換器(AD)とを備えることを特徴とする装置。
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