JP5633434B2 - 液晶表示装置 - Google Patents
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Description
対向する画素電極と共通電極との間に液晶層が挟持された表示素子と、データ線を介して供給される第1のフィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして一定期間第1の保持容量に保持する第1のサンプリング及び保持手段と、データ線を介して供給される第2のフィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして一定期間第2の保持容量に保持する第2のサンプリング及び保持手段と、第1の保持容量の第1の保持電圧又は第2の保持容量の第2の保持電圧が供給され、供給される第1又は第2の保持電圧の正転増幅信号と反転増幅信号とをそれぞれ並列に出力する正転及び反転増幅手段と、第1の保持容量から読み出した第1の保持電圧、又は第2の保持容量から読み出した第2の保持電圧を正転及び反転増幅手段に供給する保持電圧読み出し手段と、正転及び反転増幅手段から並列に出力される第1の保持電圧の正転増幅信号及び反転増幅信号、又は第2の保持電圧の正転増幅信号及び反転増幅信号を、2本のゲート制御信号用配線により交互に印加される第1及び第2のゲート制御信号に基づいて垂直走査周期より短い所定の周期で交互に切り替えて画素電極に印加するスイッチング手段とを備え、
複数の画素に対して、2本のフィールド制御信号用配線を介して供給される第1及び第2のフィールド制御信号に基づいて、第1のフィールドの映像信号表示期間は、保持電圧読み出し手段により第1の保持容量から第1の保持電圧を読み出させると同時に、第2のサンプリング及び保持手段により第2のフィールドの映像信号のデジタル-アナログ変換電圧のサンプリング及び第2の保持容量への保持を行わせる第1のフィールドの動作と、第2のフィールドの映像信号表示期間は、保持電圧読み出し手段により第2の保持容量から第2の保持電圧を読み出させると同時に、第1のサンプリング及び保持手段により第1のフィールドの映像信号のデジタル-アナログ変換電圧のサンプリング及び第1の保持容量への保持を行わせる第2のフィールドの動作とを、巡回的に行う書き込み及び読み出し制御手段と、スイッチング手段による第1の保持電圧又は第2の保持電圧の正転増幅信号及び反転増幅信号の画素電極への切り替えと同期して、画素電極の印加電圧と共通電極への共通電極電圧との差電圧の絶対値が同じになるように、共通電極電圧を反転する共通電極電圧発生手段とを有することを特徴とする。
前記反転増幅手段は、ゲートに第1のトランジスタのソースが接続された第3のトランジスタと、第3のトランジスタのソースと第2の電源との間に接続された抵抗と、第3のトランジスタのドレインに定電流負荷としてドレインが接続され、ソースに第1の電源が接続された第4のトランジスタとよりなり、第4のトランジスタのゲートには第2の制御信号が印加され、第3のトランジスタが、そのゲートに入力された第1のトランジスタからの正転増幅信号を反転増幅してそのドレインから反転増幅信号を出力する構成であることを特徴する。
101 シフトレジスタ回路
102 1ラインラッチ回路
103 コンパレータ
104 階調カウンタ
105、SW1〜SWm ビデオスイッチ
106 画素
108 極性切り替え制御回路
109 垂直シフトレジスタ
120 正転・反転アンプ
Tr1、Tr4 画素選択用トランジスタ
Tr2、Tr3、Tr5、Tr6 スイッチング用トランジスタ
Cs1、Cs2 保持容量
LC 表示素子
PE 画素電極
CE 共通電極
LCM 液晶層
Q1 ソースフォロワ用PMOSトランジスタ
Q2 定電流負荷用PMOSトランジスタ
Q3 反転増幅用PMOSトランジスタ
Q4 定電流負荷用NMOSトランジスタ
R 抵抗
Odd 奇数フィールド表示信号用配線
Even 偶数フィールド表示信号用配線
G1_odd〜Gn_odd 奇数フィールド制御信号用配線
G1_even〜Gn_even 偶数フィールド制御信号用配線
S+ 第1のゲート制御信号用配線
S- 第2のゲート制御信号用配線
D1〜Dm データ線(列信号線)
Cur_p、Cur_n 制御信号用配線
Claims (3)
- 2本のフィールド制御信号用配線を一組とする複数組のフィールド制御信号用配線、及び2本のゲート制御信号用配線を一組とする複数組のゲート制御信号用配線を少なくとも含む横信号線と、複数本のデータ線からなる縦信号線とがそれぞれ交差する交差部に設けられた複数の画素のそれぞれが、
対向する画素電極と共通電極との間に液晶層が挟持された表示素子と、
前記データ線を介して供給される第1のフィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして一定期間第1の保持容量に保持する第1のサンプリング及び保持手段と、
前記データ線を介して供給される第2のフィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして前記一定期間第2の保持容量に保持する第2のサンプリング及び保持手段と、
前記第1の保持容量の第1の保持電圧又は前記第2の保持容量の第2の保持電圧が供給され、供給される前記第1又は第2の保持電圧の正転増幅信号と反転増幅信号とをそれぞれ並列に出力する正転及び反転増幅手段と、
前記第1の保持容量から読み出した前記第1の保持電圧、又は前記第2の保持容量から読み出した前記第2の保持電圧を前記正転及び反転増幅手段に供給する保持電圧読み出し手段と、
前記正転及び反転増幅手段から並列に出力される前記第1の保持電圧の正転増幅信号及び反転増幅信号、又は前記第2の保持電圧の正転増幅信号及び反転増幅信号を、前記2本のゲート制御信号用配線により交互に印加される第1及び第2のゲート制御信号に基づいて垂直走査周期より短い所定の周期で交互に切り替えて前記画素電極に印加するスイッチング手段と
を備え、
前記複数の画素に対して、前記2本のフィールド制御信号用配線を介して供給される第1及び第2のフィールド制御信号に基づいて、第1のフィールドの映像信号表示期間は、前記保持電圧読み出し手段により前記第1の保持容量から前記第1の保持電圧を読み出させると同時に、前記第2のサンプリング及び保持手段により前記第2のフィールドの映像信号のデジタル-アナログ変換電圧のサンプリング及び前記第2の保持容量への保持を行わせる第1のフィールドの動作と、第2のフィールドの映像信号表示期間は、前記保持電圧読み出し手段により前記第2の保持容量から前記第2の保持電圧を読み出させると同時に、前記第1のサンプリング及び保持手段により前記第1のフィールドの映像信号のデジタル-アナログ変換電圧のサンプリング及び前記第1の保持容量への保持を行わせる第2のフィールドの動作とを、巡回的に行う書き込み及び読み出し制御手段と、
前記スイッチング手段による前記第1の保持電圧又は前記第2の保持電圧の前記正転増幅信号及び前記反転増幅信号の前記画素電極への切り替えと同期して、前記画素電極の印加電圧と前記共通電極への共通電極電圧との差電圧の絶対値が同じになるように、前記共通電極電圧を反転する共通電極電圧発生手段と
を有することを特徴とする液晶表示装置。 - 前記書き込み及び読み出し制御手段は、前記第1のフィールドの映像信号を奇数フィールドの映像信号とし、前記第2のフィールドの映像信号を偶数フィールドの映像信号として前記第1のフィールドの動作と前記第2のフィールドの動作とを2垂直走査期間を一周期として巡回的に行い、
前記第1の垂直走査期間の前記第1のフィールドの動作時は前記第1の保持容量から前記奇数フィールドの映像信号のデジタル-アナログ変換電圧である前記第1の保持電圧を読み出させると同時に、前記偶数フィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして前記第2の保持容量に保持させ、
前記第2の垂直走査期間の前記第2のフィールドの動作時は前記第2の保持容量から前記偶数フィールドの映像信号のデジタル-アナログ変換電圧である前記第2の保持電圧を読み出させると同時に、前記奇数フィールドの映像信号のデジタル-アナログ変換電圧をサンプリングして前記第1の保持容量に保持させる
ことを特徴とする請求項1記載の液晶表示装置。 - 前記正転増幅手段は、
ゲートに前記第1又は第2の保持電圧が供給され、ドレインに第1の電源が接続された第1のトランジスタと、
前記第1のトランジスタのソースに定電流負荷としてドレインが接続され、ソースに第2の電源が接続された第2のトランジスタとよりなり、
前記第2のトランジスタのゲートには第1の制御信号が印加され、前記第1のトランジスタのソースから前記正転増幅信号を出力する構成であり、
前記反転増幅手段は、
ゲートに前記第1のトランジスタのソースが接続された第3のトランジスタと、
前記第3のトランジスタのソースと前記第2の電源との間に接続された抵抗と、
前記第3のトランジスタのドレインに定電流負荷としてドレインが接続され、ソースに前記第1の電源が接続された第4のトランジスタとよりなり、
前記第4のトランジスタのゲートには第2の制御信号が印加され、前記第3のトランジスタが、そのゲートに入力された前記第1のトランジスタからの前記正転増幅信号を反転増幅してそのドレインから前記反転増幅信号を出力する構成である
ことを特徴する請求項1記載の液晶表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011049787A JP5633434B2 (ja) | 2011-03-08 | 2011-03-08 | 液晶表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011049787A JP5633434B2 (ja) | 2011-03-08 | 2011-03-08 | 液晶表示装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2012185412A JP2012185412A (ja) | 2012-09-27 |
JP5633434B2 true JP5633434B2 (ja) | 2014-12-03 |
Family
ID=47015528
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2011049787A Active JP5633434B2 (ja) | 2011-03-08 | 2011-03-08 | 液晶表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5633434B2 (ja) |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3413043B2 (ja) * | 1997-02-13 | 2003-06-03 | 株式会社東芝 | 液晶表示装置 |
JP3279238B2 (ja) * | 1997-12-01 | 2002-04-30 | 株式会社日立製作所 | 液晶表示装置 |
-
2011
- 2011-03-08 JP JP2011049787A patent/JP5633434B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
JP2012185412A (ja) | 2012-09-27 |
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