JP5556377B2 - 並列計算システム、プロセッサ、ネットワークスイッチ装置、及び通信方法 - Google Patents
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Description
複数のプロセッサと、該複数のプロセッサを相互に接続するネットワークと、該ネットワークの通信経路を制御するための少なくとも1つのネットワークスイッチ装置と、を備え、複数の前記プロセッサが他の複数の前記プロセッサに対して同時に通信処理を夫々実行する並列計算システムであって、前記プロセッサは、該プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対してフェーズ番号を夫々付与し、前記ネットワークスイッチ装置は、前記プロセッサにより付与された前記フェーズ番号に基づいて、前記プロセッサ通信の処理順序を制御する、ことを特徴とする並列計算システム。
(付記1)記載の並列計算システムであって、前記プロセッサは、前記各プロセッサ通信に対して前記フェーズ番号を昇順で夫々付与し、前記ネットワークスイッチ装置は、前記フェーズ番号が小さいプロセッサ通信を優先的に処理するように制御を行う、ことを特徴とする並列計算システム。
他のプロセッサとネットワークを介して接続され、相互に通信処理を行うプロセッサであって、前記プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対して、通信処理の順序を決めるためのフェーズ番号を夫々付与する、ことを特徴とするプロセッサ。
(付記3)記載の並列計算システムであって、前記プロセッサ通信に対して、前記フェーズ番号を昇順又は降順で付与する、ことを特徴とするプロセッサ。
複数のプロセッサを相互に接続するネットワークの通信経路を制御するためのネットワークスイッチ装置であって、前記プロセッサは、該プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対してフェーズ番号を夫々付与しており、前記プロセッサにより付与された前記フェーズ番号に基づいて、前記プロセッサ通信の処理順序を制御する、ことを特徴とするネットワークスイッチ装置。
(付記5)記載の並列計算システムであって、前記プロセッサは、前記プロセッサ通信に対して前記フェーズ番号を昇順で付与しており、前記フェーズ番号が小さいプロセッサ通信を優先的に処理するように制御を行う、ことを特徴とするネットワークスイッチ装置。
複数のプロセッサと、該複数のプロセッサを相互に接続するネットワークと、該ネットワークの通信経路を制御するための少なくとも1つのネットワークスイッチ装置と、を備え、複数の前記プロセッサが他の複数の前記プロセッサに対して同時に通信処理を夫々実行する並列計算システムの通信方法であって、前記プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対してフェーズ番号を夫々付与し、前記プロセッサにより付与された前記フェーズ番号に基づいて、前記プロセッサ通信の処理順序を制御する、ことを特徴とする並列計算システムの通信方法。
他のプロセッサとネットワークを介して接続され、相互に通信処理を行うプロセッサのプログラムであって、前記プロセッサ間におけるプロセッサ通信は複数の部分通信フェーズに分割されており、該分割された部分通信フェーズに対応する各プロセッサ通信に対して、通信処理の順序を決めるためのフェーズ番号を夫々付与する処理をコンピュータに実行させることを特徴とするプログラム。
10 プロセッサ
11 処理装置
12 主記憶装置
13 通信プロセッサ
14 送信ポート
15 受信ポート
20 プロセッサ間ネットワーク
21 ネットワークスイッチ装置
22 クロスバスイッチ
23 入力部
24 出力部
25 スイッチ制御部
Claims (6)
- 複数のプロセッサと、該複数のプロセッサを相互に接続するネットワークと、該ネットワークの通信経路を制御するための少なくとも1つのネットワークスイッチ装置と、を備え、複数の前記プロセッサが他の複数の前記プロセッサに対して同時に通信処理を夫々実行する並列計算システムであって、
前記プロセッサは、
該プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対して降順又は昇順でフェーズ番号を夫々付与し、
前記部分通信フェーズに対応したフェーズ番号を持つパケットのみを一斉に送信開始させ、
前記ネットワークスイッチ装置は、
前記パケットの送信が早期に終了した前記プロセッサがあるときでも、前記降順の場合は大きいフェーズ番号のパケットを、前記昇順の場合は小さいフェーズ番号のパケットを、次の部分通信フェーズまで待機させる制御を行う、ことを特徴とする並列計算システム。 - 請求項1記載の並列計算システムであって、
前記プロセッサは、前記各プロセッサ通信に対して前記フェーズ番号を昇順で夫々付与し、
前記ネットワークスイッチ装置は、前記フェーズ番号が小さいプロセッサ通信を優先的に処理するように制御を行う、ことを特徴とする並列計算システム。 - 複数のプロセッサを相互に接続するネットワークの通信経路を制御するためのネットワークスイッチ装置であって、
前記プロセッサは、該プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対して降順又は昇順でフェーズ番号を夫々付与し、前記部分通信フェーズに対応したフェーズ番号を持つパケットのみを一斉に送信開始させており、
前記パケットの送信が早期に終了した前記プロセッサがあるときでも、前記降順の場合は大きいフェーズ番号のパケットを、前記昇順の場合は小さいフェーズ番号のパケットを、次の部分通信フェーズまで待機させる制御を行う、ことを特徴とするネットワークスイッチ装置。 - 請求項3記載の並列計算システムであって、
前記プロセッサは、前記プロセッサ通信に対して前記フェーズ番号を昇順で付与しており、
前記フェーズ番号が小さいプロセッサ通信を優先的に処理するように制御を行う、ことを特徴とするネットワークスイッチ装置。 - 複数のプロセッサと、該複数のプロセッサを相互に接続するネットワークと、該ネットワークの通信経路を制御するための少なくとも1つのネットワークスイッチ装置と、を備え、複数の前記プロセッサが他の複数の前記プロセッサに対して同時に通信処理を夫々実行する並列計算システムの通信方法であって、
前記プロセッサ間におけるプロセッサ通信を複数の部分通信フェーズに分割し、該分割された部分通信フェーズに対応する各プロセッサ通信に対して降順又は昇順でフェーズ番号を夫々付与し、前記部分通信フェーズに対応したフェーズ番号を持つパケットのみを一斉に送信開始させ、
前記パケットの送信が早期に終了した前記プロセッサがあるときでも、前記降順の場合は大きいフェーズ番号のパケットを、前記昇順の場合は小さいフェーズ番号のパケットを、次の部分通信フェーズまで待機させる制御を行う、ことを特徴とする並列計算システムの通信方法。 - 複数のプロセッサを相互に接続するネットワークの通信経路を制御するためのネットワークスイッチ装置のプログラムであって、
前記プロセッサ間におけるプロセッサ通信は複数の部分通信フェーズに分割されており、該分割された部分通信フェーズに対応する各プロセッサ通信に対して降順又は昇順でフェーズ番号を夫々付与され、前記部分通信フェーズに対応したフェーズ番号を持つパケットのみを一斉に送信開始させており、
前記パケットの送信が早期に終了した前記プロセッサがあるときでも、前記降順の場合は大きいフェーズ番号のパケットを、前記昇順の場合は小さいフェーズ番号のパケットを、次の部分通信フェーズまで待たせる制御を行う、処理をコンピュータに実行させることを特徴とするプログラム。
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