JP5385455B2 - 改善されたミキサ回路 - Google Patents
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Description
文書US4,636,663は、6つのトランジスタのグループを用いる2重平衡ミキサ回路を開示する。
Claims (8)
- それぞれ第1の入力信号および第2の入力信号のための第1の入力ポート(13、23)並びに第2の入力ポート(12、22)と、混合信号を出力するための出力ポート(14、14’、24、74)と、を伴う第1のミキサコンポーネント(11、11’、21、71)としてトランジスタを含み、
前記第1のミキサコンポーネント(11、11’、21、71)の前記第1の入力ポート(13、23)および前記第2の入力ポート(12、22)の一方に信号が適用されると、他方に逆位相の信号が引き起こされるように、前記第1のミキサコンポーネント(11、11’、21、71)の前記第1の入力ポート(13、23)および前記第2の入力ポート(12、22)を電磁誘導による結合を介して接続する変圧器(15)も含む
ことを特徴とするミキサ回路(10、10’、20、30、410、420、60)。 - 前記第1の入力ポートおよび前記第2の入力ポートのうちの1つの入力ポート(13)並びに前記出力ポート(14)のDCバイアスのための入力と、
出力ポートでの負荷としてのインピーダンス(16、31)と、
をさらに含む、請求項1のミキサ回路(30、410、420、60) - 前記第1の入力ポートおよび前記第2の入力ポート(13、14、23、24)への接続は、DCシールドとして静電容量(18、18’)を含む、請求項1または2のミキサ回路(10、10’、20、30、400、410、60)。
- 前記出力ポートへの接続は、DCシールドとして静電容量(17)を示す、請求項1から3のいずれかのミキサ回路(10、10’、20、30、400、410、60)。
- それぞれ第3の入力信号および第4の入力信号のための第1の入力ポート(13’)並びに第2の入力ポート(12’)と、第2の混合信号を出力するための出力ポート(14’)と、を伴う第2のミキサコンポーネント(11’)、並びに、
前記第2のミキサコンポーネント(11’)の前記第1の入力ポート(13’)および前記第2の入力ポート(12’)の一方に信号が適用されると、他方に逆位相の信号が引き起こされるように、前記第2のミキサコンポーネント(11’)の前記第1の入力ポート(13’)および前記第2の入力ポート(12’)を電磁誘導による結合を介して接続する変圧器(15’)
をさらに含み、
前記第1のミキサコンポーネント(11)の前記出力ポートおよび前記第2のミキサコンポーネント(11’)の前記出力ポートは、相互に接続されて、共同出力ポートを形成する、
請求項1から4のいずれかのミキサ回路(400、410)。 - それぞれ第3の入力信号および第4の入力信号のための第1の入力ポート(73)並びに第2の入力ポート(72)と、出力ポート(74)と、を伴う第2のミキサコンポーネント(71)、並びに、
前記第2のミキサコンポーネント(71)の前記第1の入力ポート(73)および前記第2の入力ポート(72)の一方に信号が適用されると、他方に逆位相の信号が引き起こされるように、前記第2のミキサコンポーネント(71)の前記第1の入力ポート(73)および前記第2の入力ポート(72)を電磁誘導による結合を介して接続する変圧器(75)
をさらに含み、
前記第1のミキサコンポーネントの前記第2の入力ポートおよび前記第2のミキサコンポーネントの前記第2の入力ポートは、相互に接続されて、共同入力ポートを形成し、
各ミキサコンポーネントの前記第1の入力ポート(13、73)は、バイアス電圧の入力に用いられるように構成され、
前記ミキサ回路(60)は、第1の入力ポート(63)および第2の入力ポート(62)と、前記第1のミキサコンポーネントおよび前記第2のミキサコンポーネントの前記共同入力ポートに接続される出力ポート(64)と、を伴うさらなるミキサコンポーネント(61)を含み、
前記第1の入力信号および前記第3の入力信号は、バイアス電圧であり、前記第2の入力信号および前記第4の入力信号は、正および負の局所発振器(LO)信号であり、
前記さらなるミキサコンポーネント(61)の前記第1の入力ポート(63)は、無線周波数(RF)信号または中間周波数(IF)信号のための入力として機能し、前記第1のミキサコンポーネントの前記第2の入力ポートおよび前記第2のミキサコンポーネントの前記第2の入力ポートは、局所発振器(LO)信号のための入力として機能する、
請求項1から4のいずれかのミキサ回路(60)。 - 前記トランジスタ(11、11’)は、バイポーラトランジスタであり、
前記第1の入力ポートは、前記トランジスタのベース(13)であり、
前記第2の入力ポートは、前記トランジスタのエミッタ(12)であり、
前記出力ポートは、前記トランジスタのコレクタである、
請求項6のミキサ回路(400、410、60)。 - 前記トランジスタ(21)は、電界効果トランジスタ(FET)であり、
前記第1の入力ポートは、前記トランジスタのゲート(23)であり、
前記第2の入力ポートは、前記トランジスタのソース(22)であり、
前記出力ポートは、前記トランジスタのドレインである、
請求項6のミキサ回路(20)。
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