JP5367686B2 - データ記憶装置、メモリ制御装置及びメモリ制御方法 - Google Patents
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- G06F11/10—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's
Description
図1は、実施形態のデータ記憶装置の構成を示すブロック図である。
図2に示すように、フラッシュメモリコントローラ11は、チャネルCH-0〜CH-4毎のチャネルコントローラ100〜104と、IOPS(Input Output per Second)アクセラレータ(以下、単にアクセラレータ: accelerator)110と、データフローコントローラ120と、チャネル間パリティビットモジュール130とを含む。
以下、図3から図15までを参照して、本実施形態のICP処理(チャネル間データ保護機能)を説明する。
図15のフローチャートに示すように、リード動作では、フラッシュメモリコントローラ11は、各チャネルのフラッシュメモリからユーザデータを読み出してバッファメモリ21に転送する(ブロック1100)。このとき、フラッシュメモリコントローラ11は、読み出したユーザデータのエラーチェックをECCにより実行する(ブロック1101)。フラッシュメモリコントローラ11は、エラー訂正が可能であれば、ECCによる訂正処理を実行する(ブロック1102のYES,1103)。ECCによりエラー訂正されたユーザデータは、バッファメモリ21からホストインターフェースコントローラ13に転送される(ブロック1104)。
12…バッファマネージャモジュール、13…ホストインターフェースコントローラ、
14…サブシステムモジュール、20,200〜20n…NAND型フラッシュメモリ、
21…バッファメモリ(DRAM)、30…ホストデバイス、40…RS演算器、
100〜104…チャネルコントローラ、110…アクセラレータ、
120…データフローコントローラ、130…ICPモジュール(チャネル間パリティモジュール)、140,141…マイクロプロセッサ(CPU)。
Claims (8)
- 複数チャネルの各不揮発性メモリに対してデータの入出力を制御するチャネル制御手段と、
前記各不揮発性メモリに記憶されるデータを使用して、チャネル間の誤り検出訂正処理が可能な符号化データを生成する符号化手段と、
前記チャネル制御手段により前記符号化データを前記各チャネルに並列に書き込むときに論理ブロック単位で管理し、かつ前記符号化データに含まれるパリティデータを前記論理ブロック中の1つのプレーンに割り当てて管理するデータ制御手段とを具備し、
前記データ制御手段は、
前記論理ブロックが前記複数のチャネルと、第1及び第2のプレーンのマトリックスとして構成されている場合に、前記パリティデータを前記第1または第2のプレーンのいずれかに割り当てて管理するデータ記憶装置。 - 前記チャネル制御手段から読み出される前記符号化データに対して誤り検出訂正処理を実行する復号化手段を具備する請求項1に記載のデータ記憶装置。
- 前記データ制御手段は、
前記符号化データの生成時に使用される元データと前記パリティデータの符号中次数情報と前記論理ブロック中の位置情報を関連付けて、前記論理ブロック中において前記パリティデータを格納するプレーンにおいて前記パリティデータに割り当てられるチャネル以外の各チャネルに前記元データを割り当てる請求項1に記載のデータ記憶装置。 - 前記復号化手段は、
誤り検出訂正処理時に、前記データ制御手段から転送される前記符号化データを入力するときに、前記論理ブロックと前記符号化データの位置関係を示すチャネル番号及びプレーン番号を含む位置情報を前記データ制御手段から入力するように構成されている請求項2に記載のデータ記憶装置。 - 複数チャネルの各不揮発性メモリを有するデータ記憶装置に適用するメモリ制御装置であって、
前記各不揮発性メモリに対するデータの入出力を制御するチャネル制御手段と、
前記各不揮発性メモリに記憶されるデータを使用して、チャネル間の誤り検出訂正処理が可能な符号化データを生成する符号化手段と、
前記チャネル制御手段により前記符号化データを前記各チャネルに並列に書き込むときに前記符号化データを論理ブロック単位で管理し、かつ前記符号化データに含まれるパリティデータを前記論理ブロック中の1つのプレーンに割り当てて管理するデータ制御手段とを具備し、
前記データ制御手段は、
前記論理ブロックが前記複数のチャネルと、第1及び第2のプレーンのマトリックスとして構成されている場合に、前記パリティデータを前記第1または第2のプレーンのいずれかに割り当てて管理するメモリ制御装置。 - 前記チャネル制御手段から読み出される前記符号化データに対して誤り検出訂正処理を実行する復号化手段を具備する請求項5に記載のメモリ制御装置。
- 前記データ制御手段は、
前記符号化データの生成時に使用される元データと前記パリティデータの符号中次数情報と前記論理ブロック中の位置情報を関連付けて、前記論理ブロック中において前記パリティデータを格納するプレーンにおいて前記パリティデータに割り当てられるチャネル以外の各チャネルに前記元データを割り当てる請求項5に記載のメモリ制御装置。 - 複数チャネルの各不揮発性メモリを有するデータ記憶装置に適用するメモリ制御方法であって、
エンコード処理時に、前記各チャネルの不揮発性メモリから読み出されるデータを使用して、チャネル間の誤り検出訂正処理が可能な符号化データを生成し、
前記符号化データを前記各チャネルに並列に書き込むときに、前記符号化データを論理ブロック単位で管理し、かつ前記符号化データに含まれるパリティデータを前記論理ブロック中の1つのプレーンに割り当てて管理し、
前記論理ブロックが前記複数のチャネルと、第1及び第2のプレーンのマトリックスとして構成されている場合に、前記パリティデータを前記第1または第2のプレーンのいずれかに割り当てて管理するメモリ制御方法。
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