JP5359569B2 - メモリのアクセス方法 - Google Patents
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- データストリーム方式でデータを入力し、n×nのデータブロック方式でデータを出力するメモリのアクセス方法であって、
前記メモリのサイズは、n行A列(第0〜第n-1行第0〜第A-1列)であり、ここで、nは画像処理アルゴリズムが処理できるデータブロックの各行各列のデータの数であり、Aは画像の水平解像度Bより大きい値であり、且つAはn×nの整数倍であり、
前記メモリは、n行×nセクションに分割され、各セクションには、A/n列が含まれ、
前記メモリのアクセス方法は、
行ごとに第0行〜第n-2行において全てのセクションにおける前のB/n列にデータを順次書き込むステップ1と、
第n-1行において全てのセクションにおける前のB/n列にデータを列ごとに書き込み、毎回行ごとにn列のデータを順次読み出す方式で、第0セクションの前のB/n列のデータを読み出してn×nのデータブロックを構成するステップ2と、
セクションごとに第0セクション〜第n-2セクションにおける前のB/n列にデータを行ごとに順次書き込み、毎回行ごとにn列のデータを順次読み出す方式で、セクションごとに第1セクション〜第n-1セクッションにおける前のB/n列のデータを読み出してn×nのデータブロックを構成し、第kセクションにおいてデータを書き込み、第k+1セクッションにおいてデータを読み出し、ここで、k=0〜n-2であるステップ3と、
第n-1セクションの前のB/n列にデータを行ごとに書き込み、毎回セクションごとにn列のデータを順次読み出す方式で、第0行の各セクションにおける前のB/n列のデータを読み出してn×nのデータブロックを構成するステップ4と、
行ごとに第0行〜第n-2行において全てのセクションにおける前のB/n列にデータを順次書き込み、毎回セクションごとにn列のデータを順次読み出す方式で、行ごとに第1行〜第n-1行の各セクションにおける前のB/n列のデータを順次読み出してn×nのデータブロックを構成し、第k行においてデータを書き込み、第k+1行においてデータを読み出し、ここで、k=0〜n-2であり、それから、ステップ2へ戻るステップ5と、
を含む、ことを特徴とするメモリのアクセス方法。 - データストリーム方式でデータを入力し、n×nのデータブロック方式でデータを出力するメモリのアクセス方法であって、
前記メモリのサイズは、n行A列(第0〜第n-1行第0〜第A-1列)であり、ここで、nは画像処理アルゴリズムが処理できるデータブロックの各行各列のデータの数であり、Aは画像の水平解像度Bより大きい値であり、且つAはn×nの整数倍であり、
前記メモリは、n行×nセクションに分割され、各セクションには、A/n列が含まれ、
前記メモリのアクセス方法は、
セクションごとに第0セクッション〜第n-2セクションにおける前のB/n列にデータを行ごとに順次書き込むステップ1と、
第n-1セクションにおける前のB/n列にデータを行ごとに書き込み、毎回セクションごとにn列のデータを順次読み出す方式で、第0行の各セクションにおける前のB/n列のデータを読み出してn×nのデータブロックを構成するステップ2と、
行ごとに第0行〜第n-2行において全てのセクションにおける前のB/n列にデータを順次書き込み、毎回セクションごとにn列のデータを順次読み出す方式で、行ごとに第1行〜第n-1行の各セクションにおける前のB/n列のデータを順次読み出してn×nのデータブロックを構成し、第k行においてデータを書き込み、第k+1行においてデータを読み出し、ここで、k=0〜n-2であるステップ3と、
第n-1行において全てのセクションにおける前のB/n列にデータを列ごとに順次書き込み、毎回行ごとにn列のデータを順次読み出す方式で、第0セクションの前のB/n列のデータを読み出してn×nのデータブロックを構成するステップ4と、
セクションごとに第0セクション〜第n-2セクションにおける前のB/n列にデータを行ごとに順次書き込み、毎回行ごとにn列のデータを順次読み出す方式で、セクションごとに第1セクション〜第n-1セクションにおける前のB/n列のデータを読み出してn×nのデータブロックを構成し、第kセクションにおいてデータを書き込み、第k+1セクションにおいてデータを読み出し、ここで、k=0〜n-2であり、それから、ステップ2へ戻るステップ5と、
を含む、ことを特徴とするメモリのアクセス方法。 - nは、8である、
ことを特徴とする請求項1又は2に記載のメモリのアクセス方法。 - 前記データの入力には遅延が生じると、前記データの出力にも遅延が生じる、
ことを特徴とする請求項1又は2に記載のメモリのアクセス方法。 - 前記ステップ2、3、4及び5におけるデータの読み出し動作は、それぞれ、各自のステップにおけるデータの書き込み動作と同期し、あるいは、各自のステップにおけるデータの書き込み動作よりも遅延する、
ことを特徴とする請求項1又は2に記載のメモリのアクセス方法。
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