JP5123768B2 - Metal oxide film, method for manufacturing the same, and semiconductor device - Google Patents

Metal oxide film, method for manufacturing the same, and semiconductor device Download PDF

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Description

本発明は、主成分金属元素がIn及びZnであるアモルファス構造の金属酸化物膜とその製造方法、及びこの金属酸化物膜を用いた薄膜トランジスタ(TFT)等の半導体装置に関するものである。   The present invention relates to a metal oxide film having an amorphous structure whose main component metal elements are In and Zn, a manufacturing method thereof, and a semiconductor device such as a thin film transistor (TFT) using the metal oxide film.

近年、液晶やエレクトロルミネッセンス(EL)等のフラットパネルディスプレイが実用化されている。アクティブマトリクス型のフラットパネルディスプレイでは、各ドットを駆動するためのスイッチング素子として、アモルファスシリコンあるいはポリシリコン等の半導体薄膜を活性層とした薄膜トランジスタ(TFT)が広く用いられている。   In recent years, flat panel displays such as liquid crystals and electroluminescence (EL) have been put into practical use. In an active matrix flat panel display, a thin film transistor (TFT) having a semiconductor thin film such as amorphous silicon or polysilicon as an active layer is widely used as a switching element for driving each dot.

従来、TFTの半導体活性層は、スパッタ法や真空蒸着法等の真空成膜及びフォトリソグラフィによるパターニングの工程を含む製造方法に製造されている。これらの真空プロセスは装置コストが高く、且つプロセスが複雑である。しかも、いったん基板の略全面に成膜した後に不要部分を除去するため非効率的である。   Conventionally, a semiconductor active layer of a TFT is manufactured by a manufacturing method including steps of vacuum film formation such as sputtering and vacuum deposition and patterning by photolithography. These vacuum processes are expensive and complex. Moreover, it is inefficient because unnecessary portions are removed after a film is formed on substantially the entire surface of the substrate.

そこで近年、簡易で低コスト化が可能な液相法が注目されている。液相法を用いた半導体膜の製造に関しては、有機半導体膜の研究が活発になされている。しかしながら、現状では有機半導体は無機半導体に比べて性能や耐久性等が劣る傾向にあり、TFT用の半導体活性層としては無機半導体膜が好ましい。
液相法を用いた無機半導体膜としては主にシリコン系と酸化物系とがあり、大気中でも安定なことから、酸化物系、特にZnO系、In−Zn−O系、及びIn−Ga−Zn−O系が注目されている。
Therefore, in recent years, a liquid phase method that is simple and can be produced at low cost has attracted attention. With respect to the production of a semiconductor film using a liquid phase method, research on organic semiconductor films has been actively conducted. However, at present, organic semiconductors tend to be inferior in performance and durability compared to inorganic semiconductors, and inorganic semiconductor films are preferred as semiconductor active layers for TFTs.
As an inorganic semiconductor film using a liquid phase method, there are mainly silicon-based and oxide-based films, which are stable in the air. Therefore, oxide-based films, particularly ZnO-based films, In-Zn-O-based films, and In-Ga-- film films are used. A Zn—O system has attracted attention.

素子特性の均一性、及び粒界におけるキャリアの散乱等を考慮すれば、TFT用の半導体活性層の結晶性としてはアモルファスが好ましい。組成や製造条件にもよるが、ゾルゲル法等の液相法において、上記酸化物系でアモルファス構造が得られる焼成温度は通常700℃以下であり、600℃以下が好ましい。特に、ゾルゲル法等の液相法で上記複合酸化物系(In−Zn−O系、及びIn−Ga−Zn−O系等)を成膜する場合、アモルファスとして安定に存在する薄膜が得られる焼成温度は通常600℃以下である。また、製造コストの観点から、基板としてはガラス基板が好ましい。ガラスの歪点は600℃程度である。したがって、アモルファス膜の成膜及び製造コストを考慮すれば、700℃以下、できれば600℃以下の比較的低温プロセスが好ましい。   Considering uniformity of device characteristics, carrier scattering at grain boundaries, etc., the crystallinity of the semiconductor active layer for TFT is preferably amorphous. Although depending on the composition and production conditions, in the liquid phase method such as the sol-gel method, the firing temperature at which an amorphous structure is obtained with the above oxide system is usually 700 ° C. or less, preferably 600 ° C. or less. In particular, when the composite oxide system (In-Zn-O system, In-Ga-Zn-O system, or the like) is formed by a liquid phase method such as a sol-gel method, a thin film that stably exists as an amorphous material is obtained. The firing temperature is usually 600 ° C. or lower. Further, from the viewpoint of production cost, a glass substrate is preferable as the substrate. The strain point of glass is about 600 ° C. Accordingly, considering the film formation and manufacturing cost of the amorphous film, a relatively low temperature process of 700 ° C. or lower, preferably 600 ° C. or lower is preferable.

一般に、ZnO系はアモルファス相を形成するのが困難であり多結晶化しやすいため、素子特性にばらつきが生じやすいという傾向がある(特許文献1の段落0023参照)。また、酸素欠陥が入りやすいため、これによってキャリア電子が多数発生して抵抗値が下がりやすく、TFTとしたときにオフ電流が大きくなり良好なスイッチング特性が得られないという傾向がある(特許文献1の段落0024参照)。   In general, since ZnO is difficult to form an amorphous phase and is easily polycrystallized, the device characteristics tend to vary (see paragraph 0023 of Patent Document 1). In addition, since oxygen defects are easily generated, a large number of carrier electrons are generated by this, and the resistance value is likely to be lowered, and when a TFT is formed, there is a tendency that an off current becomes large and good switching characteristics cannot be obtained (Patent Document 1). Paragraph 0024).

In−Zn−O系は液相法では焼成温度が低くなるにつれて導電体としての性質が強くなる傾向にあり、逆に、In−Ga−Zn−O系は液相法では焼成温度が低くなるにつれて絶縁体としての性質が強くなる傾向にある。   The In—Zn—O system tends to have stronger properties as a conductor as the firing temperature becomes lower in the liquid phase method, while the In—Ga—Zn—O system has a lower firing temperature in the liquid phase method. Accordingly, the properties as an insulator tend to be stronger.

非特許文献1には、液相法によるTFT用のIn−Zn−O膜の製造が記載されている。その焼成条件は600℃1時間である(p.845,32行目参照)。組成は明記されていないが、In−Zn−O系ではZn/Inモル比が1.0に近いことが好ましいとされていること、及びp.844の化学反応式等から判断して、Zn/Inモル比が1.0に近く、ややInリッチな組成であると考えられる。非特許文献1では、電子移動度μ=16.1cm/VsのTFTが得られている(p.845,38行目参照)。
特開平2006-165529号公報 D.H.Lee et.al., Adv.Mater.19,843(2007)
Non-Patent Document 1 describes the production of an In—Zn—O film for TFTs by a liquid phase method. The firing condition is 600 ° C. for 1 hour (see p.845, line 32). Although the composition is not specified, it is said that the Zn / In molar ratio is preferably close to 1.0 in the In—Zn—O system, and p. Judging from the chemical reaction formula of 844, etc., the Zn / In molar ratio is close to 1.0, which is considered to be a slightly In-rich composition. In Non-Patent Document 1, a TFT having an electron mobility μ = 16.1 cm 2 / Vs is obtained (see p.845, line 38).
Japanese Unexamined Patent Publication No. 2006-165529 DHLee et.al., Adv.Mater.19,843 (2007)

In−Zn−O系は液相法では焼成温度が低くなるにつれて導電体としての性質が強くなる傾向にあることを述べた。非特許文献1に記載のTFTのVgs−Id特性(ゲート電圧Vgsとドレイン電流Idとの関係)を図3に示す。この図は、非特許文献1のFig.2(b)に記載のデータである。焼成条件を600℃1時間としている非特許文献1に記載のTFTはオフ時(Vgs=0V)におけるドレイン電流Idが1.0×10−4A程度と高く、オン/オフのスイッチング特性が良くない。図から読み取れるオン/オフ電流比(オフ:Vgs=0V、オン:Vgs=5V)は非常に小さく、2.0未満である。 It has been described that the In—Zn—O system tends to become more conductive as the firing temperature is lower in the liquid phase method. FIG. 3 shows Vgs-Id characteristics (a relationship between the gate voltage Vgs and the drain current Id) of the TFT described in Non-Patent Document 1. This figure is the data described in Fig. 2 (b) of Non-Patent Document 1. The TFT described in Non-Patent Document 1 with firing conditions of 600 ° C. for 1 hour has a high drain current Id of about 1.0 × 10 −4 A when off (Vgs = 0 V), and has good on / off switching characteristics. Absent. The on / off current ratio (off: Vgs = 0V, on: Vgs = 5V) that can be read from the figure is very small and less than 2.0.

本発明は上記事情に鑑みてなされたものであり、比較的低温の液相法により製造することができ、TFT等の半導体活性層として良好な特性を有するIn−Zn−O系の金属酸化物膜、及びその製造方法を提供することを目的とするものである。
本発明はまた、上記金属酸化物膜を用いたTFT等の半導体装置を提供することを目的とするものである。
The present invention has been made in view of the above circumstances, and can be produced by a liquid phase method at a relatively low temperature, and has an excellent characteristic as a semiconductor active layer such as a TFT. It aims at providing a film | membrane and its manufacturing method.
Another object of the present invention is to provide a semiconductor device such as a TFT using the metal oxide film.

本発明の金属酸化物膜は、
基板上に成膜され、主成分金属元素がIn及びZnであるアモルファス構造の金属酸化物膜において、
膜中に水酸基が存在しており、かつ、下記式(1)を充足する組成分布を有することを特徴とするものである。
Zn(T)/CIn(T)≧4.0×CZn(B)/CIn(B)・・・(1)
(式(1)中、
Zn(B)/CIn(B)は基板側の膜面におけるZn/Inモル比、
Zn(T)/CIn(T)は基板側と反対側の膜面におけるZn/Inモル比をそれぞれ示す。)
The metal oxide film of the present invention is
In an amorphous metal oxide film formed on a substrate and having main component metal elements of In and Zn,
A hydroxyl group is present in the film, and the composition has a composition distribution satisfying the following formula (1).
C Zn (T) / C In (T) ≧ 4.0 × C Zn (B) / C In (B) (1)
(In the formula (1),
C Zn (B) / C In (B) is the Zn / In molar ratio in the film surface on the substrate side,
C Zn (T) / C In (T) represents a Zn / In molar ratio in the film surface opposite to the substrate side. )

本明細書において、「主成分金属元素がIn及びZnである」とは、膜全体に含まれる金属元素の総量を100モル%としたとき、膜全体に含まれるIn濃度が10モル%以上であり、膜全体に含まれるZn濃度が30モル%以上であると定義する。
「アモルファス」は、X線回折(XRD)測定で回折ピークが検出されないことにより定義するものとする。
In this specification, “the main component metal elements are In and Zn” means that when the total amount of metal elements contained in the entire film is 100 mol%, the concentration of In contained in the entire film is 10 mol% or more. It is defined that the Zn concentration contained in the entire film is 30 mol% or more.
“Amorphous” is defined by the fact that no diffraction peak is detected by X-ray diffraction (XRD) measurement.

液相法により700℃以下の比較的低温プロセスで、アモルファス構造のIn−Zn−O系の金属酸化物膜を成膜した場合、膜中に水酸基が残存する。同じIn−Zn−O系でも、気相法、あるいは700℃超の焼成工程を含む液相法により成膜されたものでは膜中に水酸基は存在しない。換言すれば、「膜中に水酸基が存在している」ことは、液相法により700℃以下の比較的低温プロセスで成膜された膜であることを意味している。   When an amorphous In—Zn—O-based metal oxide film is formed by a liquid phase method at a relatively low temperature process of 700 ° C. or lower, a hydroxyl group remains in the film. Even in the same In—Zn—O system, there is no hydroxyl group in a film formed by a vapor phase method or a liquid phase method including a baking step exceeding 700 ° C. In other words, “a hydroxyl group is present in the film” means that the film is formed by a relatively low temperature process of 700 ° C. or less by a liquid phase method.

本明細書において、「加熱温度」は、基板を加熱するヒータあるいは加熱炉等の加熱手段の設定温度を意味する。
本明細書において、「水酸基の有無」は、IR(Infrared spectroscopy)分析を実施し、3300〜3400cm―1の吸収ピークにより分析するものとする。この吸収ピークはブロードなピークのため、ベースラインに対してピーク中心が少なくとも3%以上高いときに水酸基が有ると判定するものとする。
In the present specification, the “heating temperature” means a set temperature of a heating means such as a heater or a heating furnace for heating the substrate.
In this specification, “presence / absence of hydroxyl group” shall be analyzed by IR (Infrared spectroscopy) analysis and by an absorption peak at 3300 to 3400 cm −1 . Since this absorption peak is a broad peak, it is determined that there is a hydroxyl group when the peak center is at least 3% higher than the baseline.

本発明の金属酸化物膜は膜厚方向(深さ方向)に組成分布を有している。膜厚方向の組成分析は、SIMS(Secondary Ion Mass Spectrometry)分析により実施できる。試料表面に数keVのエネルギーを持つO あるいはCS等のイオンビーム(一次イオン)を照射すると、スパッタリングによって試料表面の原子が真空中に放出される。そのうちの一部の原子(通常は1%以下)は正又は負にイオン化されている(二次イオン)。SIMS分析は、この二次イオンを電界により引き出し、磁場あるいは高周波電場等を用いて質量分析し、試料表面の構成成分の定性・定量を行う分析方法である。SIMS分析では、表面をスパッタで削り取っていくことを利用して、深さ方向の分析が可能である。 The metal oxide film of the present invention has a composition distribution in the film thickness direction (depth direction). The composition analysis in the film thickness direction can be performed by SIMS (Secondary Ion Mass Spectrometry) analysis. When the sample surface is irradiated with an ion beam (primary ion) such as O 2 + or CS + having an energy of several keV, atoms on the sample surface are released into the vacuum by sputtering. Some of them (usually 1% or less) are ionized positively or negatively (secondary ions). The SIMS analysis is an analysis method in which the secondary ions are extracted by an electric field and subjected to mass analysis using a magnetic field or a high-frequency electric field to qualitatively and quantitatively determine constituent components on the sample surface. In SIMS analysis, analysis in the depth direction is possible by utilizing the fact that the surface is scraped off by sputtering.

膜厚方向の組成分析は、SEM−EDXあるいはRBS(Rutherford Backscattering Spectrometry)によっても実施することもできる。膜厚方向の組成分析は、オージェ電子分光にイオンスパッタを組み合わせることによっても、実施することもできる。オージェ電子分光は、試料表面に電子線を照射し、飛び出してきたオージェ電子を検出することによる定性・定量分析である。   The composition analysis in the film thickness direction can also be performed by SEM-EDX or RBS (Rutherford Backscattering Spectrometry). Composition analysis in the film thickness direction can be performed by combining ion sputtering with Auger electron spectroscopy. Auger electron spectroscopy is a qualitative and quantitative analysis by irradiating a sample surface with an electron beam and detecting the Auger electrons that have jumped out.

液相法において、仕込み組成と焼成後に実際に得られる組成は多少ずれる場合がある。本明細書において、「組成比」は仕込み組成比ではなく、実際に得られた膜の組成比を意味し、SIMS分析により膜厚方向の組成分析を実施するものとする。
なお、後記実施例においては2層積層構造の膜を製造しており、1層目あるいは2層目の層内の組成のばらつきは大きくないので、膜厚方向の組成分析は実施せず、層ごとにICP分析により組成を評価してある。実施例におけるICP分析による組成分析とSIMS分析により膜厚方向の組成分析とは同一の結果が得られる。
In the liquid phase method, the charged composition and the composition actually obtained after firing may be slightly different. In this specification, “composition ratio” means not the charged composition ratio but the composition ratio of the actually obtained film, and the composition analysis in the film thickness direction is performed by SIMS analysis.
In the examples described later, a film having a two-layer structure is manufactured, and the variation in composition in the first layer or the second layer is not large. Each composition is evaluated by ICP analysis. In the examples, the same results are obtained with the composition analysis by ICP analysis and the composition analysis in the film thickness direction by SIMS analysis.

本発明者は、上記組成分布を有する金属酸化物膜は、液相法により比較的低温プロセスで製造しても、TFTとしたときのオフ電流が0若しくはそれに近い値であり、オン/オフ電流比が大きく、スイッチング特性に優れたTFTを提供できることを見出している。   The present inventor has found that a metal oxide film having the above composition distribution has an off-current of 0 or close to a TFT even when manufactured by a liquid phase method at a relatively low temperature process, and has an on / off current value. It has been found that a TFT having a large ratio and excellent switching characteristics can be provided.

気相法による成膜であるが、「背景技術」の項で挙げた特許文献1には、In及び/又はZnを含む金属酸化物膜において、膜厚方向に組成を変化させることが記載されている。
特許文献1では、上記組成系におけるオフ電流の問題は酸素欠陥によると考えられており、成膜時の酸素分圧を制御することで、これを解決することを提案している(段落0062等)。組成分布に関しては、酸素量を膜厚方向に変えることが提案されており、この点に重点が置かれている(請求項12,段落0069、0071等)。
Although it is a film formation by a vapor phase method, Patent Document 1 cited in the section of “Background Art” describes that in a metal oxide film containing In and / or Zn, the composition is changed in the film thickness direction. ing.
In Patent Document 1, it is considered that the problem of off-current in the composition system is due to oxygen defects, and it is proposed to solve this problem by controlling the oxygen partial pressure during film formation (paragraph 0062, etc.). ). With regard to the composition distribution, it has been proposed to change the oxygen amount in the film thickness direction, and this point is emphasized (claim 12, paragraphs 0069, 0071, etc.).

特許文献1では一応、金属元素の組成比を変えることも提案されているが、あまり詳しく記載されてはいない。
具体的には、In又はZnを含む系では、第1の領域と第1の領域よりもゲート絶縁膜に近い第2の領域とを含み、第2の領域のIn濃度あるいはZn濃度を第1の領域のIn濃度あるいはZn濃度より高くすることが提案されている(請求項13,段落0076等)。
In及びZnを含む系では、第2の領域のIn濃度を第1の領域のIn濃度より高くするか、あるいは第2の領域のZn濃度を第1の領域のZn濃度より高くすることが提案されている(請求項15,段落0078等)。
上記構成では、電界効果移動度が高まることが記載されているが、その理由やメカニズム等については記載されていない(段落0076等)。
In Patent Document 1, it is also proposed to change the composition ratio of metal elements, but this is not described in detail.
Specifically, in the system containing In or Zn, the first region and the second region closer to the gate insulating film than the first region are included, and the In concentration or the Zn concentration in the second region is set to the first region. It has been proposed that the concentration be higher than the In concentration or the Zn concentration in this region (claim 13, paragraph 0076, etc.).
In a system containing In and Zn, it is proposed that the In concentration of the second region is higher than the In concentration of the first region, or that the Zn concentration of the second region is higher than the Zn concentration of the first region. (Claim 15, paragraph 0078, etc.).
In the above configuration, it is described that field effect mobility is increased, but the reason, mechanism, and the like are not described (paragraph 0076 and the like).

スパッタ法において金属元素の組成比を変化させる方法として、InあるいはZnOのターゲットを追加スパッタすることが挙げられている(段落0096)。具体的な実施例としては、ターゲットとして、1)InGaO(ZnO)組成を有する多結晶焼結体と2)酸化亜鉛の焼結体とを用意し、はじめにターゲット1)のみを用いてスパッタ法により成膜を行い、次いでターゲット1)と2)とを同時に用いてスパッタ法による成膜を行うことで、膜厚方向に組成分布を有するアモルファス構造のIn−Ga−Zn−O薄膜を製造することが記載されている(実施例3(段落0313〜0320))。この方法では基板側よりも膜表面側のZn濃度が高くなる。この実施例では、ゲート絶縁膜近傍では、InあるいはZnの多い方が、電界効果移動度が大きくなることが期待されると記載されている(段落0320)が、理由やメカニズム等については記載されていない。 As a method for changing the composition ratio of the metal element in the sputtering method, additional sputtering of an In 2 O 3 or ZnO target is cited (paragraph 0096). As a specific example, 1) a polycrystalline sintered body having an InGaO 3 (ZnO) 4 composition and 2) a sintered body of zinc oxide are prepared as targets, and sputtering is performed using only the target 1) first. The film is formed by the sputtering method, and then the target 1) and 2) are simultaneously used to form the film by sputtering, thereby producing an amorphous In-Ga-Zn-O thin film having a composition distribution in the film thickness direction. (Example 3 (paragraphs 0313 to 0320)). In this method, the Zn concentration on the film surface side is higher than that on the substrate side. In this example, it is described that the field effect mobility is expected to increase with increasing In or Zn in the vicinity of the gate insulating film (paragraph 0320), but the reason, mechanism, and the like are described. Not.

気相法と液相法では、同様の組成系でも得られる膜の構造や特性が大きく異なり、気相法では非特許文献1のようなTFTのオフ電流の問題は生じない。実際、特許文献1の図6に記載のTFTのVgs−Id曲線ではオフ電流が0となっている。すなわち、特許文献1には気相法においてZn/Inモル比を膜厚方向に変えることは提案されているが、TFTとしたときのオフ電流の問題を解決するものではない。   The vapor phase method and the liquid phase method are greatly different in the structure and characteristics of the film obtained even in the same composition system, and the vapor phase method does not cause the problem of TFT off current as in Non-Patent Document 1. Actually, the off-state current is 0 in the Vgs-Id curve of the TFT described in FIG. That is, Patent Document 1 proposes changing the Zn / In molar ratio in the film thickness direction in the vapor phase method, but does not solve the problem of off-current when a TFT is used.

本発明の金属酸化物膜において、CZn(B)/CIn(B)が0.5〜2.0であることが好ましい。 In the metal oxide film of the present invention, C Zn (B) / C In (B) is preferably 0.5 to 2.0.

本発明の金属酸化物膜の好ましい態様としては、Zn/Inモル比の異なる複数の金属酸化物層の積層構造が挙げられる。
上記態様としては、In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液を用意する工程(X)と、前記原料液を前記基板上に塗布して塗布層を形成する工程(Y)と、前記塗布層を加熱して金属酸化物層とする工程(Z)とを有する液相法により製造されたものであり、
前記原料液としてZn/Inモル比の異なる複数の原料液を用意し、各々の該原料液について工程(X)〜(Z)を実施することにより、Zn/Inモル比の異なる前記複数の金属酸化物層を積層する方法により製造されたものが挙げられる。
As a preferred embodiment of the metal oxide film of the present invention, a laminated structure of a plurality of metal oxide layers having different Zn / In molar ratios can be given.
As the above aspect, a step (X) of preparing a raw material liquid containing at least one organic precursor containing In and Zn and at least one organic solvent, and applying and applying the raw material liquid on the substrate Manufactured by a liquid phase method having a step (Y) of forming a layer and a step (Z) of heating the coating layer to form a metal oxide layer,
A plurality of raw material liquids having different Zn / In molar ratios are prepared as the raw material liquid, and the plurality of metals having different Zn / In molar ratios are performed by performing steps (X) to (Z) for each of the raw material liquids. What was manufactured by the method of laminating | stacking an oxide layer is mentioned.

本発明の金属酸化物膜において、前記基板がガラス基板であることが好ましい。
本発明によれば、膜全体として半導体性を有する金属酸化物膜を提供することができる。本発明の金属酸化物膜には導電性部分及び/又は絶縁性部分が含まれていてもよいが、膜全体として見れば、半導体性を有することが好ましい。
In the metal oxide film of the present invention, the substrate is preferably a glass substrate.
According to the present invention, a metal oxide film having semiconductivity as the entire film can be provided. The metal oxide film of the present invention may contain a conductive portion and / or an insulating portion, but preferably has semiconductivity when viewed as a whole film.

本発明の金属酸化物膜の製造方法は、
In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液を用意する工程(X)と、前記原料液を基板上に塗布して塗布層を形成する工程(Y)と、前記塗布層を加熱して金属酸化物層とする工程(Z)とを有する液相法により、主成分金属元素がIn及びZnであるアモルファス構造の金属酸化物膜を製造する金属酸化物膜の製造方法において、
前記原料液としてZn/Inモル比の異なる複数の原料液を用意し、各々の該原料液について工程(X)〜(Z)を実施して、Zn/Inモル比の異なる複数の金属酸化物層を積層することにより、
下記式(1)を充足する組成分布を有する金属酸化物膜を製造することを特徴とするものである。
Zn(T)/CIn(T)≧4.0×CZn(B)/CIn(B)・・・(1)
(式(1)中、
Zn(B)/CIn(B)は基板側の膜面におけるZn/Inモル比、
Zn(T)/CIn(T)は基板側と反対側の膜面におけるZn/Inモル比をそれぞれ示す。)
The method for producing the metal oxide film of the present invention comprises:
A step (X) of preparing a raw material liquid containing at least one organic precursor containing In and Zn and at least one organic solvent, and a step of applying the raw material liquid on a substrate to form a coating layer ( Y) and a metal for producing an amorphous metal oxide film whose main component metal elements are In and Zn by a liquid phase method having a step (Z) of heating the coating layer to form a metal oxide layer In the method for producing an oxide film,
A plurality of raw material liquids having different Zn / In molar ratios are prepared as the raw material liquid, and steps (X) to (Z) are performed on each of the raw material liquids, and a plurality of metal oxides having different Zn / In molar ratios. By laminating the layers,
A metal oxide film having a composition distribution satisfying the following formula (1) is manufactured.
C Zn (T) / C In (T) ≧ 4.0 × C Zn (B) / C In (B) (1)
(In the formula (1),
C Zn (B) / C In (B) is the Zn / In molar ratio in the film surface on the substrate side,
C Zn (T) / C In (T) represents a Zn / In molar ratio in the film surface opposite to the substrate side. )

本発明の金属酸化物膜の製造方法において、工程(Z)の加熱温度が700℃以下であることが好ましい。
工程(Y)において、インクジェット方式により前記塗布層を所定のパターンで形成することが好ましい。
In the method for producing a metal oxide film of the present invention, the heating temperature in step (Z) is preferably 700 ° C. or lower.
In the step (Y), the coating layer is preferably formed in a predetermined pattern by an ink jet method.

本発明の半導体装置は、膜全体として半導体性を有する本発明の金属酸化物膜を用いて得られた半導体活性層を備えたことを特徴とするものである。
本発明は特に、前記半導体活性層の他に、ゲート電極、ゲート絶縁膜、ソース電極、及びドレイン電極を備えたボトムゲート型の薄膜トランジスタに好ましく適用できる。
The semiconductor device of the present invention is characterized by including a semiconductor active layer obtained by using the metal oxide film of the present invention having semiconductivity as a whole film.
In particular, the present invention can be preferably applied to a bottom-gate thin film transistor including a gate electrode, a gate insulating film, a source electrode, and a drain electrode in addition to the semiconductor active layer.

本発明によれば、比較的低温の液相法により製造することができ、TFT等の半導体活性層として良好な特性を有するIn−Zn−O系の金属酸化物膜を提供することができる。この金属酸化物膜を用いることにより、スイッチング特性等の素子特性が良好な薄膜トランジスタ(TFT)等の半導体装置を提供することができる。   According to the present invention, it is possible to provide an In—Zn—O-based metal oxide film that can be manufactured by a liquid phase method at a relatively low temperature and has good characteristics as a semiconductor active layer such as a TFT. By using this metal oxide film, a semiconductor device such as a thin film transistor (TFT) having favorable element characteristics such as switching characteristics can be provided.

「金属酸化物膜、半導体装置」
図1を参照して、本発明に係る実施形態の金属酸化物膜、及びこの膜を備えた半導体装置の構造について説明する。本実施形態では、ボトムゲート型の薄膜トランジスタ(TFT)を例として説明する。このTFTは、本実施形態の金属酸化物膜からなる半導体活性層を備えている。図1はTFTの概略断面図である。視認しやすくするため、構成要素の縮尺は実際のものとは適宜異ならせてある。
"Metal oxide films, semiconductor devices"
With reference to FIG. 1, the structure of a metal oxide film according to an embodiment of the present invention and a semiconductor device including this film will be described. In this embodiment, a bottom gate type thin film transistor (TFT) will be described as an example. This TFT includes a semiconductor active layer made of the metal oxide film of the present embodiment. FIG. 1 is a schematic sectional view of a TFT. In order to facilitate visual recognition, the scale of the constituent elements is appropriately changed from the actual one.

TFT(半導体装置)1は、基板10と、この基板上に形成されたゲート電極20/ゲート絶縁膜30/半導体活性層(金属酸化物膜)40/ソース電極50/ドレイン電極60とから構成されている。ゲート絶縁膜30は基板10の略全面に形成されており、ゲート電極20/半導体活性層(金属酸化物膜)40/ソース電極50/ドレイン電極60は基板10上に所定のパターンで形成されている。   The TFT (semiconductor device) 1 includes a substrate 10 and a gate electrode 20 / gate insulating film 30 / semiconductor active layer (metal oxide film) 40 / source electrode 50 / drain electrode 60 formed on the substrate. ing. The gate insulating film 30 is formed on substantially the entire surface of the substrate 10, and the gate electrode 20 / semiconductor active layer (metal oxide film) 40 / source electrode 50 / drain electrode 60 are formed on the substrate 10 in a predetermined pattern. Yes.

基板10としては特に制限なく、通常のTFT用基板として公知のものが使用でき、シリコン基板、石英基板、及びガラス基板等が挙げられる。基板表面に酸化膜等の下地膜が形成されたものを用いることもできる。
本実施形態では、700℃以下の比較的低温でTFT用としての特性が良好な半導体活性層40を形成でき、600℃以下あるいは400℃以下のより低温でもTFT用としての特性が良好な半導体活性層40を形成できる。したがって、本実施形態では、上記例示した基板の中でも安価なガラス基板(歪点は600℃程度)を用いることができ、好ましい。
There is no restriction | limiting in particular as the board | substrate 10, A well-known thing can be used as a board | substrate for normal TFT, A silicon substrate, a quartz substrate, a glass substrate, etc. are mentioned. A substrate in which a base film such as an oxide film is formed on the surface of the substrate can also be used.
In this embodiment, the semiconductor active layer 40 having good characteristics for TFT can be formed at a relatively low temperature of 700 ° C. or lower, and the semiconductor activity having good characteristics for TFT even at lower temperatures of 600 ° C. or lower or 400 ° C. or lower. Layer 40 can be formed. Therefore, in this embodiment, an inexpensive glass substrate (with a strain point of about 600 ° C.) can be used among the above-exemplified substrates, which is preferable.

ゲート電極20、ソース電極50、及びドレイン電極60の組成は特に制限なく、Al、Cu、Ag、Au、Pt、及びこれらの合金等の金属、あるいはITO(インジウム錫酸化物)等の非金属が挙げられる。   The composition of the gate electrode 20, the source electrode 50, and the drain electrode 60 is not particularly limited, and a metal such as Al, Cu, Ag, Au, Pt, and an alloy thereof, or a nonmetal such as ITO (indium tin oxide) is used. Can be mentioned.

ゲート絶縁膜30の組成としては特に制限なく、SiO、SiN、及びSiO等のシリコン化合物、あるいはAl、TiO、ZrO、及びY等の金属酸化物等が好ましい。ゲート絶縁膜30の膜厚は特に制限なく、例えば50〜500nm程度が好ましい。 The composition of the gate insulating film 30 is not particularly limited, and silicon compounds such as SiO 2 , SiN x , and SiO x N y , or metal oxides such as Al 2 O 3 , TiO 2 , ZrO 2 , and Y 2 O 3 Etc. are preferred. The thickness of the gate insulating film 30 is not particularly limited, and is preferably about 50 to 500 nm, for example.

本実施形態において、半導体活性層40は、主成分金属元素がIn及びZnである金属酸化物膜である。
半導体活性層40は不可避不純物を含んでいてもよい。半導体活性層40はまた、特性上支障のない範囲内において、不可避不純物以上のレベルでIn及びZn以外の任意の金属元素を含むことができる。例えば、任意成分として、Ga,Al,Fe,及びMg等の金属元素を1種又は2種以上含むことができる。かかる任意成分の総量は特に制限されず、半導体特性を考慮すれば、半導体活性層40全体に含まれる金属元素の総量100モル%に対して10モル%以内が好ましい。
In the present embodiment, the semiconductor active layer 40 is a metal oxide film whose main component metal elements are In and Zn.
The semiconductor active layer 40 may contain inevitable impurities. The semiconductor active layer 40 can also contain any metal element other than In and Zn at a level higher than inevitable impurities within a range that does not hinder the characteristics. For example, one or more metal elements such as Ga, Al, Fe, and Mg can be included as optional components. The total amount of such optional components is not particularly limited, and considering semiconductor characteristics, it is preferably within 10 mol% with respect to 100 mol% of the total amount of metal elements contained in the entire semiconductor active layer 40.

本実施形態において、半導体活性層40は、Zn/Inモル比の異なる第1の金属酸化物層41と第2の金属酸化物層42との積層構造を有している。第2の金属酸化物層42のZn/Inモル比は、第1の金属酸化物層41のZn/Inモル比の4.0倍以上とされており、下記式(1)を充足する組成分布を有している。
Zn(T)/CIn(T)≧4.0×CZn(B)/CIn(B)・・・(1)
(式(1)中、
Zn(B)/CIn(B)は基板側の膜面におけるZn/Inモル比、
Zn(T)/CIn(T)は基板側と反対側の膜面におけるZn/Inモル比をそれぞれ示す。)
図1において、半導体活性層40の基板側の膜面に符号40B、基板側と反対側の膜面に符号40Tを付してある。
In the present embodiment, the semiconductor active layer 40 has a stacked structure of a first metal oxide layer 41 and a second metal oxide layer 42 having different Zn / In molar ratios. The Zn / In molar ratio of the second metal oxide layer 42 is 4.0 times or more the Zn / In molar ratio of the first metal oxide layer 41, and satisfies the following formula (1). Have a distribution.
C Zn (T) / C In (T) ≧ 4.0 × C Zn (B) / C In (B) (1)
(In the formula (1),
C Zn (B) / C In (B) is the Zn / In molar ratio in the film surface on the substrate side,
C Zn (T) / C In (T) represents a Zn / In molar ratio in the film surface opposite to the substrate side. )
In FIG. 1, a film surface on the substrate side of the semiconductor active layer 40 is denoted by reference numeral 40B, and a film surface opposite to the substrate side is denoted by reference numeral 40T.

Zn(B)/CIn(B)(=本実施形態では第1の金属酸化物層41のZn/Inモル比)は特に制限されず、TFTとして良好な半導体性を示すことから0.5〜2.0であることが好ましい。
Zn(B)/CIn(B)が小さくなるにつれて、キャリア移動度が大きくなる傾向にある。CZn(B)/CIn(B)が過小では導電体となってしまう。CZn(B)/CIn(B)が1.0又はそれに近いときにキャリア移動度の大きい半導体が得られる。したがって、CZn(B)/CIn(B)は0.8〜1.2であることが特に好ましい。
C Zn (B) / C In (B) (= Zn / In molar ratio of the first metal oxide layer 41 in this embodiment) is not particularly limited, and is 0. It is preferable that it is 5-2.0.
As C Zn (B) / C In (B) decreases, the carrier mobility tends to increase. If C Zn (B) / C In (B) is too small, it becomes a conductor. When C Zn (B) / C In (B) is 1.0 or close to it, a semiconductor with high carrier mobility can be obtained. Accordingly, C Zn (B) / C In (B) is particularly preferably 0.8 to 1.2.

半導体活性層40は液相法により700℃以下の比較的低温プロセスで製造されたアモルファス構造膜であり、膜中に水酸基が存在している。   The semiconductor active layer 40 is an amorphous structure film manufactured by a relatively low temperature process of 700 ° C. or less by a liquid phase method, and a hydroxyl group is present in the film.

「発明が解決しようとする課題」の項において、In−Zn−O系は液相法では焼成温度が低くなるにつれて導電体としての性質が強くなる傾向にあり、焼成条件を600℃1時間としている非特許文献1に記載のTFTはオフ時におけるドレイン電流が高く、オン/オフのスイッチング特性が良くないことを述べた。本発明者は、この問題は特に半導体活性層がゲート絶縁膜により被覆保護されず、半導体活性層の膜表面がTFTの素子特性に与える影響が比較的大きいボトムゲート型において顕著であることを見出している。   In the section “Problems to be Solved by the Invention”, the In—Zn—O system tends to become more conductive as the firing temperature becomes lower in the liquid phase method, and the firing condition is 600 ° C. for 1 hour. It has been described that the TFT described in Non-Patent Document 1 has a high drain current at the time of OFF and poor on / off switching characteristics. The present inventor has found that this problem is particularly noticeable in the bottom gate type in which the semiconductor active layer is not covered and protected by the gate insulating film, and the film surface of the semiconductor active layer has a relatively large influence on the device characteristics of the TFT. ing.

同じ焼成温度でもZn/Inモル比を大きくすれば導電体としての性質が弱まりオフ電流を下げられるが、同時にオン電流まで下がってしまう傾向にある。本発明者は、基板側は良好な半導体性を示すZn/Inモル比とし、基板と反対側はZn/Inモル比を高めた積層構造とすることで、少なくとも一部が半導体性を有し、膜全体として半導体膜として機能し、これをTFTの半導体活性層として用いることで、オフ電流が小さくオン/オフ電流比が大きく、オン/オフのスイッチング特性に優れたTFTを提供できることを見出した。   If the Zn / In molar ratio is increased even at the same firing temperature, the properties as a conductor are weakened and the off-current can be reduced, but at the same time, the on-current tends to decrease. The present inventor considered that the substrate side has a Zn / In molar ratio exhibiting good semiconductor properties, and the opposite side of the substrate has a laminated structure with an increased Zn / In molar ratio, so that at least a part thereof has semiconductor properties. The present inventors have found that a TFT that functions as a semiconductor film as a whole and that is used as a semiconductor active layer of a TFT can provide a TFT having a small off-current and a large on / off current ratio and excellent on / off switching characteristics. .

非特許文献1に記載のTFTのオン/オフ電流比(オフ:Vgs=0V、オン:Vgs=5V)は2.0未満であるが、本発明者は、後記実施例1〜5において1.0×10以上のオン/オフ電流比を実現している。 The on / off current ratio (off: Vgs = 0 V, on: Vgs = 5 V) of the TFT described in Non-Patent Document 1 is less than 2.0. An on / off current ratio of 0 × 10 4 or more is realized.

Zn(T)/CIn(T)とCZn(B)/CIn(B)との差は大きい方が好ましい。具体的には、半導体活性層40は好ましくは下記式(2)、より好ましくは下記式(3)、特に好ましくは(4)を充足する組成分布を有している。
Zn(T)/CIn(T)≧5.0×CZn(B)/CIn(B)・・・(2)、
Zn(T)/CIn(T)≧6.0×CZn(B)/CIn(B)・・・(3)、
Zn(T)/CIn(T)≧7.0×CZn(B)/CIn(B)・・・(4)
The difference between C Zn (T) / C In (T) and C Zn (B) / C In (B) is preferably larger. Specifically, the semiconductor active layer 40 preferably has a composition distribution that satisfies the following formula (2), more preferably the following formula (3), and particularly preferably (4).
C Zn (T) / C In (T) ≧ 5.0 × C Zn (B) / C In (B) (2),
C Zn (T) / C In (T) ≧ 6.0 × C Zn (B) / C In (B) (3),
C Zn (T) / C In (T) ≧ 7.0 × C Zn (B) / C In (B) (4)

第1の金属酸化物層41及び第2の金属酸化物層42の膜厚は特に制限されない。第1の金属酸化物層41の膜厚は例えば30〜200nmが好ましく、50〜100nmが特に好ましい。第2の金属酸化物層42の膜厚は例えば30〜100nmが好ましく、50〜100nmが特に好ましい。かかる膜厚の範囲であれば、原料液の塗布が容易であり、膜の均一性等の観点で好ましい。   The film thicknesses of the first metal oxide layer 41 and the second metal oxide layer 42 are not particularly limited. The film thickness of the first metal oxide layer 41 is preferably, for example, 30 to 200 nm, and particularly preferably 50 to 100 nm. The film thickness of the second metal oxide layer 42 is preferably, for example, 30 to 100 nm, and particularly preferably 50 to 100 nm. If it is the range of this film thickness, application | coating of a raw material liquid is easy and it is preferable from viewpoints, such as the uniformity of a film | membrane.

上記実施形態では、Zn/Inモル比の異なる2層積層構造の半導体活性層40について説明したが、半導体活性層40は上記式(1)を充足すればよいので、3層以上の積層構造でも構わない。また、半導体活性層40は、Zn/Inモル比の異なる領域が層として明確に分かれていなくてもよい。半導体活性層40は、上記式(1)を充足すれば厚み方向の組成分布は任意で構わない。
半導体活性層40の膜厚は特に制限されず、例えば60〜300nmが好ましく、100〜200nmが特に好ましい。
In the above-described embodiment, the semiconductor active layer 40 having a two-layer structure with different Zn / In molar ratios has been described. However, the semiconductor active layer 40 only needs to satisfy the above formula (1), so a three-layer or more stacked structure is also possible. I do not care. Further, in the semiconductor active layer 40, regions having different Zn / In molar ratios may not be clearly separated as layers. The semiconductor active layer 40 may have any composition distribution in the thickness direction as long as the above formula (1) is satisfied.
The film thickness of the semiconductor active layer 40 is not particularly limited, and is preferably, for example, 60 to 300 nm, particularly preferably 100 to 200 nm.

「製造方法」
図2に基づいて、TFT1の製造方法について説明する。図2は図1に対応した製造工程図である。
はじめに、図2(a)に示すように、通常の気相成膜及びフォトリフォグラフィ技術等により、基板10上にゲート電極20を所定のパターンで形成する。この基板10上に、通常の気相成膜等によりゲート絶縁膜30を成膜する。
"Production method"
A manufacturing method of the TFT 1 will be described with reference to FIG. FIG. 2 is a manufacturing process diagram corresponding to FIG.
First, as shown in FIG. 2A, the gate electrode 20 is formed in a predetermined pattern on the substrate 10 by a normal vapor deposition method, a photolithography technique, or the like. A gate insulating film 30 is formed on the substrate 10 by ordinary vapor deposition or the like.

<工程(X−1)、(X−2)>
別途、第1の金属酸化物層41用に、In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液Aを調製しておく(工程(X−1))。同様に、第2の金属酸化物層42用に、In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液Bを調製しておく(工程(X−2))。原料液A,B中のZn/Inモル比は、所望の金属酸化物層41,42の組成に合わせて調製するが、仕込み組成と焼成後に実際に得られる組成は多少ずれる場合がある。
<Process (X-1), (X-2)>
Separately, a raw material liquid A containing at least one organic precursor containing In and Zn and at least one organic solvent is prepared for the first metal oxide layer 41 (step (X-1)). ). Similarly, a raw material liquid B containing at least one organic precursor containing In and Zn and at least one organic solvent is prepared for the second metal oxide layer 42 (step (X-2 )). The Zn / In molar ratio in the raw material liquids A and B is adjusted according to the desired composition of the metal oxide layers 41 and 42, but the actual composition obtained after firing may be slightly different from the charged composition.

有機前駆体としては、金属アルコキシド化合物、有機金属酸化物、及びその他の有機金属化合物が挙げられる。
具体的には、Inを含む有機前駆体としては、インジウムイソプロポキシド、及びインジウム−n−ブトキシド等の金属アルコキシド化合物が挙げられる。
Znを含む有機前駆体としては、酢酸亜鉛等の金属カルボン酸塩;及び亜鉛エトキシド等の金属アルコキシド化合物が挙げられる。
有機溶媒としては、ゾルゲル法等の液相法の原料液に使用される任意の有機溶媒を使用することができ、
ジエチルアミノエタノール、2−エトキシエタノール、2−(メトキシエトキシ)エタノール、2−(エトキシエトキシ)エタノール、2−イソプロポキシエタノール、1−エトキシ−2−プロパノール、2-ジプロピルアミノエタノール、シクロヘキサノール、及びベンジルアルコール等のアルコール;
エチレングリコール、及びジエチレングリコール等のグリコール等が挙げられる。
Examples of the organic precursor include metal alkoxide compounds, organometallic oxides, and other organometallic compounds.
Specifically, examples of the organic precursor containing In include metal alkoxide compounds such as indium isopropoxide and indium-n-butoxide.
Examples of the organic precursor containing Zn include metal carboxylates such as zinc acetate; and metal alkoxide compounds such as zinc ethoxide.
As the organic solvent, any organic solvent used in a raw material liquid for a liquid phase method such as a sol-gel method can be used.
Diethylaminoethanol, 2-ethoxyethanol, 2- (methoxyethoxy) ethanol, 2- (ethoxyethoxy) ethanol, 2-isopropoxyethanol, 1-ethoxy-2-propanol, 2-dipropylaminoethanol, cyclohexanol, and benzyl Alcohol, such as alcohol;
Examples include glycols such as ethylene glycol and diethylene glycol.

<工程(Y−1)>
次に、図2(b)に示すように、図2(a)の工程後の基板10上に原料液Aを塗布して、第1の塗布層41Pを形成する(工程(Y−1))。このとき、半導体活性層40のパターンに合わせて、インクジェットプリンティング方式等の直接描画により第1の塗布層41Pをパターン形成することが好ましい。かかる方法では、材料の無駄がなく低コスト化が可能である。
<Process (Y-1)>
Next, as shown in FIG. 2B, the raw material liquid A is applied onto the substrate 10 after the step of FIG. 2A to form the first coating layer 41P (step (Y-1)). ). At this time, it is preferable to pattern-form the first coating layer 41P by direct drawing such as an ink jet printing method in accordance with the pattern of the semiconductor active layer 40. In such a method, there is no waste of material and cost reduction is possible.

<工程(Z−1)>
次に、図2(c)に示すように、第1の塗布層41Pを加熱して第1の金属酸化物層41とする(工程(Z−1))。アモルファス構造とするために、加熱温度は700℃以下とすることが好ましい。基板10として比較的安価なガラス基板が使用できることから、加熱温度は600℃以下、特に400℃以下とすることが好ましい。本発明では、600℃以下あるいは400℃以下の比較的低温プロセスでも、素子特性が良好なTFT1を得ることができる(後記実施例1〜5を参照)。
<Process (Z-1)>
Next, as shown in FIG.2 (c), the 1st coating layer 41P is heated and it is set as the 1st metal oxide layer 41 (process (Z-1)). In order to obtain an amorphous structure, the heating temperature is preferably 700 ° C. or lower. Since a relatively inexpensive glass substrate can be used as the substrate 10, the heating temperature is preferably 600 ° C. or lower, particularly 400 ° C. or lower. In the present invention, a TFT 1 with good device characteristics can be obtained even at a relatively low temperature process of 600 ° C. or lower or 400 ° C. or lower (see Examples 1 to 5 below).

本工程後において得られた金属酸化物層41の表面は、次工程(Y−2)を実施する前に充分に乾燥させておくことが好ましい。乾燥方法としては例えば、乾燥Air雰囲気下で保存する方法、及び加熱乾燥する方法等が挙げられる。加熱する場合、その温度は特に制限されず、例えば100〜300℃程度が好ましい。   The surface of the metal oxide layer 41 obtained after this step is preferably sufficiently dried before performing the next step (Y-2). Examples of the drying method include a method of storing in a dry Air atmosphere and a method of heating and drying. When heating, the temperature in particular is not restrict | limited, For example, about 100-300 degreeC is preferable.

<工程(Y−2)>
次に、図2(d)に示すように、上記工程後の基板10上に原料液Bを塗布して、第2の塗布層42Pを形成する(工程(Y−2))。このとき、半導体活性層40のパターンに合わせて、インクジェットプリンティング方式により第2の塗布層42Pをパターン形成することが好ましい。かかる方法では、材料の無駄がなく低コスト化が可能である。
<Process (Y-2)>
Next, as shown in FIG.2 (d), the raw material liquid B is apply | coated on the board | substrate 10 after the said process, and the 2nd coating layer 42P is formed (process (Y-2)). At this time, it is preferable that the second coating layer 42 </ b> P is patterned by an ink jet printing method in accordance with the pattern of the semiconductor active layer 40. In such a method, there is no waste of material and cost reduction is possible.

<工程(Z−2)>
次に、図2(e)に示すように、第2の塗布層42Pを加熱して第2の金属酸化物層42とする(工程(Z−2))。アモルファス構造とするために、加熱温度は700℃以下とすることが好ましい。基板10として比較的安価なガラス基板が使用できることから、加熱温度は600℃以下、特に400℃以下とすることが好ましい。本発明では、600℃以下あるいは400℃以下の比較的低温プロセスでも、素子特性が良好なTFTを得ることができる(後記実施例1〜5を参照)。
<Process (Z-2)>
Next, as shown in FIG. 2E, the second coating layer 42P is heated to form the second metal oxide layer 42 (step (Z-2)). In order to obtain an amorphous structure, the heating temperature is preferably 700 ° C. or lower. Since a relatively inexpensive glass substrate can be used as the substrate 10, the heating temperature is preferably 600 ° C. or lower, particularly 400 ° C. or lower. In the present invention, a TFT having good device characteristics can be obtained even at a relatively low temperature process of 600 ° C. or lower or 400 ° C. or lower (see Examples 1 to 5 below).

以上のように、各々の原料液について工程(X)〜(Z)を実施することにより、Zn/Inモル比の異なる複数の金属酸化物層41,42を積層することができる。第1の金属酸化物層41と第2の金属酸化物層42との積層体が半導体活性層40となる。
最後に、通常の気相成膜及びフォトリフォグラフィ技術等により、ソース電極50及びドレイン電極60を形成する。以上のようにして、TFT1を製造することができる。
As described above, a plurality of metal oxide layers 41 and 42 having different Zn / In molar ratios can be stacked by performing steps (X) to (Z) for each raw material liquid. A stacked body of the first metal oxide layer 41 and the second metal oxide layer 42 becomes the semiconductor active layer 40.
Finally, the source electrode 50 and the drain electrode 60 are formed by ordinary vapor deposition and photolithography techniques. As described above, the TFT 1 can be manufactured.

工程(Y−1)において、第1の塗布層41Pをスピンコート法あるいはディップコート法等の塗布法によって形成し、工程(Z−1)後に得られた第1の金属酸化物層41をパターニングしても構わない。同様に、工程(Y−2)において、第2の塗布層42Pをスピンコート法あるいはディップコート法等の塗布法によって形成し、工程(Z−2)後に得られた第2の金属酸化物層42をパターニングしても構わない。第1の金属酸化物層41及び第2の金属酸化物層42をかかる方法により形成する場合、第1の金属酸化物層41のパターニングと第2の金属酸化物層42のパターニングとを同時に行っても構わない。   In the step (Y-1), the first coating layer 41P is formed by a coating method such as spin coating or dip coating, and the first metal oxide layer 41 obtained after the step (Z-1) is patterned. It doesn't matter. Similarly, in the step (Y-2), the second coating layer 42P is formed by a coating method such as spin coating or dip coating, and the second metal oxide layer obtained after the step (Z-2). 42 may be patterned. When the first metal oxide layer 41 and the second metal oxide layer 42 are formed by this method, the patterning of the first metal oxide layer 41 and the patterning of the second metal oxide layer 42 are performed simultaneously. It doesn't matter.

本実施形態によれば、比較的低温の液相法により製造することができ、TFT等の半導体活性層として良好な特性を有するIn−Zn−O系の金属酸化物膜40を提供することができる。この金属酸化物膜を半導体活性層として用いることにより、素子特性が良好なTFT1を提供することができる。
本実施形態によれば、オフ電流が小さくオン/オフ電流比が大きく、オン/オフのスイッチング特性に優れたTFT1を提供することができる。
本実施形態では、液相法により半導体活性層40を製造するので、半導体活性層40の成膜に気相法のような高価な成膜装置を要せず、低コスト化が可能である。
According to the present embodiment, it is possible to provide an In—Zn—O-based metal oxide film 40 that can be manufactured by a liquid phase method at a relatively low temperature and has good characteristics as a semiconductor active layer such as a TFT. it can. By using this metal oxide film as a semiconductor active layer, it is possible to provide a TFT 1 with good device characteristics.
According to this embodiment, it is possible to provide a TFT 1 having a small off-current and a large on / off current ratio and excellent on / off switching characteristics.
In this embodiment, since the semiconductor active layer 40 is manufactured by the liquid phase method, an expensive film forming apparatus such as a vapor phase method is not required for forming the semiconductor active layer 40, and the cost can be reduced.

上記実施形態では、ボトムゲート型のTFTについて説明したが、本発明の技術はトップゲート型のTFTにも適用できる。ただし、比較的低温の液相法で製造されたIn−Zn−O系におけるTFTのオフ電流の問題は特にボトムゲート型において顕著であるので、本発明は特にボトムゲート型に対して有効である。
本発明の技術は、TFT以外のTFD(薄膜ダイオード)等の半導体装置にも適用できる。
Although the bottom gate type TFT has been described in the above embodiment, the technique of the present invention can also be applied to a top gate type TFT. However, since the problem of TFT off current in the In—Zn—O system manufactured by a relatively low temperature liquid phase method is particularly remarkable in the bottom gate type, the present invention is particularly effective for the bottom gate type. .
The technique of the present invention can also be applied to a semiconductor device such as a TFD (thin film diode) other than TFT.

本発明に係る実施例及び比較例について説明する。下記記載中、In:Znはこれらの成分のモル比を示す。   Examples and comparative examples according to the present invention will be described. In the following description, In: Zn indicates the molar ratio of these components.

(実施例1)
<原料液の調製>
原料液A:
酢酸亜鉛2水和物2.2gを脱水エタノール中93℃で攪拌し、エタノールの一部を留去した後ジエチルアミノエタノールを加えて、透明の液体を得た。この液体を80℃で攪拌しながらインジウムイソプロポキシド2.9gを加えてさらに攪拌した後、170℃に昇温してエタノールを完全に留去して薄黄色の液体(原料液A)を得た。原料液Aの仕込み組成はIn:Zn=1.0:1.0である。ICP測定を実施したところ、実際に得られた原料液Aの組成はIn:Zn=1.0:0.9であった。
原料液B:
酢酸亜鉛2水和物の量を3.3gとし、インジウムイソプロポキシドの量を0.6gとした以外は原料液Aの調製と同様にして、原料液Bを調製した。ICP測定を実施したところ、得られた原料液Bの組成はIn:Zn=1.0:7.2であった。
Example 1
<Preparation of raw material liquid>
Raw material liquid A:
Zinc acetate dihydrate (2.2 g) was stirred in dehydrated ethanol at 93 ° C., a part of the ethanol was distilled off, and diethylaminoethanol was added to obtain a transparent liquid. While stirring this liquid at 80 ° C., 2.9 g of indium isopropoxide was added and further stirred, then the temperature was raised to 170 ° C. and ethanol was completely distilled off to obtain a light yellow liquid (raw material liquid A). It was. The charged composition of the raw material liquid A is In: Zn = 1.0: 1.0. When the ICP measurement was performed, the composition of the raw material liquid A actually obtained was In: Zn = 1.0: 0.9.
Raw material liquid B:
A raw material liquid B was prepared in the same manner as the raw material liquid A except that the amount of zinc acetate dihydrate was 3.3 g and the amount of indium isopropoxide was 0.6 g. When ICP measurement was carried out, the composition of the obtained raw material liquid B was In: Zn = 1.0: 7.2.

<TFTの製造>
ガラス基板上に、ゲート電極としてTiをパターニングし、その上にゲート絶縁膜としてSiO膜をスパッタリング法によって成膜した。
上記基板上に原料液Aを1000rpm1回塗布の条件でスピンコート法により塗布して第1の塗布層を形成した後、この塗布層を400℃30分間の条件で焼成して第1の金属酸化物層を形成した。室温まで降温後、この第1の金属酸化物層を乾燥空気雰囲気下25℃で充分に乾燥させた。
上記第1の金属酸化物層の上に原料液Bを1000rpm1回塗布の条件でスピンコート法により塗布して第2の塗布層を形成した後、この塗布層を400℃30分間の条件で焼成して第2の金属酸化物層を形成した。
以上のようにして、2層積層構造の金属酸化物膜を得た。この2層積層構造の金属酸化物膜の膜厚は100nmであった。
最後に、ソース電極及びドレイン電極としてTiをパターニングして、TFTを製造した。チャネル長は50μm、チャネル幅は200μmとした。
<Manufacture of TFT>
On the glass substrate, Ti was patterned as a gate electrode, and an SiO 2 film was formed thereon as a gate insulating film by a sputtering method.
The raw material liquid A is applied onto the substrate by spin coating under the condition of 1000 rpm applied once to form a first coating layer, and then the coating layer is baked at 400 ° C. for 30 minutes to form a first metal oxide. A physical layer was formed. After the temperature was lowered to room temperature, the first metal oxide layer was sufficiently dried at 25 ° C. in a dry air atmosphere.
On the first metal oxide layer, the raw material liquid B is applied by spin coating under the condition of one application at 1000 rpm to form a second application layer, and then the application layer is baked at 400 ° C. for 30 minutes. Thus, a second metal oxide layer was formed.
As described above, a metal oxide film having a two-layer structure was obtained. The thickness of the metal oxide film having a two-layer structure was 100 nm.
Finally, Ti was patterned as a source electrode and a drain electrode to manufacture a TFT. The channel length was 50 μm and the channel width was 200 μm.

<評価>
1.XRD分析
結晶性評価用に別途ガラス基板を用意し、この基板上に上記と同じプロセスで2層積層構造の金属酸化物膜を形成した。この膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
<Evaluation>
1. XRD Analysis A glass substrate was separately prepared for crystallinity evaluation, and a metal oxide film having a two-layer structure was formed on the substrate by the same process as described above. When XRD analysis of this film was performed, no diffraction peak appeared and it was an amorphous structure.

2.TFTの素子特性
パラメータアナライザ(Agilent社製4145C、4146C)を用いて、Vgs=−40〜40V、Vds=5Vの条件で、TFTのVgs−Id特性を測定した。電子移動度μをVgs−Id曲線より線形近似を用いて算出したところ、μ=0.12cm/Vsであった。また、オン/オフ電流比(オフ:Vgs=0V, オン:Vgs=5V,以下の実施例及び比較例でも条件は同様)は1.0×10程度と大きく、良好であった。
2. Element characteristics of TFT Using a parameter analyzer (Agilent 4145C, 4146C), Vgs-Id characteristics of TFT were measured under the conditions of Vgs = -40 to 40V and Vds = 5V. When the electron mobility μ was calculated from the Vgs-Id curve using linear approximation, μ = 0.12 cm 2 / Vs. Further, the on / off current ratio (off: Vgs = 0 V, on: Vgs = 5 V, the conditions are the same in the following examples and comparative examples) was as large as about 1.0 × 10 5 and was favorable.

(実施例2)
<原料液の調製>
原料液A:実施例1と同様に調製した(In:Zn=1.0:0.9)。
原料液B:酢酸亜鉛2水和物の量を4.4gとし、インジウムイソプロポキシドの量を0.3gとした以外は実施例1と同様にして、原料液Bを調製した。ICP測定を実施したところ、得られた原料液Bの組成はIn:Zn=1.0:19.5であった。
<TFTの製造>
上記原料液を用いた以外は実施例1と同様にして、TFTを製造した。
(Example 2)
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 1 (In: Zn = 1.0: 0.9).
Raw material liquid B: Raw material liquid B was prepared in the same manner as in Example 1 except that the amount of zinc acetate dihydrate was 4.4 g and the amount of indium isopropoxide was 0.3 g. When ICP measurement was performed, the composition of the obtained raw material liquid B was In: Zn = 1.01: 19.5.
<Manufacture of TFT>
A TFT was produced in the same manner as in Example 1 except that the above raw material liquid was used.

<評価>
1.XRD分析
上記原料液を用いて実施例1と同様にして金属酸化物膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
2.TFTの素子特性
得られたTFTの素子特性を評価したところ、電子移動度μ=0.11cm/Vsであった。また、実施例1と同様にTFTのVgs−Id特性を測定したところ、オン/オフ電流比は1.0×10程度と大きく、良好であった。
<Evaluation>
1. XRD analysis When an XRD analysis of the metal oxide film was performed in the same manner as in Example 1 using the above raw material liquid, a diffraction peak did not appear and an amorphous structure was obtained.
2. Element characteristics of TFT When the element characteristics of the obtained TFT were evaluated, the electron mobility was μ = 0.11 cm 2 / Vs. Further, when the Vgs-Id characteristics of the TFT were measured in the same manner as in Example 1, the on / off current ratio was as large as about 1.0 × 10 5 and was favorable.

(実施例3)
<原料液の調製>
原料液A:実施例1と同様に調製した(In:Zn=1.0:0.9)。
原料液B:酢酸亜鉛2水和物の量を2.9gとし、インジウムイソプロポキシドの量を0.6gとした以外は実施例1と同様にして、原料液Bを調製した。ICP測定を実施したところ、得られた原料液Bの組成はIn:Zn=1.0:6.5であった。
<TFTの製造>
上記原料液を用いた以外は実施例1と同様にして、TFTを製造した。
(Example 3)
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 1 (In: Zn = 1.0: 0.9).
Raw material liquid B: Raw material liquid B was prepared in the same manner as in Example 1 except that the amount of zinc acetate dihydrate was 2.9 g and the amount of indium isopropoxide was 0.6 g. When the ICP measurement was performed, the composition of the obtained raw material liquid B was In: Zn = 1.0: 6.5.
<Manufacture of TFT>
A TFT was produced in the same manner as in Example 1 except that the above raw material liquid was used.

<評価>
1.XRD分析
上記原料液を用いて実施例1と同様にして金属酸化物膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
2.TFTの素子特性
得られたTFTの素子特性を評価したところ、電子移動度μ=0.14cm/Vsであった。また、実施例1と同様にTFTのVgs−Id特性を測定したところ、オン/オフ電流比は1.0×10程度と大きく、良好であった。
<Evaluation>
1. XRD analysis When an XRD analysis of the metal oxide film was performed in the same manner as in Example 1 using the above raw material liquid, a diffraction peak did not appear and an amorphous structure was obtained.
2. Element characteristics of TFT When the element characteristics of the obtained TFT were evaluated, the electron mobility was μ = 0.14 cm 2 / Vs. Further, when the Vgs-Id characteristics of the TFT were measured in the same manner as in Example 1, the on / off current ratio was as large as about 1.0 × 10 5 and was favorable.

(実施例4)
<原料液の調製>
原料液A:実施例3と同様に調製した(In:Zn=1.0:0.9)。
原料液B:実施例3と同様に調製した(In:Zn=1.0:6.5)。
<TFTの製造>
第1の塗布層及び第2の塗布層の焼成条件をいずれも600℃30分間とした以外は実施例3と同様にして、TFTを製造した。
Example 4
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 3 (In: Zn = 1.0: 0.9).
Raw material liquid B: prepared in the same manner as in Example 3 (In: Zn = 1.0: 6.5).
<Manufacture of TFT>
A TFT was produced in the same manner as in Example 3 except that the firing conditions of the first coating layer and the second coating layer were both set to 600 ° C. for 30 minutes.

<評価>
1.XRD分析
第1の塗布層及び第2の塗布層の焼成条件をいずれも600℃30分間とした以外は実施例3と同様にして、金属酸化物膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
2.TFTの素子特性
得られたTFTの素子特性を評価したところ、電子移動度μ=0.15cm/Vsであった。また、実施例3と同様にTFTのVgs−Id特性を測定したところ、オン/オフ電流比は1.0×10程度と大きく、良好であった。
<Evaluation>
1. XRD analysis The XRD analysis of the metal oxide film was performed in the same manner as in Example 3 except that the firing conditions of the first coating layer and the second coating layer were both set to 600 ° C. for 30 minutes. It did not appear and had an amorphous structure.
2. Element characteristics of TFT When the element characteristics of the obtained TFT were evaluated, the electron mobility was μ = 0.15 cm 2 / Vs. Further, when the Vgs-Id characteristics of the TFT were measured in the same manner as in Example 3, the on / off current ratio was as large as about 1.0 × 10 5 and was favorable.

(実施例5)
<原料液の調製>
原料液A:実施例1と同様に調製した(In:Zn=1.0:0.9)。
原料液B:実施例1と同様に調製した(In:Zn=1.0:7.2)。
<TFTの製造>
上記原料液を用い、第1の塗布層及び第2の塗布層をインクジェットプリンティング方式により所定のパターンで塗布した以外は実施例1と同様にして、TFTを製造した。
(Example 5)
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 1 (In: Zn = 1.0: 0.9).
Raw material liquid B: prepared in the same manner as in Example 1 (In: Zn = 1.0: 7.2).
<Manufacture of TFT>
A TFT was manufactured in the same manner as in Example 1 except that the first coating layer and the second coating layer were coated in a predetermined pattern by the inkjet printing method using the raw material liquid.

<評価>
1.XRD分析
実施例1と同様に金属酸化物膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。第1の塗布層及び第2の塗布層の塗布は実施例1と同様に、スピンコート法により実施した。
2.TFTの素子特性
得られたTFTの素子特性を評価したところ、電子移動度μ=0.10cm/Vsであった。また、実施例1と同様にTFTのVgs−Id特性を測定したところ、オン/オフ電流比は1.0×10程度と大きく、良好であった。
<Evaluation>
1. XRD analysis When a metal oxide film was subjected to XRD analysis in the same manner as in Example 1, no diffraction peak appeared, and the structure was amorphous. The coating of the first coating layer and the second coating layer was performed by the spin coat method as in Example 1.
2. Element characteristics of TFT When the element characteristics of the obtained TFT were evaluated, the electron mobility was μ = 0.10 cm 2 / Vs. Further, when the Vgs-Id characteristics of the TFT were measured in the same manner as in Example 1, the on / off current ratio was as large as about 1.0 × 10 4 and was favorable.

(比較例1)
<原料液の調製>
原料液A:実施例1と同様に調製した(In:Zn=1.0:0.9)。
<TFTの製造>
ガラス基板上に、ゲート電極としてTiをパターニングし、その上にゲート絶縁膜としてSiO膜をスパッタリング法によって成膜した。
上記基板上に原料液Aをインクジェットプリンティング方式により塗布して塗布層を形成した後、この塗布層を400℃30分間の条件で焼成して単層構造の金属酸化物膜を形成した。この金属酸化物膜の膜厚は50nmであった。この上に、実施例1と同様に、ソース電極及びドレイン電極を形成して、TFTを製造した。
(Comparative Example 1)
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 1 (In: Zn = 1.0: 0.9).
<Manufacture of TFT>
On the glass substrate, Ti was patterned as a gate electrode, and an SiO 2 film was formed thereon as a gate insulating film by a sputtering method.
After the raw material liquid A was applied onto the substrate by an ink jet printing method to form a coating layer, this coating layer was baked under conditions of 400 ° C. for 30 minutes to form a single layer metal oxide film. The thickness of this metal oxide film was 50 nm. On this, a source electrode and a drain electrode were formed in the same manner as in Example 1 to manufacture a TFT.

<評価>
1.XRD分析
結晶性評価用に別途ガラス基板を用意し、この基板上に原料液Aを1000rpm1回塗布の条件でスピンコート法により塗布して塗布層を形成した後、この塗布層を400℃30分間の条件で焼成して単層構造の金属酸化物膜を形成した。この膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
2.TFTの素子特性
得られたTFTの素子特性を評価したところ、Vgs=−40〜40Vの範囲において常時Id=10−3Aと導電性を示し、TFT動作が見られなかった。
<Evaluation>
1. XRD analysis A glass substrate is prepared separately for crystallinity evaluation, and the coating liquid is formed on this substrate by spin coating under the condition of coating at 1000 rpm once, and then the coating layer is formed at 400 ° C. for 30 minutes. The metal oxide film having a single layer structure was formed by firing under the conditions described above. When XRD analysis of this film was performed, no diffraction peak appeared and it was an amorphous structure.
2. Element characteristics of TFT When element characteristics of the obtained TFT were evaluated, conductivity was always shown as Id = 10 −3 A in the range of Vgs = −40 to 40V, and TFT operation was not observed.

(比較例2)
<原料液の調製>
原料液A:実施例1と同様に調製した(In:Zn=1.0:0.9)。
原料液B:酢酸亜鉛2水和物の量を3.8gとし、インジウムイソプロポキシドの量を1.5gとした以外は実施例1と同様にして、原料液Bを調製した。ICP測定を実施したところ、得られた原料液Bの組成はIn:Zn=1.0:3.4であった。
<TFTの製造>
上記原料液を用いた以外は実施例1と同様にして、TFTを製造した。
(Comparative Example 2)
<Preparation of raw material liquid>
Raw material liquid A: prepared in the same manner as in Example 1 (In: Zn = 1.0: 0.9).
Raw material liquid B: Raw material liquid B was prepared in the same manner as in Example 1 except that the amount of zinc acetate dihydrate was 3.8 g and the amount of indium isopropoxide was 1.5 g. When the ICP measurement was performed, the composition of the obtained raw material liquid B was In: Zn = 1.0: 3.4.
<Manufacture of TFT>
A TFT was produced in the same manner as in Example 1 except that the above raw material liquid was used.

<評価>
1.XRD分析
上記原料液を用いて実施例1と同様にして金属酸化物膜のXRD分析を実施したところ、回折ピークは現れず、アモルファス構造であった。
2.TFTの素子特性
得られたTFTのVgs−Id特性を測定したところ、Vgs=−20VのときのId=1.0×10−4A、Vgs=20VのときのId=4.0×10−4Aであった。Vgsが負の領域でIdはわずかに減少したものの、Vgs=−20〜20Vの範囲において常時導電性を示し、TFT動作が見られなかった。
<Evaluation>
1. XRD analysis When an XRD analysis of the metal oxide film was performed in the same manner as in Example 1 using the above raw material liquid, a diffraction peak did not appear and an amorphous structure was obtained.
2. Element characteristics of TFT When Vgs-Id characteristics of the obtained TFT were measured, Id = 1.0 × 10 −4 A when Vgs = −20V, Id = 4.0 × 10 when Vgs = 20V 4 A. Although Id slightly decreased in the region where Vgs was negative, conductivity was always exhibited in the range of Vgs = -20 to 20V, and TFT operation was not observed.

(組成及び評価結果のまとめ)
実施例1〜5及び比較例1〜2の製造条件及び評価結果を、表1及び表2にまとめておく。表中、B/Aは、(原料液BのZn/Inモル比)/(原料液AのZn/Inモル比)の値を示す。
(Summary of composition and evaluation results)
The production conditions and evaluation results of Examples 1 to 5 and Comparative Examples 1 and 2 are summarized in Tables 1 and 2. In the table, B / A represents a value of (Zn / In molar ratio of raw material liquid B) / (Zn / In molar ratio of raw material liquid A).

Figure 0005123768
Figure 0005123768

Figure 0005123768
Figure 0005123768

本発明の金属酸化物膜は、薄膜トランジスタ(TFT)等の半導体装置、太陽電池、及び熱電変換デバイス等の活性層に好ましく適用することができる。   The metal oxide film of the present invention can be preferably applied to active layers such as semiconductor devices such as thin film transistors (TFTs), solar cells, and thermoelectric conversion devices.

本発明に係る実施形態の金属酸化物膜、及びこの膜を備えた半導体装置の構成を示す断面図Sectional drawing which shows the structure of the metal oxide film of embodiment which concerns on this invention, and a semiconductor device provided with this film | membrane (a)〜(f)は図1の半導体装置の製造工程図(A)-(f) is a manufacturing-process figure of the semiconductor device of FIG. 非特許文献1に記載のTFTのVgs−Id特性Vgs-Id characteristics of TFT described in Non-Patent Document 1

符号の説明Explanation of symbols

1 TFT(半導体装置)
10 基板
20 ゲート電極
30 ゲート絶縁膜
40 半導体活性層(積層構造の金属酸化物膜)
40B 半導体活性層の基板側の膜面
40T 半導体活性層の基板側と反対側の膜面
41 第1の金属酸化物層
41P 第1の塗布層
42 第2の金属酸化物層
42P 第2の塗布層
50 ソース電極
60 ドレイン電極
1 TFT (semiconductor device)
DESCRIPTION OF SYMBOLS 10 Substrate 20 Gate electrode 30 Gate insulating film 40 Semiconductor active layer (metal oxide film of laminated structure)
40B Film surface of semiconductor active layer on substrate side 40T Film surface of semiconductor active layer opposite to substrate side 41 First metal oxide layer 41P First coating layer 42 Second metal oxide layer 42P Second coating Layer 50 Source electrode 60 Drain electrode

Claims (8)

基板上に設けられたゲート電極、ゲート絶縁膜、半導体活性層、ソース電極及びドレイン電極を備えたボトムゲート型の薄膜トランジスタにおいて、
前記半導体活性層が、主成分金属元素がIn及びZnであるアモルファス構造の金属酸化物膜であって、膜中に水酸基が存在しており、かつ、下記式(1)を充足する組成分布を有するものであることを特徴とする薄膜トランジスタ。
Zn(T)/CIn(T)≧4.0×CZn(B)/CIn(B)・・・(1)
(式(1)中、
Zn(B)/CIn(B)は基板側の膜面におけるZn/Inモル比、
Zn(T)/CIn(T)は基板側と反対側の膜面におけるZn/Inモル比をそれぞれ示す。)
In a bottom gate type thin film transistor provided with a gate electrode, a gate insulating film, a semiconductor active layer, a source electrode and a drain electrode provided on a substrate,
The semiconductor active layer, a metal oxide film in an amorphous structure the main component metal element is In and Zn, are present hydroxyl groups in the film, and the composition distribution to satisfy Formula (1) A thin film transistor characterized by comprising:
C Zn (T) / C In (T) ≧ 4.0 × C Zn (B) / C In (B) (1)
(In the formula (1),
C Zn (B) / C In (B) is the Zn / In molar ratio in the film surface on the substrate side,
C Zn (T) / C In (T) represents a Zn / In molar ratio in the film surface opposite to the substrate side. )
前記金属酸化物膜において、Zn(B)/CIn(B)が0.5〜2.0であることを特徴とする請求項1に記載の薄膜トランジスタ 2. The thin film transistor according to claim 1, wherein in the metal oxide film, C Zn (B) / C In (B) is 0.5 to 2.0. 前記金属酸化物膜が、Zn/Inモル比の異なる複数の金属酸化物層の積層構造を有することを特徴とする請求項1又は2に記載の薄膜トランジスタThe thin film transistor according to claim 1 or 2, wherein the metal oxide film has a laminated structure of a plurality of metal oxide layers having different Zn / In molar ratios. 前記金属酸化物膜が、In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液を用意する工程(X)と、前記原料液を前記基板上に塗布して塗布層を形成する工程(Y)と、前記塗布層を加熱して金属酸化物層とする工程(Z)とを有する液相法により製造されたものであり、
前記原料液としてZn/Inモル比の異なる複数の原料液を用意し、各々の該原料液について工程(X)〜(Z)を実施することにより、Zn/Inモル比の異なる前記複数の金属酸化物層を積層する方法により製造されたものであることを特徴とする請求項3に記載の薄膜トランジスタ
A step (X) of preparing a raw material liquid in which the metal oxide film includes at least one organic precursor containing In and Zn and at least one organic solvent; and applying the raw material liquid on the substrate. And a step (Y) of forming a coating layer, and a step (Z) of heating the coating layer to form a metal oxide layer.
A plurality of raw material liquids having different Zn / In molar ratios are prepared as the raw material liquid, and the plurality of metals having different Zn / In molar ratios are performed by performing steps (X) to (Z) for each of the raw material liquids. The thin film transistor according to claim 3, wherein the thin film transistor is manufactured by a method of stacking oxide layers.
前記基板がガラス基板であることを特徴とする請求項1〜4のいずれかに記載の薄膜トランジスタ。 The thin film transistor according to claim 1, wherein the substrate is a glass substrate . 基板上に設けられたゲート電極、ゲート絶縁膜、半導体活性層、ソース電極及びドレイン電極を備えたボトムゲート型の薄膜トランジスタの製造方法において、
In及びZnを含む少なくとも1種の有機前駆体と少なくとも1種の有機溶媒とを含む原料液を用意する工程(X)と、前記原料液を基板上に塗布して塗布層を形成する工程(Y)と、前記塗布層を加熱して金属酸化物層とする工程(Z)とを有する液相法により、主成分金属元素がIn及びZnであるアモルファス構造の金属酸化物膜を前記半導体活性層として成膜する際に、
前記原料液としてZn/Inモル比の異なる複数の原料液を用意し、各々の該原料液について工程(X)〜(Z)を実施して、Zn/Inモル比の異なる複数の金属酸化物層を積層することにより、
下記式(1)を充足する組成分布を有する金属酸化物膜を成膜することを特徴とする薄膜トランジスタの製造方法
Zn(T)/CIn(T)≧4.0×CZn(B)/CIn(B)・・・(1)
(式(1)中、
Zn(B)/CIn(B)は基板側の膜面におけるZn/Inモル比、
Zn(T)/CIn(T)は基板側と反対側の膜面におけるZn/Inモル比をそれぞれ示す。)
In a method for manufacturing a bottom gate type thin film transistor including a gate electrode, a gate insulating film, a semiconductor active layer, a source electrode and a drain electrode provided on a substrate,
A step (X) of preparing a raw material liquid containing at least one organic precursor containing In and Zn and at least one organic solvent, and a step of applying the raw material liquid on a substrate to form a coating layer ( and Y), wherein the liquid phase method the coating layer is heated to a step (Z) to the metal oxide layer, metal oxide film using the semiconductor active amorphous structure main component metal element is in, and Zn When depositing as a layer,
A plurality of raw material liquids having different Zn / In molar ratios are prepared as the raw material liquid, and steps (X) to (Z) are performed on each of the raw material liquids, and a plurality of metal oxides having different Zn / In molar ratios. By laminating the layers,
The manufacturing method of the thin-film transistor characterized by forming the metal oxide film which has a composition distribution which satisfies following formula (1).
C Zn (T) / C In (T) ≧ 4.0 × C Zn (B) / C In (B) (1)
(In the formula (1),
C Zn (B) / C In (B) is the Zn / In molar ratio in the film surface on the substrate side,
C Zn (T) / C In (T) represents a Zn / In molar ratio in the film surface opposite to the substrate side. )
工程(Z)の加熱温度が700℃以下であることを特徴とする請求項に記載の薄膜トランジスタの製造方法The method for producing a thin film transistor according to claim 6 , wherein the heating temperature in the step (Z) is 700 ° C or lower. 工程(Y)において、インクジェットプリンティング方式により前記塗布層を所定のパターンで形成することを特徴とする請求項6又は7に記載の薄膜トランジスタの製造方法8. The method of manufacturing a thin film transistor according to claim 6, wherein in the step (Y), the coating layer is formed in a predetermined pattern by an ink jet printing method .
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