JP5099569B1 - 直並列切り替え式セル電圧バランス回路のスイッチをmosfetで構成した回路及びその駆動回路 - Google Patents
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Abstract
【解決手段】相互充放電を行うべき蓄電セル同士を並列接続してなる、スイッチ切り替えにより実現されるいずれかの接続状態において形成される並列回路の各々が、当該並列回路内において一方の極性の電流を遮断しないよう配置された電界効果トランジスタと、当該並列回路内において他方の極性の電流を遮断しないよう配置された電界効果トランジスタと、を備えるよう電界効果トランジスタを配置することによって、少数のトランジスタによる電圧均等化動作を可能とする。
【選択図】図8
Description
をオンとすることによりスイッチ100のゲート電極とソース電極を短絡して両電極間に蓄えられた電荷を開放することにより、スイッチ100をオフとする方式で当該スイッチ100を駆動させる。
第1の接続状態において互いに並列接続される、第1の直列回路に含まれる蓄電セルと第2の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、第1の直列回路に含まれる蓄電セルの電極側にソース電極が接続され、第2の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続されたMOSFETが含まれるよう、MOSFETを配置し、さらに、第1の接続状態において互いに並列接続される、第1の直列回路に含まれる蓄電セルと第3の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、第1の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続され、第3の直列回路に含まれる蓄電セルの電極側にソース電極が接続されたMOSFETが含まれるよう、MOSFETを配置することにより、上記第1のスイッチ群を構成することができる。
また、第2の接続状態において互いに並列接続される、第1の直列回路に含まれる蓄電セルと第2の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、第1の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続され、第2の直列回路に含まれる蓄電セルの電極側にソース電極が接続されたMOSFETが含まれるよう、MOSFETを配置し、さらに、第2の接続状態において互いに並列接続される、第1の直列回路に含まれる蓄電セルと第3の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、第1の直列回路に含まれる蓄電セルの電極側にソース電極が接続され、第3の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続されたMOSFETが含まれるよう、MOSFETを配置することにより、上記第2のスイッチ群を構成することができる。
図8に、本発明の第1実施形態に係る電圧均等化回路1の回路図を示す。ただし、各スイッチに接続される駆動回路部分は省略されている。
次に、電圧均等化回路1による蓄電セル電圧の均等化動作を説明する。説明を単純にするため、以下において第1のスイッチ群に含まれるスイッチは全て、図10にて示される構成を備えた第1の駆動信号出力回路へと接続され、第2のスイッチ群に含まれるスイッチは全て、同様の構成を備えた第2の駆動信号出力回路へと接続されているものとする。
」と示されるとおり、一例としては最も低電位側に配置されたセルの低電位側電極へと接続することができる。)、第2のモジュールに含まれる各スイッチのオン、オフを切り替えるための駆動信号出力回路(第1のモジュールに用いられた回路とは別の回路である。)の基準電位点を、当該第2のモジュール内のいずれかの蓄電セルへと接続する(一例としては、図13に「
」と示されるとおりの点に接続する。)ならば、各モジュール内の結合コンデンサに印加される電圧は、最大でも、第1の直列回路を構成する蓄電セルのうち各々のモジュール内に含まれる蓄電セル(第1のモジュールにおいてはでC1A〜C3Aであり、第2のモジュールにおいてはでC4A〜C6Aである。)の合計電圧程度に抑えられるため、結合コンデンサの耐電圧に応じてモジュールのサイズを適切に選択することにより、全体としての直列数に制限が加わることを回避できる。
C1A〜C6A 蓄電セル
C1B〜C5B 蓄電セル
C1C〜C5C 蓄電セル
C1D〜C3D 蓄電セル
C1E〜C3E 蓄電セル
C1F〜C2F 蓄電セル
Sa1〜Sa17 スイッチ
Sa11〜Sa16 スイッチ
Sa21〜Sa26 スイッチ
Sb1〜Sb17 スイッチ
Sb11〜Sb16 スイッチ
Sb21〜Sb26 スイッチ
2 駆動回路部分
Ca1 結合コンデンサ
Ra1 抵抗
Da1 ダイオード
3 駆動信号出力回路
VCC 電源
VG 基準電位点
TNPN NPN型トランジスタ
TPNP PNP型トランジスタ
R1〜R3 抵抗
D1 発光ダイオード
D2 フォトダイオード
S1 スイッチ
V1 発光素子駆動電源
Claims (8)
- n(nは2以上の整数)個の蓄電セルを直列接続して構成される、第1の直列回路と、 n−1個の蓄電セルを直列接続して構成される、第2,第3の直列回路と、
第1,第2のスイッチ群と
を備え、
前記第1のスイッチ群に含まれる各々のスイッチをオンとすることにより、
前記第1の直列回路を構成する第k(kは2以上n以下の整数)の蓄電セルと、前記第2の直列回路を構成する第k−1の蓄電セルと、が各々並列接続されることによりn−1個の並列回路が構成され、且つ、前記第1の直列回路を構成する第l(lは1以上n−1以下の整数)の蓄電セルと、前記第3の直列回路を構成する第lの蓄電セルと、が各々並列接続されることによりn−1個の並列回路が構成される、第1の接続状態
を実現し、
前記第2のスイッチ群に含まれる各々のスイッチをオンとすることにより、
前記第1の直列回路を構成する第lの蓄電セルと、前記第2の直列回路を構成する第lの蓄電セルと、が各々並列接続されることによりn−1個の並列回路が構成され、且つ、前記第1の直列回路を構成する第kの蓄電セルと、前記第3の直列回路を構成する第k−1の蓄電セルと、が各々並列接続されることによりn−1個の並列回路が構成される、第2の接続状態
を実現し、
前記第1,第2の接続状態間での切り替えによって、前記第1〜第3の直列回路を構成する各々の蓄電セルの電圧を均等化するよう構成された、電圧均等化回路において、
前記第1のスイッチ群は、
前記第1の接続状態において互いに並列接続される、前記第1の直列回路に含まれる蓄電セルと前記第2の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、該第1の直列回路に含まれる蓄電セルの電極側にソース電極が接続され、該第2の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続された電界効果トランジスタが含まれるよう、電界効果トランジスタを配置し、
前記第1の接続状態において互いに並列接続される、前記第1の直列回路に含まれる蓄電セルと前記第3の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、該第1の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続され、該第3の直列回路に含まれる蓄電セルの電極側にソース電極が接続された電界効果トランジスタが含まれるよう、電界効果トランジスタを配置してなり、
前記第2のスイッチ群は、
前記第2の接続状態において互いに並列接続される、前記第1の直列回路に含まれる蓄電セルと前記第2の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、該第1の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続され、該第2の直列回路に含まれる蓄電セルの電極側にソース電極が接続された電界効果トランジスタが含まれるよう、電界効果トランジスタを配置し、
前記第2の接続状態において互いに並列接続される、前記第1の直列回路に含まれる蓄電セルと前記第3の直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間に、該第1の直列回路に含まれる蓄電セルの電極側にソース電極が接続され、該第3の直列回路に含まれる蓄電セルの電極側にドレイン電極が接続された電界効果トランジスタが含まれるよう、電界効果トランジスタを配置してなる
ことを特徴とする、電圧均等化回路。 - 前記第1,第2のスイッチ群に含まれる各々のスイッチはMOSFET(Metal−Oxide−Semiconductor Field−Effect Transistor)であることを特徴とする、請求項1に記載の電圧均等化回路。
- 前記第1,第2のスイッチ群に含まれる各々のMOSFETのゲート電極に対して結合コンデンサが直列接続され、該各々のMOSFETのソース電極とゲート電極との間に抵抗が接続され、更に、該抵抗に対して並列に、該ソース電極から該ゲート電極へと向かう電流を遮断しないようダイオードが接続されており、該結合コンデンサを介して該ゲート電極へと入力される駆動信号の制御により各々のMOSFETのオン、オフを切り替えるよう構成されたことを特徴とする、請求項2に記載の電圧均等化回路。
- 発光素子を備えた発光部と、
前記発光素子の発光に応答して電気信号を発生する、受光素子と、該電気信号に応じて前記駆動信号を出力するプッシュプル回路と、を備え、前記発光素子に対して電気的に絶縁された、受光部と
を備えた駆動信号出力回路が前記結合コンデンサの各々に接続され、該結合コンデンサを介してゲート電極へと入力される前記駆動信号の制御により各々のMOSFETのオン、オフを切り替えるよう構成されたことを特徴とする、請求項3に記載の電圧均等化回路。 - 前記駆動信号出力回路として、
前記第1のスイッチ群に含まれる各々のMOSFETのゲート電極へと直列接続された前記結合コンデンサの全てへと接続されて、該第1のスイッチ群に含まれるMOSFETのゲート電極の全てへと、該結合コンデンサの各々を介して駆動信号を出力する、第1の駆動信号出力回路と、
前記第2のスイッチ群に含まれる各々のMOSFETのゲート電極へと直列接続された前記結合コンデンサの全てへと接続されて、該第2のスイッチ群に含まれるMOSFETのゲート電極の全てへと、該結合コンデンサの各々を介して駆動信号を出力する、第2の駆動信号出力回路と
を備え、前記第1,第2の駆動信号出力回路から入力される各々の前記駆動信号の制御により、前記第1,第2のスイッチ群に含まれる各々のMOSFETのオン、オフを切り替えるよう構成されたことを特徴とする、請求項4に記載の電圧均等化回路。 - 請求項4又は5に記載の電圧均等化回路において、
前記駆動信号出力回路の各々が備える前記発光素子を発光素子駆動回路へと接続し、更に該発光素子駆動回路の各々を、前記第1〜第3の直列回路に含まれる蓄電セルのいずれかへと接続することにより、該発光素子駆動回路の各々を動作させるための電源として該蓄電セルのいずれかを用いるよう構成し、且つ、
前記駆動信号出力回路の各々が備える、前記プッシュプル回路を、前記第1〜第3の直列回路に含まれる蓄電セルのいずれかへと接続することにより、該プッシュプル回路の各々を動作させるための電源として該蓄電セルのいずれかを用いるよう構成した
ことを特徴とする、無停電電源装置。 - 直列数nがniである、請求項4に記載の電圧均等化回路として、1以上N(Nは2以上の整数)以下の整数iに対してそれぞれ与えられるN個のモジュール(以下、それぞれを第iのモジュールとする。)を直列接続し、
前記N個のモジュールのうち、直接接続される2つのモジュールにおける第2の直列回路間、及び第3の直列回路間に、それぞれ蓄電セルを接続する
ことにより構成される、電圧均等化回路において、
第iのモジュールに含まれるMOSFETのオン、オフを切り替えるための前記駆動信号出力回路、に含まれる前記プッシュプル回路の基準電位点を、該第iのモジュールに含まれるいずれかの蓄電セルに接続した
ことを特徴とする、電圧均等化回路。 - n(nは2以上の整数)個の蓄電セルを直列接続して各々が構成される、m個(mは1以上の整数)の直列回路と、n−1個の蓄電セルを直列接続して各々が構成される、m個又はm±1個であって複数個(ただし並列数が4L−2個の場合は除く。Lは自然数)の直列回路と、をそれぞれ交互に並列接続し、
第1,第2のスイッチ群を更に設け、
前記第1のスイッチ群に含まれる各々のスイッチをオンとすることにより、
各々の直列回路に含まれる蓄電セルが、該蓄電セルを含む直列回路と並列接続された直列回路に含まれる、いずれか1以上の蓄電セルと並列接続されて並列回路を構成する、第1の接続状態
を実現し、
前記第2のスイッチ群に含まれる各々のスイッチをオンとすることにより、
各々の直列回路に含まれる蓄電セルが、該蓄電セルを含む直列回路と並列接続された直列回路に含まれる、いずれか1以上の蓄電セルと並列接続されて、前記第1の接続状態において構成された並列回路とは異なる並列回路を構成する、第2の接続状態
を実現し、
前記第1,第2の接続状態間での切り替えによって、各々の直列回路を構成する蓄電セルの電圧を均等化するよう構成された、電圧均等化回路において、
前記第1のスイッチ群は、
前記第1の接続状態において互いに並列接続される、前記n個の蓄電セルを直列接続して構成される直列回路に含まれる蓄電セルと前記n−1個の蓄電セルを直列接続して構成される直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間のそれぞれに電界効果トランジスタが含まれるよう、電界効果トランジスタを配置してなり、
前記第2のスイッチ群は、
前記第2の接続状態において互いに並列接続される、前記n個の蓄電セルを直列接続して構成される直列回路に含まれる蓄電セルと前記n−1個の蓄電セルを直列接続して構成される直列回路に含まれる蓄電セルとからなる蓄電セル組の各々の高電位側電極間及び低電位側電極間のそれぞれに電界効果トランジスタが含まれるよう、電界効果トランジスタを配置してなり、
さらに、前記蓄電セル組の各々の高電位側電極間に含まれる電界効果トランジスタのうち少なくとも1つがオフ状態において妨げる電流の極性と、前記蓄電セル組の各々の低電位側電極間に含まれる電界効果トランジスタのうち少なくとも1つがオフ状態において妨げる電流の極性と、が異なる極性となるよう、電界効果トランジスタの各々に内在するダイオードの極性を定めることにより、オフ状態の電界効果トランジスタを介して蓄電セル組の各々が相互充放電することを妨げる
ことを特徴とする、電圧均等化回路。
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