JP4914936B2 - ループ型方向性結合器 - Google Patents
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- Variable-Direction Aerials And Aerial Arrays (AREA)
- Structure Of Belt Conveyors (AREA)
Description
又は
K=Kc・F1・D1=Ki・D2=Kc・F1・D3=Ki・D4
又は
K=Kc・D1=Ki・F2・D2=Kc・D3=Ki・F2・D4
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3*F5=Ki*F6*D4=K2
Kc*D1=Ki*F4*D2=K1
Kc*D3=Ki*F6*D4=K2
Kc*D1*F3=Ki*D2=K1
Kc*D3*F5=Ki*D4=K2
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3*F5=Ki*D4=K2
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3=Ki*F6*D4=K2
Kc*D1=Ki*F4*D2=K1
且つ
Kc*D3*F5=Ki*F6*D4=K2
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3=Ki*F6*D4=K2
Kc*D1=Ki*F2*D2=K
Kc*D3=Ki*F2*D4=K
である。
Kc*F1*D1=Ki*D2=K
Kc*F1*D3=Ki*D4=K
である。
Kc*F1*D1=Ki*F2*D2=K
Kc*F1*D3=Ki*F2*D4=K
である。
又は
Kc*F1*D1=Ki*D2=K 且つ Kc*F1*D3=Ki*D4=K
又は
Kc*F1*D1=Ki*F2*D2=K 且つ Kc*F1*D3=Ki*F2*D4=K
加算経路1:Kc*D1*F3=K1、加算経路2:Ki*D2*F4=K1
減算経路1:Kc*D3*F5=K2、減算経路2:Ki*D4*F6=K2
加算経路1:Kc*D1*F3=K1、加算経路2:Ki*D2*F4=K1
減算経路1:Kc*D3*F5=K2、減算経路2:Ki*D4=K2
加算経路1:Kc*D1*F3=K1、加算経路2:Ki*D2*F4=K1
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減算経路1:Kc*D3=K2、減算経路2:Ki*D4*F6=K2
Kc*D1=Kc*F4*D2=K
Kc*D3=Ki*F6*D4=K
Claims (14)
- 導波路、詳細には中空導波路、平面導波路または同軸導波路を、第1のアーム(12)と第2のアーム(14)を有する半ループアンテナ(10)の形で有し、導波路上の前進信号aと前記導波路上の後進信号bとを無接触結合するループ型方向性結合器であって、
前記アンテナの前記第1のアーム(12)が、第1の回路網(18)の第1の入力(20)に接続され、
前記アンテナの前記第2のアーム(14)が、前記第1の回路網(18)の第2の入力(22)に接続され、
前記第1の回路網(18)は、前記第1の入力(20)に第1の電力分割器(56)を、前記第2の入力(22)に第2の電力分割器(58)を有し、これらの電力分割器(56,58)は、前記アンテナの前記アーム(12,14)に印加される、それぞれの信号を分割し、
前記第1の回路網(18)は、前記第1と第2の電力分割器(56,58)からの前記信号を加算し、前記加算により得られた前記信号Kc(a+b)を(ここでKcは、前記ループ型方向性結合器の容量結合係数である)、前記第1の回路網(18)の第1の出力(24)に供給する第1の加算器(60)と、前記第1と第2の電力分割器(56,58)からの前記信号を互いに減算して、前記減算により得られた前記信号Ki(a−b)を(ここでKiは、前記ループ型方向性結合器の誘導結合係数である)、前記第1の回路網(18)の第2の出力(26)に供給する第1の減算器(62)とを有し、
前記第1の回路網(18)の前記第1の出力(24)に接続された第1の入力(40)と、前記第1の回路網(18)の前記第2の出力(26)に接続された第2の入力(42)とを有する第3の回路網(38)を備え、
前記第3の回路網(38)は、前記第1の入力(40)に第3の電力分割器(66)を、前記第2の入力(42)に第4の電力分割器(68)を有し、前記電力分割器(66,68)は、前記第3の回路網(38)の前記入力(40,42)に印加された前記それぞれの信号を分割し、
前記第3の回路網(38)は、複素透過係数D1を有する第1の容量信号経路(120)を介して前記第3の電力分割器(66)から信号を受け取り、複素透過係数D2を有する第1の誘導信号経路(122)を介して前記第4の電力分割器(68)から信号を受け取り、これらの信号を加算して、前記加算により得られた前記信号を前記第3の回路網(38)の第1の出力(44)に供給する第2の加算器(70)を有し、
前記第3の回路網(38)は、複素透過係数D3を有する第2の容量信号経路(124)を介して前記第3の電力分割器(66)から前記信号を受け取り、複素透過係数D4を有する第2の誘導信号経路(126)を介して前記第4の電力分割器(68)から前記信号を受け取り、これらの信号を互いに減算し、前記減算により得られた信号を前記第3の回路網(38)の第2の出力(46)に供給する第2の減算器(72)を有し、
前記第1と第3の回路網(18,38)の間の前記信号経路(128,130)の少なくとも1つ、及び/又は、前記電力分割器(66,68)と前記第2の加算器(70)及び第2の減算器(72)との間の前記信号経路(120,122,124,126)の少なくとも1つに、前記所定の信号経路(120,122,124,126,128,130)上の前記信号の前記振幅及び/又は位相を変化させる、少なくとも1つの結合係数整合手段(64,112,114)が、振幅と位相が同一の結合係数K1,K2を有する信号が前記第2の加算器(70)と第2の減算器(72)における加算と減算のために存在するように配置されたループ型方向性結合器。 - 請求項1に記載のループ型方向性結合器において、
前記第1の回路網(18)の前記第1の出力(24)に接続された第1の入力(30)と、前記第1の回路網(18)の前記第2の出力(26)に接続された第2の入力(32)と、第3の回路網(38)の第1の入力(40)に接続された第1の出力(34)と、前記第3の回路網(38)の前記第2の入力(42)に接続された第2の出力(36)とを有する第2の回路網(28)を備え、
前記第2の回路網(28)は、前記第2の加算器(70)及び第2の減算器(72)における加算と減算のために振幅と位相が同じ結合係数K1,K2を有する信号が存在するように、前記第2の回路網(28)の前記第1の入力(30)及び/又は前記第2の回路網(28)の前記第2の入力(32)における前記信号の振幅及び/又は位相を変化させる少なくとも1つの結合係数整合手段(64)を有するループ型方向性結合器。 - 請求項2に記載のループ型方向性結合器において、
K1=K2=Kであり、
前記結合係数整合手段(64)は、前記第2の回路網(28)の前記第1の入力(30)での前記信号に第1の複素係数F1を掛け、且つ/又は前記第2の回路網(28)の前記第2の入力(32)での前記信号に第2の複素係数F2を掛け、前記第1及び/又は第2の複素係数F1,F2が、以下の式が成り立つように選択されるように設計されたループ型方向性結合器。
K=Kc・F1・D1=Ki・F2・D2=Kc・F1・D3=Ki・F2・D4
又は
K=Kc・F1・D1=Ki・D2=Kc・F1・D3=Ki・D4
又は
K=Kc・D1=Ki・F2・D2=Kc・D3=Ki・F2・D4 - 請求項2と請求項3の少なくとも1項に記載のループ型方向性結合器において、
第1の切換スイッチ(84)が、前記第2の回路網(28)の前記第1の出力(34)と前記第3の回路網(38)の前記第1の入力(40)の間に配置され構成され、
第2の切換スイッチ(86)が、前記第2の回路網(28)の前記第2の出力(36)と前記第3の回路網(38)の前記第2の出力(42)の間に配置され構成され、
これら切換スイッチ(84,86)が、必要に応じて、前記第2の回路網(28)の前記第1及び第2の出力(34,36)から来る前記信号を、前記第3の回路網(38)の前記第1及び第2の入力(40,42)にそれぞれ印加する又は前記第3の回路網(38)をバイパスする間に前記信号を前方に送るループ型方向性結合器。 - 請求項2又は3に記載のループ型方向性結合器において、
前記第2の回路網(28)の前記第1の出力(34)と前記第3の回路網(38)の前記第1の入力(40)の間に、前記第2の回路網(28)の前記第1の出力(34)から来る前記信号を、前記第3の回路網(38)の前記第1の入力(40)と第3の切換スイッチ(98)に印加する第5の電力分割器(96)が配置され、
前記第2の回路網(28)の前記第2の出力(36)と前記第3の回路網(38)の前記第2の入力(42)の間に、前記第2の回路網(28)の前記第2の出力(36)から来る前記信号を前記第3の回路網(38)の前記第2の入力(42)と第4の切換スイッチ(102)とに印加する第6の電力分割器(100)が配置され、
前記切換スイッチ(98,102)は、必要に応じて、前記電力分割器(96,100)から来る前記信号を受信器(108)又は終端抵抗器(104,106)に供給するように配置され構成されたループ型方向性結合器。 - 先行する請求項の少なくともいずれか1項に記載のループ型方向性結合器において、
結合係数整合手段(112,114)は、前記第1及び第2の容量信号経路(120,124)及び/又は第1と第2の誘導信号経路(122,126)のそれぞれに配置され、前記第1の容量信号経路(120)内の前記結合係数整合手段は、前記信号に複素係数F3を掛け、前記第1の誘導信号経路(122)内の前記結合係数整合手段(112)は、前記信号に複素係数F4を掛け、前記第2の容量信号経路(124)内の前記結合係数整合手段は、前記信号に複素係数F5を掛け、前記第2の誘導信号経路(126)内の前記結合係数整合手段(114)は、前記信号に複素係数F6を掛け、前記複素係数F3、F4、F5及びF6は、結合係数整合手段が、前記第3の回路網(38)の全ての前記信号経路(120,122,124,126)内に配置されたときには、
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3*F5=Ki*F6*D4=K2
又は、結合係数整合手段(112,114)が、前記第3の回路網(38)の前記第1及び第2の誘導信号経路(122,126)のみに配置されたときには、
Kc*D1=Ki*F4*D2=K1
且つ
Kc*D3=Ki*F6*D4=K2
又は、結合係数整合手段が、前記第3の回路網(38)の前記第1及び第2の容量信号経路(120,124)のみに配置されたときには、
Kc*D1*F3=Ki*D2=K1
且つ
Kc*D3*F5=Ki*D4=K2
又は、結合係数整合手段が、前記第3の回路網(38)の前記第1及び第2の容量信号経路(120,124)並びに前記第3の回路網の前記第1の誘導信号経路(122)のそれぞれに配置されたときには、
Kc*D1*F3=Ki*F4*D2=Ki
且つ
Kc*D3*F5=Ki*D4=K2
又は、結合係数整合手段が、前記第3の回路網(38)の前記第1及び第2の容量信号経路(120,124)並びに前記第3の回路網の前記第2の誘導信号経路(126)のそれぞれに配置されたときには、
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3=Ki*F6*D4=K2
又は、結合係数整合手段(112,114)が、前記第3の回路網(38)の第1及び第2の誘導信号経路(122,126)並びに前記第3の回路網の前記第2の容量信号経路(124)のそれぞれに配置されたときには、
Kc*D1=Ki*F4*D2=K1
且つ
Kc*D3*F5=Ki*F6*D4=K2
又は、結合係数整合手段(112,114)が、前記第3の回路網(38)の第1及び第2の誘導信号経路(122,126)並びに前記第3の回路網の前記第1の容量信号経路(120)のそれぞれに配置されたときには、
Kc*D1*F3=Ki*F4*D2=K1
且つ
Kc*D3=Ki*F6*D4=K2
が成り立つように選択されたループ型方向性結合器。 - 先行する請求項の少なくともいずれか1項に記載のループ型方向性結合器において、
それぞれの混合器(48,52)とフィルタ(50,54)とが、前記アンテナの前記第1のアーム(12)と前記第1の回路網(18)の前記第1の入力(20)との間と、前記アンテナの前記第2のアーム(14)と前記第1の回路網(18)の前記第2の入力(22)との間に配置され、
前記混合器(48,52)及びフィルタ(50,54)が、前記アンテナの前記アーム(12,14)から来た前記信号を所定の中間周波数に変換するように設計されたループ型方向性結合器。 - 請求項7に記載のループ型方向性結合器において、
前記混合器(48,52)は、前記アンテナの前記アーム(12,14)からの前記信号に混合する混合器信号(76)を前記混合器(48,52)に供給する可変周波数発振器(VFO)(74)に接続されたループ型方向性結合器。 - 請求項8に記載のループ型方向性結合器において、
前記VFO(74)は、局部発振器及び/又は基準発振器を有するフェーズロックループの形をとるループ型方向性結合器。 - 請求項8又は9に記載のループ型方向性結合器において、
前記VFO(74)は、前記結合係数整合手段(64;112,114)を制御する制御システム(78)に接続され、
前記結合係数整合手段(64;112,114)を制御する前記制御システム(78)は、前記混合器(48,52)に供給される前記混合器周波数(80)の関数として、複素係数F、即ち、場合によっては複素係数F1、F2、F3、F4、F5、及び/又はF6を設定するループ型方向性結合器。 - 請求項5及び10に記載のループ型方向性結合器において、
前記受信器(108)は、前記結合係数整合手段(64;112,114)を制御する制御システム(78)に接続されたループ型方向性結合器。 - 請求項11に記載のループ型方向性結合器において、
前記受信器(108)は、前記結合係数整合手段(64)を制御する前記制御システム(78)を制御して、前記結合係数整合手段(64)を制御する前記制御システム(78)が、前記第2の回路網(28)の前記出力(34,36)の両方に同一の結合係数Kが存在するように、前記結合係数整合手段(64)が前記第2の回路網(28)の前記第1の入力(30)及び/又は前記第2の回路網(28)の前記第2の入力(32)の前記信号の前記振幅及び/又は位相を変化させるようなパラメータを前記結合係数整合手段(64)に供給するように設計されたループ型方向性結合器。 - 請求項11に記載のループ型方向性結合器において、
前記受信器(108)は、前記結合係数整合手段(64)を制御する前記制御システム(78)を制御して、前記結合係数整合手段(64)を制御する前記制御システム(78)が、第1の結合係数K1が前記第2の加算器(70)の入力に存在し、且つ第2の結合係数K2が前記第2の減算器(72)の入力に存在するように前記結合係数整合手段(64)が前記第2の回路網(28)の前記第1の入力(30)及び/又は前記第2の回路網(28)の前記第2の入力(32)の前記信号の前記振幅及び/又は位相を変化させるようなパラメータを前記結合係数整合手段(64)に供給するように設計されたループ型方向性結合器。 - 先行する請求項の少なくともいずれか1項に記載のループ型方向性結合器において、
方向性受信器に接続されたスイッチ又は電力分割器が、前記少なくとも1つの結合係数整合手段(112,114)と前記第2の加算器(70)又は第2の減算器(72)との間、又は、場合によっては、前記第2の加算器(70)と前記第2の減算器(72)の前記入力の少なくとも1方の上流に設けられたループ型方向性結合器。
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