JP4759252B2 - 電力制御回路並びにそれを用いた半導体装置及び送受信回路 - Google Patents
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Description
図1に本発明の電力制御回路による実施の形態1を示す。本実施の形態の電力制御回路の構造、動作及び効果を簡便に説明するため、本発明を一例としてGSM及びW−CDMAに対応した携帯電話端末へ適用する場合が取り上げられる。図1は、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。
図2Aに本発明の電力制御回路による実施の形態2を示す。図2Aは、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。本発明を適用する携帯電話端末は、GSM及びW−CDMAに加えてEDGEにも対応している。従って、本実施の形態の電力制御回路は、GSM及びEDGE動作に適用され、マルチモード電力制御回路となる。
図7に本発明の電力制御回路による実施の形態3を示す。図7は、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。本発明を適用する携帯電話端末は、実施の形態2と同様にGSM、W−CDMA及びEDGEの各々に対応している。本実施の形態の電力制御回路は、変調信号出力期間450に比較器90bをオフとすることが可能になる場合に用いられ、サンプルホールド回路140cのみがA/D変換器80aの入力側に配置される。従って、実施の形態2に比べて、サンプルホールド回路の個数が少ない分、電力制御回路220が小型化される。
図9に本発明の電力制御回路による実施の形態3を示す。図9は、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。本実施の形態の電力制御回路は、図2Aにおけるサンプルホールド回路140aをA/D変換器70を構成する初段サンプルホールド回路140dと兼用にすることが可能になる場合に用いられる。実施の形態2に比べて、サンプルホールド回路140aが省略される分、電力制御回路220が小型化される。
図10に本発明の半導体装置及び送受信回路による実施の形態5を示す。本実施の形態は、例えばGSM及びEDGE(以下、「GSM/EDGE」と略記する)(第2の通信方式)並びにW−CDMA(第1の通信方式)に対応の携帯電話端末に用いられ、実施の形態2〜4から選択された電力制御回路220が備えられる。
図11に本発明の半導体装置及び送受信回路による実施の形態6を示す。本実施の形態では、実施の形態5の送受信回路に対してモジュール構成が変更される。
図12に本発明の半導体装置及び送受信回路による実施の形態7を示す。本実施の形態では、実施の形態5、6の半導体装置及び送受信回路に対して周波数変換回路20aと電力増幅器40aとの間の構成が変更され、その間に利得可変増幅器30を含む経路と含まない経路が設けられる。
図13に本発明の半導体装置及び送受信回路による実施の形態8を示す。本実施の形態では、実施の形態7の半導体装置及び無線通信モジュールに対して、周波数変換回路20aからの経路毎に電力増幅器が配置される。図13において、40bはW−CDMA用の電力増幅器、40cはGSM/EDGE用の電力増幅器である。本実施の形態では、このように、電力増幅器がW−CDMA用、GSM/EDGE用に別個に備えられるので、それに伴い、電力制御回路220は、GSM/EDGE用電力増幅器40cに対してのみ制御を行なう。
図14に本発明の半導体装置及び送受信回路による実施の形態9を示す。本実施の形態では、実施の形態8の半導体装置及び送受信回路に対して、電力増幅器40b、40cのそれぞれに方向性結合器が設けられる。図14において、50bは、W−CDMA用電力増幅器40bとアイソレータ500の間に配置した方向性結合器、50cは、GSM/EDGE用電力増幅器40cと送信フィルタ520aの間に配置した方向性結合器である。このような構成によって、周波数変換回路20aとデュプレクサ510との間にW−CDMA用に独立した経路が形成され、周波数変換回路20aとアンテナスイッチ530aとの間にGSM/EDGE用に独立した経路が形成される。
図15に本発明の半導体装置及び送受信回路による実施の形態10を示す。本実施の形態では、実施の形態9の半導体装置及び送受信回路に対して、方向性結合器50b、50cのそれぞれに検波器が設けられる。図15において、60bは、方向性結合器50bと電力制御回路220の間に配置したW−CDMA用の検波器、60cは、方向性結合器50cと電力制御回路220の間に配置したGSM/EDGE用の検波器である。
図16に本発明の半導体装置及び送受信回路による実施の形態11を示す。本実施の形態は、ローバンドGSM、ローバンドEDGE、ハイバンドGSM、ハイバンドEDGE、及びW−CDMAの各方式に対応する携帯電話端末に用いられ、実施の形態2〜4から選択された電力制御回路220が備えられる。ローバンド、ハイバンドの周波数は上述の通り、ローバンドが800〜900MHz帯、ハイバンドが1800〜1900MHz帯である。更に、W−CDMAの周波数は、説明の簡便性を考慮して、1800〜1900MHz帯とする。
図17A及び図17Bに本発明の半導体装置及び送受信回路による実施の形態12を示す。本実施の形態は、アンテナがW−CDMA用とGSM/EDGE用とで別々に設けられる。
図18に本発明の半導体装置及び送受信回路による実施の形態13を示す。本実施の形態では、電力増幅器40の電源電圧を調整する回路が付加される。
図19に本発明の半導体装置及び送受信回路による実施の形態14を示す。電力制御回路220への入力信号を実施の形態1〜13では電力増幅器40の出力信号を検出することによって得ていたのに代えて、本実施の形態では、電力増幅器40の消費電流を検知することによって得るように検出方法が変更される。
図20に本発明の電力制御回路による実施の形態15を示す。図20は、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。本発明を適用する携帯電話端末は、実施の形態1と同様にGSM方式及びW−CDMA方式に対応しているが、利得制御が電力増幅器40で行なわれるのでなく、利得可変増幅器30で行なわれるように構成される。
図21に本発明の電力制御回路による実施の形態16を示す。図21は、本実施の形態の電力制御回路を具備した携帯電話端末の送信部を示す回路構成図である。本発明を適用する携帯電話端末は、実施の形態1と同様にGSM及びW−CDMAに対応しているが、利得制御が電力増幅器40及び利得可変増幅器30で行なわれるように構成される。
Claims (29)
- 電力制御信号に応じて増幅器の出力電力が所望の電力値となるように上記増幅器の利得を制御する電力制御回路であって、
上記増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記増幅器の利得を制御するための利得制御信号を出力する加算器と
を具備して成り、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタと
を具備する
ことを特徴とする電力制御回路。 - 請求項2において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする電力制御回路。 - 請求項1において、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持するサンプルホールド回路を更に具備し、
上記サンプルホールド回路が動作中に上記第2の比較器が動作を停止する
ことを特徴とする電力制御回路。 - 受信された第1の信号を増幅する受信回路と、
上記受信回路が出力する増幅後の上記第1の信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する第3の信号を入力して周波数変換を行なって第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第4の信号を増幅する外部の第2の増幅器の出力電力が所望の電力値となるように電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備し、
上記電力制御回路は、
上記外部の第2の増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記回路ブロックが同一半導体基板上に形成され、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタと
を具備する
ことを特徴とする半導体装置。 - 請求項4において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記第1の電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記第1の電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする半導体装置。 - 請求項4において、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持するサンプルホールド回路を更に具備し、
上記サンプルホールド回路が動作中に上記第2の比較器が動作を停止する
ことを特徴とする半導体装置。 - 受信された第1の信号を増幅する受信回路と、
上記受信回路が出力する増幅後の上記第1の信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する第3の信号を入力して周波数変換を行なって第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第4の信号を増幅する外部の第2の増幅器の出力電力が所望の電力値となるように電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備し、
上記電力制御回路は、
上記外部の第2の増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記回路ブロックが同一半導体基板上に形成され、
上記利得制御信号によって上記外部の第2の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする半導体装置。 - 受信された第1の信号を増幅する受信回路と、
上記受信回路が出力する増幅後の上記第1の信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する第3の信号を入力して周波数変換を行なって第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第4の信号を増幅する外部の第2の増幅器の出力電力が所望の電力値となるように電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備し、
上記電力制御回路は、
上記外部の第2の増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記回路ブロックが同一半導体基板上に形成され、
上記第1の増幅器は、上記利得制御信号によっても利得が制御され、上記利得制御信号によって上記第1の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする半導体装置。 - 受信された第1の信号を増幅する受信回路と、
上記受信回路が出力する増幅後の上記第1の信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する第3の信号を入力して周波数変換を行なって第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第4の信号を増幅する外部の第2の増幅器の出力電力が所望の電力値となるように電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備し、
上記電力制御回路は、
上記外部の第2の増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記回路ブロックが同一半導体基板上に形成され、
送信する上記第3の信号は、第1の通信方式と第2の通信方式とから選択された一方の通信方式の信号であり、上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられる
ことを特徴とする半導体装置。 - アンテナによって受信された第1の通信方式の第1aの信号を増幅する第1の受信回路と、
上記アンテナによって受信された第2の通信方式の第1bの信号を増幅する第2の受信回路と、
上記第1又は第2の受信回路が出力する増幅後の上記第1a又は第1bの信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する上記第1の通信方式の第3aの信号又は上記第2の通信方式の第3bの信号を入力して周波数変換を行なって、第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第1の増幅器が出力する増幅後の上記第4の信号を電力増幅する第2の増幅器と、
上記第2の増幅器の出力信号の電力値を検出して検出信号を出力する検出器と、
上記第2の増幅器の出力電力が所望の電力値となるように第1の電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備して成り、
上記電力制御回路は、
上記検出器が出力する上記検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記第1の電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記第1の電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記第1の電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記第1の電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタと
を具備する
ことを特徴とする送受信回路。 - 請求項10において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記第1の電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記第1の電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする送受信回路。 - アンテナによって受信された第1の通信方式の第1aの信号を増幅する第1の受信回路と、
上記アンテナによって受信された第2の通信方式の第1bの信号を増幅する第2の受信回路と、
上記第1又は第2の受信回路が出力する増幅後の上記第1a又は第1bの信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する上記第1の通信方式の第3aの信号又は上記第2の通信方式の第3bの信号を入力して周波数変換を行なって、第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第1の増幅器が出力する増幅後の上記第4の信号を電力増幅する第2の増幅器と、
上記第2の増幅器の出力信号の電力値を検出して検出信号を出力する検出器と、
上記第2の増幅器の出力電力が所望の電力値となるように第1の電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備して成り、
上記電力制御回路は、
上記検出器が出力する上記検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記第1の電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられ、
上記利得制御信号によって上記第2の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする送受信回路。 - アンテナによって受信された第1の通信方式の第1aの信号を増幅する第1の受信回路と、
上記アンテナによって受信された第2の通信方式の第1bの信号を増幅する第2の受信回路と、
上記第1又は第2の受信回路が出力する増幅後の上記第1a又は第1bの信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する上記第1の通信方式の第3aの信号又は上記第2の通信方式の第3bの信号を入力して周波数変換を行なって、第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第1の増幅器が出力する増幅後の上記第4の信号を電力増幅する第2の増幅器と、
上記第2の増幅器の出力信号の電力値を検出して検出信号を出力する検出器と、
上記第2の増幅器の出力電力が所望の電力値となるように第1の電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備して成り、
上記電力制御回路は、
上記検出器が出力する上記検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記第1の電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられ、
上記第1の増幅器は、上記利得制御信号によっても利得が制御され、上記利得制御信号によって上記第1の増幅器の利得が制御されることにより、上記出力電力が制御されることを特徴とする送受信回路。 - アンテナによって受信された第1の通信方式の第1aの信号を増幅する第1の受信回路と、
上記アンテナによって受信された第2の通信方式の第1bの信号を増幅する第2の受信回路と、
上記第1又は第2の受信回路が出力する増幅後の上記第1a又は第1bの信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する上記第1の通信方式の第3aの信号又は上記第2の通信方式の第3bの信号を入力して周波数変換を行なって、第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第1の増幅器が出力する増幅後の上記第4の信号を電力増幅する第2の増幅器と、
上記第2の増幅器の出力信号の電力値を検出して検出信号を出力する検出器と、
上記第2の増幅器の出力電力が所望の電力値となるように第1の電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備して成り、
上記電力制御回路は、
上記検出器が出力する上記検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記第1の電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられ、
上記第1の通信方式がW−CDMA(Wide-band Code Division Multiple Access)であり、上記第2の通信方式がGSM(Global System for Mobile Communication)又はEDGE(Enhanced Data rates for GSM Evolution)の少なくともいずれかである
ことを特徴とする送受信回路。 - 電力制御信号に応じて増幅器の出力電力が所望の電力値となるように上記増幅器の利得を制御する電力制御回路であって、
上記増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記増幅器の利得を制御するための利得制御信号を出力する加算器と
を具備して成り、
上記ディジタル帰還回路が上記増幅器の電力値を一定に保つ機能を有し、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタとを具備する
ことを特徴とする電力制御回路。 - 請求項15において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする電力制御回路。 - 請求項15において、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持するサンプルホールド回路を更に具備し、
上記サンプルホールド回路が動作中に上記第2の比較器が動作を停止する
ことを特徴とする電力制御回路。 - 受信された第1の信号を増幅する受信回路と、
上記受信回路が出力する増幅後の上記第1の信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する第3の信号を入力して周波数変換を行なって第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第4の信号を増幅する外部の第2の増幅器の出力電力が所望の電力値となるように電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備し、
上記電力制御回路は、
上記外部の第2の増幅器の出力電力の電力値を検出して得る検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記回路ブロックが同一半導体基板上に形成され、
上記ディジタル帰還回路が上記増幅器の電力値を一定に保つ機能を有し、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタとを具備する
ことを特徴とする半導体装置。 - 請求項18において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記第1の電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記第1の電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする半導体装置。 - 請求項18において、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持するサンプルホールド回路を更に具備し、
上記サンプルホールド回路が動作中に上記第2の比較器が動作を停止する
ことを特徴とする半導体装置。 - 請求項18において、
上記利得制御信号によって上記外部の第2の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする半導体装置。 - 請求項18において、
上記第1の増幅器は、上記利得制御信号によっても利得が制御され、上記利得制御信号によって上記第1の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする半導体装置。 - 請求項18において、
送信する上記第3の信号は、第1の通信方式と第2の通信方式とから選択された一方の通信方式の信号であり、上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられる
ことを特徴とする半導体装置。 - アンテナによって受信された第1の通信方式の第1aの信号を増幅する第1の受信回路と、
上記アンテナによって受信された第2の通信方式の第1bの信号を増幅する第2の受信回路と、
上記第1又は第2の受信回路が出力する増幅後の上記第1a又は第1bの信号に対して周波数変換を行なって第2の信号を出力する第1の周波数変換回路と、
送信する上記第1の通信方式の第3aの信号又は上記第2の通信方式の第3bの信号を入力して周波数変換を行なって、第4の信号を出力する第2の周波数変換回路と、
上記周波数変換回路が出力する上記第4の信号を増幅する第1の増幅器であって、第2の電力制御信号によって利得が制御される第1の増幅器と、
上記第1の増幅器が出力する増幅後の上記第4の信号を電力増幅する第2の増幅器と、
上記第2の増幅器の出力信号の電力値を検出して検出信号を出力する検出器と、
上記第2の増幅器の出力電力が所望の電力値となるように第1の電力制御信号によって上記出力電力を制御する電力制御回路と
を含む回路ブロックを具備して成り、
上記電力制御回路は、
上記検出器が出力する上記検出信号をディジタル信号に変換してから上記第1の電力制御信号との差分を取り、上記差分をアナログ信号に変換して第1の帰還信号を出力するディジタル帰還回路と、
アナログ信号に変換された上記第1の電力制御信号と上記検出信号との差分の高周波成分を第2の帰還信号として出力するアナログ帰還回路と、
上記第1の帰還信号と上記第2の帰還信号との和を取って上記出力電力を制御するための利得制御信号を出力する加算器と
を具備し、
上記ディジタル帰還回路が上記増幅器の電力値を一定に保つ機能を有し、
上記ディジタル帰還回路は、
上記検出信号をディジタル信号に変換して出力するアナログ/ディジタル変換器と、
上記アナログ/ディジタル変換器のディジタル出力信号と上記第1の電力制御信号との差分を出力する第1の比較器と、
上記第1の比較器のディジタル出力信号をアナログ信号に変換して上記第1の帰還信号を出力する第1のディジタル/アナログ変換器と
を具備し、
上記アナログ帰還回路は、
上記第1の電力制御信号をアナログ信号に変換して出力する第2のディジタル/アナログ変換器と、
上記検出信号と上記第2のディジタル/アナログ変換器が出力するアナログ信号に変換された上記第1の電力制御信号との差分を取る第2の比較器と、
上記第2の比較器の出力信号の高周波成分を取り出して上記第2の帰還信号を出力するハイパスフィルタと
を具備する
ことを特徴とする送受信回路。 - 請求項24において、
上記検出信号を記憶して保持する第1のサンプルホールド回路と、
上記第1の電力制御信号を記憶して保持する第2のサンプルホールド回路と、
上記第1のディジタル/アナログ変換器と上記第1の比較器との間に配置され、上記第1の比較器の上記ディジタル出力信号を記憶して保持する第3のサンプルホールド回路とを更に具備し、
上記検出信号は、上記第1のサンプルホールド回路を経て上記アナログ/ディジタル変換器と上記第2の比較器とに入力され、上記第1の電力制御信号は、上記第2のサンプルホールド回路を経て上記第2のディジタル/アナログ変換器に入力される
ことを特徴とする送受信回路。 - 請求項24において、
上記第2の電力制御信号は、上記第1の通信方式に対して用いられ、上記第1の電力制御信号は、上記第2の通信方式に対して用いられる
ことを特徴とする送受信回路。 - 請求項26において、
上記利得制御信号によって上記第2の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする送受信回路。 - 請求項26において、
上記第1の増幅器は、上記利得制御信号によっても利得が制御され、上記利得制御信号によって上記第1の増幅器の利得が制御されることにより、上記出力電力が制御される
ことを特徴とする送受信回路。 - 請求項26において、
上記第1の通信方式がW−CDMA(Wide-band Code Division Multiple Access)であり、上記第2の通信方式がGSM(Global System for Mobile Communication)又はEDGE(Enhanced Data rates for GSM Evolution)の少なくともいずれかである
ことを特徴とする送受信回路。
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