JP4731025B2 - Cylinder type capacitor and method of manufacturing cylinder type capacitor - Google Patents
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Description
【0001】
【発明の属する技術分野】
この発明は、半導体集積回路に用いられるシリンダ型キャパシタ、特に電極材料の一部として粗面状ポリシリコンを用いたシリンダ型キャパシタ及びその製造方法に関する。
【0002】
【従来の技術】
近年、半導体集積回路の高集積化が要求されており、半導体集積回路に実装されるキャパシタについても、微少な実装面積に対してより大きい静電容量を有するキャパシタの構造及び製造方法が要求されている。
【0003】
このような要求を満たすキャパシタとして、シリンダ型キャパシタが開発されている。このシリンダ型キャパシタによれば、上部電極及び下部電極が三次元的な構造を有している。従って、キャパシタの実装面積に対して上部電極及び下部電極の実質的な電極面積を大きくすることが出来る。
【0004】
このようなシリンダ型キャパシタの製造方法及び構造についての第1の従来技術を、図6、図7及び図8(A)を参照して説明する。図6及び図7は、第1の従来技術のシリンダ型キャパシタの製造方法を示す工程図であり、図8(A)は第1の従来技術のシリンダ型キャパシタの構造を示す断面図である。
【0005】
まず、層間絶縁膜102上にエッチングストッパ膜104を形成し、しかる後に、層間絶縁膜102下にある半導体素子と導通を取るためのコンタクトホール106を形成する(図6(A))。その後、エッチングストッパ膜104上に下部電極底部材料膜108を形成し、同時にコンタクトホール106を満たし埋め込みコンタクト110を形成する(図6(B))。この下部電極底部材料膜108は、キャパシタの下部電極の一部である下部電極底部を形成するための膜であり、例えばポリシリコンなどで形成する。
【0006】
次に、下部電極底部材料膜108上に、犠牲膜112を例えばSiO2等で形成する(図6(C))。そして、下部電極底部材料膜108及び犠牲膜112を、凸型に残存するように、エッチングする(図6(D))。この残存した下部電極底部材料膜108が下部電極底部114となる。
【0007】
次に、この凸型の残存部分(113、114)及び犠牲膜除去用のエッチングストッパ膜104上に、下部電極側壁部材料膜116を形成する(図7(A))。この下部電極側壁部材料膜116は、キャパシタの下部電極の一部である下部電極側壁部を形成するための膜であり、例えばポリシリコンなどで形成する。次に、異方性エッチングを行うことにより、下部電極側壁部材料膜116のうち、層間絶縁膜の主表面と平行な下部電極側壁部材料膜の部分を除去する(図7(B))。下部電極側壁部材料膜116のうち、このエッチング工程により残存した下部電極側壁部材料膜の部分が下部電極側壁部118となる。その後、犠牲膜113を除去することにより、下部電極120が完成する(図7(C))。図示しないが、その後、誘電体層及び上部電極を形成することにより、シリンダ型キャパシタが完成する。
【0008】
上述した製造方法により製造した第1の従来技術のシリンダ型キャパシタの構成例を図8に示す。図6及び図7に示した工程により層間絶縁膜102上に下部電極120がシリンダ状に形成されている。そして、下部電極の表面に沿って誘電体層122が形成されており、さらにその上に、上部電極124が形成されている。上部電極の誘電体層と接する側の表面は、下部電極の形状に沿った形状となっている。従って、このシリンダ型キャパシタの実装面積、すなわち、下部電極の底部の面積と比較して、下部電極及び上部電極が向かい合う表面の対向面積(以後、キャパシタ表面積と称する。)を大きくすることが出来る。すなわち、静電容量を大きくすることが出来る。
【0009】
次に、シリンダ型キャパシタの製造方法の第2の従来公知例を、図9及び図10を参照して説明する。図9及び図10は、第2の従来技術のシリンダ型キャパシタの製造方法を示す工程図である。
【0010】
第1の従来技術と同様に、層間絶縁膜102上に犠牲膜除去用のエッチングストッパ膜104を形成し、しかる後に、コンタクトホールを形成する。次に、コンタクトホール内へ埋め込みコンタクト材料膜104を設けて、埋め込みコンタクト130を形成するが、同時に、エッチングストッパ膜104上にも、埋め込みコンタクト材料膜が形成される。そして、このエッチングストッパ膜104上に形成された埋め込みコンタクト材料膜を除去するために、エッチバックを行う(図9(A))。
【0011】
次に、エッチングストッパ膜104上及び埋め込みコンタクト130上に犠牲膜132を形成する(図9(B))。次に、犠牲膜を凹型に残存するように、エッチングする(図9(C))。
【0012】
次に、この凹型の残存部分134、エッチングストッパ膜104及び埋め込みコンタクト130上に、下部電極材料膜136を形成する(図9(D))。この下部電極材料膜136は、キャパシタの下部電極を形成するための膜であり、例えばポリシリコンなどで形成する。次に、下部電極材料膜136上に、シリンダ埋め込み材料膜138を形成する(図10(A))。そして、このシリンダ埋め込み材料膜138及び下部電極材料膜136をエッチバックして、下部電極材料膜136の縦断面形状が、ほぼU字状となるようにする。このU字状の内側には埋め込み材料膜144部分が残存していて、下部電極材料膜部分が、底部と側壁部を有するシリンダ状となる(図10(B))。そして、残存している犠牲膜142及びシリンダ埋め込み材料膜144を除去することにより、下部電極140が完成する(図10(C))。図示しないが、その後、誘電体層及び上部電極を形成することにより、シリンダ型キャパシタが完成する。
【0013】
上述した製造方法により製造した第2の従来技術のシリンダ型キャパシタの構成例は図示しないが、図8に示した第1の従来技術のシリンダ型キャパシタの構成例とほとんど同様である。
【0014】
また、第2の従来技術をさらに発展させた技術として、さらに電極面積を増加させてキャパシタの静電容量を増加させた、第3の従来技術の構造及び製造方法もある。この第3の従来技術の製造方法及び構造について図9、図11及び図8(B)を参照して説明する。図11は、第3の従来技術のシリンダ型キャパシタの製造方法を示す工程図であり、図8(B)は第3の従来技術のシリンダ型キャパシタの構造を示す図である。図9(A)〜図9(D)は、第2の従来技術と同様であるので、説明を省略する。図9(D)の後に、下部電極材料膜136上に、粗面状電極材料膜150を形成する(図11(A))。この粗面状電極材料膜150としては、下部電極材料膜と同様に、ポリシリコンなどで形成する。その後、第2の従来技術と同様に、シリンダ埋め込み材料膜138を形成し(図11(B))、シリンダ埋め込み材料膜138、下部電極材料膜136及び粗面状電極材料膜150をエッチバックし(図11(C))、残存した犠牲膜142及びシリンダ埋め込み材料膜144を除去する(図11(D))。下部電極140内に残存した粗面状電極材料膜部分が粗面状電極膜152となる。その後、誘電体層122及び上部電極124を形成することにより、シリンダ型キャパシタが完成する(図8(B))。
【0015】
上述した製造方法により製造した第3の従来技術のシリンダ型キャパシタの構造によれば、図8(A)に示した第1の従来技術の構造や、第2の従来技術の構造と比較して、下部電極の内壁に粗面状電極膜が形成されているので、キャパシタ表面積をさらに大きくすることが出来る。すなわち、さらに静電容量を大きくすることが出来る。
【0016】
【発明が解決しようとする課題】
しかしながら、半導体集積回路において、シリンダ型キャパシタ等の各素子の更なる微小化が要求されている。つまり、微小化によって要求される実装面積に対し、充分な静電容量を有することが必要になる。
【0017】
そして、第1の従来技術においては、実装面積つまり下部電極の底部面積に対して静電容量の大きさが充分ではない。これに対し、実装面積を一定のままで、さらに静電容量を大きくするためにキャパシタ表面積を増加させるためには、シリンダの高さすなわち下部電極の側壁部の高さを大きくするしかない。
【0018】
しかしながら、シリンダを高くすると、後にシリンダ型キャパシタと半導体集積回路の他の素子とのコンタクトを形成する際に、高アスペクト比を有するエッチングが必要になる。従って、現実的にシリンダを高くするのにも限界がある。つまり、この構成においては、充分な静電容量を得ることが出来ないという第1の問題点がある。
【0019】
また、第2の従来技術においては、上述した第1の従来技術と同様の問題点が発生する。さらに、第2の従来技術においては、第1の従来技術と比較して、シリンダ埋め込み材料膜の形成(図10(A))及びエッチバック工程(図9(A))などが余計に必要であるために、工程が複雑になる。また、エッチバック工程により、パーティクルが発生し、キャパシタの性能低下につながる可能性がある。同時に、エッチバック工程によって下部電極の側壁部の高さが決定されるため、この高さにバラツキが生じやすいという第2の問題点がある。
【0020】
また、第3の従来技術においては、上述した第2の従来技術における製造工程が複雑になる問題点及びエッチバック工程を有することによる問題点を有する。
【0021】
また、第1の従来技術における問題点は、粗面状電極材料膜を用いることにより解決されるが、新たな問題点が発生する。すなわち、上述したキャパシタの微小化の要求に伴い、実装面積をさらに縮小していくと、下部電極の側壁部の間隔も同時に小さくなる。従って、側壁部内側に形成されている粗面状電極材料膜同士が接触すると、設計通りに容量増加が実現できない。また、シリンダ状の下部電極内部が埋まってしまうことによって、誘電体層及び上部電極が図8(B)に示したような下部電極の表面に沿った形状にならなくなる恐れがあり、この場合には、静電容量が大幅に悪化する。また、側壁部内側の粗面状電極材料膜同士の接触は、微小化に伴い発生する問題点であるが、図8(B)の構造であると、下部電極の底部の面積にかかわらず、下部電極側壁部の粗面状電極材料膜及び下部電極底部の粗面状電極材料膜が接触して連続形成されているので、設計通りに容量増加が実現できない。このようにこれらの第3の従来技術に特有の第3の問題点がある。
【0022】
この発明は上述の問題点に鑑みなされたものであり、従って、この発明の目的は、微小化の要求を満たしつつ充分な静電容量を確保することによって第1の問題点を解決するシリンダ型キャパシタ及びこのシリンダ型キャパシタの製造方法を提供することにある。同時に、第2の問題点が発生しないシリンダ型キャパシタの製造方法を提供する。また、好ましくは、第3の問題点が発生しないシリンダ型キャパシタ及びこのシリンダ型キャパシタの製造方法を提供する。さらに、好ましくは、第3の従来技術で得られた大きさ以上の静電容量を有するシリンダ型キャパシタ及びこのシリンダ型キャパシタの製造方法を提供する。
【0028】
【課題を解決するための手段】
本発明のシリンダ型キャパシタによれば、下部電極が下部電極底部と下部電極側壁部とを有しており、下部電極がシリンダ状に形成されているシリンダ型キャパシタにおいて、下部電極底部の内側表面上、下部電極側壁部の外側表面上、及び下部電極側壁部の内側表面上のうち下部電極底部の内側表面から所定の高さ以上離れた領域に、粗面状電極膜が形成されていることを特徴とする。
【0029】
このような構成にすることにより、第1の問題点を解決する。このとき、粗面状電極膜は、第1表面のみならず、第2表面及び第3表面にも形成されているので、実質的な電極表面積を増大させることが出来る。また、第1表面と第2表面との接触点付近の第2表面には粗面状電極膜が形成されていないので、第1表面と第2表面に形成された粗面状電極膜が接触しないという効果を得ることが出来る。すなわち、第3の問題点を一部解決することが出来る。
【0037】
また、本発明のシリンダ型キャパシタの製造方法は、下部電極が下部電極底部と下部電極側壁部とを有しており、下部電極がシリンダ状に形成されているシリンダ型キャパシタを製造するに当たり、次のような工程を有している。
【0038】
(a)下地上に下部電極底部材料膜を形成した後に、下部電極底部材料膜上に第1粗面状電極材料膜を形成する工程。
(b)第1粗面状電極材料膜上に犠牲膜を形成する工程。
(c)下部電極底部材料膜と第1粗面状電極材料膜と犠牲膜とを、凸型積層体として残存するようにパターニングすることにより、下部電極底部と第1粗面状電極膜とを形成する工程。
(d)前記凸型積層体の側面に、前記下部電極側壁部を形成する工程。
【0039】
(h)しかる後、前記凸型積層体を構成する前記犠牲膜を、その表面から深さ方向に、前記下部電極底部の内側表面から所定の高さにまで除去する工程。
(i)しかる後、前記凸型積層体の露出表面に第2粗面状電極材料膜を形成する工程。
(j)しかる後、残存している前記犠牲膜を除去して第2粗面状電極膜を形成する工程。
【0040】
このような構成にすることにより、本発明のシリンダ型キャパシタを容易に製造することが出来、第2の問題点も解決することが出来る。
【0041】
【発明の実施の形態】
以下、この発明の実施の形態について、図面を用いて説明する。なお、図中、各構成成分の大きさ、形状および配置関係は、この発明が理解できる程度に概略的に示してあるにすぎず、また、以下に説明する数値的条件は単なる例示にすぎない。
【0042】
最初に、第1の実施の形態のシリンダ型キャパシタの構造について、図1(A)を参照して説明する。図1(A)は、第1の実施の形態のシリンダ型キャパシタの構造を示す断面図である。
【0043】
このキャパシタ10は、下部電極12、上部電極14及び下部電極12と上部電極14に挟まれた誘電体層16を有している。そして、下部電極12は下部電極底部18と下部電極側壁部20とを有している。従って、図1(A)に示すように下部電極12はシリンダ状に形成されている。従って、このキャパシタ10をシリンダ型キャパシタと称する。なお、この断面図とは垂直方向にとったキャパシタ10の断面も、図1(A)と同様になっている。すなわち、下部電極底部18は、円形状、四角形などの任意の形状でよいが、下部電極側壁部20は下部電極底部18を取り囲むように形成されている。
【0044】
この実施の形態においては、下部電極底部18はポリシリコンによって形成されており、数十〜数百nmの厚さになっている。同様に、下部電極側壁部20もポリシリコンによって形成されており、数十〜数百nmの厚さになっている。
【0045】
下部電極底部18表面上には、粗面状電極膜22が形成されている。この粗面状電極膜22も、ポリシリコンによって形成されており、数十nmの厚さになっている。従って、下部電極12は、下部電極底部18と、下部電極側部20と、粗面状電極膜22とで構成されているといえる。
【0046】
そして、誘電体層16は、エッチングストッパ膜28、下部電極側壁部20及び粗面状電極膜22の表面に沿うように形成されている。同様に、上部電極14は、誘電体層16の表面に沿うように形成されている。
【0047】
従って、このキャパシタ10の性能は、次のように表現することが出来る。キャパシタ10の被形成層24の実装面積は、下部電極12と被形成層24が接している面積、つまり、下部電極底部18及び下部電極側壁部20が、被形成層24と接している面積であり、図1(A)中のシリンダの幅Wの大きさに密接に関係している。また、シリンダ高さは、下部電極側壁部20の高さであり、図1(A)中のHで表される。ここで、シリンダ型キャパシタにおいては、電極面積は、下部電極12と上部電極14とが対向している面積であり、この電極面積が大きいほどシリンダ型キャパシタの静電容量が大きくなる。従って、電極面積を大きくするには、下部電極底部18の面積を大きくするか、或いは、シリンダを高くするかのどちらかである。しかしながら、実装面積の微小化の要求、及び、アスペクト比からシリンダ高さにも上限があることを考慮すると、これらの大きさを大きくして、電極面積を大きくするのには限界がある。これに対して、粗面状電極膜22は、通常のポリシリコンの電極の約2倍の表面積を有する。従って、この実施の形態のキャパシタ10の構成によれば、実装面積は従来と同等であっても、実質的に電極面積を増加させることが可能になる。
【0048】
また、このキャパシタ10の下部電極底部18の幅は、数十〜数百nmであり、実際上、粗面状電極膜22の膜厚の約2倍程度の大きさである場合もあり得る。この場合には、粗面状電極膜22が第2表面すなわち下部電極側壁部20の内側表面にも形成されている場合には、粗面状電極膜22同士が一部接触する恐れがある。この場合には、上部電極14及び誘電体層16をシリンダ内部に埋め込んだ状態で形成できなくなる。しかしながら、この実施の形態の場合には、第1表面すなわち下部電極底部18内側表面上にのみ粗面状電極膜22を有する構造であるので、このような問題点が発生する恐れはない。
【0049】
また、キャパシタ10は、被形成層24上に形成されている。この被形成層24は層間絶縁膜26、層間絶縁膜26上に形成されたエッチングストッパ膜28、及び埋め込みコンタクト30によって構成されている。通常の半導体集積回路においては、実装密度を増加させるために、半導体素子を基板上に複数層形成するが、これらの複数層の半導体素子を電気的に分離するために、層間絶縁膜26が形成されている。この実施の形態においては、この層間絶縁膜26上にキャパシタ10が実装されている構成とする。エッチングストッパ膜28は、詳しくは後述するが、キャパシタ10を形成する際のエッチングによって層間絶縁膜26が化学的に反応するなどの影響を受けないために形成されている。また、埋め込みコンタクト30は、このキャパシタ10と、層間絶縁膜26下に形成されている他の半導体素子との電気的接続を得るために形成されている。
【0050】
この実施の形態においては、埋め込みコンタクト30と下部電極底部18とは、同じ材料、つまりポリシリコンによって形成されている。
【0051】
なお、この実施の形態においては、粗面状電極膜22及び下部電極12は、ポリシリコンを用いて形成してあるが、キャパシタ10の電極として使用できる材料であれば他の材料に変更可能である。また、粗面状電極膜22及び下部電極12として、必ずしも同じ材料を使用する必要はない。
【0052】
また、下部電極底部18上に粗面状電極膜22が形成されているが、下部電極底部18を有しなく、粗面状電極膜22のみが形成されており、この粗面状電極膜22がシリンダの底部をなしている構造であっても、同様の効果を奏することができる。
【0053】
次に、第1の実施の形態のシリンダ型キャパシタの製造方法について、図2及び図3を参照して説明する。図2及び図3は、第1の実施の形態のシリンダ型キャパシタの製造方法を示す工程図であり、一連の工程を図2及び図3に分けて示してある。
【0054】
まず、キャパシタ10を形成する前に、被形成層24を形成する。
【0055】
このため、層間絶縁膜26上に、エッチングストッパ膜28を形成する。エッチングストッパ膜28は、後述する犠牲膜除去工程において、層間絶縁膜26がエッチングの影響を受けないように層間絶縁膜26を保護する役割を有している。従って、例えば窒化シリコン(SiN)によって形成すれば良く、CVD法によって50〜200nmの膜厚で形成すれば良い。
【0056】
その後、層間絶縁膜26下の半導体素子と電気的に接続するために、コンタクトホール32を、通常のフォトリソ及びエッチングによって層間絶縁膜26及びエッチングストッパ膜28を、パターニングして形成する(図2(A))。
【0057】
次に、被形成層24上に、下部電極底部材料膜34を形成する。この下部電極底部材料膜34は、後にエッチングされて下部電極底部18となる膜であり、例えば熱CVD法によってポリシリコンの膜を数十〜数百nmの厚さに形成する。このとき同時に、コンタクトホール32内にも、ポリシリコンが埋め込まれてるために、埋め込みコンタクト30が形成される。但し、下部電極底部材料膜34が数十〜数百nmの厚さで形成されると共に、埋め込みコンタクト30が形成されるためには、コンタクトホール32の径がある程度小さくなければならない。実際上は、この径が下部電極底部材料膜34の膜厚の2倍以下であることが望ましい。また、この実施の形態においては、下部電極底部材料膜34及び埋め込みコンタクト30を一度の工程において形成したが、次に述べるように、埋め込みコンタクト30を上述の被形成層24を形成する工程で形成した後に、下部電極底部材料膜34のみを形成しても良い。この場合には、コンタクトホール32をポリシリコンによって埋め込むことによりエッチングストッパ膜28上にも形成されたポリシリコンの膜をエッチバックを行うことによって、埋め込みコンタクト30を形成する。その後、下部電極底部材料膜34を形成すればよい。コンタクトホール32の径が、下部電極底部材料膜34の膜厚と比較して大きい場合には、このように、下部電極底部材料膜34及び埋め込みコンタクト30を別工程で形成する方法が有効である。
【0058】
次に、下部電極底部材料膜34上に、第1粗面状電極材料膜36を形成する。この第1粗面状電極材料膜36は、後にエッチングされて粗面状電極膜22に加工される膜であり、例えば熱CVD法によって粗面状ポリシリコンの膜を数十nmの厚さに形成する(図2(B))。ここで、上述した下部電極底部材料膜34及び第1粗面状電極材料膜36の双方とも、熱CVD法によってポリシリコンで形成する場合には、通常CVD法の反応温度を異ならせる。すなわち、熱CVD装置及び反応材料は同じであっても、反応温度を高くするに従って、順次に、アモルファスシリコン、粗面状ポリシリコン、ポリシリコンが生成する。従って、同じ熱CVD装置及び反応材料によって温度を変化させるだけで、順に下部電極底部材料膜34及び第1粗面状電極材料膜36を成膜することが出来るので、これらの膜を容易に形成できる。通常粗面状ポリシリコン膜を成膜する場合には、下地としてポリシリコンを成膜した後、温度などのCVD条件を変化させて形成する。なお、下部電極底部材料膜34を形成せずに、第1粗面状電極材料膜36のみを形成する方法も考えられるが、この発明のようなシリンダ型キャパシタの場合には、機械的強度に劣る恐れがあるため、下部電極底部材料膜34上に第1粗面状電極材料膜36を形成するのが好ましい。
【0059】
次に、第1粗面状電極材料膜36上に犠牲膜38を形成する。この犠牲膜38は、下部電極底部18及び下部電極側壁部20を形成することにより、下部電極12を3次元のシリンダ形状として形成するために一時的に形成する膜である。従って、犠牲膜38は、例えば熱CVD法によって二酸化シリコン(SiO2)の膜を数百nmの厚さに形成する(図2(C))。なお、この膜厚が、後に形成する下部電極側壁部20の高さになるので、この高さの設計に応じて膜厚を制御すればよい。
【0060】
次に、下部電極底部材料膜34と第1粗面状電極材料膜36と犠牲膜38とを、凸型形状に残存するようにパターニングする(図2(D))。この凸型残存部分を図中凸型形成部42として示す。このパターニングは、例えば通常のフォトリソ及びドライエッチングを用いることによって行えばよい。また、このパターニングにより、下部電極底部材料膜32はエッチングされて下部電極底部18が形成されるので、被形成層24の主表面に垂直方向から見たときに、下部電極底部18の形成予定領域が残存するようにパターニングすれば良い。
【0061】
次に、上述した凸型形成部42に下部電極側壁部材料膜44を形成する(図3(A))。実際には、この実施の形態のように、凸型形状に残存した部分以外に、エッチングストッパ膜28上にも下部電極側壁部材料膜44を形成しても良い。この下部電極側壁部材料膜44は、後にエッチングされて下部電極側壁部20となる膜であり、例えば熱CVD法によってポリシリコンの膜を数十〜数百nmの厚さに形成する。
【0062】
次に、下部電極側壁部材料膜44を、下部電極側壁部20となる部分のみ残存させるように、エッチングする(図3(B))。このエッチングは、通常のサイドウォール形成のための異方性ドライエッチングを行えば良い。このとき、凸型形成部42の上部及びエッチングストッパ膜28の上部、すなわち、被形成層24の主表面の広がり方向と平行方向に形成されている下部電極側壁部材料膜44が除かれた状態に達したときにエッチングを終了すれば良い。このエッチングにより、凸型形成部42のサイドウォールとして下部電極側壁部20が形成される。
【0063】
次に、残存した犠牲膜40を除去する(図3(C))。このとき、例えば犠牲膜40のみを選択的に除去出来るようなエッチャントを用いたウェットエッチングを行えばよい。犠牲膜40として、上述したように二酸化シリコンを用いた場合には、エッチャントにフッ酸(HF)を用いればよい。なお、エッチングストッパ膜28は、層間絶縁膜26として二酸化シリコンを用い、犠牲膜40のエッチングにフッ酸を用いた場合に、層間絶縁膜26がエッチングされるのを防止するために設けた膜である。従って、犠牲膜40の除去時に、層間絶縁膜26がエッチングされる恐れがない材料を用いた場合にはエッチングストッパ膜28を設ける必要はない。また、上述した他のエッチングにより、層間絶縁膜26がエッチングされる恐れがある材料を用いた場合には、エッチングストッパ膜28を設ける必要がある。
【0064】
以上の工程により、下部電極底部18、下部電極側壁部20及び粗面状電極膜22によって構成された下部電極12が完成する。
【0065】
その後、図示しないが、下部電極12表面に沿うように、順次に誘電体層16及び上部電極14を形成することにより、図1(A)に示したような第1の発明のキャパシタ10が完成する。なお、図1(A)においては、下部電極12の表面のみならず、エッチングストッパ膜28上にも誘電体層16及び上部電極14が形成されているが、少なくとも下部電極12上に形成されていれば良い。被形成層24上に複数のキャパシタ10が形成され、これらのキャパシタの上部電極14を共通電極としてキャパシタを並列的に接続する場合には、被形成層24全面にわたって上部電極14を形成すると製造が容易になる。
【0066】
上述した第1の実施の形態のシリンダ型キャパシタの製造方法によれば、第1の実施の形態のシリンダ型キャパシタを容易に製造することが出来る。
【0067】
また、第2及び第3の従来技術で行ったエッチバック工程が不必要であるので、製造工程が簡略である。また、エッチバック工程に起因するパーティクルが発生したり、シリンダ高さが制御できないといった問題点が発生しない。すなわち、第2の問題点が発生しない。
【0068】
次に、第2の実施の形態のシリンダ型キャパシタの構造について、図1(B)を参照して説明する。図1(B)は、第2の実施の形態のシリンダ型キャパシタの構造を示す断面図である。
【0069】
このキャパシタ50の構造によれば、下部電極底部18表面に粗面状電極膜22が形成されている以外に、下部電極側壁部20の外側表面にも粗面状電極膜52が形成されている。この粗面状電極膜22及び粗面状電極膜52としては、例えばポリシリコンによって形成し、数十〜数百nmの膜厚を有していればよい。
【0070】
このように下部電極底部18表面に粗面状電極膜22が形成されているので、通常の下部電極底部18のみの構成と比較して、実質的に電極面積が大きくなる。同様に、下部電極側壁部20の外側表面に粗面状電極膜52が形成されているので、通常の下部電極側壁部20の外側表面のみの構成と比較して、実質的に電極面積が大きくなる。この電極面積の増加の程度は、粗面状電極膜22及び粗面状電極膜52の材料や形成方法などによるが、上述したようにポリシリコンで形成した場合には、例えば約2倍の電極面積を有することが期待できる。従って、キャパシタ50の実装面積及びシリンダ高さが同じであっても、実質的な電極面積をさらに大きくすることが出来る。つまり、第1の問題点を解決することが出来る。また、第1の発明のキャパシタ10と同様に、下部電極側壁部20の内側表面には粗面状電極膜52が形成されていないので、両粗面状電極膜22と52とが接触することもなく、従って、第3の問題点が発生しない。
【0071】
その他のキャパシタ50の構成は、第1の実施の形態のキャパシタ10の構造と同じであるので、説明を省略する。
【0072】
次に、第2の実施の形態のキャパシタ50の製造方法について、図4を参照して説明する。図4は、第2の実施の形態のシリンダ型キャパシタの製造方法を示す工程図である。
【0073】
但し、図2(A)〜(D)、並びに、図3(A)及び(B)の工程は、第1の実施の形態のキャパシタ10の製造方法と同様であるので、説明を省略する。また、図3(B)に示した工程と、図4(A)に示した工程とは同じである。つまり、図4(A)は、下部電極側壁部材料膜44に対して、サイドウォールエッチングを行うことによって、下部電極側壁部20を形成した状態を示している。
【0074】
この後、第2粗面状電極材料膜58を少なくとも図4(A)における下部電極側壁部20上に形成する。通常は、図4(A)における下部電極側壁部20、犠牲膜40及びエッチングストッパ膜28上の全部の表面に形成する。この第2粗面状電極材料膜58は、後に下部電極側壁部20の外側表面上の粗面状電極膜52を形成するための膜であり、既に説明した第1粗面状電極材料膜36と同様に、例えば、熱CVD法により、粗面状ポリシリコンの膜を数十〜数百nmの膜厚で形成すればよい(図3(B))。
【0075】
次に、第2粗面状電極材料膜58の下部電極側壁部20の外側表面以外の部分、すなわちエッチングストッパ膜28上および犠牲膜40の表面に形成されている部分をエッチングによって除去する。つまり、犠牲膜40上に形成されている第2粗面状電極材料膜58を除去する必要があり、下部電極側壁部20の外側表面に形成されている第2粗面状電極材料膜58を除去しないことを意味する。このエッチングとしては、例えば、第1の実施の形態において説明したサイドウォールエッチングと同様のドライエッチングを行えばよい。このエッチングは、犠牲膜40の表面を露出するために行う(図4(C))。この工程により、第2粗面状電極材料膜58の残存性により、粗面状電極膜52が形成される。
【0076】
次に、犠牲膜40を除去する(図4(D))。この工程は、第1の実施の形態における図3(C)を用いて説明した犠牲膜40を除去する工程と同様である。
【0077】
以上の工程により、下部電極底部18、下部電極側壁部20、粗面状電極膜22及び52によって構成された下部電極12が完成する。
【0078】
その後、図示しないが、第1の実施の形態と同様に、下部電極12表面に沿うように、順次に誘電体層54及び上部電極56を形成することにより、図1(B)に示したような第2の実施の形態のキャパシタ50が完成する。
【0079】
上述した第2の実施の形態のシリンダ型キャパシタの製造方法によれば、第2の実施の形態のシリンダ型キャパシタを容易に製造することが出来る。
【0080】
また、第1の実施の形態と同様に、第2の問題点が発生しない。
【0081】
次に、第3の実施の形態のシリンダ型キャパシタの構造について、図1(C)を参照して説明する。図1(C)は、第3の実施の形態のシリンダ型キャパシタの構造を示す断面図である。
【0082】
このキャパシタ60の構造によれば、下部電極底部18の表面すなわち上面に粗面状電極膜22が形成され、下部電極側壁部20の外側表面にも粗面状電極膜62が形成されている以外に、下部電極側壁部20の内側表面垂直壁面にも粗面状電極膜64が62と連続して形成されている。この粗面状電極膜22、粗面状電極膜62及び粗面状電極膜64としては、例えばポリシリコンによって形成し、数十〜数百nmの膜厚を有していればよい。また、この粗面状電極膜64は、下部電極側壁部20の内側表面全域に対して形成されているのではなく、下部電極底部18と下部電極側壁部20とが接する部分(境界部分)Bから、所定距離以上離れた内側表面領域上に対して形成されている。すなわち、境界部分Bからの一定の高さ以上の領域の下部電極側壁部20の内側表面に対して形成されている。従って、粗面状電極膜62及び粗面状電極膜64は連続的に形成されているが、粗面状電極膜22及び粗面状電極膜64の間には粗面状電極膜が形成されていない領域が存在する。すなわち、両電極膜22と64とは互いに離間して形成されている。
【0083】
このように下部電極底部18表面に粗面状電極膜22が形成されているので、通常の下部電極底部18のみの構成と比較して、実質的に電極面積が大きくなる。同様に、下部電極側壁部20の外側表面に粗面状電極膜62が形成されているので、通常の下部電極側壁部20の外側表面のみの構成と比較して、実質的に電極面積が大きくなる。同様に、下部電極側壁部20の内側表面の一部に粗面状電極膜64が形成されているので、通常の下部電極側壁部20の内側表面のみの構成と比較して、実質的に電極面積が大きくなる。この電極面積の増加の程度は、粗面状電極膜22、粗面状電極膜62及び粗面状電極膜64の材料や形成方法などによるが、上述したようにポリシリコンで形成した場合には、例えば約2倍の電極面積を有することが期待できる。従って、キャパシタ60の実装面積及びシリンダ高さが同じであっても、実質的な電極面積をさらに大きくすることが出来る。つまり、第1の問題点を解決することが出来る。つまり、このキャパシタ60の電極面積は、第1及び第2の実施の形態のキャパシタ10及び50の電極面積よりも大きくすることが出来る。同時に、第3の従来技術におけるキャパシタの電極面積よりも大きくすることが出来る。また、第1及び第2の実施の形態のキャパシタ10及び50と同様に、下部電極側壁部20の内側表面の粗面状電極膜すなわち粗面状電極膜64と、下部電極底部18の内側表面の粗面状電極膜すなわち粗面状電極膜22とが接触しない。但し、下部電極側壁部20の内側表面の粗面状電極膜すなわち粗面状電極膜64同士が接触する可能性はある。つまり、下部電極底部18の幅が、対向する下部電極側壁部20の内側表面に形成されている粗面状電極膜64の膜厚の2倍より小さい場合には、粗面状電極膜64同士が接触する。以上のことから、第3の問題点を一部解決すると言える。
【0084】
その他のキャパシタ60の構成は、第2の実施の形態のキャパシタ50の構造と同じであるので、説明を省略する。
【0085】
次に、第3の実施の形態のキャパシタ60の製造方法について、図5を参照して説明する。図5は、第3の実施の形態のシリンダ型キャパシタの製造方法を示す工程図である。
【0086】
但し、図2(A)〜(D)、並びに、図3(A)及び(B)の工程は、第1の実施の形態のキャパシタ10の製造方法と同様であるので、説明を省略する。また、図3(B)に示した工程と、図5(A)に示した工程とは同じである。つまり、図5(A)は、下部電極側壁部材料膜44に対して、サイドウォールエッチングを行うことによって、下部電極側壁部20を形成した状態を示している。
【0087】
この後、犠牲膜40のうち、下部電極底部18と下部電極側壁部20とが接する部分から所定距離以上離れた部分を選択的に除去する。つまり、図5(B)における下部電極底部18と下部電極側壁部20との境界部分Bから所定距離h以上離れた部分の犠牲膜40を除去する。この所定距離hは、下部電極側壁部20の内側表面に形成する粗面状電極膜の形成領域を考慮して選択する。この犠牲膜40の除去方法としては、第1の実施の形態の図3(C)において説明した犠牲膜40の除去と同様の方法を用いれば良い。そして、エッチング時間などのエッチング条件を適当に制御することにより、所定距離h以上の部分の犠牲膜40を選択的に除去出来る。図5(B)において、残存した犠牲膜70で示す。
【0088】
次に、第2粗面状電極材料膜72を少なくとも図5(B)における下部電極側壁部20上に形成する。通常は、図5(B)における下部電極側壁部20、犠牲膜70及びエッチングストッパ膜28上の全部の表面に形成する。この第2粗面状電極材料膜72は、後に下部電極側壁部20の外側表面上及び内側表面上のそれぞれ粗面状電極膜62及び粗面状電極膜64を形成するための膜であり、図2(B)で説明した第1粗面状電極材料膜36と同様に、例えば、熱CVD法により、粗面状ポリシリコンの膜を数十〜数百nmの膜厚で形成すればよい(図5(C))。
【0089】
次に、第2粗面状電極材料膜72の下部電極側壁部20の表面以外の部分、すなわちエッチングストッパ膜28上および犠牲膜70の表面に形成されている部分をエッチングによって除去する。つまり、犠牲膜70上に形成されている第2粗面状電極材料膜72の部分を除去する必要があり、下部電極側壁部20の外側表面に形成されている第2粗面状電極材料膜72の部分を除去しないことを意味する。このエッチングとしては、例えば、第1の実施の形態において説明したサイドウォールエッチングと同様の垂直方向からの異方性ドライエッチングを行えばよい。このエッチングは、犠牲膜70の表面を露出するために行う(図5(D))。この工程により、粗面状電極膜62及び粗面状電極膜64が形成される。
【0090】
次に、犠牲膜70を除去する(図5(E))。この工程は、第1の実施の形態における図3(C)を用いて説明した犠牲膜40を除去する工程と同様である。
【0091】
以上の工程により、下部電極底部18、下部電極側壁部20、粗面状電極膜22、62及び64によって構成された下部電極12が完成する。
【0092】
その後、図示しないが、第1の実施の形態と同様に、下部電極12表面に沿うように、順次に誘電体層66及び上部電極68を形成することにより、図1(C)に示したような第3の実施の形態のキャパシタ60が完成する。
【0093】
上述した第3の実施の形態のシリンダ型キャパシタの製造方法によれば、第3の実施の形態のシリンダ型キャパシタを容易に製造することが出来る。
【0094】
また、第1及び第2の実施の形態と同様に、第2の問題点が発生しない。
【0095】
上述の第1〜第3の実施の形態のシリンダ型キャパシタにおいては、下部電極及び粗面状電極膜をポリシリコンで形成した構成であったが、これに限られず、電極材料として使用できる他の任意好適な材料を使用できる。但し、粗面状電極膜に使用する材料は、粗面状に形成できる材料である必要がある。同様に、第1〜第3の実施の形態のシリンダ型キャパシタの製造方法においても、電極材料として使用できる他の任意好適な材料を使用できる。
【0096】
また、第1〜第3の実施の形態のシリンダ型キャパシタの製造方法においては、第1粗面状電極材料膜の形成は、下部電極底部材料膜を形成した後に行っていた。すなわち、下部電極底部材料膜上に、下部電極底部材料膜とは別の第1粗面状電極材料膜を形成する構成であった。しかしながら、下部電極底部材料膜の表面を何らかの手法により粗面化して、この粗面化された下部電極底部材料膜の表面部分を第1粗面状電極材料膜としても良い。この例として、下部電極底部材料膜にポリシリコンを使用した場合に、ポリシリコン膜の表面を粗面化してHSGを形成することにより、このHSG膜を第1粗面状電極材料膜とすることが出来る。
【0097】
【発明の効果】
上述した説明から明らかなように、第1の発明のシリンダ型キャパシタによれば、下部電極底部表面上に、粗面状電極膜が形成されている。また、第2の発明のシリンダ型キャパシタによれば、下部電極底部表面上及び下部電極側壁部の外側表面上に、粗面状電極膜が形成されている。また、第3の発明のシリンダ型キャパシタによれば、下部電極底部表面上、下部電極側壁部の外側表面上、及び下部電極側壁部の内側表面上のうち下部電極底部と下部電極側壁部とが接する部分から所定距離以上離れた領域上に、粗面状電極膜が形成されている。
【0098】
従って、実装面積又はシリンダ高さを大きくすることなしに、実質的な電極面積を大きくすることが出来る。その結果、静電容量の大きなキャパシタとすることが出来る。特に、第3の発明のシリンダ型キャパシタによれば、最も大きな静電容量を有することが期待できる。また、第1及び第2の発明のシリンダ型キャパシタによれば、下部電極側壁部の内側表面に粗面状電極膜が形成されていないので、内側表面に粗面状電極膜が形成されているときの粗面状電極膜同士が接触することによる電極面積増加が図れないという問題点が発生しない。
【0099】
また、第1〜第3の発明のシリンダ型キャパシタの製造方法によれば、それぞれ第1〜第3の発明のシリンダ型キャパシタを容易に製造することが出来る。また、従来技術のように、エッチバック工程が不必要であるので、パーティクルが発生する或いはシリンダ高さの制御が困難であるといった問題点が発生しない。
【図面の簡単な説明】
【図1】(A)〜(C)は、この発明のシリンダ型キャパシタの構造を示す断面図である。
【図2】(A)〜(D)は、第1の実施の形態のシリンダ型キャパシタの製造方法を示す工程図(その1)である。
【図3】(A)〜(C)は、第1の実施の形態のシリンダ型キャパシタの製造方法を示す工程図(その2)である。
【図4】(A)〜(D)は、第2の実施の形態のシリンダ型キャパシタの製造方法を示す工程図である。
【図5】(A)〜(E)は、第3の実施の形態のシリンダ型キャパシタの製造方法を示す工程図である。
【図6】(A)〜(D)は、第1の従来技術のシリンダ型キャパシタの製造方法を示す工程図(その1)である。
【図7】(A)〜(C)は、第1の従来技術のシリンダ型キャパシタの製造方法を示す工程図(その2)である。
【図8】(A)及び(B)は、従来技術のシリンダ型キャパシタの構造を示す断面図である。
【図9】(A)〜(D)は、第2の従来技術のシリンダ型キャパシタの製造方法を示す工程図(その1)である。
【図10】(A)〜(C)は、第2の従来技術のシリンダ型キャパシタの製造方法を示す工程図(その2)である。
【図11】(A)〜(D)は、第3の従来技術のシリンダ型キャパシタの製造方法を示す工程図である。
【符号の説明】
10,50,60,100:シリンダ型キャパシタ
12:下部電極
14,56,68:上部電極
16,54,66:誘電体層
18:下部電極底部
20:下部電極側壁部
22,52,62,64:粗面状電極膜
24:被形成層
26:層間絶縁膜
28:エッチングストッパ膜
30:埋め込みコンタクト
32:コンタクトホール
34:下部電極底部材料膜
36:第1粗面状電極材料膜
38,40,70:犠牲膜
42:凸型形成部
44:下部電極側壁部材料膜
58,72:第2粗面状電極材料膜
102:層間絶縁膜
104:エッチングストッパ膜
106:コンタクトホール
108:下部電極底部材料膜
110,130:埋め込みコンタクト
112,113,132,134,142:犠牲膜
114:下部電極底部
116:下部電極側壁部材料膜
118:下部電極側壁部
120,140:下部電極
122:誘電体層
124:上部電極
136:下部電極材料膜
138,144:シリンダ埋め込み材料膜
150:粗面状電極材料膜
152:粗面状電極膜[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a cylinder type capacitor used in a semiconductor integrated circuit, and more particularly to a cylinder type capacitor using rough surface-like polysilicon as a part of an electrode material and a manufacturing method thereof.
[0002]
[Prior art]
In recent years, higher integration of semiconductor integrated circuits has been demanded, and capacitors mounted on semiconductor integrated circuits are also required to have a capacitor structure and manufacturing method having a larger capacitance with respect to a small mounting area. Yes.
[0003]
A cylinder type capacitor has been developed as a capacitor satisfying such requirements. According to this cylinder type capacitor, the upper electrode and the lower electrode have a three-dimensional structure. Accordingly, the substantial electrode areas of the upper electrode and the lower electrode can be increased with respect to the mounting area of the capacitor.
[0004]
A first conventional technique for the manufacturing method and structure of such a cylinder type capacitor will be described with reference to FIGS. 6, 7 and 8A. FIG. 6 and FIG. 7 are process diagrams showing a method for manufacturing a cylinder capacitor according to the first prior art, and FIG. 8A is a cross-sectional view showing the structure of the cylinder capacitor according to the first prior art.
[0005]
First, an
[0006]
Next, a
[0007]
Next, a lower electrode
[0008]
FIG. 8 shows a configuration example of the first conventional cylinder capacitor manufactured by the manufacturing method described above. The
[0009]
Next, a second conventional example of a method for manufacturing a cylinder type capacitor will be described with reference to FIGS. 9 and 10 are process diagrams showing a method of manufacturing a cylinder type capacitor according to the second prior art.
[0010]
As in the first prior art, an
[0011]
Next, a
[0012]
Next, a lower
[0013]
A configuration example of the cylinder capacitor of the second prior art manufactured by the manufacturing method described above is not shown, but is almost the same as the configuration example of the cylinder capacitor of the first prior art shown in FIG.
[0014]
Further, as a technology that further develops the second prior art, there is a structure and manufacturing method of the third prior art in which the capacitance of the capacitor is increased by further increasing the electrode area. The manufacturing method and structure of the third prior art will be described with reference to FIGS. 9, 11 and 8B. FIG. 11 is a process diagram showing a third conventional method of manufacturing a cylinder-type capacitor, and FIG. 8B is a diagram showing the structure of the third conventional cylinder-type capacitor. Since FIG. 9A to FIG. 9D are the same as those of the second prior art, description thereof is omitted. After FIG. 9D, a rough
[0015]
According to the structure of the cylinder capacitor of the third prior art manufactured by the manufacturing method described above, compared with the structure of the first prior art shown in FIG. 8A and the structure of the second prior art. Since the rough electrode film is formed on the inner wall of the lower electrode, the capacitor surface area can be further increased. That is, the capacitance can be further increased.
[0016]
[Problems to be solved by the invention]
However, in semiconductor integrated circuits, further miniaturization of each element such as a cylinder type capacitor is required. That is, it is necessary to have a sufficient capacitance for the mounting area required by miniaturization.
[0017]
In the first prior art, the capacitance is not sufficient with respect to the mounting area, that is, the bottom area of the lower electrode. On the other hand, in order to increase the capacitor surface area in order to further increase the capacitance while keeping the mounting area constant, it is only possible to increase the height of the cylinder, that is, the height of the side wall of the lower electrode.
[0018]
However, when the cylinder is made high, etching having a high aspect ratio is required when a contact between the cylinder type capacitor and another element of the semiconductor integrated circuit is formed later. Therefore, there is a limit to actually increasing the cylinder height. In other words, this configuration has a first problem that a sufficient capacitance cannot be obtained.
[0019]
Further, the second conventional technique has the same problems as the first conventional technique described above. Further, in the second conventional technique, formation of a cylinder embedding material film (FIG. 10 (A)) and an etch back process (FIG. 9 (A)) are necessary as compared with the first conventional technique. This complicates the process. In addition, the etch back process may generate particles, which may lead to a decrease in capacitor performance. At the same time, since the height of the side wall portion of the lower electrode is determined by the etch back process, there is a second problem that the height tends to vary.
[0020]
Further, the third conventional technique has a problem that the manufacturing process in the second conventional technique described above is complicated and a problem due to having an etch-back process.
[0021]
The problem in the first prior art is solved by using a rough electrode material film, but a new problem occurs. That is, as the mounting area is further reduced in accordance with the above-described requirement for miniaturization of the capacitor, the interval between the side walls of the lower electrode is also reduced. Accordingly, when the rough electrode material films formed on the inner side of the side wall portions come into contact with each other, the increase in capacity cannot be realized as designed. In addition, since the inside of the cylindrical lower electrode is buried, the dielectric layer and the upper electrode may not have a shape along the surface of the lower electrode as shown in FIG. 8B. The capacitance is greatly deteriorated. In addition, the contact between the rough electrode material films on the inner side of the side wall is a problem that occurs with miniaturization, but with the structure of FIG. 8B, regardless of the area of the bottom of the lower electrode, Since the rough electrode material film on the side wall of the lower electrode and the rough electrode material film on the bottom of the lower electrode are continuously formed in contact with each other, the increase in capacity cannot be realized as designed. Thus, there is a third problem peculiar to these third prior arts.
[0022]
The present invention has been made in view of the above-described problems. Accordingly, an object of the present invention is to provide a cylinder type that solves the first problem by ensuring sufficient capacitance while satisfying the demand for miniaturization. An object of the present invention is to provide a capacitor and a method for manufacturing the cylinder type capacitor. At the same time, a method of manufacturing a cylinder type capacitor that does not cause the second problem is provided. Preferably, a cylinder type capacitor that does not cause the third problem and a method of manufacturing the cylinder type capacitor are provided. Further, preferably, a cylinder type capacitor having a capacitance larger than that obtained by the third prior art and a method for manufacturing the cylinder type capacitor are provided.
[0028]
[Means for Solving the Problems]
The present inventionAccording to the cylinder type capacitor, in the cylinder type capacitor in which the lower electrode has a lower electrode bottom portion and a lower electrode side wall portion, and the lower electrode is formed in a cylinder shape, on the inner surface of the lower electrode bottom portion, the lower portion A rough electrode film is formed in a region at a predetermined height or more away from the inner surface of the lower electrode bottom portion on the outer surface of the electrode sidewall portion and on the inner surface of the lower electrode sidewall portion. To do.
[0029]
By adopting such a configuration, the first problem is solved. At this time, the rough electrode film is formed not only on the first surface but also on the second surface and the third surface., RealQualitative electrode surface areaIncreaseCan be great. The secondSince the rough surface electrode film is not formed on the second surface in the vicinity of the contact point between the first surface and the second surface, the rough surface electrode film formed on the first surface and the second surface is not in contact. Can be obtained. That is, part of the third problem can be solved.
[0037]
Also,The present inventionThe manufacturing method of the cylinder type capacitor includes the following steps in manufacturing a cylinder type capacitor in which the lower electrode has a lower electrode bottom and a lower electrode side wall, and the lower electrode is formed in a cylinder shape. have.
[0038]
(A) A step of forming a first rough electrode material film on the lower electrode bottom material film after forming the lower electrode bottom material film on the base.
(B) A step of forming a sacrificial film on the first rough electrode material film.
(C) The lower electrode bottom and the first rough electrode film are patterned by patterning the lower electrode bottom material film, the first rough electrode material film, and the sacrificial film so as to remain as a convex laminate. Forming step.
(D) A step of forming the lower electrode side wall portion on the side surface of the convex laminate.
[0039]
(H) Thereafter, the step of removing the sacrificial film constituting the convex laminate from the surface in the depth direction to a predetermined height from the inner surface of the bottom of the lower electrode.
(I) Thereafter, a step of forming a second rough electrode material film on the exposed surface of the convex laminate.
(J) Thereafter, the remaining sacrificial film is removed to form a second rough electrode film.
[0040]
With this configuration,The present inventionIt is easy to manufacture cylinder type capacitorsComeSecond problemAlsoIt can be solved.
[0041]
DETAILED DESCRIPTION OF THE INVENTION
Embodiments of the present invention will be described below with reference to the drawings. In the drawings, the size, shape, and arrangement relationship of each component are shown only schematically to the extent that the present invention can be understood, and the numerical conditions described below are merely examples. .
[0042]
First, the structure of the cylinder type capacitor according to the first embodiment will be described with reference to FIG. FIG. 1A is a cross-sectional view showing the structure of the cylinder type capacitor according to the first embodiment.
[0043]
The
[0044]
In this embodiment, the
[0045]
A
[0046]
The
[0047]
Therefore, the performance of the
[0048]
The width of the
[0049]
The
[0050]
In this embodiment, the buried
[0051]
In this embodiment, the
[0052]
In addition, the
[0053]
Next, a method for manufacturing the cylinder type capacitor according to the first embodiment will be described with reference to FIGS. 2 and 3 are process diagrams showing the manufacturing method of the cylinder type capacitor according to the first embodiment, and a series of processes are shown separately in FIG. 2 and FIG.
[0054]
First, the
[0055]
Therefore, an
[0056]
Thereafter, in order to electrically connect to the semiconductor element under the
[0057]
Next, a lower electrode
[0058]
Next, a first rough
[0059]
Next, a
[0060]
Next, the lower electrode
[0061]
Next, a lower electrode
[0062]
Next, the lower electrode
[0063]
Next, the remaining
[0064]
Through the above steps, the
[0065]
Thereafter, although not shown, the
[0066]
According to the manufacturing method of the cylinder type capacitor of the first embodiment described above, the cylinder type capacitor of the first embodiment can be easily manufactured.
[0067]
Further, since the etch-back process performed by the second and third conventional techniques is unnecessary, the manufacturing process is simplified. Further, there is no problem that particles are generated due to the etch back process and the cylinder height cannot be controlled. That is, the second problem does not occur.
[0068]
Next, the structure of the cylinder type capacitor according to the second embodiment will be described with reference to FIG. FIG. 1B is a cross-sectional view illustrating the structure of the cylinder type capacitor according to the second embodiment.
[0069]
According to the structure of the
[0070]
Since the
[0071]
The other configurations of the
[0072]
Next, a method for manufacturing the
[0073]
However, since the steps of FIGS. 2A to 2D and FIGS. 3A and 3B are the same as the method of manufacturing the
[0074]
Thereafter, a second rough surface
[0075]
Next, portions other than the outer surface of the lower electrode
[0076]
Next, the
[0077]
Through the above steps, the
[0078]
Thereafter, although not shown, as in the first embodiment, the
[0079]
According to the manufacturing method of the cylinder type capacitor of the second embodiment described above, the cylinder type capacitor of the second embodiment can be easily manufactured.
[0080]
Further, as in the first embodiment, the second problem does not occur.
[0081]
Next, the structure of the cylinder type capacitor according to the third embodiment will be described with reference to FIG. FIG. 1C is a cross-sectional view showing the structure of the cylinder type capacitor according to the third embodiment.
[0082]
According to the structure of this
[0083]
Since the
[0084]
The other configuration of the
[0085]
Next, a method for manufacturing the
[0086]
However, since the steps of FIGS. 2A to 2D and FIGS. 3A and 3B are the same as the method of manufacturing the
[0087]
Thereafter, a portion of the
[0088]
Next, a second rough
[0089]
Next, portions other than the surface of the
[0090]
Next, the
[0091]
Through the above steps, the
[0092]
Thereafter, although not shown, as in the first embodiment, the
[0093]
According to the manufacturing method of the cylinder type capacitor of the third embodiment described above, the cylinder type capacitor of the third embodiment can be easily manufactured.
[0094]
Further, the second problem does not occur as in the first and second embodiments.
[0095]
In the cylinder type capacitors of the first to third embodiments described above, the lower electrode and the rough electrode film are formed of polysilicon. However, the present invention is not limited to this, and other materials that can be used as electrode materials are used. Any suitable material can be used. However, the material used for the rough electrode film needs to be a material that can be formed into a rough surface. Similarly, any other suitable material that can be used as an electrode material can also be used in the manufacturing methods of the cylinder type capacitors of the first to third embodiments.
[0096]
Moreover, in the manufacturing method of the cylinder type capacitor of the first to third embodiments, the first rough electrode material film is formed after the lower electrode bottom material film is formed. That is, the first rough electrode material film different from the lower electrode bottom material film is formed on the lower electrode bottom material film. However, the surface of the lower electrode bottom material film may be roughened by any method, and the roughened surface portion of the lower electrode bottom material film may be used as the first rough electrode material film. As an example of this, when polysilicon is used for the lower electrode bottom material film, the surface of the polysilicon film is roughened to form HSG, thereby making this HSG film a first rough electrode material film. I can do it.
[0097]
【The invention's effect】
As is apparent from the above description, according to the cylinder type capacitor of the first invention, the rough electrode film is formed on the bottom electrode bottom surface. According to the cylinder type capacitor of the second invention, the rough electrode film is formed on the bottom electrode bottom surface and on the outer surface of the bottom electrode side wall. According to the cylinder type capacitor of the third invention, the lower electrode bottom portion and the lower electrode side wall portion on the bottom electrode bottom surface, the outer surface of the lower electrode sidewall portion, and the inner surface of the lower electrode sidewall portion are A rough electrode film is formed on a region separated by a predetermined distance or more from the contact portion.
[0098]
Therefore, the substantial electrode area can be increased without increasing the mounting area or the cylinder height. As a result, a capacitor having a large capacitance can be obtained. In particular, according to the cylinder type capacitor of the third invention, it can be expected to have the largest capacitance. Further, according to the cylinder type capacitors of the first and second inventions, since the rough electrode film is not formed on the inner surface of the lower electrode side wall, the rough electrode film is formed on the inner surface. There is no problem that the electrode area cannot be increased due to the contact between the rough surface electrode films.
[0099]
Moreover, according to the manufacturing method of the cylinder type capacitor of 1st-3rd invention, the cylinder type capacitor of 1st-3rd invention can each be manufactured easily. Further, unlike the prior art, since an etch back process is unnecessary, there is no problem that particles are generated or cylinder height is difficult to control.
[Brief description of the drawings]
1A to 1C are cross-sectional views showing the structure of a cylinder type capacitor according to the present invention.
FIGS. 2A to 2D are process diagrams (part 1) illustrating a method for manufacturing the cylinder-type capacitor according to the first embodiment; FIGS.
FIGS. 3A to 3C are process diagrams (part 2) illustrating the method for manufacturing the cylinder type capacitor according to the first embodiment; FIGS.
FIGS. 4A to 4D are process diagrams illustrating a method for manufacturing a cylinder-type capacitor according to a second embodiment;
FIGS. 5A to 5E are process diagrams showing a method for manufacturing a cylinder type capacitor according to a third embodiment; FIGS.
FIGS. 6A to 6D are process diagrams (part 1) showing a method for manufacturing a cylinder-type capacitor according to a first prior art. FIGS.
FIGS. 7A to 7C are process diagrams (part 2) illustrating a manufacturing method of the cylinder type capacitor according to the first prior art; FIGS.
8A and 8B are cross-sectional views showing the structure of a conventional cylinder capacitor.
FIGS. 9A to 9D are process diagrams (part 1) illustrating a method for manufacturing a cylinder-type capacitor according to a second prior art. FIGS.
FIGS. 10A to 10C are process diagrams (part 2) illustrating a method for manufacturing a cylinder type capacitor according to a second prior art. FIGS.
FIGS. 11A to 11D are process diagrams illustrating a third conventional method for manufacturing a cylinder-type capacitor. FIGS.
[Explanation of symbols]
10, 50, 60, 100: Cylinder type capacitor
12: Lower electrode
14, 56, 68: Upper electrode
16, 54, 66: Dielectric layer
18: Bottom of bottom electrode
20: Lower electrode side wall
22, 52, 62, 64: Rough surface electrode film
24: Formation layer
26: Interlayer insulating film
28: Etching stopper film
30: Embedded contact
32: Contact hole
34: Lower electrode bottom material film
36: first rough electrode material film
38, 40, 70: Sacrificial film
42: convex forming part
44: Lower electrode sidewall material film
58, 72: second rough electrode material film
102: Interlayer insulating film
104: Etching stopper film
106: Contact hole
108: Lower electrode bottom material film
110, 130: buried contacts
112, 113, 132, 134, 142: sacrificial film
114: Lower electrode bottom
116: Lower electrode sidewall material film
118: Lower electrode side wall
120, 140: Lower electrode
122: Dielectric layer
124: Upper electrode
136: Lower electrode material film
138, 144: Cylinder embedding material film
150: Rough surface electrode material film
152: Rough surface electrode film
Claims (7)
前記下部電極底部の内側表面上、前記下部電極側壁部の外側表面上、及び前記下部電極側壁部の内側表面上のうち前記下部電極底部の内側表面から所定の高さ以上離れた領域に、粗面状電極膜が形成されていることを特徴とするシリンダ型キャパシタ。In the cylinder type capacitor in which the lower electrode has a lower electrode bottom and a lower electrode side wall, and the lower electrode is formed in a cylinder shape,
On the inner surface of the lower electrode bottom, on the outer surface of the lower electrode sidewall, and on the inner surface of the lower electrode sidewall, rough regions are separated from the inner surface of the lower electrode bottom by a predetermined height or more. A cylindrical capacitor, wherein a planar electrode film is formed.
前記下部電極底部、前記下部電極側壁部及び前記粗面状電極膜は、ポリシリコンによって形成されていることを特徴とするシリンダ型キャパシタ。The cylinder type capacitor according to claim 1 ,
The cylinder type capacitor, wherein the lower electrode bottom, the lower electrode side wall, and the rough electrode film are made of polysilicon.
下地上に下部電極底部材料膜を形成した後に、該下部電極底部材料膜上に第1粗面状電極材料膜を形成する工程と、
該第1粗面状電極材料膜上に犠牲膜を形成する工程と、
前記下部電極底部材料膜と該第1粗面状電極材料膜と該犠牲膜とを、凸型積層体として残存するようにパターニングすることにより、前記下部電極底部と第1粗面状電極膜とを形成する工程と、
前記凸型積層体の側面に、前記下部電極側壁部を形成する工程と、
しかる後、前記凸型積層体を構成する前記犠牲膜を、その表面から深さ方向に、前記下部電極底部の内側表面から所定の高さにまで除去する工程と、
しかる後、前記下部電極側壁部の露出表面に第2粗面状電極材料膜を形成する工程と、
しかる後、残存している前記犠牲膜を除去して第2粗面状電極膜を形成する工程と
を有することを特徴とするシリンダ型キャパシタの製造方法。In manufacturing a cylinder type capacitor in which the lower electrode has a lower electrode bottom and a lower electrode side wall, and the lower electrode is formed in a cylinder shape,
Forming a first rough electrode material film on the lower electrode bottom material film after forming the lower electrode bottom material film on the ground;
Forming a sacrificial film on the first rough electrode material film;
By patterning the lower electrode bottom part material film, the first rough surface electrode material film, and the sacrificial film so as to remain as a convex laminate, the lower electrode bottom part, the first rough surface electrode film, Forming a step;
Forming the lower electrode sidewall on the side surface of the convex laminate;
Thereafter, the step of removing the sacrificial film constituting the convex laminate from the surface in a depth direction to a predetermined height from the inner surface of the bottom of the lower electrode,
Thereafter, forming a second rough electrode material film on the exposed surface of the lower electrode side wall,
Thereafter, the step of removing the remaining sacrificial film and forming a second roughened electrode film is provided.
前記下部電極側壁部形成工程は、
全面に、下部電極側壁部材料膜を形成する工程と、
該下部電極側壁部材料膜を、前記下部電極側壁部となる部分のみ残存させるように、エッチングする工程と
を有することを特徴とするシリンダ型キャパシタの製造方法。In the manufacturing method of the cylinder type capacitor according to claim 3 ,
The lower electrode side wall forming step includes
Forming a lower electrode sidewall material film over the entire surface;
And a step of etching the lower electrode side wall portion material film so as to leave only a portion that becomes the lower electrode side wall portion.
前記第2粗面状電極材料膜形成工程後に、
前記第2粗面状電極材料膜の前記下部電極側壁部の外側表面以外の部分のうち、少なくとも前記犠牲膜の表面に形成されている部分をエッチングによって除去する工程を有することを特徴とするシリンダ型キャパシタの製造方法。In the manufacturing method of the cylinder type capacitor according to claim 3 or 4 ,
After the second rough surface electrode material film forming step,
Cylinder having a step of removing at least a portion formed on the surface of the sacrificial film out of a portion of the second rough electrode material film other than the outer surface of the side wall of the lower electrode by etching. Type capacitor manufacturing method.
前記下部電極底部、前記下部電極側壁部及び前記粗面状電極膜を、ポリシリコンによって形成することを特徴とするシリンダ型キャパシタの製造方法。In the manufacturing method of the cylinder type capacitor according to any one of claims 3 to 5 ,
A method of manufacturing a cylinder-type capacitor, wherein the bottom electrode bottom portion, the bottom electrode sidewall portion, and the rough electrode film are formed of polysilicon.
前記下地は、
層間絶縁膜上に、エッチングストッパ膜を形成し、
しかる後、該層間絶縁膜及び該エッチングストッパ膜の双方を貫通するコンタクトホールを形成することにより、設けられていることを特徴とするシリンダ型キャパシタの製造方法。In the manufacturing method of the cylinder type capacitor according to any one of claims 3 to 6 ,
The foundation is
An etching stopper film is formed on the interlayer insulating film,
Thereafter, a method of manufacturing a cylinder type capacitor is provided, wherein a contact hole penetrating both the interlayer insulating film and the etching stopper film is formed.
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