JP4632127B2 - Display device - Google Patents

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Description

本発明は、表示装置に関し、特に、表示パネル上に複数の表示画素及びその周辺回路を備えた液晶表示装置に関する。   The present invention relates to a display device, and more particularly to a liquid crystal display device including a plurality of display pixels and peripheral circuits on a display panel.

近年、携帯電話やデジタルカメラ等の携帯型電子機器の普及に伴い、液晶表示装置の需要が益々高まっている。次に、従来例に係る液晶表示装置の概略について、図面を参照して説明する。図4は、この液晶表示装置の等価回路図である。なお、図4では、1つの表示パネル上の表示領域にマトリクス状に形成された複数の表示画素の中から、1つの表示画素10だけを示している。   In recent years, with the spread of portable electronic devices such as mobile phones and digital cameras, the demand for liquid crystal display devices is increasing. Next, an outline of a liquid crystal display device according to a conventional example will be described with reference to the drawings. FIG. 4 is an equivalent circuit diagram of the liquid crystal display device. In FIG. 4, only one display pixel 10 is shown from among a plurality of display pixels formed in a matrix in a display area on one display panel.

図4に示すように、ガラス基板等からなる表示パネル1P上で、行方向に延びた走査線11と列方向に延びたデータ線12の交差点の付近に、薄膜トランジスタ(TFT;Thin Film Transistor)である例えばNチャネル型の画素選択用TFT13が配置されている。この画素選択用TFT13のゲートは、走査線11に接続されており、そのソースは、データ線12に接続されている。走査線11には垂直駆動回路21から出力される画素選択信号Gが印加され、それに応じて画素選択用TFT13のオンまたはオフが制御される。データ線12には水平駆動回路22から表示信号Dが出力される。   As shown in FIG. 4, on a display panel 1P made of a glass substrate or the like, a thin film transistor (TFT) is provided in the vicinity of the intersection of the scanning line 11 extending in the row direction and the data line 12 extending in the column direction. For example, an N-channel type pixel selection TFT 13 is arranged. The gate of the pixel selection TFT 13 is connected to the scanning line 11, and the source thereof is connected to the data line 12. A pixel selection signal G output from the vertical drive circuit 21 is applied to the scanning line 11, and the on / off state of the pixel selection TFT 13 is controlled accordingly. A display signal D is output from the horizontal drive circuit 22 to the data line 12.

画素選択用TFT13のドレインは、液晶層LCを挟む不図示の画素電極及び共通電極のうち、画素電極に接続されている。なお、この液晶層LCは誘電体として機能するためキャパシタとして表されている。また、画素選択用TFT13のドレインには、上記画素電極に印加される表示信号Dを一水平期間保持するための保持容量Csが接続されている。   The drain of the pixel selection TFT 13 is connected to a pixel electrode among pixel electrodes and common electrodes (not shown) that sandwich the liquid crystal layer LC. The liquid crystal layer LC is expressed as a capacitor because it functions as a dielectric. The drain of the pixel selecting TFT 13 is connected to a holding capacitor Cs for holding the display signal D applied to the pixel electrode for one horizontal period.

なお、上記構成では、画素選択用TFT13のソースにデータ線12が接続され、そのドレインに画素電極が接続されているが、ソースに画素電極が接続され、ドレインにデータ線12が接続されてもよい。   In the above configuration, the data line 12 is connected to the source of the pixel selection TFT 13 and the pixel electrode is connected to the drain thereof, but the pixel electrode is connected to the source and the data line 12 is connected to the drain. Good.

次に、上記液晶表示装置の動作について説明する。ハイレベルの画素選択信号Gが1水平期間にわたって走査線11に印加されると、画素選択用TFT13がオンする。すると、データ線12の出力された表示信号Dが画素選択用TFT13を通して保持容量Csによって保持されると共に、上記画素電極に印加される。そして、表示信号Dに応じて、1水平期間にわたって液晶層の電界が制御され、その電界に応じて液晶分子の配向が制御される。これにより、黒表示もしくは白表示の液晶表示が行われる。この動作を1フィールド期間にわたって、全ての行の表示画素10に対して行うことにより、表示領域の全体に所望の画像を表示することができる。   Next, the operation of the liquid crystal display device will be described. When the high-level pixel selection signal G is applied to the scanning line 11 over one horizontal period, the pixel selection TFT 13 is turned on. Then, the display signal D output from the data line 12 is held by the holding capacitor Cs through the pixel selection TFT 13 and applied to the pixel electrode. Then, the electric field of the liquid crystal layer is controlled over one horizontal period according to the display signal D, and the alignment of the liquid crystal molecules is controlled according to the electric field. Thereby, black or white liquid crystal display is performed. By performing this operation on the display pixels 10 in all rows over one field period, a desired image can be displayed on the entire display region.

上記表示パネル1Pは、例えば以下に示すようなレイアウトを有している。即ち、図5に示すように、表示パネル1P上に、走査線とデータ線を備えた複数の表示画素10が配置された表示領域10Aが配置されている。   The display panel 1P has a layout as shown below, for example. That is, as shown in FIG. 5, a display area 10A in which a plurality of display pixels 10 having scanning lines and data lines is arranged on the display panel 1P.

表示領域10の周りには、表示パネル1Pの第1の辺E1に沿って、垂直駆動回路21が配置されている。また、その第1の辺E1と直交する表示パネル1Pの第2の辺E2に沿って、水平駆動回路22が配置されている。また、その第2の辺E2に沿って、水平駆動回路22よりも第2の辺E2に近い側に、制御回路30が配置されている。この制御回路は、垂直駆動回路21及び水平駆動回路22に、同期信号等の制御信号やその他の必要な電圧信号を供給する。   Around the display area 10, a vertical drive circuit 21 is disposed along the first side E1 of the display panel 1P. In addition, a horizontal drive circuit 22 is disposed along the second side E2 of the display panel 1P orthogonal to the first side E1. A control circuit 30 is disposed along the second side E2 on the side closer to the second side E2 than the horizontal drive circuit 22. This control circuit supplies a control signal such as a synchronization signal and other necessary voltage signals to the vertical drive circuit 21 and the horizontal drive circuit 22.

また、表示パネル1Pの第1の辺E1及びそれに対向する第3の辺E3に沿った制御回路30の両側の領域には、垂直駆動回路21及び制御回路30に接続された第1の入力回路141と、垂直駆動回路22及び制御回路30に接続された第2の入力回路142が配置されている。上記接続は、それぞれ、第1及び第2の配線151,152を介して行われる。   A first input circuit connected to the vertical drive circuit 21 and the control circuit 30 is provided on both sides of the control circuit 30 along the first side E1 of the display panel 1P and the third side E3 opposite to the first side E1. 141 and a second input circuit 142 connected to the vertical drive circuit 22 and the control circuit 30 are arranged. The connection is performed through the first and second wirings 151 and 152, respectively.

これらの第1及び第2の入力回路141,142は、制御回路30から出力されて垂直駆動回路22及び制御回路30に入力される信号(制御信号等)に対して、所定の処理を行うものである。例えば、図示しないが、第1及び第2の入力回路141,142は、ダイオード回路のような静電保護回路、及び制御信号等の電圧を昇圧する昇圧回路の両者もしくはいずれか一方を含む。   These first and second input circuits 141 and 142 perform predetermined processing on signals (control signals and the like) output from the control circuit 30 and input to the vertical drive circuit 22 and the control circuit 30. It is. For example, although not shown, the first and second input circuits 141 and 142 include an electrostatic protection circuit such as a diode circuit and / or a booster circuit that boosts a voltage such as a control signal.

なお、本願に関連する技術文献としては、以下の特許文献が挙げられる。
特開2002−140015号公報
In addition, the following patent documents are mentioned as technical documents relevant to the present application.
Japanese Patent Laid-Open No. 2002-140015

上記表示パネル1Pの第1の辺E1及びそれに対向する第3の辺E3に沿った制御回路30の両側の領域では、第1及び第2の入力回路141,142が配置されている。そのため、上記制御回路30の両側の領域が広がることになり、表示パネル1Pの額縁、即ち、表示領域以外の領域が広がってしまうという問題が生じていた。結果として、表示パネルのサイズが大きくなると共に、表示パネル全体に対する表示領域の占める面積の割合が小さくなっていた。   In areas on both sides of the control circuit 30 along the first side E1 of the display panel 1P and the third side E3 opposite to the first side E1, first and second input circuits 141 and 142 are arranged. For this reason, the areas on both sides of the control circuit 30 are expanded, and there is a problem that the frame of the display panel 1P, that is, an area other than the display area is expanded. As a result, the size of the display panel is increased, and the ratio of the area occupied by the display area to the entire display panel is reduced.

そこで本発明は、表示領域が配置されていない額縁の面積を極力小さく抑えた表示装置を提供する。 Therefore, the present invention provides a display device in which the area of a frame in which no display area is arranged is minimized.

本発明の表示装置は、上記課題に鑑みて為されたものであり、表示パネルにおいて、走査線とデータ線を備えた複数の表示画素が配置された表示領域と、表示パネルの第1の辺に沿って表示パネル上に配置され、走査線に画素選択信号を供給する垂直駆動回路と、第1の辺と直交する表示パネルの第2の辺に沿って表示パネル上に配置され、データ線に表示信号を供給する水平駆動回路と、上記第2の辺に沿って表示パネル上に配置され、垂直駆動回路及び水平駆動回路に制御信号を供給する制御回路と、上記第1及び第2の辺以外の表示パネルの辺に沿った領域のうち、表示領域のいずれかの辺に沿った表示パネル上の領域に配置された第1の入力回路と、上記第1の辺と対向する第3の辺、及び第2の辺と対向する第4の辺に沿って表示パネル上に配置され、垂直駆動回路、制御回路、及び第1の入力回路を互いに接続する第1の配線と、前記第1の辺に沿った前記表示パネル上の領域に配置された第2の入力回路と、前記表示パネル上に配置され、前記水平駆動回路、前記制御回路、及び前記第2の入力回路を接続する第2の配線と、を備えることを特徴とする。 The display device of the present invention has been made in view of the above problems, and in the display panel, a display area in which a plurality of display pixels including scanning lines and data lines are arranged, and a first side of the display panel disposed on the display panel along a vertical driving circuit for supplying a pixel selection signal to the scanning lines, disposed on the display panel along a second side of the display panel which is perpendicular to the first side, the data line A horizontal driving circuit for supplying a display signal to the display panel , a control circuit disposed on the display panel along the second side, for supplying a control signal to the vertical driving circuit and the horizontal driving circuit, and the first and second A first input circuit arranged in a region on the display panel along any side of the display region among regions along the side of the display panel other than the side, and a third facing the first side. sides, and displayed along the fourth side facing the second side Disposed on panel, the vertical drive circuit, control circuit, and the first wiring for connecting the first input circuit to each other, a second disposed on the region on the display panel along a first side And an input circuit and a second wiring which is disposed on the display panel and connects the horizontal drive circuit, the control circuit, and the second input circuit.

本発明によれば、表示パネルの額縁、即ち、表示領域以外の領域を極力狭くすることができる。これにより、表示パネルのサイズを極力小さく抑えることが可能となると共に、表示パネル全体に対する表示領域の占める面積の割合を極力大きくすることが可能となる。   According to the present invention, the frame of the display panel, that is, the area other than the display area can be made as narrow as possible. As a result, the size of the display panel can be kept as small as possible, and the ratio of the area occupied by the display area to the entire display panel can be maximized.

次に、本発明の第1の実施形態に係る液晶表示装置について図面を参照して説明する。図1は、本実施形態に係る液晶表示装置を示す平面図である。なお、図1では、図4及び図5に示した液晶表示装置と同様の構成要素については同一の符号を付して説明を行うものとする。   Next, a liquid crystal display device according to a first embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a plan view showing a liquid crystal display device according to the present embodiment. In FIG. 1, the same components as those of the liquid crystal display device shown in FIGS. 4 and 5 are denoted by the same reference numerals and described.

図1に示すように、液晶表示装置である表示パネル1Pの表示領域10Aには、図4の等価回路図に示したものと同様の複数の表示画素10がマトリクス状に配置されている。各表示画素10の走査線11及びデータ線12は、それぞれ垂直駆動回路21、水平駆動回路22に接続されている。   As shown in FIG. 1, a plurality of display pixels 10 similar to those shown in the equivalent circuit diagram of FIG. 4 are arranged in a matrix in a display area 10A of a display panel 1P that is a liquid crystal display device. The scanning line 11 and the data line 12 of each display pixel 10 are connected to a vertical driving circuit 21 and a horizontal driving circuit 22, respectively.

ここで、垂直駆動回路21は、表示パネル1Pの第1の辺S1に沿って、表示領域10Aに近接して配置される。また、水平駆動回路22は、表示パネル1Pの第1の辺S1と直交する第2の辺S2に沿って、表示領域10Aに近接して配置される。   Here, the vertical drive circuit 21 is disposed close to the display region 10A along the first side S1 of the display panel 1P. Further, the horizontal drive circuit 22 is disposed close to the display region 10A along the second side S2 orthogonal to the first side S1 of the display panel 1P.

また、表示パネル1Pの第2の辺S2に沿って、水平駆動回路22よりも第2の辺S2に近い領域に、図5に示したものと同様の制御回路30が配置されている。なお、この領域には、制御回路30に替わって、後でユーザーが制御回路を実装するためのFPC(Flexible Printed Circuit)が形成されていてもよい。   Further, a control circuit 30 similar to that shown in FIG. 5 is disposed along the second side S2 of the display panel 1P in a region closer to the second side S2 than the horizontal drive circuit 22. In this region, instead of the control circuit 30, an FPC (Flexible Printed Circuit) for a user to mount the control circuit later may be formed.

そして、表示パネル1Pの第1の辺S1と対向する第3の辺S3に沿った領域のうち、表示領域10Aの辺に沿った領域に、第1の入力回路41が配置されている。この第1の入力回路41は、その配置位置と形成領域の形状以外は、図5に示した第1の入力回路141と同様である。   The first input circuit 41 is arranged in a region along the side of the display region 10A among regions along the third side S3 facing the first side S1 of the display panel 1P. The first input circuit 41 is the same as the first input circuit 141 shown in FIG. 5 except for the arrangement position and the shape of the formation region.

また、垂直駆動回路21と第1の入力回路41とを接続し、かつ制御回路30と第1の入力回路41とを接続する第1の配線51が、表示パネル1Pの第1の辺と対向する第3の辺S3、及び第2の辺S2と対向する第4の辺S4に沿って延びるように配置されている。この第1の配線51の本数は、第1の入力回路41の入出力信号の数に対応している。図1では、第1の配線51は2本である場合について示している。   The first wiring 51 that connects the vertical drive circuit 21 and the first input circuit 41 and connects the control circuit 30 and the first input circuit 41 is opposed to the first side of the display panel 1P. The third side S3 and the fourth side S4 facing the second side S2 are disposed so as to extend. The number of the first wirings 51 corresponds to the number of input / output signals of the first input circuit 41. FIG. 1 shows a case where there are two first wirings 51.

また、表示パネル1Pの第1の辺S1に沿った領域のうち、制御回路30に隣接する領域には、図5に示した従来例の第2の入力回路142と同様の第2の入力回路42が形成されている。また、その領域には、水平駆動回路21、制御回路30、第2の入力回路42を接続する第2の配線52が配置されている。   Further, in the region along the first side S1 of the display panel 1P, the region adjacent to the control circuit 30 has a second input circuit similar to the second input circuit 142 of the conventional example shown in FIG. 42 is formed. In the region, a second wiring 52 for connecting the horizontal drive circuit 21, the control circuit 30, and the second input circuit 42 is disposed.

上述したように、本実施形態の第1の入力回路41及び第1の配線51の配置によれば、表示パネル1Pの第1の辺S1と対向する第3の辺S3に沿った領域のうち制御回路30に隣接する領域を、空き領域とすることができる。その空き領域は、表示領域10Aが形成されない領域、即ち額縁に相当する領域である。従って、従来例にみられたような第1の入力回路141が配置された場合に比して、表示パネル1Pの額縁の面積を極力小さく抑えることが可能となる。これにより、表示パネル1Pのサイズを極力小さく抑えることが可能となると共に、表示パネル1P全体に対する表示領域10Aの占める面積の割合を極力大きくすることが可能となる。   As described above, according to the arrangement of the first input circuit 41 and the first wiring 51 of the present embodiment, among the regions along the third side S3 facing the first side S1 of the display panel 1P. An area adjacent to the control circuit 30 can be an empty area. The empty area is an area where the display area 10A is not formed, that is, an area corresponding to a frame. Therefore, the frame area of the display panel 1P can be minimized as compared with the case where the first input circuit 141 as in the conventional example is disposed. As a result, the size of the display panel 1P can be kept as small as possible, and the ratio of the area occupied by the display region 10A to the entire display panel 1P can be maximized.

なお、第1の実施形態と同様の効果を奏する他の実施例として、上記第1の入力回路41及び第1の配線51は、次のように配置されていてもよい。次に本発明の第2の実施形態に係る液晶表示装置について図面を参照して説明する。図2は、本実施形態に係る液晶表示装置を示す平面図である。図2に示すように、第1の実施形態と同様に、表示パネル1P上に、表示領域10A、垂直駆動回路21、水平駆動回路22、制御回路30、第2の入力回路42及び第2の配線52が配置されている。   Note that, as another example having the same effect as the first embodiment, the first input circuit 41 and the first wiring 51 may be arranged as follows. Next, a liquid crystal display device according to a second embodiment of the present invention will be described with reference to the drawings. FIG. 2 is a plan view showing the liquid crystal display device according to the present embodiment. As shown in FIG. 2, as in the first embodiment, the display area 10A, the vertical drive circuit 21, the horizontal drive circuit 22, the control circuit 30, the second input circuit 42, and the second display area are displayed on the display panel 1P. A wiring 52 is arranged.

本実施形態では、第1の実施形態とは異なり、第1の入力回路41は、表示パネル1Pの第2の辺S2と対向する第4の辺S4に沿った領域のうち、表示領域10Aの辺に沿った領域に配置されている。また、垂直駆動回路21と第1の入力回路41とを接続し、かつ制御回路30と第1の入力回路41とを接続する第1の配線51は、表示パネル1Pの第1の辺S1と対向する第3の辺S3、及び第2の辺S2と対向する第4の辺S4に沿って延びるように配置されている。本実施形態によっても、第1の実施形態と同様に額縁の面積を極力小さく抑えることが可能となる。   In the present embodiment, unlike the first embodiment, the first input circuit 41 includes the display area 10A in the area along the fourth side S4 facing the second side S2 of the display panel 1P. It is arranged in a region along the side. The first wiring 51 that connects the vertical drive circuit 21 and the first input circuit 41 and connects the control circuit 30 and the first input circuit 41 is connected to the first side S1 of the display panel 1P. It arrange | positions so that it may extend along 3rd edge | side S3 which opposes, and 4th edge | side S4 which opposes 2nd edge | side S2. Also according to the present embodiment, the area of the frame can be minimized as in the first embodiment.

また、上記第1の入力回路41は、複数の箇所に形成されてもよい。次に、本発明の第3の実施形態に係る液晶表示装置について図面を参照して説明する。図3は、本実施形態に係る液晶表示装置を示す平面図である。図3に示すように、第1の実施形態と同様に、表示パネル1P上に、表示領域10A、垂直駆動回路21、水平駆動回路22、制御回路30、第2の入力回路42及び第2の配線52が配置されている。   The first input circuit 41 may be formed at a plurality of locations. Next, a liquid crystal display device according to a third embodiment of the present invention will be described with reference to the drawings. FIG. 3 is a plan view showing the liquid crystal display device according to the present embodiment. As shown in FIG. 3, as in the first embodiment, on the display panel 1P, the display area 10A, the vertical drive circuit 21, the horizontal drive circuit 22, the control circuit 30, the second input circuit 42 and the second input circuit 42 are displayed. A wiring 52 is arranged.

本実施形態では、第1及び第2の実施形態とは異なり、表示パネル1P上に、複数の、例えば2つの第1の入力回路41A,41Bが配置されている。一方の第1の入力回路41Aは、表示パネル1Pの第1の辺S1と対向する第3の辺S3に沿った領域のうち、表示領域10Aの辺に沿った領域に配置されている。また、他方の第1の入力回路41Bは、表示パネル1Pの第2の辺S2と対向する第4の辺S4に沿った領域のうち、表示領域10Aの辺に沿った領域に配置されている。   In the present embodiment, unlike the first and second embodiments, a plurality of, for example, two first input circuits 41A and 41B are arranged on the display panel 1P. One first input circuit 41A is arranged in a region along the side of the display region 10A among regions along the third side S3 facing the first side S1 of the display panel 1P. The other first input circuit 41B is arranged in a region along the side of the display region 10A among the regions along the fourth side S4 facing the second side S2 of the display panel 1P. .

また、第1の配線51は、垂直駆動回路21、制御回路30、及び複数の第1の入力回路41A,41B、を互いに接続するように、表示パネル1Pの第1の辺S1と対向する第3の辺S3、及びその第2の辺S2と対向する第4の辺S4に沿って配置されている。本実施形態によっても、第1の実施形態と同様に表示パネル1Pの額縁の面積を極力小さく抑えることが可能となる。   The first wiring 51 is opposed to the first side S1 of the display panel 1P so as to connect the vertical drive circuit 21, the control circuit 30, and the plurality of first input circuits 41A and 41B to each other. The third side S3 is disposed along the fourth side S4 facing the second side S2. Also according to the present embodiment, the area of the frame of the display panel 1P can be suppressed as small as possible as in the first embodiment.

本発明の第1の実施形態に係る液晶表示装置を示す平面図である。1 is a plan view showing a liquid crystal display device according to a first embodiment of the present invention. 本発明の第2の実施形態に係る液晶表示装置を示す平面図である。It is a top view which shows the liquid crystal display device which concerns on the 2nd Embodiment of this invention. 本発明の第3の実施形態に係る液晶表示装置を示す平面図である。It is a top view which shows the liquid crystal display device which concerns on the 3rd Embodiment of this invention. 従来例に係る液晶表示装置の表示画素の等価回路図である。It is an equivalent circuit schematic of the display pixel of the liquid crystal display device which concerns on a prior art example. 従来例に係る液晶表示装置を示す平面図である。It is a top view which shows the liquid crystal display device concerning a prior art example.

符号の説明Explanation of symbols

1P 表示パネル 10 表示画素 10A 表示領域
11 走査線 12 データ線 13 画素選択用TFT
21 垂直駆動回路 22 水平駆動回路 30制御回路
41,141 第1の入力回路 42,142 第2の入力回路
51,151 第1の配線 52,152 第2の配線
Cs 保持容量 LC 液晶層
1P Display Panel 10 Display Pixel 10A Display Area 11 Scan Line 12 Data Line 13 Pixel Selection TFT
DESCRIPTION OF SYMBOLS 21 Vertical drive circuit 22 Horizontal drive circuit 30 Control circuit 41,141 1st input circuit 42,142 2nd input circuit 51,151 1st wiring 52,152 2nd wiring Cs Retention capacity LC Liquid crystal layer

Claims (6)

表示パネルにおいて、走査線とデータ線を備えた複数の表示画素が配置された表示領域と、
前記表示パネルの第1の辺に沿って前記表示パネル上に配置され、前記走査線に画素選択信号を供給する垂直駆動回路と、
前記第1の辺と直交する前記表示パネルの第2の辺に沿って前記表示パネル上に配置され、前記データ線に表示信号を供給する水平駆動回路と、
前記第2の辺に沿って前記表示パネル上に配置され、前記垂直駆動回路及び前記水平駆動回路に制御信号を供給する制御回路と、
前記第1及び第2の辺以外の前記表示パネルの辺に沿った領域のうち、前記表示領域のいずれかの辺に沿った前記表示パネル上の領域に配置された第1の入力回路と、
前記第1の辺と対向する第3の辺、及び前記第2の辺と対向する第4の辺に沿って前記表示パネル上に配置され、前記垂直駆動回路、前記制御回路、及び前記第1の入力回路を互いに接続する第1の配線と、
前記第1の辺に沿った前記表示パネル上の領域に配置された第2の入力回路と、
前記表示パネル上に配置され、前記水平駆動回路、前記制御回路、及び前記第2の入力回路を接続する第2の配線と、を備えることを特徴とする表示装置。
In the display panel, a display area in which a plurality of display pixels having scanning lines and data lines are arranged;
A vertical driving circuit disposed on the display panel along a first side of the display panel and supplying a pixel selection signal to the scanning line;
A horizontal drive circuit disposed on the display panel along a second side of the display panel orthogonal to the first side and supplying a display signal to the data line;
A control circuit disposed on the display panel along the second side and supplying a control signal to the vertical driving circuit and the horizontal driving circuit;
A first input circuit disposed in a region on the display panel along one of the sides of the display region among regions along the side of the display panel other than the first and second sides;
The vertical drive circuit, the control circuit, and the first circuit are disposed on the display panel along a third side that faces the first side and a fourth side that faces the second side. A first wiring for connecting the input circuits of each other;
A second input circuit disposed in a region on the display panel along the first side;
A display device comprising: a second wiring arranged on the display panel and connecting the horizontal driving circuit, the control circuit, and the second input circuit .
前記第1の入力回路は、前記第3の辺に沿って前記表示パネル上に配置されていることを特徴とする請求項1記載の表示装置。 The display device according to claim 1, wherein the first input circuit is disposed on the display panel along the third side. 前記第1の入力回路は、前記第4の辺に沿って前記表示パネル上に配置されていることを特徴とする請求項1記載の表示装置。 The display device according to claim 1, wherein the first input circuit is disposed on the display panel along the fourth side. 複数の前記第1の入力回路を有し、各第1の入力回路は、前記第3の辺に沿って、もしくは前記第4の辺に沿って前記表示パネル上に配置されていることを特徴とする請求項1記載の表示装置。 A plurality of the first input circuits are provided, and each first input circuit is disposed on the display panel along the third side or along the fourth side. The display device according to claim 1. 前記第1の入力回路は、制御回路から供給される制御信号の電圧を昇圧する昇圧回路を含むことを特徴とする請求項1、2、3、4のうちいずれかに記載の表示装置。   The display device according to claim 1, wherein the first input circuit includes a booster circuit that boosts a voltage of a control signal supplied from the control circuit. 前記第1の入力回路は、静電保護回路を含むことを特徴とする請求項1、2、3、4、5のうちいずれかに記載の表示装置。   The display device according to claim 1, wherein the first input circuit includes an electrostatic protection circuit.
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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001166334A (en) * 1999-12-08 2001-06-22 Seiko Epson Corp Electrooptical device
JP2001343945A (en) * 2000-05-31 2001-12-14 Toshiba Corp Planar display device
JP2003167562A (en) * 2001-12-04 2003-06-13 Sony Corp Display device and portable terminal device using the same
JP2003347926A (en) * 2002-05-30 2003-12-05 Sony Corp Level shift circuit, display apparatus, and mobile terminal
JP2004004243A (en) * 2002-05-31 2004-01-08 Sony Corp Display and portable terminal
JP2004226786A (en) * 2003-01-24 2004-08-12 Sony Corp Display device

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001166334A (en) * 1999-12-08 2001-06-22 Seiko Epson Corp Electrooptical device
JP2001343945A (en) * 2000-05-31 2001-12-14 Toshiba Corp Planar display device
JP2003167562A (en) * 2001-12-04 2003-06-13 Sony Corp Display device and portable terminal device using the same
JP2003347926A (en) * 2002-05-30 2003-12-05 Sony Corp Level shift circuit, display apparatus, and mobile terminal
JP2004004243A (en) * 2002-05-31 2004-01-08 Sony Corp Display and portable terminal
JP2004226786A (en) * 2003-01-24 2004-08-12 Sony Corp Display device

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