JP4104106B2 - Ferroelectric film, ferroelectric film manufacturing method, ferroelectric capacitor, ferroelectric capacitor manufacturing method, and ferroelectric memory device - Google Patents
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Description
【0001】
【発明の属する技術分野】
本発明は、強誘電体膜、強誘電体膜の製造方法、強誘電体キャパシタ、強誘電体キャパシタの製造方法および強誘電体メモリ装置に関する。
【0002】
【背景技術】
現在、ICメモリとして強誘電体メモリ装置が提案されている。強誘電体メモリ装置は、強誘電体膜を有し、この強誘電体膜を1対の電極で挟んで構成されており、自発分極によりデータを保持するものである。この強誘電体膜は、一般に、PZTに代表されるペロブスカイト結晶構造を有する無機系の酸化物強誘電体物質からなる。
【0003】
しかし、酸化物強誘電体の形成には、通常、高温における酸素雰囲気下での熱処理が必要となる。このため、以下のような問題が発生する。1)電極材料として、プラチナやイリジウムなどの貴金属を用いなければならないため、材料コストが増大する。2)アルミニウムやタングステンなどを配線材料とするLSIプロセスとの適合性が悪い。
【0004】
また、酸化物強誘電体物質は、微細加工する際のドライエッチングで一般的に用いられるエッチングガスとの反応性が乏しい。このため、酸化物強誘電体は、微細な加工が困難である。
【0005】
そこで、現在、強誘電体物質として、ポリフッ化ビニリデン系の有機強誘電体材料が提案されている。しかし、ポリフッ化ビニリデン系の有機強誘電体材料は、駆動電圧が高く、応答速度が遅いという問題を有する。
【0006】
【発明が解決しようとする課題】
本発明の目的は、酸化物強誘電体材料やポリフッ化ビニリデン系の有機強誘電体材料でないものからなる、新規の強誘電体膜およびその製造方法を提供することにある。
【0007】
本発明の他の目的は、上記本発明に係る強誘電体膜を有する強誘電体キャパシタおよびその製造方法を提供することにある。
【0008】
本発明の他の目的は、上記本発明に係る強誘電体キャパシタを有する強誘電体メモリ装置を提供することにある。
【0009】
【課題を解決するための手段】
(強誘電体膜)
本発明の強誘電体膜は、ドナーを含む膜と、アクセプターを含む膜とを有する。
【0010】
ここで、「ドナー」とは、アクセプターに電子を与えやすい物質をいう。つまり、「アクセプター」とは、ドナーから電子を受け取りやすい物質をいう。
【0011】
本発明の強誘電体膜が強誘電性を示す理由は、後に詳述する。
【0012】
本発明の強誘電体膜は、少なくとも次のいずれかの態様をとることができる。
【0013】
(1)ドナーを含む膜と、アクセプターを含む膜とは、互いに接触して形成されている態様である。
【0014】
(2)前記ドナーから前記アクセプターに電子が移動するとともに、正の電荷が、前記ドナーを含む膜から前記アクセプターを含む膜へ移動する態様である。
【0015】
(3)前記ドナーは、フルバレン骨格を有するドナー、メタロセン骨格を有するドナーおよびドナー性金属錯体の群から選択される少なくとも1種である態様である。
【0016】
(4)前記アクセプターは、キノン骨格を有するアクセプター、フラーレン系化合物およびアクセプター性金属錯体の群から選択される少なくとも1種である態様である。
【0017】
(5)前記ドナーを含む膜は、ドナーが高分子中に分散されて構成されている態様である。
【0018】
(6)前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成されている態様である。
【0019】
(7)前記高分子は、ポリメチルメタクリレート、ポリカーボネート、ポリアルボネート、ポリジアリルフタレート、ポリチオフェン、ポリカルバゾールおよびこれらの誘導体のうち少なくとも1種である態様である。
【0020】
(8)前記ドナーを含む膜と、前記アクセプターを含む膜とが積層された態様である。
【0021】
(9)前記強誘電体膜は、ドナーを含む膜を複数有し、かつ、アクセプターを含む膜を複数有し、
前記アクセプターを含む膜と、前記ドナーを含む膜とは、交互に積層されている態様である。
【0022】
(強誘電体膜の製造方法)
本発明の強誘電体膜の製造方法は、ドナーを含む膜を形成する工程、および
アクセプターを含む膜を形成する工程を含む。
【0023】
本発明の製造方法は、少なくとも次のいずれかの態様をとることができる。
【0024】
(1)前記ドナーを含む膜と、前記アクセプターを含む膜とは、互いに接触して形成される態様である。
【0025】
(2)前記ドナーから前記アクセプターに電子が移動するとともに、正の電荷が、前記ドナーを含む膜から前記アクセプターを含む膜へ移動する態様である。
【0026】
(3)前記ドナーを含む膜および前記アクセプターを含む膜の少なくとも一方は、蒸着法により形成される態様である。
【0027】
(4)前記ドナーを含む膜および前記アクセプターを含む膜の少なくとも一方は、スピンコート法により形成される態様である。
【0028】
(5)前記ドナーを含む膜および前記アクセプターを含む膜の少なくとも一方は、インクジェット法により形成される態様である。
【0029】
(6)前記ドナーは、本発明の強誘電体膜において示したものと同様の態様である。
【0030】
(7)前記アクセプターは、本発明の示したものと同様の態様である。
【0031】
(8)前記ドナーを含む膜は、ドナーが高分子中に分散されて構成されている態様である。
【0032】
(9)前記ドナーを含む膜と、前記アクセプターを含む膜とは積層されて形成される態様である。
【0033】
(10)前記強誘電体膜は、ドナーを含む膜を複数有し、かつ、アクセプターを含む膜を複数有し、
前記ドナーを含む膜と、前記アクセプターを含む膜とは、交互に積層される態様である。
【0034】
(11)前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成されている態様である。
【0035】
(12)前記高分子は、本発明の示したものと同様の態様である。
【0036】
(強誘電体キャパシタ)
本発明の強誘電体キャパシタは、請求項1〜8のいずれかに記載の強誘電体膜と、第1電極と、第2電極とを含み、
前記強誘電体膜は、少なくとも、前記第1電極と前記第2電極との間において、設けられている。
【0037】
本発明の強誘電体キャパシタは、次のいずれかの態様をとることができる。
【0038】
(1)前記強誘電体キャパシタは、前記第1電極、前記強誘電体膜および前記第2電極が、順次積層されて構成されている態様である。前記ドナーを含む膜と、前記アクセプターを含む膜とが積層された態様である。また、前記強誘電体膜は、ドナーを含む膜を複数有し、かつ、アクセプターを含む膜を複数有し、前記アクセプターを含む膜と、前記ドナーを含む膜とは、交互に積層されている態様であってもよい。
【0039】
(2)前記強誘電体キャパシタは、前記第1電極、前記強誘電体膜および前記第2電極が、基体の表面方向に沿って順次並んで構成されている態様である。また、前記強誘電体キャパシタは、ドナーを含む膜およびアクセプターを含む膜が、基体の表面方向に沿って順次並んで構成されている態様であってもよい。
【0040】
(強誘電体キャパシタの製造方法)
本発明の第1の強誘電体キャパシタの製造方法は、請求項11〜23のいずれかに記載の強誘電体膜の製造方法を含む。
【0041】
(強誘電体メモリ装置)
本発明の第1の強誘電体メモリ装置は、請求項24〜29のいずれかに記載の強誘電体キャパシタを含む。
【0042】
本発明の第2の強誘電体メモリ装置は、トランジスタ形成領域を構成する基体を含み、該基体上に所定パターンで配置された請求項24〜29のいずれかに記載の強誘電体キャパシタを有する。
【0043】
本発明の第3の強誘電体メモリ装置は、半導体基板上に形成されたゲート絶縁層に、請求項24〜27のいずれかに記載の強誘電体キャパシタが接続されている。
【0044】
本発明の第4の強誘電体メモリ装置は、請求項24〜27のいずれかに記載の強誘電体キャパシタからなるメモリセルがマトリクス状に配列され、
前記強誘電体キャパシタは、第1信号電極と、該第1信号電極と交差する方向に配列された第2信号電極と、少なくとも前記第1信号電極と前記第2信号電極との交差領域に配置された強誘電体膜と、を含む。
【0045】
【発明の実施の形態】
以下、本発明の好適な実施の形態について、図面を参照しながら説明する。
【0046】
[第1の実施の形態]
以下、本発明に係る強誘電体膜を有する強誘電体キャパシタを説明する。図1は、第1の実施の形態に係る強誘電体キャパシタを模式的に示す断面図である。
【0047】
強誘電体キャパシタC100は、基体100の上に形成されている。強誘電体キャパシタC100は、下部電極(第1電極)20、強誘電体膜30および上部電極(第2電極)22が順次積層されて、構成されている。強誘電体膜30は、ドナーを含む膜32と、アクセプターを含む膜34とが順次積層されて構成されている。図1に示された例では、ドナーを含む膜32の上に、アクセプターを含む膜34が形成されているが、これに限定されず、アクセプターを含む膜の上に、ドナーを含む膜を形成してもよい。
【0048】
ドナーを含む膜32は、ドナーを高分子中に分散させた材料からなってもよいし、または、ドナーのみから構成されることもできる。ドナーとしては、たとえば、フルバレン骨格を有するドナー、メタロセン骨格を有するドナー、ドナー性金属錯体を挙げることができる。
【0049】
フルバレン骨格を有するドナーとしては、たとえば、下記一般式(1)で表される化合物を挙げることができる。
【0050】
【化1】
【0051】
式中、R1、R2、R3およびR4は、H、アルキル基、−SHまたは−SRmを表し、Xは、SまたはSeを表す。ここで、Rmは、アルキル基を表す。
【0052】
フルバレン骨格を有するドナーの具体例としては、1)R1、R2、R3およびR4がHであり、XがSである、テトラチアフルバレン(TTF)、2)R1、R2、R3およびR4がCH3であり、XがSeである、テトラメチルテトラセレナフルバレン(TMTSF)、3)下記式(2)で表される化合物のビスエチレンジチオテトラフルバレン(BEDT−TTF)を挙げることができる。
【0053】
【化2】
【0054】
メタロセン骨格を有するドナーとしては、たとえば、下記一般式(3)で表される化合物を挙げることができる。
【0055】
【化3】
【0056】
式(3)中、Rは、たとえばHまたはCH3を表し、MはたとえばFe、Co、Ni、Mn、Cr、RuまたはSmを表す。なお、各Rは、相互に同じであっても、異なっていてもよい。
【0057】
ドナー性金属錯体としては、たとえば、下記一般式(4)で表される化合物を挙げることができる。
【0058】
【化4】
【0059】
式中、Mは、たとえばFe、Co、Ni、Mn、Cr、RuまたはSmを表す。
【0060】
一般式(4)において、錯体の配位子は、R1、R2およびR4の配位位置を占める3座配位子と、R3、R5およびR6の配位位置を占める3座配位子とであることができる。R1、R2およびR4の配位位置を占める3座配位子およびR3、R5およびR6の配位位置を占める3座配位子は、たとえば下記式(5)で表される化合物を挙げることができる。
【0061】
【化5】
【0062】
または、一般式(4)において、錯体の配位子は、R1、R4およびR5の配位位置を占める3座配位子と、R2、R3およびR6の配位位置を占める3座配位子とであることができる。R1、R4およびR5の配位位置を占める3座配位子およびR2、R3およびR6の配位位置を占める3座配位子は、たとえば下記式(6)で表される化合物を挙げることができる。
【0063】
【化6】
【0064】
アクセプターを含む膜は、アクセプターを高分子中に分散させた材料からなってもよいし、または、アクセプターのみから構成されることもできる。アクセプターとしては、たとえば、キノン骨格を有するアクセプター、フラーレン系化合物、アクセプター性金属錯体を挙げることができる。
【0065】
キノン骨格を有するアクセプターとしては、たとえば、下記一般式(7)により表される化合物を挙げることができる。
【0066】
【化7】
【0067】
一般式(7)において、RはたとえばH、F、ClまたはBrを表し、XはたとえばO、N(CN)またはC(CN)2を表す。
【0068】
キノン骨格を有するアクセプターとしては、より具体的には、1)RがHであり、XがC(CN)2である、テトラシアノキノンジメタン(TCNQ)、2)RがClであり、XがOである、クロラニルを挙げることができる。
【0069】
フラーレン系化合物としては、たとえば、C60、C70、C82、C90、カーボンナノチューブを挙げることができる。
【0070】
アクセプター性金属錯体としては、たとえば、下記一般式(8)により表される化合物を挙げることができる。
【0071】
【化8】
【0072】
式中、Mは、たとえばFe、Co、Ni、Mn、Cr、RuまたはSmを表す。
【0073】
一般式(8)において、錯体の配位子は、R1、R2およびR4の配位位置を占める3座配位子と、R3、R5およびR6の配位位置を占める3座配位子とであることができる。R1、R2およびR4の配位位置を占める3座配位子およびR3、R5およびR6の配位位置を占める3座配位子は、たとえば下記式(9)で表される化合物を挙げることができる。
【0074】
【化9】
【0075】
または、一般式(8)において、錯体の配位子は、R1、R4およびR5の配位位置を占める3座配位子と、R2、R3およびR6の配位位置を占める3座配位子とであることができる。R1、R4およびR5の配位位置を占める3座配位子およびR2、R3およびR6の配位位置を占める3座配位子は、たとえば下記式(10)で表される化合物を挙げることができる。
【0076】
【化10】
【0077】
(強誘電性を示す原理)
以下に、ドナーを含む膜32と、アクセプターを含む膜34との積層膜が、強誘電性を示す理由を説明する。
【0078】
図16(A)に示すように、第1電極20と第2電極22との間において電圧を印加することにより、ドナーを含む膜32とアクセプターを含む膜34との界面において、ドナーからアクセプターに電子が移動し、分極する。その結果、ドナーを含む膜32とアクセプターを含む膜34との積層膜は、強誘電性を示すこととなる。なお、この積層膜が強誘電性を示すことは、後述する実験例からも明らかである。
【0079】
また、図16(B)に示すように、ドナーを含む膜32とアクセプターを含む膜34との界面において、ドナーからアクセプターに電子が移動する際に、同時に、正に帯電した物質(たとえばプロトン)を移動させることが好ましい。この場合、アクセプターを含む膜34において電荷が中和され、電子が移動して分極した結果生じた負電荷同士のクーロン反発を抑えることができ、分極を確実にすることができる。すなわち、分極前の初期状態に戻るのを確実に抑えることができる。その結果、確実に、ドナーを含む膜とアクセプターを含む膜との積層膜は、強誘電性を示すこととなる。
【0080】
(作用効果)
以下、本実施の形態の作用効果を説明する。
【0081】
(1)本実施の形態によれば、強誘電体膜30が、酸化物強誘電体物質から構成されていない。したがって、強誘電体膜30の微細加工が容易である。
【0082】
(2)強誘電体膜が酸化物強誘電体物質からなる場合には、電極の材料が制限され、しかも適用できる電極の材料が高価であった。しかし、本実施の形態の強誘電体膜によれば、安価で微細加工し易い電極・配線材料(たとえばアルミニウム)を、第1および第2電極20,22の材料として適用することができる。
【0083】
(3)本実施の形態に係る強誘電体キャパシタによれば、強誘電体膜がポリフッ化ビニリデンからなる場合に比べて、低電圧駆動が可能である。
【0084】
(変形例)
強誘電体キャパシタC100は、次の変形が可能である。
【0085】
(1)図2に示すように、第1の電極20と第2の電極22とが、基体100の表面上に形成され、第1電極22と第2電極22との間において、強誘電体膜30が形成されていてもよい。すなわち、第1電極20、強誘電体膜30および第2電極22が、基体100の表面方向に、順次並んで形成してもよい。この場合、強誘電体膜30は、ドナーを含む膜32およびアクセプターを含む膜34が、基体100の表面方向に、順次並んで形成することができる。
【0086】
(2)強誘電体膜30は、図3に示すように、ドナーを含む膜32とアクセプターを含む膜34とが交互に積層されて構成されていてもよい。
【0087】
[第2の実施の形態]
以下、本発明の強誘電体膜を有する強誘電体キャパシタの製造方法について説明する。図4は、第2の実施の形態に係る強誘電体キャパシタの製造工程を模式的に示す断面図である。
【0088】
まず、図4(a)に示すように、基体100の上に、第1電極20を形成する。第1電極20の形成方法は、特に限定されず、例えば気相法、液相法などを用いることができる。気相法としては、スパッタリング、真空蒸着、MOCVDなどを用いることができる。また、液相法としては、電解メッキ、無電解メッキなどを適用できる。第1の電極の材質は、特に限定されず、たとえばAl、Ni、W、Au、Ag、Cu、Ir,IrOx,Pt,Ru,RuOx,SrRuOx,LaSrCoOxである。第1電極の厚さは、たとえば10〜400nmである。
【0089】
次に、第1電極20の上に、強誘電体膜30を形成する。具体的には、強誘電体膜30は、次のようにして形成することができる。
【0090】
まず、第1電極20の上に、ドナーを含む膜32を形成する。ドナーを含む膜32は、たとえば、スピンコート法、蒸着法により形成されることができる。スピンコート法により、ドナーを含む膜32を形成する場合には、溶媒に溶かされた高分子にドナーを分散させたものをスピンコートすることにより、ドナーを含む膜32を形成することができる。この高分子としては、ポリメチルメタクリレート(poly(methylmethacrelate))、ポリカーボネート(polycarbonate)、ポリアルボネート(poly(arbonate))、ポリジアリルフタレート(poly(diallylphthalate))、ポリチオフェン(poly(thiophene))、ポリカルバゾール(poly(carbazole))、およびこれらの誘導体を挙げることができる。ドナーを含む膜の厚さは、たとえば10〜1000nm、好ましくは50〜200nmである。
【0091】
次に、ドナーを含む膜32の上に、アクセプターを含む膜34を形成する。こうして、ドナーを含む膜32とアクセプターを含む膜34とからなる強誘電体膜30が形成される。アクセプターを含む膜34は、たとえばスピンコート法、蒸着法により形成されることができる。スピンコート法により、アクセプターを含む膜34を形成する場合には、溶媒に溶かされた高分子にアクセプターを分散させたものをスピンコートすることにより、アクセプターを含む膜を形成することができる。この高分子としては、ドナーを含む膜32において説明したものを適用することができる。アクセプターを含む膜34の厚さは、たとえば10〜1000nm、好ましくは50〜200nmである。
【0092】
次に、アクセプターを含む膜34の上に、第2電極22を形成する。第2電極22の形成方法および材質は、第1電極20と同様のものをとることができる。第2電極22の厚さは、たとえば10〜400nmである。
【0093】
次に、図4(b)に示すように、第2電極22の上に、所定のパターンを有するレジスト層R1を形成する。次に、図4(c)に示すように、レジスト層R1をマスクとして、第2電極22、強誘電体膜30および第1電極20をエッチングして、強誘電体キャパシタC100が形成される。このエッチングは、公知の方法を用いることができ、たとえば、ドライエッチング、ウエットエッチングである。ドライエッチングは、エッチングによる寸法変動が小さいという点で好ましい。その後、レジスト層R1を除去する。
【0094】
(変形例)
実施の形態に係る強誘電体メモリの製造方法は、次の変形が可能である。
【0095】
(1)図5に示すように、第1電極20の上に、インクジェット法により、インクジェットヘッド500からドナー材料32aを供給して、所定のパターンでドナーを含む膜32を形成することができる。
【0096】
また、アクセプターを含む膜34も同様にして形成することができる。
【0097】
(2)次のようにして、所定のパターンを有するドナーを含む膜32を形成することができる。図6に示すように、ドナーおよび感光剤を含む材料からなる膜32bを全面に形成する。次に、その膜の所定領域を露光し、露光した部分32cを変質させる。次に、その変質した部分32cをリンスにより選択的に除去し、所定のパターンを有するドナーを含む膜32を形成することができる。
【0098】
上記の場合、露光した部分のみをリンスにより選択的に除去する態様であったが、これとは逆に、露光しなかった部分のみをリンスにより選択的に除去して、露光した部分を残す態様であってもよい。
【0099】
また、アクセプターを含む膜34も同様にして、パターニングすることができる。
【0100】
[第3の実施の形態]
本発明の強誘電体メモリ装置は、上記強誘電体キャパシタC100を含んで形成され、以下に示す各種の態様を取りうる。
【0101】
(第1の強誘電体メモリ装置)
図7は、第1の強誘電体メモリ装置1000を模式的に示す断面図である。この強誘電メモリ装置1000は、強誘電体メモリ装置の制御を行うトランジスタ形成領域を有する。このトランジスタ形成領域が第1の実施の形態で述べた基体100に相当する。
【0102】
基体100は、半導体基板10にトランジスタ12を有する。トランジスタ12は、公知の構成を適用でき、薄膜トランジスタ(TFT)、あるいはMOSFETを用いることができる。図示の例ではMOSFETを用いており、トランジスタ12は、ドレインおよびソース14、16と、ゲート電極18とを有する。ドレインおよびソースの一方14には電極15が形成され、ドレインおよびソースの他方16にはプラグ電極26が形成されている。プラグ電極26は、必要に応じてバリア層を介して強誘電体キャパシタC100の第1電極20に接続されている。そして、各メモリセルは、LOCOSあるいはトレンチアイソレーションなどの素子分離領域17によって分離されている。トランジスタ12などが形成された半導体基板10上には、酸化シリコンなどの絶縁物からなる層間絶縁膜19が形成されている。
【0103】
以上の構成において、強誘電体キャパシタC100より下の構造体が基体100であるトランジスタ形成領域を構成している。このトランジスタ形成領域は、具体的には、半導体基板10に形成されたトランジスタ12、電極15,26、層間絶縁層19などを有する構造体からなる。このような基体100上に、第1電極20、本発明に係る強誘電体膜30および第2電極22が積層された強誘電体キャパシタC100が形成されている。強誘電体膜30は、図7の例では、ドナーを含む膜32およびアクセプターを含む膜34が順次積層されて構成されている。
【0104】
この強誘電体メモリ装置1000は、DRAMセルと同様に、蓄積容量に情報としての電荷をため込む構造を有する。すなわち、メモリセルは、図8および図9に示すように、トランジスタと強誘電体キャパシタにより構成される。
【0105】
図8は、メモリセルが1つのトランジスタ12と1つの強誘電体キャパシタC100とを有する、いわゆる1T1Cセル方式を示す。このメモリセルは、ワード線WLとビット線BLとの交点に位置し、強誘電体キャパシタC100の一端は、ビット線BLとの接続をオン・オフするトランジスタ12を介してビット線に接続される。また、強誘電体キャパシタC100の他端は、プレート線PLと接続されている。そして、トランジスタ12のゲートはワード線WLに接続されている。ビット線BLは、信号電荷を増幅するセンスアンプ200に接続されている。
【0106】
以下に、1T1Cセルにおける動作の例を簡単に説明する。
【0107】
読み出し動作においては、ビット線BLを0Vに固定した後、ワード線WLに電圧を印加し、トランジスタ12をオンする。その後、プレート線PLを0Vから電源電圧VCC程度まで印加することにより、強誘電体キャパシタC100に記憶した情報に対応した分極電荷量がビット線BLに伝達される。この分極電荷量によって生じた微少電位変化を差動式センスアンプ200で増幅することにより、記憶情報をVCCまたは0Vの2つの情報として読み出すことができる。
【0108】
書き込み動作においては、ワード線WLに電圧を印加し、トランジスタ12をオン状態にした後、ビット線BL−プレート線PL間に電圧を印加し、強誘電体キャパシタC100の分極状態を変更し決定する。
【0109】
図9は、2つのトランジスタ12と2つの強誘電体キャパシタC100とを有する、いわゆる2T2Cセルを示す図である。この2T2Cセルは、前述した1T1Cセルを2個組み合わせて、相補型の情報を保持する構造を有する。すなわち、2T2Cセルでは、センスアンプ200への2つの差動入力として、相補型にデータを書き込んだ2つのメモリセルから相補信号を入力し、データを検出する。このため、2T2Cセル内の2つの強誘電体キャパシタC100,C100は同じ回数の書き込みが行われるため、強誘電体キャパシタC100の強誘電体膜の劣化状態が等しくなり、安定な動作が可能となる。
【0110】
(第2の強誘電体メモリ装置)
図10および図11は、MISトランジスタ型メモリセルを有する強誘電体メモリ装置2000を示す。この強誘電体メモリ装置2000は、ゲート絶縁層13に強誘電体キャパシタC100を直接接続する構造を有する。具体的には、半導体基板10にソースおよびドレイン14,16が形成され、さらに、ゲート絶縁層13上には、フローティングゲート電極(第1電極)20、本発明に係る強誘電体膜30およびゲート電極(第2電極)22が積層された強誘電体キャパシタC100が接続されている。強誘電体膜30は、図10の例においては、ドナーを含む膜32およびアクセプターを含む膜34が積層されて構成されている。この強誘電体メモリ装置2000においては、半導体基板10、ソース,ドレイン14,16およびゲート絶縁層13が、第1の実施の形態で述べた基体100に相当する。
【0111】
また、この強誘電体メモリ装置2000は、図11に示すように、ワード線WLは各セルのゲート電極22に接続され、ドレインはビット線BLに接続されている。この強誘電体メモリ装置においては、データの書き込み動作は、選択するセルのワード線WLとウェル(ソース)間に電界を印加することによって行われる。また、読み出し動作は、選択セルに対応するワード線WLを選択し、選択セルのビット線BLに接続したセンスアンプ200によって各トランジスタを流れる電流量を検出することで行われる。
【0112】
(第3の強誘電体メモリ装置)
図12は、第3の強誘電体メモリ装置を模式的に示す図であり、図13は、メモリセルアレイの一部を拡大して示す平面図であり、図14は、図12のA−A線に沿った断面図である。平面図において、( )内の数字は最上層より下の層を示す。
【0113】
この例の強誘電体メモリ装置3000は、図12に示すように、メモリセル120が単純マトリクス状に配列されたメモリセルアレイ100Aと、メモリセル(強誘電体キャパシタC100)120に対して選択的に情報の書き込みもしくは読み出しを行うための各種回路、例えば、第1信号電極(第1電極)20を選択的に制御するための第1駆動回路150と、第2信号電極(第2電極)22を選択的に制御するための第2駆動回路152と、センスアンプなどの信号検出回路(図示せず)とを含む。
【0114】
メモリセルアレイ100Aは、行選択のための第1信号電極(ワード線)20と、列選択のための第2信号電極(ビット線)22とが直交するように配列されている。すなわち、X方向に沿って第1信号電極20が所定ピッチで配列され、X方向と直交するY方向に沿って第2信号電極22が所定ピッチで配列されている。なお、信号電極は、上記の逆でもよく、第1信号電極がビット線、第2信号電極がワード線でもよい。
【0115】
本実施の形態に係るメモリセルアレイ100Aは、図13および図14に示すように、絶縁性の基体100上に、第1信号電極20、本発明に係る強誘電体膜30および第2信号電極22が積層され、第1信号電極20,強誘電体層30および第2信号電極22によって強誘電体キャパシタ120が構成される。すなわち、第1信号電極20と第2信号電極22との交差領域において、それぞれ強誘電体キャパシタ120からなるメモリセルが構成されている。強誘電体膜30は、図14の例においては、ドナーを含む膜32およびアクセプターを含む膜34が順次積層されて構成されている。
【0116】
また、強誘電体膜30と第2信号電極22とからなる積層体の相互には、基体100および第1信号電極20の露出面を覆うように、誘電体層38が形成されている。この誘電体層38は、強誘電体膜30に比べて小さい誘電率を有することが望ましい。このように強誘電体膜30および第2信号電極22からなる積層体の相互間に、強誘電体膜30より誘電率の小さい誘電体層38を介在させることにより、第1,第2信号電極20,22の浮遊容量を小さくすることができる。その結果、強誘電体メモリ装置3000における書き込みおよび読み出しの動作をより高速に行うことが可能となる。
【0117】
次に、強誘電体メモリ装置3000における書き込み,読み出し動作の一例について述べる。
【0118】
まず、読み出し動作においては、選択セルのキャパシタに読み出し電圧「V0」が印加される。これは、同時に‘0’の書き込み動作を兼ねている。このとき、選択されたビット線を流れる電流またはビット線をハイインピーダンスにしたときの電位をセンスアンプにて読み出す。さらにこのとき、非選択セルのキャパシタには、読み出し時のクロストークを防ぐため、所定の電圧が印加される。
【0119】
書き込み動作においては、‘1’の書き込みの場合は、選択セルのキャパシタに「−V0」の電圧が印加される。‘0’の書き込みの場合は、選択セルのキャパシタに、該選択セルの分極を反転させない電圧が印加され、読み出し動作時に書き込まれた‘0’状態を保持する。このとき、非選択セルのキャパシタには、書き込み時のクロストークを防ぐため、所定の電圧が印加される。
【0120】
以上、蓄積容量型、MISトランジスタ型および単純マトリクス型の強誘電体メモリ装置の例について述べたが、本発明の強誘電体メモリ装置はこれらに限定されず、他のタイプのメモリトランジスタにも適用できる。要するに、本発明の強誘電体メモリ装置は、少なくとも第1電極と強誘電体膜とが積層された構造を有するものに適用できる。
【0121】
[実験例]
ドナーを含む膜と、アクセプターを含む膜との積層膜が、強誘電体膜として機能することができるかどうか調べた。
【0122】
試験体(キャパシタ)は、次の構成とした。ガラス基板の上に、下部電極として透明電極(ITO:インジウム−スズ酸化物)を形成した。下部電極の上にドナーを含む膜を形成し、ドナーを含む膜の上にアクセプターを含む膜を形成した。アクセプターを含む膜の上に、上部電極を形成した。
【0123】
ドナーを含む膜は、ドナーを高分子に分散した材料から構成した。ドナーはジメチルフェナジンとし、高分子はポリビスフェノールカーボネートとした。なお、ドナーを含む膜は、ジメチルフェナジンおよびポリビスフェノールカーボネートをクロロホルムに溶かしたものを、スピンコートして形成された。アクセプターは、フラーレンとした。
【0124】
アクセプターを含む膜は、フラーレンを真空蒸着して形成された。上部電極は金からなり、蒸着法により形成した。
【0125】
図15に、この試験体(キャパシタ)の分極と、電圧との関係を表すグラフを示す。図15に示すように、電圧の上げ下げに対して、ヒステリシスループが観測された。このことは、ドナーを含む膜と、アクセプターを含む膜との積層膜が、強誘電性を示すことを示す。すなわち、このキャパシタが強誘電体メモリとして応用できることを示している。
【0126】
本発明は、上記の実施の形態に限定されず、本発明の要旨を超えない範囲で種々の変更が可能である。
【図面の簡単な説明】
【図1】第1の実施の形態に係る強誘電体キャパシタを模式的に示す断面図である。
【図2】第1の実施の形態に係る強誘電体キャパシタの変形例を模式的に示す断面図である。
【図3】第1の実施の形態に係る強誘電体キャパシタの変形例を模式的に示す断面図である。
【図4】第2の実施の形態に係る強誘電体キャパシタの製造工程を模式的に示す断面図である。
【図5】第2の実施の形態に係る強誘電体キャパシタの製造工程の変形例を模式的に示す断面図である。
【図6】第2の実施の形態に係る強誘電体キャパシタの製造工程の変形例を模式的に示す断面図である。
【図7】本発明にかかる強誘電体メモリ装置が適用された蓄積容量型の強誘電体メモリ装置を模式的に示す断面図である。
【図8】図7に示す強誘電体メモリ装置を適用した1T1C方式のメモリセルを示す図である。
【図9】図7に示す強誘電体メモリ装置を適用した2T2C方式のメモリセルを示す図である。
【図10】本発明にかかる強誘電体メモリ装置が適用されたMISトランジスタ型の強誘電体メモリ装置を模式的に示す断面図である。
【図11】図10に示す強誘電体メモリ装置を適用したメモリセルを示す図である。
【図12】本発明にかかる強誘電体メモリ装置が適用された、メモリセルが単純マトリクス状に配列された強誘電体メモリ装置を模式的に示す図である。
【図13】図12に示す強誘電体メモリ装置のメモリセルアレイを示す平面図である。
【図14】図13のA−A線に沿った部分を模式的に示す断面図である。
【図15】試験体(キャパシタ)の分極と、電圧との関係を表すグラフを示す。
【図16】ドナーを含む膜とアクセプターを含む膜との積層膜において、強誘電性が示される原理を説明するための模式図である。
【符号の説明】
10 半導体基板
12 トランジスタ
14,16 ソース/ドレイン
17 素子分離領域
19 層間絶縁膜
20 第1電極(下部電極,フローティングゲート電極,第1信号電極)
22 第2電極(上部電極,ゲート電極,第2信号電極)
30 強誘電体膜
32 ドナーを含む膜
34 アクセプターを含む膜
100 基体
100A メモリセルアレイ
120 メモリセル(強誘電体キャパシタ)
C100 強誘電体キャパシタ
1000,2000,3000 強誘電体メモリ装置[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a ferroelectric film, a method for manufacturing a ferroelectric film, a ferroelectric capacitor, a method for manufacturing a ferroelectric capacitor, and a ferroelectric memory device.
[0002]
[Background]
At present, a ferroelectric memory device has been proposed as an IC memory. A ferroelectric memory device has a ferroelectric film, and is formed by sandwiching the ferroelectric film between a pair of electrodes, and holds data by spontaneous polarization. This ferroelectric film is generally made of an inorganic oxide ferroelectric substance having a perovskite crystal structure typified by PZT.
[0003]
However, formation of an oxide ferroelectric usually requires heat treatment in an oxygen atmosphere at a high temperature. For this reason, the following problems occur. 1) Since noble metals such as platinum and iridium must be used as the electrode material, the material cost increases. 2) Poor compatibility with LSI processes using aluminum or tungsten as a wiring material.
[0004]
In addition, the oxide ferroelectric material is poor in reactivity with an etching gas generally used in dry etching for fine processing. For this reason, fine processing is difficult for the oxide ferroelectric.
[0005]
Therefore, an organic ferroelectric material based on polyvinylidene fluoride has been proposed as a ferroelectric substance. However, the polyvinylidene fluoride organic ferroelectric material has a problem that the drive voltage is high and the response speed is slow.
[0006]
[Problems to be solved by the invention]
An object of the present invention is to provide a novel ferroelectric film made of an oxide ferroelectric material or a polyvinylidene fluoride-based organic ferroelectric material and a method for producing the same.
[0007]
Another object of the present invention is to provide a ferroelectric capacitor having a ferroelectric film according to the present invention and a method for manufacturing the same.
[0008]
Another object of the present invention is to provide a ferroelectric memory device having the ferroelectric capacitor according to the present invention.
[0009]
[Means for Solving the Problems]
(Ferroelectric film)
The ferroelectric film of the present invention has a film containing a donor and a film containing an acceptor.
[0010]
Here, “donor” refers to a substance that easily gives electrons to an acceptor. That is, an “acceptor” refers to a substance that easily receives electrons from a donor.
[0011]
The reason why the ferroelectric film of the present invention exhibits ferroelectricity will be described in detail later.
[0012]
The ferroelectric film of the present invention can take at least one of the following aspects.
[0013]
(1) A film containing a donor and a film containing an acceptor are formed in contact with each other.
[0014]
(2) In this aspect, electrons move from the donor to the acceptor, and positive charges move from the donor-containing film to the acceptor-containing film.
[0015]
(3) The said donor is an aspect which is at least 1 sort (s) selected from the group of the donor which has a fulvalene skeleton, the donor which has a metallocene skeleton, and a donor metal complex.
[0016]
(4) The said acceptor is an aspect which is at least 1 sort (s) selected from the group of the acceptor which has a quinone skeleton, a fullerene type compound, and an acceptor metal complex.
[0017]
(5) The film containing the donor is an embodiment in which the donor is dispersed in a polymer.
[0018]
(6) The film containing the acceptor is an aspect in which the acceptor is dispersed in a polymer.
[0019]
(7) In the aspect, the polymer is at least one of polymethyl methacrylate, polycarbonate, polyalbonate, polydiallyl phthalate, polythiophene, polycarbazole, and derivatives thereof.
[0020]
(8) A mode in which a film containing the donor and a film containing the acceptor are stacked.
[0021]
(9) The ferroelectric film has a plurality of films containing a donor and a plurality of films containing an acceptor,
The film including the acceptor and the film including the donor are alternately stacked.
[0022]
(Manufacturing method of ferroelectric film)
The method for producing a ferroelectric film of the present invention includes a step of forming a film containing a donor and a step of forming a film containing an acceptor.
[0023]
The production method of the present invention can take at least one of the following aspects.
[0024]
(1) The film containing the donor and the film containing the acceptor are formed in contact with each other.
[0025]
(2) In this aspect, electrons move from the donor to the acceptor, and positive charges move from the donor-containing film to the acceptor-containing film.
[0026]
(3) At least one of the film containing the donor and the film containing the acceptor is an embodiment formed by a vapor deposition method.
[0027]
(4) At least one of the film including the donor and the film including the acceptor is formed by a spin coating method.
[0028]
(5) At least one of the film containing the donor and the film containing the acceptor is an embodiment formed by an inkjet method.
[0029]
(6) The donor is in the same mode as that shown in the ferroelectric film of the present invention.
[0030]
(7) The acceptor is in the same mode as shown in the present invention.
[0031]
(8) The film containing a donor is an embodiment in which a donor is dispersed in a polymer.
[0032]
(9) The film including the donor and the film including the acceptor are stacked.
[0033]
(10) The ferroelectric film has a plurality of films containing a donor and a plurality of films containing an acceptor,
The film including the donor and the film including the acceptor are alternately stacked.
[0034]
(11) The film containing the acceptor is an aspect in which the acceptor is dispersed in a polymer.
[0035]
(12) The polymer is in the same mode as shown in the present invention.
[0036]
(Ferroelectric capacitor)
A ferroelectric capacitor of the present invention includes the ferroelectric film according to any one of claims 1 to 8, a first electrode, and a second electrode,
The ferroelectric film is provided at least between the first electrode and the second electrode.
[0037]
The ferroelectric capacitor of the present invention can take one of the following modes.
[0038]
(1) The ferroelectric capacitor is an aspect in which the first electrode, the ferroelectric film, and the second electrode are sequentially stacked. In this embodiment, a film containing the donor and a film containing the acceptor are stacked. The ferroelectric film includes a plurality of films including a donor and includes a plurality of films including an acceptor, and the films including the acceptor and the films including the donor are alternately stacked. An aspect may be sufficient.
[0039]
(2) The ferroelectric capacitor is an aspect in which the first electrode, the ferroelectric film, and the second electrode are sequentially arranged along the surface direction of the substrate. The ferroelectric capacitor may be configured such that a film containing a donor and a film containing an acceptor are sequentially arranged along the surface direction of the substrate.
[0040]
(Manufacturing method of ferroelectric capacitor)
The manufacturing method of the 1st ferroelectric capacitor of this invention includes the manufacturing method of the ferroelectric film in any one of Claims 11-23.
[0041]
(Ferroelectric memory device)
A first ferroelectric memory device according to the present invention includes the ferroelectric capacitor according to any one of claims 24 to 29.
[0042]
30. A second ferroelectric memory device according to the present invention includes a substrate constituting a transistor formation region, and has the ferroelectric capacitor according to claim 24 arranged in a predetermined pattern on the substrate. .
[0043]
In a third ferroelectric memory device of the present invention, the ferroelectric capacitor according to any one of claims 24 to 27 is connected to a gate insulating layer formed on a semiconductor substrate.
[0044]
According to a fourth ferroelectric memory device of the present invention, memory cells comprising the ferroelectric capacitors according to any one of claims 24 to 27 are arranged in a matrix.
The ferroelectric capacitor is arranged in a first signal electrode, a second signal electrode arranged in a direction intersecting the first signal electrode, and at least an intersecting region of the first signal electrode and the second signal electrode. A ferroelectric film.
[0045]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, preferred embodiments of the present invention will be described with reference to the drawings.
[0046]
[First Embodiment]
Hereinafter, a ferroelectric capacitor having a ferroelectric film according to the present invention will be described. FIG. 1 is a cross-sectional view schematically showing a ferroelectric capacitor according to the first embodiment.
[0047]
The ferroelectric capacitor C100 is formed on the
[0048]
The
[0049]
As a donor which has a fulvalene skeleton, the compound represented by following General formula (1) can be mentioned, for example.
[0050]
[Chemical 1]
[0051]
In the formula, R 1 , R 2 , R 3 and R 4 represent H, an alkyl group, —SH or —SRm, and X represents S or Se. Here, Rm represents an alkyl group.
[0052]
Specific examples of donors having a fulvalene skeleton include 1) tetrathiafulvalene (TTF) in which R 1 , R 2 , R 3 and R 4 are H and X is S, 2) R 1 , R 2 , R 3 and R 4 are CH 3, X is Se, tetramethyltetrathiafulvalene Serena full Valentin (TMTSF), 3) bisethylenedithio tetrafluoropropoxy Bullen of a compound represented by the following formula (2) (BEDT-TTF ).
[0053]
[Chemical formula 2]
[0054]
Examples of the donor having a metallocene skeleton include compounds represented by the following general formula (3).
[0055]
[Chemical 3]
[0056]
In formula (3), R represents, for example, H or CH 3 , and M represents, for example, Fe, Co, Ni, Mn, Cr, Ru, or Sm. Each R may be the same as or different from each other.
[0057]
Examples of the donor metal complex include compounds represented by the following general formula (4).
[0058]
[Formula 4]
[0059]
In the formula, M represents, for example, Fe, Co, Ni, Mn, Cr, Ru, or Sm.
[0060]
In the general formula (4), the ligand of the complex is a tridentate ligand that occupies the coordination positions of R 1 , R 2, and R 4 , and 3 that occupies the coordination positions of R 3 , R 5, and R 6. Can be a bidentate ligand. The tridentate ligand that occupies the coordination positions of R 1 , R 2, and R 4 and the tridentate ligand that occupies the coordination positions of R 3 , R 5, and R 6 are represented by, for example, the following formula (5). Can be mentioned.
[0061]
[Chemical formula 5]
[0062]
Alternatively, in the general formula (4), the ligand of the complex includes a tridentate ligand that occupies the coordination positions of R 1 , R 4, and R 5 , and the coordination positions of R 2 , R 3, and R 6. It can be an occupied tridentate ligand. The tridentate ligand occupying the coordination positions of R 1 , R 4 and R 5 and the tridentate ligand occupying the coordination positions of R 2 , R 3 and R 6 are represented by, for example, the following formula (6). Can be mentioned.
[0063]
[Chemical 6]
[0064]
The film containing the acceptor may be made of a material in which the acceptor is dispersed in the polymer, or may be composed only of the acceptor. Examples of the acceptor include an acceptor having a quinone skeleton, a fullerene compound, and an acceptor metal complex.
[0065]
As an acceptor which has a quinone skeleton, the compound represented by following General formula (7) can be mentioned, for example.
[0066]
[Chemical 7]
[0067]
In the general formula (7), R represents, for example, H, F, Cl or Br, and X represents, for example, O, N (CN) or C (CN) 2 .
[0068]
More specifically, as an acceptor having a quinone skeleton, 1) tetracyanoquinone dimethane (TCNQ) in which R is H and X is C (CN) 2 , 2) R is Cl, and X Mention may be made of chloranil, wherein is O.
[0069]
Examples of fullerene compounds include C 60 , C 70 , C 82 , C 90 , and carbon nanotubes.
[0070]
As an acceptor metal complex, the compound represented by following General formula (8) can be mentioned, for example.
[0071]
[Chemical 8]
[0072]
In the formula, M represents, for example, Fe, Co, Ni, Mn, Cr, Ru, or Sm.
[0073]
In the general formula (8), the ligand of the complex is a tridentate ligand that occupies the coordination positions of R 1 , R 2, and R 4 , and 3 that occupies the coordination positions of R 3 , R 5, and R 6. Can be a bidentate ligand. The tridentate ligand occupying the coordination positions of R 1 , R 2 and R 4 and the tridentate ligand occupying the coordination positions of R 3 , R 5 and R 6 are represented by, for example, the following formula (9). Can be mentioned.
[0074]
[Chemical 9]
[0075]
Alternatively, in the general formula (8), the ligand of the complex is a tridentate ligand that occupies the coordination positions of R 1 , R 4, and R 5 , and the coordination positions of R 2 , R 3, and R 6. It can be an occupied tridentate ligand. The tridentate ligand occupying the coordination positions of R 1 , R 4 and R 5 and the tridentate ligand occupying the coordination positions of R 2 , R 3 and R 6 are represented by, for example, the following formula (10). Can be mentioned.
[0076]
[Chemical Formula 10]
[0077]
(Principle showing ferroelectricity)
The reason why the laminated film of the
[0078]
As shown in FIG. 16A, by applying a voltage between the
[0079]
In addition, as shown in FIG. 16B, when electrons move from the donor to the acceptor at the interface between the donor-containing
[0080]
(Function and effect)
Hereinafter, the operational effects of the present embodiment will be described.
[0081]
(1) According to the present embodiment, the
[0082]
(2) When the ferroelectric film is made of an oxide ferroelectric substance, the electrode material is limited, and the applicable electrode material is expensive. However, according to the ferroelectric film of the present embodiment, an electrode / wiring material (for example, aluminum) that is inexpensive and easy to finely process can be applied as the material of the first and
[0083]
(3) The ferroelectric capacitor according to the present embodiment can be driven at a lower voltage than the case where the ferroelectric film is made of polyvinylidene fluoride.
[0084]
(Modification)
The ferroelectric capacitor C100 can be modified as follows.
[0085]
(1) As shown in FIG. 2, the
[0086]
(2) As shown in FIG. 3, the
[0087]
[Second Embodiment]
A method for manufacturing a ferroelectric capacitor having a ferroelectric film according to the present invention will be described below. FIG. 4 is a cross-sectional view schematically showing the manufacturing process of the ferroelectric capacitor according to the second embodiment.
[0088]
First, as shown in FIG. 4A, the
[0089]
Next, a
[0090]
First, a
[0091]
Next, a
[0092]
Next, the
[0093]
Next, as illustrated in FIG. 4B, a resist layer R <b> 1 having a predetermined pattern is formed on the
[0094]
(Modification)
The manufacturing method of the ferroelectric memory according to the embodiment can be modified as follows.
[0095]
(1) As shown in FIG. 5, the
[0096]
Further, the
[0097]
(2) The
[0098]
In the above case, only the exposed portion was selectively removed by rinsing. Conversely, only the unexposed portion was selectively removed by rinsing to leave the exposed portion. It may be.
[0099]
Further, the
[0100]
[Third Embodiment]
The ferroelectric memory device of the present invention is formed including the ferroelectric capacitor C100, and can take various modes shown below.
[0101]
(First ferroelectric memory device)
FIG. 7 is a cross-sectional view schematically showing the first
[0102]
The
[0103]
In the above configuration, the structure below the ferroelectric capacitor C100 constitutes the transistor formation region which is the
[0104]
This
[0105]
FIG. 8 shows a so-called 1T1C cell system in which the memory cell has one
[0106]
An example of the operation in the 1T1C cell will be briefly described below.
[0107]
In the read operation, after the bit line BL is fixed to 0V, a voltage is applied to the word line WL to turn on the
[0108]
In the write operation, a voltage is applied to the word line WL to turn on the
[0109]
FIG. 9 shows a so-called 2T2C cell having two
[0110]
(Second ferroelectric memory device)
10 and 11 show a
[0111]
In the
[0112]
(Third ferroelectric memory device)
12 is a diagram schematically showing a third ferroelectric memory device, FIG. 13 is a plan view showing a part of the memory cell array in an enlarged manner, and FIG. 14 is an AA diagram in FIG. It is sectional drawing along a line. In the plan view, numbers in parentheses indicate layers below the top layer.
[0113]
As shown in FIG. 12, the
[0114]
In the
[0115]
As shown in FIGS. 13 and 14, the
[0116]
In addition, a
[0117]
Next, an example of write and read operations in the
[0118]
First, in the read operation, the read voltage “V 0 ” is applied to the capacitor of the selected cell. This also serves as a write operation of “0” at the same time. At this time, the current flowing through the selected bit line or the potential when the bit line is set to high impedance is read by the sense amplifier. Further, at this time, a predetermined voltage is applied to the capacitor of the non-selected cell in order to prevent crosstalk during reading.
[0119]
In the write operation, when “1” is written, a voltage of “−V 0 ” is applied to the capacitor of the selected cell. In the case of writing “0”, a voltage that does not reverse the polarization of the selected cell is applied to the capacitor of the selected cell, and the “0” state written during the read operation is held. At this time, a predetermined voltage is applied to the capacitor of the non-selected cell in order to prevent crosstalk during writing.
[0120]
The examples of the storage capacitor type, MIS transistor type, and simple matrix type ferroelectric memory devices have been described above. However, the ferroelectric memory device of the present invention is not limited to these, and can be applied to other types of memory transistors. it can. In short, the ferroelectric memory device of the present invention can be applied to one having a structure in which at least a first electrode and a ferroelectric film are laminated.
[0121]
[Experimental example]
It was investigated whether a laminated film of a film containing a donor and a film containing an acceptor can function as a ferroelectric film.
[0122]
The test body (capacitor) was configured as follows. On the glass substrate, a transparent electrode (ITO: indium-tin oxide) was formed as a lower electrode. A film containing a donor was formed on the lower electrode, and a film containing an acceptor was formed on the film containing the donor. An upper electrode was formed on the film containing the acceptor.
[0123]
The film containing the donor was composed of a material in which the donor was dispersed in a polymer. The donor was dimethylphenazine and the polymer was polybisphenol carbonate. The film containing the donor was formed by spin-coating dimethylphenazine and polybisphenol carbonate dissolved in chloroform. The acceptor was fullerene.
[0124]
The film containing the acceptor was formed by vacuum evaporation of fullerene. The upper electrode was made of gold and formed by vapor deposition.
[0125]
FIG. 15 is a graph showing the relationship between the polarization of the test body (capacitor) and the voltage. As shown in FIG. 15, a hysteresis loop was observed as the voltage was raised or lowered. This indicates that a laminated film of a film containing a donor and a film containing an acceptor exhibits ferroelectricity. That is, this indicates that this capacitor can be applied as a ferroelectric memory.
[0126]
The present invention is not limited to the above embodiment, and various modifications can be made without departing from the gist of the present invention.
[Brief description of the drawings]
FIG. 1 is a cross-sectional view schematically showing a ferroelectric capacitor according to a first embodiment.
FIG. 2 is a cross-sectional view schematically showing a modification of the ferroelectric capacitor according to the first embodiment.
FIG. 3 is a cross-sectional view schematically showing a modification of the ferroelectric capacitor according to the first embodiment.
FIG. 4 is a cross-sectional view schematically showing a manufacturing process of a ferroelectric capacitor according to a second embodiment.
FIG. 5 is a cross-sectional view schematically showing a modification of the manufacturing process of the ferroelectric capacitor according to the second embodiment.
FIG. 6 is a cross-sectional view schematically showing a modified example of the manufacturing process of the ferroelectric capacitor according to the second embodiment.
7 is a cross-sectional view schematically showing a storage capacitor type ferroelectric memory device to which the ferroelectric memory device according to the present invention is applied; FIG.
8 is a diagram showing a 1T1C type memory cell to which the ferroelectric memory device shown in FIG. 7 is applied. FIG.
9 is a diagram showing a 2T2C type memory cell to which the ferroelectric memory device shown in FIG. 7 is applied.
FIG. 10 is a cross-sectional view schematically showing a MIS transistor type ferroelectric memory device to which the ferroelectric memory device according to the present invention is applied.
11 is a diagram showing a memory cell to which the ferroelectric memory device shown in FIG. 10 is applied.
FIG. 12 is a diagram schematically showing a ferroelectric memory device in which memory cells are arranged in a simple matrix, to which the ferroelectric memory device according to the present invention is applied.
13 is a plan view showing a memory cell array of the ferroelectric memory device shown in FIG. 12; FIG.
14 is a cross-sectional view schematically showing a portion along line AA in FIG.
FIG. 15 is a graph showing the relationship between the polarization of a specimen (capacitor) and the voltage.
FIG. 16 is a schematic diagram for explaining the principle that ferroelectricity is exhibited in a laminated film of a film including a donor and a film including an acceptor.
[Explanation of symbols]
DESCRIPTION OF
22 Second electrode (upper electrode, gate electrode, second signal electrode)
30
C100
Claims (26)
前記ドナーを含む膜は、ドナーが高分子中に分散されて構成され、
前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成されている、強誘電体膜。It consists of a structure in which a film containing a donor and a film containing an acceptor are in contact with each other,
The film containing the donor is configured by dispersing the donor in a polymer,
The film containing the acceptor is a ferroelectric film formed by dispersing the acceptor in a polymer.
前記ドナーを含む膜は、ドナーが高分子中に分散されて構成され、
前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成されている、強誘電体膜。A film containing a donor and a film containing an acceptor are stacked,
The film containing the donor is configured by dispersing the donor in a polymer,
The film containing the acceptor is a ferroelectric film formed by dispersing the acceptor in a polymer.
前記ドナーから前記アクセプターに電子が移動するとともに、正の電荷が、前記ドナーを含む膜から前記アクセプターを含む膜へ移動する、強誘電体膜。In claim 1 or 2,
A ferroelectric film in which electrons move from the donor to the acceptor and positive charges move from the donor-containing film to the acceptor-containing film.
前記ドナーは、フルバレン骨格を有するドナー、メタロセン骨格を有するドナーおよびドナー性金属錯体の群から選択される少なくとも1種である、強誘電体膜。In any one of Claims 1-3,
The ferroelectric film, wherein the donor is at least one selected from the group consisting of a donor having a fulvalene skeleton, a donor having a metallocene skeleton, and a donor metal complex.
前記アクセプターは、キノン骨格を有するアクセプター、フラーレン系化合物およびアクセプター性金属錯体の群から選択される少なくとも1種である、強誘電体膜。In any one of Claims 1-4,
The ferroelectric film, wherein the acceptor is at least one selected from the group consisting of an acceptor having a quinone skeleton, a fullerene compound, and an acceptor metal complex.
前記高分子は、ポリメチルメタクリレート、ポリカーボネート、ポリアルボネート、ポリジアリルフタレート、ポリチオフェン、ポリカルバゾールおよびこれらの誘導体のうち少なくとも1種である、強誘電体膜。In any one of Claims 1-5,
The ferroelectric film, wherein the polymer is at least one of polymethyl methacrylate, polycarbonate, polyalbonate, polydiallyl phthalate, polythiophene, polycarbazole, and derivatives thereof.
前記強誘電体膜は、前記ドナーを含む膜を複数有し、かつ、前記アクセプターを含む膜を複数有し、
前記アクセプターを含む膜と、前記ドナーを含む膜とは、交互に積層されている、強誘電体膜。In any one of Claims 2-6,
The ferroelectric film has a plurality of films containing the donor and a plurality of films containing the acceptor,
The film including the acceptor and the film including the donor are ferroelectric films that are alternately stacked.
アクセプターを含む膜を形成する工程を含み、
前記ドナーを含む膜は、ドナーが高分子中に分散されて構成され、
前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成され、
前記ドナーから前記アクセプターに電子が移動するとともに、正の電荷が、前記ドナーを含む膜から前記アクセプターを含む膜へ移動するように、前記ドナーを含む膜と、前記アクセプターを含む膜とが互いに接触して形成された構造からなる強誘電体膜の製造方法。Forming a film containing a donor, and forming a film containing an acceptor,
The film containing the donor is configured by dispersing the donor in a polymer,
The film containing the acceptor is configured by dispersing the acceptor in a polymer,
The film containing the donor and the film containing the acceptor are in contact with each other so that electrons move from the donor to the acceptor and positive charges move from the film containing the donor to the film containing the acceptor. A method of manufacturing a ferroelectric film having a structure formed as described above.
アクセプターを含む膜を形成する工程を含み、
前記ドナーを含む膜は、ドナーが高分子中に分散されて構成され、
前記アクセプターを含む膜は、アクセプターが高分子中に分散されて構成される、
前記ドナーを含む膜と、前記アクセプターを含む膜とが積層されて形成される強誘電体膜の製造方法。Forming a film containing a donor, and forming a film containing an acceptor,
The film containing the donor is configured by dispersing the donor in a polymer,
The film containing the acceptor is configured by dispersing the acceptor in a polymer.
A method of manufacturing a ferroelectric film formed by laminating a film containing the donor and a film containing the acceptor.
前記ドナーを含む膜および前記アクセプターを含む膜の少なくとも一方は、スピンコート法により形成される、強誘電体膜の製造方法。In either of claims 8 or 9 ,
At least one of the film | membrane containing the said donor and the film | membrane containing the said acceptor is a manufacturing method of the ferroelectric film formed by a spin coat method.
前記ドナーを含む膜および前記アクセプターを含む膜の少なくとも一方は、インクジェット法により形成される、強誘電体膜の製造方法。In either of claims 8 or 9 ,
At least one of the film | membrane containing the said donor and the film | membrane containing the said acceptor is a manufacturing method of the ferroelectric film formed by the inkjet method.
前記ドナーは、フルバレン骨格を有するドナー、メタロセン骨格を有するドナーおよびドナー性金属錯体の群から選択される少なくとも1種である、強誘電体膜の製造方法。In any of the claims 8-10,
The method for producing a ferroelectric film, wherein the donor is at least one selected from the group consisting of a donor having a fulvalene skeleton, a donor having a metallocene skeleton, and a donor metal complex.
前記アクセプターは、キノン骨格を有するアクセプター、フラーレン系化合物およびアクセプター性金属錯体の群から選択される少なくとも1種である、強誘電体膜の製造方法。In any of the claims 8-12,
The method for producing a ferroelectric film, wherein the acceptor is at least one selected from the group consisting of an acceptor having a quinone skeleton, a fullerene compound, and an acceptor metal complex.
前記強誘電体膜は、前記ドナーを含む膜を複数有し、かつ、前記アクセプターを含む膜を複数有し、
前記ドナーを含む膜と、前記アクセプターを含む膜とは、交互に積層される、強誘電体膜の製造方法。In any of the claims 9-13,
The ferroelectric film has a plurality of films containing the donor and a plurality of films containing the acceptor,
The method of manufacturing a ferroelectric film, wherein the film including the donor and the film including the acceptor are alternately stacked.
前記高分子は、ポリメチルメタクリレート、ポリカーボネート、ポリアルボネート、ポリジアリルフタレート、ポリチオフェン、ポリカルバゾールおよびこれらの誘導体のうち少なくとも1種である、強誘電体膜の製造方法。In any one of claims 8-14,
The method for producing a ferroelectric film, wherein the polymer is at least one of polymethyl methacrylate, polycarbonate, polyalbonate, polydiallyl phthalate, polythiophene, polycarbazole, and derivatives thereof.
前記強誘電体膜は、少なくとも、前記第1電極と前記第2電極との間において、設けられている、強誘電体キャパシタ。Including the ferroelectric film according to claim 1, a first electrode, and a second electrode;
The ferroelectric capacitor, wherein the ferroelectric film is provided at least between the first electrode and the second electrode.
前記強誘電体キャパシタは、前記第1電極、前記強誘電体膜および前記第2電極が、順次積層されて構成されている、強誘電体キャパシタ。In claim 16 ,
The ferroelectric capacitor is a ferroelectric capacitor in which the first electrode, the ferroelectric film, and the second electrode are sequentially stacked.
前記ドナーを含む膜と、前記アクセプターを含む膜とが積層された、強誘電体キャパシタ。In claim 17 ,
A ferroelectric capacitor in which a film containing the donor and a film containing the acceptor are stacked.
前記強誘電体膜は、前記ドナーを含む膜を複数有し、かつ、前記アクセプターを含む膜を複数有し、
前記アクセプターを含む膜と、前記ドナーを含む膜とは、交互に積層されている、強誘電体キャパシタ。In claim 18 ,
The ferroelectric film has a plurality of films containing the donor and a plurality of films containing the acceptor,
The ferroelectric capacitor, wherein the film including the acceptor and the film including the donor are alternately stacked.
前記強誘電体キャパシタは、前記第1電極、前記強誘電体膜および前記第2電極が、基体の表面方向に沿って順次並んで構成されている、強誘電体キャパシタ。In claim 16 ,
The ferroelectric capacitor is a ferroelectric capacitor in which the first electrode, the ferroelectric film, and the second electrode are sequentially arranged along the surface direction of a substrate.
前記強誘電体キャパシタは、前記ドナーを含む膜および前記アクセプターを含む膜が、基体の表面方向に沿って順次並んで構成されている、強誘電体キャパシタ。In claim 20 ,
The ferroelectric capacitor is a ferroelectric capacitor in which a film containing the donor and a film containing the acceptor are sequentially arranged along the surface direction of the substrate.
前記強誘電体キャパシタは、第1信号電極と、該第1信号電極と交差する方向に配列された第2信号電極と、少なくとも前記第1信号電極と前記第2信号電極との交差領域に配置された強誘電体膜と、を含む、強誘電体メモリ装置。Memory cells comprising the ferroelectric capacitors according to any one of claims 16 to 19 are arranged in a matrix,
The ferroelectric capacitor is arranged in a first signal electrode, a second signal electrode arranged in a direction intersecting the first signal electrode, and at least an intersecting region of the first signal electrode and the second signal electrode. And a ferroelectric memory device.
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