JP4010358B2 - リレーラッチング回路 - Google Patents
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Description
【発明の属する技術分野】
本発明は、リレーラッチング回路に関し、特に、ラッチングリレーを用いることなく、トランジスタ、ダイオード及び抵抗を用いて簡単かつ安価にリレーオンをラッチングするための新規な改良に関する。
【０００２】
【従来の技術】
従来、用いられていたこの種のリレーラッチング方法としては、社内で用いていた構成であるため、その構成を示す特許文献及び非特許文献等は開示していないが、一般に、リレーに対して専用のリレーすなわち、ラッチングリレーを用いてリレー自体のラッチングを行っていた。
【０００３】
【発明が解決しようとする課題】
従来のリレーラッチング方法は、以上のように構成されているため、次のような課題が存在していた。
すなわち、リレーをラッチングするために、別に、専用のラッチングリレーを設けなければならず、機械的かつ電気的に複雑かつ大型化し、消費電力も大きくなり、各種電子装置を小型化するための大きい障害となっていた。
【０００４】
本発明は、以上のような課題を解決するためになされたもので、特に、ラッチングリレーを用いることなく、トランジスタ、ダイオード及び抵抗を用いて簡単かつ安価にリレーオンをラッチングするようにしたリレーラッチング回路を提供することを目的とする。
【０００５】
【課題を解決するための手段】
本発明によるリレーラッチング回路は、リレー駆動制御信号が入力され電源に接続されたフォトカプラと、前記フォトカプラ及び前記電源に接続された第１トランジスタと、前記第１トランジスタに接続された第２トランジスタと、前記第２トランジスタと前記電源との間に設けられたリレーと、前記第２トランジスタとグランドとの間に接続され互いに直列接続の一対のダイオードとからなり、前記リレー駆動制御信号の入力によって前記フォトカプラがオンとなると共に前記第２トランジスタがオンとなり、前記各ダイオードに電流が流れて前記リレーがオンし、前記第１トランジスタがオンすることによって前記第２トランジスタはオンのままとなるようにした構成である。
【０００６】
【発明の実施の形態】
以下、図面と共に本発明によるリレーラッチング回路の好適な実施の形態について説明する。
図１において符号１で示されるものは周知のフォトトランジスタ１ａとＬＥＤ１ｂとからなるフォトカプラであり、このフォトカプラ１にはリレー駆動制御信号２が入力されるように構成され、前記フォトトランジスタ１ａ及びＬＥＤ１ｂはグランドＧに接地されている。
【０００７】
前記フォトカプラ１には電源Ｖが抵抗Ｒ１を介して接続され、前記フォトカプラ１のフォトトランジスタ１ａには、第１トランジスタＱ１のコレクタＣ、抵抗Ｒ２及び第２トランジスタＱ２のベースＢが接続されている。
【０００８】
前記第１トランジスタＱ１のエミッタＥはグランドＧに接地され、そのベースＢは抵抗Ｒ３、Ｒ４を介して第２トランジスタＱ２のコレクタＣに接続され、このコレクタＣは互いに直列に接続された一対の第１、第２ダイオードＣＲ１、ＣＲ２を介してグランドＧに接地されている。
【０００９】
前記第２トランジスタＱ２のエミッタＥには、電源Ｖに接続された機械式のリレー１０が接続されている。
【００１０】
次に、動作について述べる。まず、リレー駆動制御信号２がフォトカプラ１に入力されることにより、このフォトカプラ１がオンとなり、第２トランジスタＱ２がオンとなる。
この第２トランジスタＱ２がオンとなることにより、各ダイオードＣＲ１、ＣＲ２に電流が流れ、第２トランジスタＱ２のコレクタＣと第１ダイオードＣＲ１との接続点Ａの電位が各ダイオードＣＲ１、ＣＲ２の順方向電圧の２倍となる。前述の状態で第１トランジスタＱ１がオンとなると共に前記第２トランジスタＱ２がオンのままとなる。
【００１１】
【発明の効果】
本発明によるリレーラッチング回路は、以上のように構成されているため、次のような効果を得ることができる。
すなわち、リレー駆動制御信号が入力されるフォトカプラとリレーとの間に、トランジスタとダイオードと抵抗からなるリレー保持回路が設けられているため、従来のように、リレーをラッチングするためのラッチングリレーを用いる必要がなく、ラッチング回路の簡略化、小型化及びコストダウンを達成することができる。
【図面の簡単な説明】
【図１】本発明によるリレーラッチング回路を示す回路図である。
【符号の説明】
１ フォトカプラ
２ リレー駆動制御信号
Ｖ 電源
Ｑ１ 第１トランジスタ
Ｑ２ 第２トランジスタ
Ｇ グランド
Ａ 接続点
１０ リレー
ＣＲ１、ＣＲ２ ダイオード
Claims (1)
- リレー駆動制御信号(2)が入力され電源(V)に接続されたフォトカプラ(1)と、前記フォトカプラ(1)及び前記電源(V)に接続された第１トランジスタ(Q1)と、前記第１トランジスタ(Q1)に接続された第２トランジスタ(Q2)と、前記第２トランジスタ(Q2)と前記電源(V)との間に設けられたリレー(10)と、前記第２トランジスタ(Q2)とグランド(G)との間に接続され互いに直列接続の一対のダイオード(CR1、CR2)とからなり、前記リレー駆動制御信号(2)の入力によって前記フォトカプラ(1)がオンとなると共に前記第２トランジスタ(Q2)がオンとなり、前記各ダイオード(CR1、CR2)に電流が流れて前記リレー(10)がオンし、前記第１トランジスタ(Q1)がオンすることによって前記第２トランジスタ(Q2)はオンのままとなるように構成したことを特徴とするリレーラッチング回路。
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| JP2003007446A JP4010358B2 (ja) | 2003-01-15 | 2003-01-15 | リレーラッチング回路 |
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| JP2003007446A JP4010358B2 (ja) | 2003-01-15 | 2003-01-15 | リレーラッチング回路 |
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| Publication Number | Publication Date |
|---|---|
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