JP3882848B2 - 液晶表示装置 - Google Patents
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Description
(全体構成)
図1Aは本発明の液晶表示装置の一実施形態の構成を示し、図1Bはアクティブマトリクス型液晶表示装置のおける画素部の構成を示す図である。
本実施形態は、データ線駆動回路200における動作に特徴があり、以下、具体的に説明する。
次に、図9および図10を用いて、図3に示される回路の動作を具体的に説明する。図9及び図10は、N=4,M=10の例を示している。図9は、シフトレジスタ220から並列に走る4つのパルスが定常的に出力されるようになるまで(その状態が図10に示される)の動作のうちの、初期段階の動作を示している。
、上述したように、「CL1」,「nCL1」は動作クロックであり、「SP」はスタートパルスである。図10においても同様である。
スが、ゲート回路240より同時に出力される(OUT1,OUT11,OUT21,OUT31)。以後、各パルスは相互の間隔を保ちながら同一方向に並列に走るようになり、4つのパルスが同時に出力される状態が定常的に実現される。
図11Aは比較例のデータ線駆動回路の構成を示す図であり、図11Bは図11Aの構成の問題点を示す図である。
図22A〜図22Eに、ドライバ部のTFTと、アクティブマトリクス部(画素部)のTFTとを同時に基板上に形成する場合の、製造プロセス(低温製造プロセス)の一例が示されている。本製造プロセスにより製造されるTFTは、ポリシリコンを用いた、LDD(Lightly Doped Drain)構造のTFTである。
本発明は、アナログ方式のドライバを用いたデータ線駆動回路のみならず、デジタルドライバを用いたデータ線駆動回路にも適用が可能である。
本発明の第3の実施形態の特徴が図19A,図19Bに示されている。第1の実施形態では、ゲート回路240をナンドゲートで構成していたが(図3)、本実施形態では、ゲート回路240を排他的論理和ゲート251で構成している。排他的論理和ゲート251は、シフトレジスタの隣接する2つの段の出力(a,b・・・)を入力とし、映像信号のサンプリングタイミングを決めるために使用されるパルス(X,Y,Z・・・)を出力する。
図13Aに本発明の第4の実施形態の要部構成が示される。
、一本のシフトレジスタの「第157段の出力」を示し、「OUT159」は、「第159番目のナンドゲートの出力」を示す。
図1に示す液晶表示装置は、データ線等の電気的特性の検査にも適している。すなわち、図15の上側に示すように、検査用信号の入力回路2000を設けることにより、データ線やアナログスイッチの周波数特性や、データ線の断線等を正確かつ高速に検出可能となる。
1つのスタートパルス(SP)を入力し、そのパルスを全段数に渡ってシフトさせれば、順次に1つのパルスが発生し、各選択期間毎に1つのスタートパルス(SP)を入力すれば、図10に示すように、複数のパルスを同時に発生させることができる。
ドライバ214(図8の構成と同一である)を設けてもよい。この場合、デジタルドライバ214は、本来のデータ線を駆動するという働きの他に、検査用信号の入力回路としても機能することになる。
220 シフトレジスタ、 222〜226,242〜246 ゲート回路、 240
ゲート回路、 251 排他的論理和ゲート、 261 アナログスイッチ、 300
画素部(アクティブマトリクス)、 350 TFT、 370 液晶素子、 410,414,416,440 MOSトランジスタ、 412 データ線容量、 418,504 インバータ、 420 ホールディングコンデンサ、 400 バッファ回路(ボルテージフォロワ)、502,506 クロックドインバータ、 1000 アナログ映像信号発生装置、 1100,1110 タイミングコントローラ、 1250 A/D変換回路、 1260 γ補正用ROM、 1270 データの組み替え回路、 1500 第1のラッチ、 1510 第2のラッチ、 1600 D/Aコンバータ、 2000 検査用信号の入力回路、 3000 対向基板、 3100 アクティブマトリクス基板、 4000 ガラス基板、 4100 絶縁膜、 4200a,4200b,4200c ポリシリコンアイランド4300 ゲート酸化膜、 4400a,4400b,4400c ゲート電極、 4500a,4500b マスク材、 4702 p型ソース・ドレイン領域、 4700,4900 n型ソース・ドレイン領域、 4800a,4800b マスク材、 5000 層間絶縁膜、 5001,5002,5004,5006,5008 金属電極、 6000 最終保護膜、 V1〜V4 映像信号、 SP スタートパルス、 CL1,nCL1 動作クロック、 t1,t2,t3,t4 時刻、 GP 走査線の選択パルス、 D(n) データ線、 S1〜S4 映像信号線、 SR シフトレジスタ、 S10 配線、 V1a〜V1d デジタル映像信号、 E,nE 出力イネーブル信号、 BL 水平帰線期間、 TG テストイネーブル信号、 TC 電源電圧
Claims (11)
- 複数の走査線と、
複数のデータ線と、
前記複数の走査線と前記複数のデータ線の交点に対応して液晶画素が形成されている液晶マトリクスと、
前記複数のデータ線の一端に接続されるアナログ駆動回路である第1のデータ線駆動回路と、
前記複数のデータ線の他端に接続されるデジタル駆動回路である第2のデータ線駆動回路と、
前記第1のデータ線駆動回路に複数のアナログ映像信号を供給する複数のアナログ映像信号線と、
前記第2のデータ線駆動回路にデジタル映像信号を供給するデジタル映像信号線と、を有し、
前記第1のデータ線駆動回路が前記複数のデータ線の一部を同時に駆動するものであり、第1のシフトレジスタと、前記アナログ映像信号線に電気的に接続され、前記第1のシフトレジスタからの複数の出力により前記複数のアナログ映像信号の一部を前記複数のデータ線の一部に同時に出力する複数のスイッチと、を含み、
前記第2のデータ線駆動回路が前記複数のデータ線の全部を同時に駆動するものであり、第2のシフトレジスタと、前記デジタル映像信号線に電気的に接続され、前記第2のシフトレジスタからの出力により前記デジタル映像信号を取り込む回路と、前記デジタル映像信号を取り込む回路から出力された前記デジタル映像信号をアナログ信号に変換して前記データ線の全部に同時に出力するD/Aコンバータと、を含むことを特徴とする液晶表示装置。 - 複数の走査線と、
複数のデータ線と、
前記複数の走査線と前記複数のデータ線の交点に対応して液晶画素が形成されている液晶マトリクスと、
前記複数のデータ線の一端に接続されるアナログ駆動回路である第1のデータ線駆動回路と、
前記複数のデータ線の他端に接続されるデジタル駆動回路である第2のデータ線駆動回路と、
前記第1のデータ線駆動回路に複数のアナログ映像信号を供給する複数のアナログ映像信号線と、
前記第2のデータ線駆動回路にデジタル映像信号を供給するデジタル映像信号線と、を有し、
前記第1のデータ線駆動回路が前記複数のデータ線の一部を同時に駆動するものであり、第1のシフトレジスタと、前記アナログ映像信号線に電気的に接続され、前記第1のシフトレジスタからの複数の出力により前記複数のアナログ映像信号の一部を前記複数のデータ線の一部に同時に出力する複数のスイッチと、を含み、
前記第2のデータ線駆動回路が点順次駆動方式であり、第2のシフトレジスタと、前記デジタル映像信号線に電気的に接続され、前記第2のシフトレジスタからの出力により前記デジタル映像信号を取り込む回路と、前記デジタル映像信号を取り込む回路から出力された前記デジタル映像信号をアナログ信号に変換して前記複数のデータ線の各々に出力するD/Aコンバータと、を含むことを特徴とする液晶表示装置。 - 複数の走査線と、
複数のデータ線と、
前記複数の走査線と前記複数のデータ線の交点に対応して液晶画素が形成されている液晶マトリクスと、
前記複数のデータ線の一端に接続されるアナログ駆動回路である第1のデータ線駆動回路と、
前記複数のデータ線の他端に接続されるデジタル駆動回路である第2のデータ線駆動回路と、
前記第1のデータ線駆動回路に複数のアナログ映像信号を供給する複数のアナログ映像信号線と、
前記第2のデータ線駆動回路にデジタル映像信号を供給するデジタル映像信号線と、を有し、
前記第1のデータ線駆動回路が前記複数のデータ線の一部を同時に駆動するものであり、第1のシフトレジスタと、前記第1のシフトレジスタに電気的に接続された複数の第1の第1のゲート回路と、前記アナログ映像信号線に電気的に接続され、複数の第1の第1のゲート回路からの複数の出力により前記複数のアナログ映像信号の一部を前記複数のデータ線の一部に同時に出力する複数のスイッチと、を含み、
前記第2のデータ線駆動回路が前記複数のデータ線の全部を同時に駆動するものであり、第2のシフトレジスタと、前記デジタル映像信号線に電気的に接続され、前記第2のシフトレジスタからの出力により前記デジタル映像信号を取り込む回路と、前記デジタル映像信号を取り込む回路から出力された前記デジタル映像信号をアナログ信号に変換して前記データ線の全部に同時に出力するD/Aコンバータと、を含むことを特徴とする液晶表示装置。 - 複数の走査線と、
複数のデータ線と、
前記複数の走査線と前記複数のデータ線の交点に対応して液晶画素が形成されている液晶マトリクスと、
前記複数のデータ線の一端に接続されるアナログ駆動回路である第1のデータ線駆動回路と、
前記複数のデータ線の他端に接続されるデジタル駆動回路である第2のデータ線駆動回路と、
前記第1のデータ線駆動回路に複数のアナログ映像信号を供給する複数のアナログ映像信号線と、
前記第2のデータ線駆動回路にデジタル映像信号を供給するデジタル映像信号線と、を有し、
前記第1のデータ線駆動回路が前記複数のデータ線の一部を同時に駆動するものであり、第1のシフトレジスタと、前記第1のシフトレジスタに電気的に接続された複数の第1の第1のゲート回路と、前記アナログ映像信号線に電気的に接続され、前記複数の第1の第1のゲート回路からの複数の出力により前記複数のアナログ映像信号の一部を前記複数のデータ線の一部に同時に出力する複数のスイッチと、を含み、
前記第2のデータ線駆動回路が点順次駆動方式であり、第2のシフトレジスタと、前記デジタル映像信号線に電気的に接続され、前記第2のシフトレジスタからの出力により前記デジタル映像信号を取り込む回路と、前記デジタル映像信号を取り込む回路から出力された前記デジタル映像信号をアナログ信号に変換して前記複数のデータ線の各々に出力するD/Aコンバータと、を含むことを特徴とする液晶表示装置。 - 請求項1に記載の液晶表示装置において、
前記第2のデータ線駆動回路が線順次駆動方式である、液晶表示装置。 - 請求項5に記載の液晶表示装置において、
前記デジタル映像信号を取り込む回路が複数のラッチである、液晶表示装置。 - 請求項5に記載の液晶表示装置において、
前記デジタル映像信号を取り込む回路が、複数の第1のラッチと、前記複数の第1のラッチに電気的に接続される複数の第2のラッチとを含み、前記複数の第1のラッチが前記デジタル映像信号線に電気的に接続され、前記第2のシフトレジスタからの出力により前記デジタル映像信号を取り込み、前記複数の第2のラッチが前記デジタル映像信号を前記D/Aコンバータに出力するものである、液晶表示装置。 - 請求項1ないし7のいずれかに記載の液晶表示装置において、
前記複数の走査線と前記複数のデータ線の交差に対応して複数のトランジスタが形成されている、液晶表示装置。 - 請求項3または4に記載の液晶表示装置において、
前記第1のゲート回路がNANDゲートである、液晶表示装置。 - 請求項3または4に記載の液晶表示装置において、
前記第1のゲート回路が排他的論理和ゲートであり、前記複数の第1のゲート回路の各々が前記第1のシフトレジスタと電気的に接続され、前記第1のゲート回路の各々が前記第1のシフトレジスタからのふたつの出力を入力し、前記第1のゲート回路からの複数の出力が前記複数の第1のスイッチに入力される、液晶表示装置。 - 請求項3または4に記載の液晶表示装置において、
前記第2のデータ線駆動回路が複数の第2のゲート回路を含み、前記複数の第2のゲート回路の各々が前記第2のシフトレジスタと電気的に接続され、前記第2のゲート回路の各々が前記第2のシフトレジスタからのふたつの出力を入力し、前記第2のゲート回路からの複数の出力が前記複数の第2のスイッチに入力される、液晶表示装置。
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