JP2006126870A - 液晶表示装置 - Google Patents
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Abstract
【解決手段】 走査線Lとデータ線Dの交点に対応して液晶表示画素が形成されている液晶表示マトリックス300と、走査線を駆動する走査線駆動回路101,102と、データ線を駆動するデータ線駆動回路212とを有する液晶表示装置である。データ線駆動回路は、複数段を備えるシフトレジスタ220と、データ線の各々の第1の端側に対応して設けられ、シフトレジスタの出力に応じて映像信号をサンプリングするための複数のスイッチ回路261とを有し、データ線の各々の第2の端側には線順次デジタルドライバ214を有し、データ線駆動回路212は、アナログ映像信号に基づいてデータ線を駆動し、線順次デジタルドライバ214は、デジタル映像信号に基づいて前記データ線を駆動する。
【選択図】 図20
Description
シフトレジスタの出力信号を、アナログドライバにおける映像信号のサンプリングタイミングを決めるために使用すれば、高速なデータ線の駆動が実現される。したがって、液晶表示マトリクスの駆動回路をTFTで構成した場合でも、消費電力を増大させずに、駆動回路の高速動作が可能となる。
(全体構成)
図1Aは本発明の液晶表示装置の一実施形態の構成を示し、図1Bはアクティブマトリクス型液晶表示装置のおける画素部の構成を示す図である。
本実施形態は、データ線駆動回路200における動作に特徴があり、以下、具体的に説明する。
次に、図9および図10を用いて、図3に示される回路の動作を具体的に説明する。図9及び図10は、N=4,M=10の例を示している。図9は、シフトレジスタ220から並列に走る4つのパルスが定常的に出力されるようになるまで(その状態が図10に示される)の動作のうちの、初期段階の動作を示している。
、上述したように、「CL1」,「nCL1」は動作クロックであり、「SP」はスタートパルスである。図10においても同様である。
スが、ゲート回路240より同時に出力される(OUT1,OUT11,OUT21,OUT31)。以後、各パルスは相互の間隔を保ちながら同一方向に並列に走るようになり、4つのパルスが同時に出力される状態が定常的に実現される。
図11Aは比較例のデータ線駆動回路の構成を示す図であり、図11Bは図11Aの構成の問題点を示す図である。
図22A〜図22Eに、ドライバ部のTFTと、アクティブマトリクス部(画素部)のTFTとを同時に基板上に形成する場合の、製造プロセス(低温製造プロセス)の一例が示されている。本製造プロセスにより製造されるTFTは、ポリシリコンを用いた、LDD(Lightly Doped Drain)構造のTFTである。
本発明は、アナログ方式のドライバを用いたデータ線駆動回路のみならず、デジタルドライバを用いたデータ線駆動回路にも適用が可能である。
本発明の第3の実施形態の特徴が図19A,図19Bに示されている。第1の実施形態では、ゲート回路240をナンドゲートで構成していたが(図3)、本実施形態では、ゲート回路240を排他的論理和ゲート251で構成している。排他的論理和ゲート251は、シフトレジスタの隣接する2つの段の出力(a,b・・・)を入力とし、映像信号のサンプリングタイミングを決めるために使用されるパルス(X,Y,Z・・・)を出力する。
図13Aに本発明の第4の実施形態の要部構成が示される。
、一本のシフトレジスタの「第157段の出力」を示し、「OUT159」は、「第159番目のナンドゲートの出力」を示す。
図1に示す液晶表示装置は、データ線等の電気的特性の検査にも適している。すなわち、図15の上側に示すように、検査用信号の入力回路2000を設けることにより、データ線やアナログスイッチの周波数特性や、データ線の断線等を正確かつ高速に検出可能となる。
1つのスタートパルス(SP)を入力し、そのパルスを全段数に渡ってシフトさせれば、順次に1つのパルスが発生し、各選択期間毎に1つのスタートパルス(SP)を入力すれば、図10に示すように、複数のパルスを同時に発生させることができる。
ドライバ214(図8の構成と同一である)を設けてもよい。この場合、デジタルドライバ214は、本来のデータ線を駆動するという働きの他に、検査用信号の入力回路としても機能することになる。
220 シフトレジスタ、 222〜226,242〜246 ゲート回路、 240
ゲート回路、 251 排他的論理和ゲート、 261 アナログスイッチ、 300
画素部(アクティブマトリクス)、 350 TFT、 370 液晶素子、 410,414,416,440 MOSトランジスタ、 412 データ線容量、 418,504 インバータ、 420 ホールディングコンデンサ、 400 バッファ回路(ボルテージフォロワ)、502,506 クロックドインバータ、 1000 アナログ映像信号発生装置、 1100,1110 タイミングコントローラ、 1250 A/D変換回路、 1260 γ補正用ROM、 1270 データの組み替え回路、 1500 第1のラッチ、 1510 第2のラッチ、 1600 D/Aコンバータ、 2000 検査用信号の入力回路、 3000 対向基板、 3100 アクティブマトリクス基板、 4000 ガラス基板、 4100 絶縁膜、 4200a,4200b,4200c ポリシリコンアイランド4300 ゲート酸化膜、 4400a,4400b,4400c ゲート電極、 4500a,4500b マスク材、 4702 p型ソース・ドレイン領域、 4700,4900 n型ソース・ドレイン領域、 4800a,4800b マスク材、 5000 層間絶縁膜、 5001,5002,5004,5006,5008 金属電極、 6000 最終保護膜、 V1〜V4 映像信号、 SP スタートパルス、 CL1,nCL1 動作クロック、 t1,t2,t3,t4 時刻、 GP 走査線の選択パルス、 D(n) データ線、 S1〜S4 映像信号線、 SR シフトレジスタ、 S10 配線、 V1a〜V1d デジタル映像信号、 E,nE 出力イネーブル信号、 BL 水平帰線期間、 TG テストイネーブル信号、 TC 電源電圧
Claims (2)
- 走査線とデータ線の交点に対応して液晶表示画素が形成されている液晶表示マトリックスと、前記走査線を駆動する走査線駆動回路と、前記データ線を駆動するデータ線駆動回路と、を有する液晶表示装置において、
前記データ線駆動回路は、
複数段を備えるシフトレジスタと、
前記データ線の各々の第1の端側に対応して設けられ、前記シフトレジスタの出力に応じて映像信号をサンプリングするための複数のスイッチ回路と、
を有し、
前記データ線の各々の第2の端側には線順次デジタルドライバを有し、
前記データ線駆動回路は、アナログ映像信号に基づいて前記データ線を駆動し、前記線順次デジタルドライバは、デジタル映像信号に基づいて前記データ線を駆動することを特徴とする液晶表示装置。 - 前記線順次デジタルドライバは、
デジタル映像信号を取り込んで一時的に記憶する第1のラッチと、
前記第1のラッチの各ビットのデジタルデータを一括して取り込んで一時的に記憶する第2のラッチと、
前記第2のラッチの各ビットのデジタルデータを同時にアナログ信号に変換し、前記データ線を同時に駆動するD/Aコンバータと、
を有し、
前記線順次デジタルドライバを検査用の信号の入力回路として用いて、前記D/Aコンバータより検査用の信号を前記データ線に供給すること特徴とする請求項1記載の液晶表示装置。
Priority Applications (1)
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2006
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