JP3612985B2 - Gallium nitride compound semiconductor device and manufacturing method thereof - Google Patents
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Description
【0001】
【発明の属する技術分野】
本発明は、基板上に窒化ガリウム系化合物半導体から成る層が積層された発光素子及びその製造方法に関し、特にその発光出力を大きくする構造を持つ発光素子及びその製造方法に関する。
【0002】
【従来の技術】
図3に従来の技術により製造された窒化ガリウム系化合物半導体から成る発光素子の断面図を示す。本素子100は、ダブルヘテロ型の青色LEDであり、有機金属気相成長法(以下「MOVPE」と略す)により製造されたものである。
図3に示すように、本素子100は、サファイヤ基板10、AlNバッファ層11、n型GaNクラッド層12、GaInN活性層13、p型AlGaNクラッド層14、p型GaNコンタクト層15、正電極16A、負電極16B、電極パッド17より構成されている。
【0003】
【発明が解決しようとする課題】
例えば、光を放出する活性層がGaInNにより形成されている従来のダブルヘテロ型のLEDでは、図3のGaInN活性層13のInモル分率を減少させることにより、発光波長を紫外に近づけるにつれて、素子100の発光出力が減少していた。これは、MOVPEによるダブルヘテロ型のLED製造時には、GaInN活性層13内に発光出力を維持する上で望ましくない応力が発生し易く、Inがこの時の歪みを緩和しこの応力を抑制する役割を果たしているためだと考えられる。即ち、素子100は、この歪みを緩和するInの減少により、InGaN活性層13内に存在する発光に直接寄与する電子の局在準位が形成されにくくなるために、発光出力を維持することができないものと思われる。
【0004】
本発明は、上記の課題を解決するために成されたものであり、その目的は、発光波長を紫外に近づけても発光出力を維持することができる構造を持つ発光素子を提供することである。
【0005】
【課題を解決するための手段】
第1の手段は、基板上に窒化ガリウム系化合物半導体から成る層が積層された発光素子において、光を放出する活性層を含む前記基板から前記活性層までの少なくとも一つの層に、前記基板上に成長する層の結晶構造上の歪みを緩和するためのピットが形成された、厚さが3000Åから6000Åの歪み緩和層を設けることである。
また、第2の手段は、第1の手段の歪み緩和層を不純物が添加された層により構成することである。
また、第3の手段は、活性層をGax In1-x N(0≦x≦1)で形成された層により構成することである。
【0006】
また、上記の構造を持つ窒化ガリウム系化合物半導体素子の製造方法としては、以下の手段がある。
即ち、第4の手段は、光を放出する活性層を含む前記基板から前記活性層までの少なくとも一つの層として、第1の所定の温度から第2の所定の温度にまで積層温度を降下させることにより、ピットが形成された、厚さが3000Åから6000Åの歪み緩和層を積層させる方法である。
また、第5の手段は、第4の手段の歪み緩和層をケイ素をドーピングしたn型の窒化ガリウムにより形成する方法である。
また、第6の手段は、上記の第1の所定の温度を1000℃から1150℃とする方法である。
また、第7の手段は、上記の第2の所定の温度を500℃から950℃とする方法である。
更に、第8の手段は、第4乃至第7のいずれか一つの手段において活性層の形成を歪み緩和層のピットが埋まって平らに成る前までに完了させることにより、活性層にもピットを形成する方法である。
更に、第9の手段は、第4乃至第8のいずれか一つの手段において活性層をGax In1-x N(0≦x≦1)を結晶成長させることにより形成する方法である。
以上の手段により、上記の課題を解決することができる。
【0007】
【作用および発明の効果】
ヘテロ成長の場合には、成長層に歪みが入りやすい。その歪みを活性層に至る前の層で緩和する歪み緩和層を設けることにより、活性層の結晶性を向上させることができる。この結果、発光素子の光出力を向上させる事が出来る。
例えば、図3に示す従来のMOVPEによるダブルヘテロ型のLED素子100は、GaInN活性層13内の発光出力を維持する上で望ましくない結晶構造上の歪みを緩和する役割を果たすInのモル分率が減少すると、GaInN活性層13内に存在する発光に直接寄与する電子の局在準位が形成されにくくなるために、発光出力を維持できないものと思われる。
そこで、例えば、第1図に示すように活性層23よりも下に、厚さが3000Åから6000Åの、ピットを持つ層を設け、その層の上に活性層を積層させることにした。これにより、活性層内に局所的に歪みの強弱ができるようになり、上記の歪みが緩和されるようになった。
以上の作用により、例えば、図1のGaInN活性層23におけるInのモル分率を減少させても、発光に直接寄与する電子の局在準位が形成されにくくならないため、発光出力が維持できるものと考えられる。
上記のピットは、歪み緩和層を500℃から950℃の低温領域で結晶成長させることにより、形成することができた。
また、前記第3の手段は、歪み緩和層に不純物を添加し電気伝導性を付与することにより、ピットの先端に静電気による高電界が形成されるのを防止するためのものであり、これにより歪み緩和層における絶縁破壊が防止され、本発光素子の寿命が維持できるようになる。
【0008】
【発明の実施の形態】
以下、本発明を具体的な実施例に基づいて説明する。
図1は、サファイア基板20上に形成されたGaN 系化合物半導体で形成された発光素子200の模式的な断面構成図である。基板20の上には窒化アルミニウム(AlN) から成る膜厚約200Åのバッファ層21が設けられ、その上にシリコン(Si)ドープのGaN から成る膜厚約4.0 μmの高キャリア濃度n+ 層22Aが形成されている。この高キャリア濃度n+ 層22Aの上にSiドープのn型GaN から成る膜厚約0.5 μmのクラッド層22Bが形成されている。
そして、クラッド層22Bの上に単一量子井戸構造(SQW)の中心となる膜厚約500Åの活性層23が形成されている。活性層23の上にはp型Al0.15Ga0.85N から成る膜厚約600Åのクラッド層24が形成されている。さらに、クラッド層24の上にはp型GaN から成る膜厚約1500Åのコンタクト層25が形成されている。
【0009】
又、コンタクト層25の上には金属蒸着による透光性の電極26Aが、n+ 層22A上には電極26Bが形成されている。透光性の電極26Aは、コンタクト層25に接合する膜厚約15Åのコバルト(Co)と、Coに接合する膜厚約60Åの金(Au)とで構成されている。電極26Bは膜厚約 200Åのバナジウム(V) と、膜厚約1.8 μmのアルミニウム(Al)又はAl合金で構成されている。電極26A上の一部には、CoもしくはNiとAu、Al、又は、それらの合金から成る膜厚約1.5 μmの電極パッド27が形成されている。
【0010】
次に、この発光素子200の製造方法について説明する。
上記発光素子200は、MOVPEによる気相成長により製造された。用いられたガスは、アンモニア(NH3) 、キャリアガス(H2,N2) 、トリメチルガリウム(Ga(CH3)3)(以下「TMG 」と記す)、トリメチルアルミニウム(Al(CH3)3)(以下「TMA 」と記す)、トリメチルインジウム(In(CH3)3)(以下「TMI 」と記す)、シラン(SiH4)とシクロペンタジエニルマグネシウム(Mg(C5H5)2) (以下「CP2Mg 」と記す)である。
まず、有機洗浄及び熱処理により洗浄したa面を主面とした単結晶の基板20をMOVPE 装置の反応室に載置されたサセプタに装着する。次に、常圧でH2を反応室に流しながら温度1150℃で基板20をベーキングした。
次に、基板20の温度を400 ℃まで低下させて、H2、NH3 及びTMA を供給してAlN のバッファ層21を約200Åの膜厚に形成した。
【0011】
次に、基板20の温度を1150℃にまで上げ、H2、NH3 、TMG 及びシランを供給し、膜厚約4.0 μm、電子濃度2 ×1018/cm3のシリコン(Si)ドープのGaN から成る高キャリア濃度n+ 層22Aを形成した。
次に、ピットを持つ歪み緩和層を形成した。即ち、基板20の温度を900℃にまで降下させ、N2又はH2、NH3 、TMG 及びシランを供給して、膜厚約0.5μm、電子濃度1×1018/cm3のシリコン(Si)ドープのGaNから成る、多数のピットを持つクラッド層22Bを形成した。このクラッド層22Bが歪み緩和層となる。
上記のクラッド層22Bを形成した後、結晶温度を850℃に降温し、N2又はH2、NH3 、TMG 及びTMI を供給して、膜厚約500ÅのGa0.8In0.2N から成る活性層23を形成した。本活性層23は、上記のクラッド層22Bが持つピットが埋まって、平らに成る前までに積層を完了させた。これにより、図1に示すように、本活性層23自身の上部にもピットを形成することができた。
【0012】
次に、基板20の温度を1000℃に昇温し、N2又はH2、NH3 、TMG 、TMA 及びCP2Mg を供給して、膜厚約50nm、マグネシウム(Mg)をドープしたp型Al0.15Ga0.85N から成るクラッド層24を形成した。
次に、基板20の温度を1000℃に保持し、N2又はH2、NH3 、TMG 及びCP2Mg を供給して、膜厚約100nm 、Mgをドープしたp型GaN から成るコンタクト層25を形成した。
次に、コンタクト層25の上にエッチングマスクを形成し、所定領域のマスクを除去して、マスクで覆われていない部分のコンタクト層25、クラッド層24、活性層23、クラッド層22B、n+ 層22Aの一部を塩素を含むガスによる反応性イオンエッチングによりエッチングして、n+ 層22Aの表面を露出させた。
次に、以下の手順で、n+ 層22Aに対する電極26Bと、コンタクト層25に対する透光性の電極26Aとを形成した。
【0013】
(1) フォトレジストを塗布し、フォトリソグラフィによりn+ 層22Aの露出面上の所定領域に窓を形成して、10−6Torrオーダ以下の高真空に排気した後、膜厚約 200Åのバナジウム(V) と膜厚約 1.8μmのAlを蒸着した。次に、フォトレジストを除去する。これによりn+ 層22Aの露出面上に電極26Bが形成される。
(2) 次に、表面上にフォトレジストを一様に塗布して、フォトリソグラフィにより、コンタクト層25の上の電極形成部分のフォトレジストを除去して、窓部を形成する。
(3) 蒸着装置にて、フォトレジスト及び露出させたコンタクト層25上に、10−6Torrオーダ以下の高真空に排気した後、膜厚約15ÅのCoを成膜し、このCo上に膜厚約60ÅのAuを成膜する。
【0014】
(4) 次に、試料を蒸着装置から取り出し、リフトオフ法によりフォトレジスト上に堆積したCo、Auを除去し、コンタクト層25上に透光性の電極26Aを形成する。
(5) 次に、透光性の電極26A上の一部にボンディング用の電極パッド27を形成するために、フォトレジストを一様に塗布して、その電極パッド27の形成部分のフォトレジストに窓を開ける。次に、CoもしくはNiとAu、Al、又は、それらの合金を膜厚1.5 μm程度に、蒸着により成膜させ、(4) の工程と同様に、リフトオフ法により、フォトレジスト上に堆積したCoもしくはNiとAu、Al、又はそれらの合金から成る膜を除去して、電極パッド27を形成する。
(6) その後、試料雰囲気を真空ポンプで排気し、O2ガスを供給して圧力 3Paとし、その状態で雰囲気温度を約 550℃にして、3 分程度、加熱し、コンタクト層25、クラッド層24をp型低抵抗化すると共にコンタクト層25と電極26Aとの合金化処理、n+ 層22Aと電極26Bとの合金化処理を行った。このようにして、発光素子200を形成した。
【0015】
図2に、窒化ガリウム系化合物半導体素子の活性層のフォトルミネセンス強度の波長特性を示した測定図を示す。グラフAは、本発明による発光素子200の活性層のフォトルミネセンス強度の波長特性を示した測定図であり、ピットが形成されたn型GaNクラッド層22Bの厚さは6000Å、成長温度は900℃のものを測定した。また、グラフBは、従来技術による発光素子の活性層のフォトルミネセンス強度の波長特性を示した測定図である。
本図より、本発明による窒化ガリウム系化合物半導体素子の発光強度が、従来のものよりも著しく増加していることが分かる。
【0016】
発光素子200の活性層23はSQW構造としたが、活性層の構造は、MQW構造でもよい。活性層、クラッド層、コンタクト層、その他の層は、任意の混晶比の4元、3元、2元系のAlx Gay In1−x−y N (0≦x≦1,0≦y≦1)としても良い。又、p型不純物としてMgを用いたがベリリウム(Be)、亜鉛(Zn)等の2族元素を用いることができる。
一般に、ピットを持つ歪み緩和層を形成するには、その層の通常の結晶成長温度よりも低温でその層を成長させればよく、窒化ガリウム系化合物半導体素子の場合、その低温領域は、500℃から950℃である。
また、上記の実施例では、クラッド層を歪み緩和層としたが、活性層23を成長させる初期段階でGa0.8In0.2N を低温成長させ、ピットを形成したのちに通常の成長温度に昇温して、活性層を形成する方法も考えられる。
また、クラッド層よりも下の層に、一般式Alx Gay In1−x−y N (0≦x≦1,0≦y≦1)で表される化合物を低温成長させてピットを形成して、歪み緩和層としてもよい。
ピット層の厚さは、約3000Åから6000Å程度が、最も適当な範囲であり、これよりも薄いと、活性層の歪みが緩和され難くなり、これよりも厚いと、活性層の結晶度が劣化する傾向にある。
【図面の簡単な説明】
【図1】本発明による窒化ガリウム系化合物半導体素子の断面図。
【図2】窒化ガリウム系化合物半導体素子の活性層のフォトルミネセンス強度の波長特性を示した測定図。
【図3】従来技術による窒化ガリウム系化合物半導体素子の断面図。
【符号の説明】
100,200…ダブルヘテロ型LED発光素子
10,20…サファイヤ基板
11,21…AlNバッファ層
12,22A…n型GaNクラッド層
22B…ピットが形成されたn型GaNクラッド層
13…GaInN活性層
23…ピットが形成されたGaInN活性層
14,24…p型AlGaNクラッド層
15,25…p型GaNコンタクト層
16A,26A…正電極
16B,26B…負電極
17,27…電極パッド[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a light emitting device in which a layer made of a gallium nitride compound semiconductor is stacked on a substrate and a method for manufacturing the same, and more particularly to a light emitting device having a structure for increasing the light output and a method for manufacturing the same.
[0002]
[Prior art]
FIG. 3 shows a cross-sectional view of a light emitting device made of a gallium nitride compound semiconductor manufactured by a conventional technique. The
As shown in FIG. 3, the
[0003]
[Problems to be solved by the invention]
For example, in a conventional double hetero-type LED in which an active layer that emits light is made of GaInN, by reducing the In mole fraction of the GaInN
[0004]
The present invention has been made to solve the above-described problems, and an object of the present invention is to provide a light-emitting element having a structure capable of maintaining a light emission output even when the light emission wavelength is made close to ultraviolet. .
[0005]
[Means for Solving the Problems]
In the light emitting device in which a layer made of a gallium nitride compound semiconductor is stacked on a substrate, the first means includes at least one layer from the substrate including the active layer that emits light to the active layer. And providing a strain relaxation layer having a thickness of 3000 to 6000 mm in which pits are formed to relieve strain on the crystal structure of the layer to be grown.
The second means is that the strain relaxation layer of the first means is constituted by a layer to which an impurity is added.
The third means is that the active layer is composed of a layer formed of Ga x In 1-x N (0 ≦ x ≦ 1).
[0006]
In addition, as a method for producing a gallium nitride compound semiconductor device having the above structure, there are the following means.
That is, the fourth means lowers the stacking temperature from the first predetermined temperature to the second predetermined temperature as at least one layer from the substrate including the active layer that emits light to the active layer. In this method, a strain relaxation layer having a thickness of 3000 to 6000 mm in which pits are formed is laminated.
The fifth means is a method of forming the strain relaxation layer of the fourth means with n-type gallium nitride doped with silicon.
The sixth means is a method of setting the first predetermined temperature from 1000 ° C. to 1150 ° C.
The seventh means is a method of setting the second predetermined temperature from 500 ° C. to 950 ° C.
Further, the eighth means completes the formation of the active layer in any one of the fourth to seventh means before the pits of the strain relaxation layer are filled and flattened, whereby pits are also formed in the active layer. It is a method of forming.
Further, the ninth means is a method in which the active layer is formed by crystal growth of Ga x In 1-x N (0 ≦ x ≦ 1) in any one of the fourth to eighth means.
The above-described problems can be solved by the above means.
[0007]
[Operation and effect of the invention]
In the case of hetero growth, the growth layer tends to be distorted. By providing a strain relaxation layer that relaxes the strain in the layer before reaching the active layer, the crystallinity of the active layer can be improved. As a result, the light output of the light emitting element can be improved.
For example, the conventional MOVPE double hetero-
Therefore, for example, as shown in FIG. 1, a layer having a pit having a thickness of 3000 to 6000 mm is provided below the
With the above operation, for example, even if the molar fraction of In in the GaInN
The above pits could be formed by crystal growth of the strain relaxation layer in a low temperature region of 500 ° C. to 950 ° C.
Further, the third means is to prevent the formation of a high electric field due to static electricity at the tip of the pit by adding an impurity to the strain relaxation layer to impart electrical conductivity. The dielectric breakdown in the strain relaxation layer is prevented, and the lifetime of the light emitting element can be maintained.
[0008]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, the present invention will be described based on specific examples.
FIG. 1 is a schematic cross-sectional configuration diagram of a
Then, an
[0009]
Further, a
[0010]
Next, a method for manufacturing the
The
First, the
Next, the temperature of the
[0011]
Next, the temperature of the
Next, a strain relaxation layer having pits was formed. That is, the temperature of the
After forming the
[0012]
Next, the temperature of the
Next, the temperature of the
Next, an etching mask is formed on the
Next, an
[0013]
(1) A photoresist is applied, a window is formed in a predetermined region on the exposed surface of the n + layer 22A by photolithography, and after evacuating to a high vacuum of the order of 10 −6 Torr or less, vanadium having a film thickness of about 200 mm (V) and Al having a film thickness of about 1.8 μm were deposited. Next, the photoresist is removed. As a result, an
(2) Next, a photoresist is uniformly applied on the surface, and the photoresist in the electrode formation portion on the
(3) After evacuating to a high vacuum of the order of 10 −6 Torr or less on the photoresist and the exposed
[0014]
(4) Next, the sample is taken out from the vapor deposition apparatus, Co and Au deposited on the photoresist are removed by a lift-off method, and a
(5) Next, in order to form a
(6) Thereafter, the sample atmosphere is evacuated with a vacuum pump, O 2 gas is supplied to a pressure of 3 Pa, and in this state, the atmosphere temperature is set to about 550 ° C., and heating is performed for about 3 minutes. 24 was reduced in p-type resistance, alloyed with the
[0015]
FIG. 2 is a measurement diagram showing the wavelength characteristics of the photoluminescence intensity of the active layer of the gallium nitride compound semiconductor device. Graph A is a measurement diagram showing the wavelength characteristics of the photoluminescence intensity of the active layer of the
From this figure, it can be seen that the emission intensity of the gallium nitride-based compound semiconductor device according to the present invention is remarkably increased as compared with the conventional one.
[0016]
Although the
In general, in order to form a strain relaxation layer having pits, the layer may be grown at a temperature lower than the normal crystal growth temperature of the layer. In the case of a gallium nitride compound semiconductor device, the low temperature region is 500 From 950 ° C to 950 ° C.
In the above embodiment, the cladding layer is a strain relaxation layer, but normal growth is performed after Ga 0.8 In 0.2 N is grown at a low temperature and pits are formed in the initial stage of growing the
Further, a compound represented by the general formula Al x Ga y In 1-xy N (0 ≦ x ≦ 1, 0 ≦ y ≦ 1) is grown at a low temperature below the cladding layer to form pits. And it is good also as a distortion relaxation layer.
The thickness of the pit layer is about 3000 to 6000 mm, which is the most appropriate range. If the thickness is smaller than this, the distortion of the active layer is difficult to be relaxed, and if it is thicker than this, the crystallinity of the active layer is deteriorated. Tend to.
[Brief description of the drawings]
FIG. 1 is a cross-sectional view of a gallium nitride compound semiconductor device according to the present invention.
FIG. 2 is a measurement diagram showing wavelength characteristics of photoluminescence intensity of an active layer of a gallium nitride-based compound semiconductor device.
FIG. 3 is a cross-sectional view of a conventional gallium nitride compound semiconductor device.
[Explanation of symbols]
DESCRIPTION OF SYMBOLS 100,200 ... Double hetero type | mold LED
Claims (9)
光を放出する活性層を含む前記基板から前記活性層までの少なくとも一つの層に、前記基板上に成長する層の結晶構造上の歪みを緩和するためのピットが形成された、厚さが3000Åから6000Åの歪み緩和層を設けたことを特徴とする窒化ガリウム系化合物半導体素子。In a light emitting device in which a layer made of a gallium nitride compound semiconductor is stacked on a substrate,
At least one layer from the substrate including the active layer that emits light to the active layer is formed with pits for relaxing distortion on the crystal structure of the layer grown on the substrate, and has a thickness of 3000 mm. A gallium nitride-based compound semiconductor device characterized in that a strain relaxation layer of 1 to 6000 mm is provided.
光を放出する活性層を含む前記基板から前記活性層までの少なくとも一つの層として、第1の所定の温度から第2の所定の温度にまで成長温度を降下させることにより、ピットが形成された、厚さが3000Åから6000Åの歪み緩和層を積層させることを特徴とする窒化ガリウム系化合物半導体素子の製造方法。A method of manufacturing a light emitting device in which a layer made of a gallium nitride compound semiconductor is stacked on a substrate,
Pits were formed by lowering the growth temperature from a first predetermined temperature to a second predetermined temperature as at least one layer from the substrate including the active layer that emits light to the active layer. A method of manufacturing a gallium nitride-based compound semiconductor device comprising laminating a strain relaxation layer having a thickness of 3000 to 6000 mm .
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