JP3605099B2 - 液晶表示装置のフリッカ抑止回路 - Google Patents
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Description
【発明の属する技術分野】
本発明は、液晶表示装置に係り、特に表示更新時に発生するフリッカの防止技術に関するものである。
【0002】
【従来の技術】
周波数分析方式パッシブソーナーにおいては、受信信号の周波数分析結果をLOFAR(Low Frequency Analyzing and Reco−rding)表示と呼ばれる記録方式で記録紙やCRT表示画面上に表示する手段が採用されていたが、表示装置技術の進展に伴い、液晶表示装置が用いられるようになってきている。
【0003】
この液晶表示装置はCRTに比べて大幅に小型、軽量化を図ることが可能である。また表示性能の点でも幾何学的歪みが少ないなどの他、著しく高画質化が進んでおり、今後の映像機器における表示装置の本命として大きく注目されている。
【0004】
しかしながら、液晶自体の応答特性の悪さから、液晶表示装置には応答速度が遅いといった潜在的な問題が存在している。すなわち、現状の液晶表示装置においては、その応答速度は画面の更新時間であるフレーム時間より長いということである。このことは結果として液晶表示装置の応答速度の遅れを起因として、動画表示の際の残像や、速く動く画像に対応できないなどの問題点が顕在化されていた。
【0005】
ここで、LOFAR表示は、例えば横軸を周波数軸とし、縦軸を経過時間とする周波数対経過時間の表示座標上に、分析結果である周波数スペクトルを表示する。この場合の信号強度は、液晶表示装置の表示画面上で輝度情報として表示される。この輝度情報は表示画面上では黒地に無数の白点が点在するように観測される。そして、このLOFAR表示は経過時間に応じて画面全体を更新するようにして観測する。
【0006】
前述したように、液晶表示装置においては、応答速度の遅れを起因として速く動く画像に対応できないという問題点があり、このことから、LOFAR表示を更新するとLOFAR表示のフレーム単位で輝度変化(以下、フリッカという。)が生じる。このフリッカは液晶表示装置の応答速度、すなわち輝度上昇時間と輝度減衰時間の差違により生じるものであることが知られている。
【0007】
つまり、輝度上昇時間が輝度減衰時間より遅い場合は、白点が黒地になっていくのが、黒地から白点になっていくのに比較して速いために、画面全域における全体の輝度変化がフレーム単位で一旦暗くなってから、また明るくなっていくように観測されるのである。
【0008】
WO 99/54865は、前述のフリッカを解決する方法を提供している。このフリッカ解決方法は、液晶表示装置の輝度上昇時間と輝度減衰時間の相違を一致させるために、輝度減衰時間が輝度減衰時間に比較して遅いことに着目して、輝度減衰波形のみに補正を加える方法である。すなわち、輝度減衰波形のフレーム時間単位での補正を行い形状、振幅が等しく傾きが逆になるような波形を得るようにして、輝度上昇の波形と同様にするようにしていた。こうすることによって、輝度上昇時間と輝度減衰時間が同等となり、フリッカが起こりづらくなるからである。
【0009】
【発明が解決しようとする課題】
しかしながら、近年液晶表示装置においても応答速度の改善を図ってきており、1〜2フレーム時間で輝度変化が可能なように輝度上昇時間と輝度減衰時間が短くなってきている。そのため前述のWO 99/54865が開示するような輝度減衰波形のみのフレーム時間単位での補正では、形状、振幅が等しく傾きが逆にするような輝度上昇波形と輝度減衰波形を得ることができなくなってきた。なぜなら、この技術が有効であるためには、少なくとも輝度上昇時間と輝度減衰時間が数フレーム時間必要だからである。このため従来どおり画面全域での合成輝度にはフレーム周期のフリッカが出現するという欠点が出てきた。
【0010】
前述のWO 99/54865には、補正周期をフレーム周期の整数倍とする旨の記述があるが、ビデオインタフェース機能を有する一般的な液晶表示装置では、入力するビデオ信号のフレーム周期を変更することはできないため、特殊なインタフェース回路を具備する液晶表示装置が必要になるという欠点もある。しかも、その技術内容については明細書中に具体的に開示されておらず、いかなる技術であるか不明であり、適用効果についても明確ではない。
本発明は、上記課題を解決するためになされたもので、液晶表示装置の輝度上昇波形と輝度減衰波形の両方を数フレームで変化する傾きの緩やかな応答波形とすることによりフリッカを発生させなくする液晶表示装置のフリッカ抑止回路を提供することを目的とする。
【0011】
【課題を解決するための手段】
本発明になる液晶表示装置のフリッカ抑止回路は、液晶表示装置の輝度応答時間をもとに輝度変化を緩やかにするための第1輝度変化検出閾値C1および第2輝度変化検出閾値C2と液晶表示装置に表示される映像を目視してフリッカが観測されないようなビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2とを設定する設定部と、演算部からの演算結果である1フレーム分の画像を記憶するフレームメモリと、現在のフレームの画素の輝度Aとこのフレームメモリから読み出される1フレーム前の対応する画素の輝度Bと、前記ビデオ信号の上昇時間T1、ビデオ信号の減衰時間T2、第1の輝度変化検出閾値C1および第2の輝度変化検出閾値C2とをもとに、
(A−B)>C1の場合には{B+(A−B)×T1}の演算結果を出力し、
(B−A)>C2の場合には{B+(A−B)×T2}の演算結果を出力し、
その他の場合には演算を行わずにAをそのまま出力する前記演算部とを有することを特徴とするものである。
【0012】
【作用】
本発明によれば、課題を解決する手段で述べたように、現在の画素の輝度Aと前フレームの対応する画素の輝度Bとの間に一定値以上の差違がある場合にはその中間値をその画素の輝度とし、それ以外の場合は現在の画素の輝度をその画素の輝度とすることにしたので、各画素の輝度上昇および輝度減衰は数フレーム期間で変化する傾きの緩やかな応答となるから、フレーム周期でのフリッカの発生は抑止される。
【0013】
【発明の実施の形態】
以下、本発明につき図面を参照して詳細に説明する。
図1は本発明の1実施形態を示す液晶表示装置のフリッカ抑止回路のブロック図である。
図1において、1は液晶表示装置に表示するアナログビデオ信号をデジタルビデオ信号に変換するビデオA/D変換部、2は液晶表示装置の輝度応答時間をもとに輝度変化を緩やかにするための第1輝度変化検出閾値C1および第2輝度変化検出閾値C2と液晶表示装置に表示される映像を目視してフリッカが観測されないようなビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2とを設定する設定部、3は演算部からの演算結果である1フレーム分の画像を記憶するフレームメモリである。
【0014】
4はフレームメモリ3から読み出される1フレーム前の画素の輝度Bと現在のフレームの対応する画素の輝度Aと、前記ビデオ信号の上昇時間T1、ビデオ信号の減衰時間T2、第1の輝度変化検出閾値C1および第2の輝度変化検出閾値C2とをもとに、(A−B)>C1の場合には{B+(A−B)×T1}の演算結果を出力し、(B−A)>C2の場合には{B+(A−B)×T2}の演算結果を出力し、その他の場合には演算を行わずにAをそのまま出力する演算部、5は演算部4からの演算結果を入力して液晶表示装置に表示可能なアナログビデオ信号に変換するビデオD/A変換部である。
【0015】
次にこのフリッカ抑止回路の動作について説明する。
まず、設定部2で輝度変化を緩やかにするための第1輝度変化検出閾値C1および第2輝度変化検出閾値C2、目視してフリッカが観測されないようなビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2として適当な初期値を設定し、演算部4に送出する。
【0016】
アナログ信号であるビデオ信号がビデオA/D変換部1に入力され、ここでデジタルビデオ信号に変換され、輝度Aとして演算部4の一方の入力端に入力される。演算部4のもう一方の入力端には、フレームメモリ3からタイミングを合わせて読み出される前フレームの対応する画素の輝度Bが入力され、前述した演算処理を受けてその結果がその画素の輝度Cとして出力される。
【0017】
この演算結果はフレームメモリ3とビデオD/A変換部5に入力され、フレームメモリ3では次のフレームの演算用のデータとして記憶され、ビデオD/A変換部5では液晶表示装置(図示せず。)に表示可能なようにアナログ信号であるビデオ信号に変換される。
このようにしてビデオ信号が液晶表示装置に表示されるのである。ここで、最初は初期値として設定されたビデオ信号の上昇時間とビデオ信号の減衰時間を、この表示画像を目視してフリッカが観測されないように再度設定し直すのである。こうしてフリッカの発生しない液晶表示装置への画像表示が可能となるのである。
【0018】
次に、ビデオ信号の輝度が上昇する場合、減衰する場合に分けてフリッカ抑止動作について説明する。
【0019】
最初にビデオ信号の輝度が上昇する場合について説明する。
簡単のために、輝度が最低である黒から輝度が最高である白に輝度が上昇する場合を例にとって説明する。
前述したように、演算部4にはパラメータとしてビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2と、第1輝度変化検出閾値C1、第2の輝度変化検出閾値C2が設定されている。また、演算機能ブロックとして、(A−B)>C1の場合には{B+(A−B)×T1}の演算結果を出力し、(B−A)>C2の場合には{B+(A−B)×T2}の演算結果を出力し、その他の場合には演算を行わずにAをそのまま出力する演算機能ブロックが組み込まれている。
【0020】
最初のフレームでは、まだ輝度が最低の黒であるから、フレームメモリ3にはその画素輝度が「0」となっている。ここで次のフレームでその画素が輝度が最高の白となったとする。こうなると、輝度Aは最高輝度であり、輝度Bは最低輝度であるから、(A−B)>C1が成立するので演算結果は{B+(A−B)×T1}となり、この演算結果がフレームメモリ3に記憶されるとともに、ビデオD/A変換部5を介して液晶表示装置に表示される。
【0021】
この演算は(A−B)>C1が成立しなくなるフレームまで繰り返され、その間演算部4からの演算結果はフレーム単位で緩やかに増加していく。そして、(A−B)>C1が成立しなくなると、その画素の輝度としてそのフレームの画素の輝度がそのまま出力されるので、最終的には最高輝度が液晶表示装置に表示される。
【0022】
次にビデオ信号の輝度が減衰する場合について説明する。
簡単のために、輝度が最高である白から輝度が最低である黒に輝度が減衰する場合を例にとって説明する。
前述したように、演算部4にはパラメータとしてビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2と、第1輝度変化検出閾値C1、第2の輝度変化検出閾値C2が設定されている。また、演算機能ブロックとして、(A−B)>C1の場合には{B+(A−B)×T1}の演算結果を出力し、(B−A)>C2の場合には{B+(A−B)×T2}の演算結果を出力し、その他の場合には演算を行わずにAをそのまま出力する演算機能ブロックが組み込まれている。
【0023】
最初のフレームでは、まだ輝度が最高の白であるから、フレームメモリ3にはその画素輝度が「FF(8ビットの場合)」となっている。ここで次のフレームでその画素が輝度が最低の黒となったとする。こうなると、輝度Aは最低輝度であり、輝度Bは最高輝度であるから、(B−A)>C2が成立するので演算結果は{B+(A−B)×T2}となり、この演算結果がフレームメモリ3に記憶されるとともに、ビデオD/A変換部5を介して液晶表示装置に表示される。
【0024】
この演算は(B−A)>C2が成立しなくなるフレームまで繰り返され、その間演算部4からの演算結果はフレーム単位で緩やかに減衰していく。そして、(B−A)>C2が成立しなくなると、その画素の輝度としてそのフレームの画素の輝度がそのまま出力されるので、最終的には最低輝度が液晶表示装置に表示される。
【0025】
以上説明したように、ビデオ信号の輝度が上昇するときでも、減衰するときでもフレーム単位で緩やかな応答となる。そして、フリッカが観測されないようにビデオ信号の上昇時間T1とビデオ信号の減衰時間T2を設定部2から設定しているので、液晶表示装置へ出力されるフレーム単位でのビデオ信号の輝度上昇曲線と輝度減衰曲線は形状、振幅が同じで傾きが反対となるからフリッカの発生が抑止される。
【0026】
【発明の効果】
本発明によれば、以上説明したように、現在の画素の輝度Aと前フレームの対応する画素の輝度Bとの間に一定値以上の差違がある場合にはその中間値をその画素の輝度とし、それ以外の場合は現在の画素の輝度をその画素の輝度とすることにしたので、各画素の輝度上昇および輝度減衰は数フレーム期間で変化する傾きの緩やかな応答となるから、フレーム周期でのフリッカの発生は抑止される。従って応答速度が遅い液晶表示装置を使用して画像を表示しても、輝度の安定した画像表示が可能となる。
【図面の簡単な説明】
【図1】本発明の1実施の形態を示す液晶表示装置のフリッカ抑止回路のブロック図である。
【符号の説明】
1 ビデオA/D変換部
2 設定部
3 フレームメモリ
4 演算部
5 ビデオD/A変換部
Claims (1)
- 液晶表示装置の輝度応答時間をもとに輝度変化を緩やかにするための第1輝度変化検出閾値C1および第2輝度変化検出閾値C2と液晶表示装置に表示される映像を目視してフリッカが観測されないようなビデオ信号の上昇時間T1およびビデオ信号の減衰時間T2とを設定する設定部と、
演算部からの演算結果である1フレーム分の画像を記憶するフレームメモリと、
現在のフレームの画素の輝度Aとこのフレームメモリから読み出される1フレーム前の対応する画素の輝度Bと、前記ビデオ信号の上昇時間T1、ビデオ信号の減衰時間T2、第1の輝度変化検出閾値C1および第2の輝度変化検出閾値C2とをもとに、
(A−B)>C1の場合には{B+(A−B)×T1}の演算結果を出力し、
(B−A)>C2の場合には{B+(A−B)×T2}の演算結果を出力し、
その他の場合には演算を行わずにAをそのまま出力する
前記演算部と
を有することを特徴とする液晶表示装置のフリッカ抑止回路。
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JP2002205159A JP3605099B2 (ja) | 2002-07-15 | 2002-07-15 | 液晶表示装置のフリッカ抑止回路 |
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