JP3534475B2 - Character framing device for karaoke - Google Patents
Character framing device for karaokeInfo
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- JP3534475B2 JP3534475B2 JP04650095A JP4650095A JP3534475B2 JP 3534475 B2 JP3534475 B2 JP 3534475B2 JP 04650095 A JP04650095 A JP 04650095A JP 4650095 A JP4650095 A JP 4650095A JP 3534475 B2 JP3534475 B2 JP 3534475B2
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- Reverberation, Karaoke And Other Acoustics (AREA)
Description
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、カラオケシステム、さ
らに詳しくいえばカラオケ装置の画面に表示される文字
を縁取りするカラオケ用文字縁取り装置に関する。
【０００２】
【従来の技術】近年、カラオケが盛んになり、カラオケ
装置が広く普及している。カラオケ装置のＣＲＴ画面に
は伴奏にしたがってテロップで歌詞が表示されるように
なっている。この画面上の歌詞は、通常の文字では目立
ちにくい等の理由から、文字を飾るために影を付けた
り、縁取りをしたりすること等が行われている。また、
背景画面と同じ色の文字を用いた場合、背景の中にしず
んで読取りが困難になることを回避するために縁取りが
行われる。
【０００３】
【発明が解決しようとする課題】従来は文字に縁取りを
する場合、ソフトウエアによって縁取り機能を実現して
いたため、文字データのほかに縁取りのためのデータを
予め持たねばならなかった。そのため、文字データに付
随するデータが多くなり、メモリを多く使わなければな
らないという欠点があった。本発明の目的は、上記欠点
を解決するもので、文字縁取りのためのデータを持つ必
要をなくし、ＲＡＭ等のメモリの容量を少なくすること
のできるカラオケ用文字縁取り装置を提供することにあ
る。
【０００４】
【課題を解決するための手段】前記目的を達成するため
に本発明によるカラオケ用文字縁取り装置は、 前記目
的を達成するために本発明によるカラオケ用文字縁取り
装置は、画面上に表示される文字に縁取りを行うための
文字縁取り装置において、文字データを格納するビデオ
ＲＡＭと、前記ビデオＲＡＭの文字データを構成する画
面をライン毎に読み出す際、前記画面の１つのラインの
アドレスに対し，前記１つのラインのアドレスの１つ下
のラインのアドレスおよび前記１つのラインのアドレス
の１つ上のラインのアドレ スを生成するアドレスカウン
タと、前記アドレスカウンタが出力するアドレスに従っ
て１ライン単位で読み出されるすべてのドットそれぞれ
に対し、そのドットを中心に１つ先のドットと１つ後の
ドットの連続する３つのドット情報と縁取り用データ生
成ラッチ回路の出力とを入力とするＯＲ回路群と、前記
ＯＲ回路群が出力するタイミングで前記ＯＲ回路群のそ
れぞれの出力をラッチする、多数の前記縁取り用データ
生成ラッチ回路よりなる縁取り用データ生成ラッチ回路
群と、前記縁取り用データ生成ラッチ回路群の出力をド
ットクロックによりシリースに出力し有効な文字データ
のドットに対し縁取りデータを出力する縁取り用シフト
レジスタと、前記ビデオＲＡＭの前記１つのラインを読
み出すタイミングで、前記ビデオＲＡＭより読み出され
る文字データをラッチする文字データ用ラッチ回路群
と、前記文字データ用ラッチ回路群の出力をドットクロ
ックによりシリースに出力し文字データのドット情報を
出力する文字データ用シフトレジスタとからなり、表示
される文字の最外郭を形成するドットの外側に縁取りを
行うデータを形成するように構成されている。
【０００５】
【作用】上記構成によれば、文字データに対応して縁取
りデータをメモリに持つ必要はなく、表示に際して縁取
りデータを得ることができる。
【０００６】
【実施例】以下、図面等を参照して本発明をさらに詳し
く説明する。図１（ａ）は、１６ドット×１６ドットで
構成される文字の一例を示す図である。この文字は文字
データのみで形成されており、縁取りはなされていな
い。図１（ｂ）は、縁取り文字２の例を示すもので、文
字部２ｂの最外郭部の外側に縁取り部２ａが形成されて
いる。従来では縁取り部２ａのデータがメモリに格納さ
れていた。
【０００７】図２は、文字データに対し縁取りすべき部
分を説明するための図である。ｂ0 ，ｂ1 ，ｂ2 ・・・
は横方向のドットに、ａ0 ，ａ1 ，ａ2 は縦方向のドッ
トにそれぞれ対応している。この例では、ｂ5 ａ3 ，ｂ
5 ａ4 ，ｂ6 ａ3 およびｂ6 ａ4 のドットに有効なデー
タがあり、ｂ4 ａ2 ，ｂ4 ａ3 ，ｂ4 ａ4 ，ｂ4 ａ5 ，
ｂ5 ａ2 ，ｂ5 ａ5，ｂ6 ａ2 ，ｂ6 ａ5 ，ｂ7 ａ2 ，
ｂ7 ａ3 ，ｂ7 ａ4 およびｂ7 ａ5 のドット部分が縁取
りすべき部分４である。有効なデータのラインをａ3 と
し、ｂ5 ａ3 の文字データのドットを中心とした場合、
１つ先を右，一つ手前を左とした場合の例を（ｂ）に示
してある。
【０００８】図３は、本発明によるカラオケ用文字縁取
り装置の実施例を示す回路ブロック図である。この実施
例は、１６ドット×１６ドットより構成される文字の縁
取りデータを作成する例であり、ビデオＲＡＭ５には１
６ドット×１６ドットの文字データが格納されている。
アドレスカウンタ１１は、読み出すべきラインのアドレ
スに対し、そのラインより１つ下のラインのアドレスと
１つ上のラインのアドレスを生成している。
【０００９】したがって、ビデオＲＡＭ５から読み出す
べきラインの１６ドット分のデータが並列データとして
読み出され、つぎに上記ラインより１つ下のラインの１
６ドット分のデータが，さらに上記ラインの１つ上のラ
インの１６ドット分のデータがそれぞれ並列データとし
て読み出される。この読み出し動作が縦方向に対し繰り
返される。すなわち、上記３ラインずつの読み出し動作
が文字を構成する画面１６×１６に対し行われる。
【００１０】最初に読み出した１ラインの１６ドットの
データは１６個のＯＲ回路６ａ，６ｂ・・・にそれぞれ
入力される。各ＯＲ回路は各ドットデータを中心に前後
のドット（右と左側のドット）の情報および対応の縁取
り用データ生成ラッチ回路７ａ，７ｂ・・・の出力をオ
ア入力としている。なお、ラインの先頭のドットのデー
タに対しては右側のドットデータは存在せず、また、ラ
インの末端のドットに対し左側のドットデータは存在し
ないので、１番目のＯＲ回路６ａと１６番目のＯＲ回路
６ｐの入力は縁取り用データ生成ラッチ回路７ａと７ｐ
の出力を含めて３入力となる。
【００１１】つぎに読み出される１つ下のライン，さら
に次に読み出される１つ上のラインについても同様に上
記ＯＲ回路６に入力される。各ＯＲ回路の出力はそれぞ
れ縁取り用データ生成ラッチ回路７ａ，７ｂ・・・にラ
ッチされる。一方、文字データ用ラッチ回路８ａ，８ｂ
・・・は最初に読み出したラインの有効な文字データの
各ドットをラッチする。縁取り用データ生成ラッチ回路
７ａ，７ｂ・・・のラッチ出力は、ドットクロックで同
期がとられ、順番に縁取り用シフトレジスタ９に転送さ
れる。縁取り用シフトレジスタ９からは縁取りデータが
１ドットずつ出力される。文字データ用ラッチ回路８
ａ，８ｂ・・・のラッチ出力も、同様にドットクロック
で同期がとられ、順番に文字データ用シフトレジスタ１
０に転送される。文字データ用シフトレジスタ１０から
は文字データが１ドットずつ出力される。
【００１２】図４は、図３の回路の動作を説明するため
のタイミングチャートである。この例は図２（ｂ）に示
すようにｂ5 ａ3 の文字データドットに注目し、このド
ットに対し、ｂ5 ａ2 ，ｂ4 ａ3 の位置に縁取りデータ
が形成される場合を示したものである。なお、この例に
基づきドットデータが入力されるＯＲ回路を６ｘ，縁取
り用データ生成ラッチ回路を７ｘ，文字データ用ラッチ
回路を８ｘとして説明する。ａ 3 のラインにおいて、ａ
3 ｂ 5 のアドレスを中心に、ａ 3 ｂ 6 のアドレス（ライ
ンａ 3 の横方向においてａ 3 ｂ 5 のアドレス値を０とす
ると、このアドレスから＋１インクリメントしたアドレ
ス値）と、ａ 3 ｂ 4 のアドレス（同じくａ 3 ｂ 5 のアド
レス値から−１デクリメントしたアドレス値）が読み出
されると、ＯＲ回路６ｘの中心の入力および右側入力に
は“１”が、左側入力には“０”が入力される。このＯ
Ｒ回路６ｘ対応の縁取り用データ生成ラッチ回路７ｘに
は“１”がラッチされる。このとき文字データ用ラッチ
回路８ｘには“１”がラッチされる。
【００１３】そしてドットクロックで同期がとられ縁取
り用データ生成ラッチ回路７ｘの“１”は縁取り用シフ
トレジスタ９に、文字データ用ラッチ回路８ｘの“１”
は文字データ用シフトレジスタ１０に転送される。つぎ
にａ4 のラインおよびａ2 のラインについても同様に動
作する。この結果、文字データ用シフトレジスタ１０よ
りｂ5 ａ3 のドット“１”が出力される（図４6)）。こ
のｂ5 ａ3 のドットに対応して縁取り用シフトレジスタ
９より図４5)に示すように縁取りデータが出力される。
図４5)の波形は、ｂ5 ａ3 のドットに対し上側のドット
位置（ｂ5 ａ2 ）と左側のドット位置（ｂ4 ａ3 ）に縁
取りデータ“１”が出力されている。
【００１４】以上の実施例では、文字の構成が１６ドッ
ト×１６ドットの場合の例について説明したが、例えば
３２ドット×３２ドット，その他のドット数でも同様に
適用できる。かかる場合、ＯＲ回路，縁取り用データ生
成回路および文字データ用ラッチ回路の数は横方向のド
ット数と同じ数となる。
【００１５】
【発明の効果】以上、説明したように本発明は、文字デ
ータを格納するビデオＲＡＭと、ビデオＲＡＭの文字デ
ータを構成する画面をライン毎に読み出す際、前記画面
の１つのラインのアドレスに対し，前記１つのラインの
アドレスの１つ下のラインのアドレスおよび前記１つの
ラインのアドレスの１つ上のラインのアドレスを生成す
るアドレスカウンタと、アドレスカウンタが出力するア
ドレスに従って１ライン単位で読み出されるすべてのド
ットそれぞれに対し、そのドットを中心に１つ先のドッ
トと１つ後のドットの連続する３つのドット情報と縁取
り用データ生成ラッチ回路の出力とを入力とするＯＲ回
路群と、ＯＲ回路群が出力するタイミング で前記ＯＲ回
路群のそれぞれの出力をラッチする、多数の前記縁取り
用データ生成ラッチ回路よりなる縁取り用データ生成ラ
ッチ回路群と、縁取り用データ生成ラッチ回路群の出力
をドットクロックによりシリースに出力し有効な文字デ
ータのドットに対し縁取りデータを出力する縁取り用シ
フトレジスタと、ビデオＲＡＭの前記１つのラインを読
み出すタイミングで、前記ビデオＲＡＭより読み出され
る文字データをラッチする文字データ用ラッチ回路群
と、文字データ用ラッチ回路群の出力をドットクロック
によりシリースに出力し文字データのドット情報を出力
する文字データ用シフトレジスタとからなり、表示され
る文字の最外郭を形成するドットの外側に縁取りを行う
データを形成するものである。したがって、縁取りのた
めのデータをメモリ内に格納する必要はなく、メモリを
節約することができるという効果がある。Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a karaoke system, and more particularly to a karaoke character bordering device for bordering characters displayed on a screen of a karaoke machine. 2. Description of the Related Art In recent years, karaoke has become popular, and karaoke apparatuses have become widespread. Lyrics are displayed in telop on the CRT screen of the karaoke apparatus according to the accompaniment. The lyrics on this screen are shaded or edged to decorate the characters, for example, because the lyrics are not conspicuous with ordinary characters. Also,
When a character having the same color as that of the background screen is used, bordering is performed in order to prevent the reading from becoming difficult due to the inside of the background. Conventionally, in the case of bordering a character, a bordering function has been realized by software. Therefore, data for bordering must be previously provided in addition to character data. Therefore, there is a disadvantage that the data accompanying the character data increases and a large amount of memory must be used. SUMMARY OF THE INVENTION It is an object of the present invention to provide a karaoke character trimming device which solves the above-mentioned drawbacks and eliminates the need for having data for character trimming and can reduce the capacity of a memory such as a RAM. In order to achieve the above object, a karaoke character bordering device according to the present invention is provided. To achieve the above object, a karaoke character bordering device according to the present invention is provided on a screen. In a character bordering apparatus for bordering a character to be set, a video RAM for storing character data and an image forming the character data of the video RAM are provided.
When reading a plane line by line, one line of the screen
One address below the address of the one line with respect to the address
Address of the line and the address of the one line
An address counter for generating the address of the line on one of the, according to the address which the address counter outputs
For each dot read out one line at a time, three consecutive dot information of a dot ahead and a dot subsequent to that dot and the output of the edging data generation latch circuit are input. an OR circuit group to the
A large number of the edging data latching each output of the OR circuit group at a timing output by the OR circuit group;
A framing data generation latch circuit group comprising a generation latch circuit; and a framing shift register for outputting the output of the framing data generation latch circuit group to a series by a dot clock and outputting framing data for dots of valid character data. Read the one line of the video RAM
A character data latch circuit group for latching character data read from the video RAM at the timing of reading, and a character for outputting the output of the character data latch circuit group to a series by a dot clock and outputting dot information of the character data. The data shift register is configured to form data for bordering outside the dots forming the outermost outline of the displayed character. According to the above construction, it is not necessary to store border data in a memory corresponding to character data, and border data can be obtained at the time of display. Hereinafter, the present invention will be described in more detail with reference to the drawings and the like. FIG. 1A is a diagram showing an example of a character composed of 16 dots × 16 dots. This character is formed only of character data and is not bordered. FIG. 1B shows an example of a border character 2, in which a border portion 2a is formed outside the outermost portion of the character portion 2b. Conventionally, the data of the border 2a is stored in the memory. FIG. 2 is a diagram for explaining a portion of the character data to be bordered. b 0 , b 1 , b 2 ...
Denotes dots in the horizontal direction, and a 0 , a 1 , and a 2 correspond to dots in the vertical direction. In this example, b 5 a 3 , b
5 a 4, b 6 a include 3 and b 6 a 4 dots valid data, b 4 a 2, b 4 a 3, b 4 a 4, b 4 a 5,
b 5 a 2, b 5 a 5, b 6 a 2, b 6 a 5, b 7 a 2,
The dot portions of b 7 a 3 , b 7 a 4 and b 7 a 5 are portions 4 to be bordered. When the valid data line is a 3 and the dot of the character data of b 5 a 3 is the center,
(B) shows an example in which one point is right and one point is left. FIG. 3 is a circuit block diagram showing an embodiment of a karaoke character bordering device according to the present invention. This embodiment is an example of creating border data of a character composed of 16 dots × 16 dots.
Character data of 6 dots × 16 dots is stored.
The address counter 11 generates an address of a line below and an address of a line immediately above the line to be read. Therefore, reading from the video RAM 5
The data for 16 dots of the power line is read out as parallel data, and then the data of one line below the line is read.
The data for 6 dots is read as parallel data, and the data for 16 dots on the line immediately above the line is read as parallel data. This read operation is repeated in the vertical direction. That is, the read operation for each of the three lines is performed.
Is performed on a screen 16 × 16 constituting characters. The first read data of 16 dots of one line is input to each of 16 OR circuits 6a, 6b,.... Each OR circuit uses the information of the preceding and succeeding dots (dots on the right and left) around each dot data and the outputs of the corresponding bordering data generation latch circuits 7a, 7b,. Note that the right dot data does not exist for the leading dot data of the line, and the left dot data does not exist for the terminal dot of the line, so that the first OR circuit 6a and the sixteenth The inputs of the OR circuit 6p are the data generation latch circuits 7a and 7p for bordering.
There are three inputs including the output of. The next lower line to be read next and the next upper line to be read next are similarly input to the OR circuit 6. The output of each OR circuit is latched by each of the bordering data generation latch circuits 7a, 7b,. On the other hand, character data latch circuits 8a and 8b
... latches each dot of valid character data of the line read first. The latch outputs of the framing data generation latch circuits 7a, 7b,... Are synchronized by the dot clock and are sequentially transferred to the framing shift register 9. The framing shift register 9 outputs framing data one dot at a time. Latch circuit for character data 8
The latch outputs a, 8b,... are similarly synchronized by the dot clock, and are sequentially shifted in the character data shift register 1.
0 is transferred. The character data shift register 10 outputs character data one dot at a time. FIG. 4 is a timing chart for explaining the operation of the circuit of FIG. This example focused on character data dots b 5 a 3 as shown in FIG. 2 (b), with respect to the dot, shows the case where border data is formed at the position of b 5 a 2, b 4 a 3 It is a thing. It is to be noted that an OR circuit to which dot data is input is 6x, a data generation latch circuit for bordering is 7x, and a latch circuit for character data is 8x based on this example. In a 3 of the line, a
Mainly address 3 b 5, the address of a 3 b 6 (Lai
It is in the lateral direction of down a 3 address value of a 3 b 5 0
Then, the address incremented by +1 from this address
A scan value), the address of a 3 b 4 (also add the a 3 b 5
Address value decremented by 1 from the address value)
Then, "1" is input to the center input and the right input of the OR circuit 6x, and "0" is input to the left input. This O
"1" is latched in the bordering data generation latch circuit 7x corresponding to the R circuit 6x. At this time, "1" is latched in the character data latch circuit 8x. Synchronized by the dot clock, "1" of the framing data generation latch circuit 7x is stored in the framing shift register 9 and "1" of the character data latch circuit 8x.
Is transferred to the character data shift register 10. Next operates similarly also in line line and a 2 of a 4. As a result, b 5 a 3 dots "1" is output from the shift register 10 for character data (Fig. 46)). The b 5 a 3 of corresponding to the dot from the border shift register 9 as shown in FIG. 45) border data is output.
Waveform of FIG. 45) is, b 5 upper dot position with respect to the dots of a 3 (b 5 a 2) and the left dot position (b 4 a 3) to the border data "1" is output. In the above embodiment, an example in which the character configuration is 16 dots × 16 dots has been described. However, the present invention can be similarly applied to, for example, 32 dots × 32 dots and other dot numbers. In such a case, the number of OR circuits, border data generation circuits, and character data latch circuits is the same as the number of dots in the horizontal direction. [0015] [Effect of the Invention above, the present invention as described, a video RAM for storing character data, video RAM characters de
When reading the screens that compose the data line by line,
To the address of one line,
The address of the line immediately below the address and the one
An address counter for generating the address of the line immediately above the line address, and an address output by the address counter.
For each dot read out on a line-by-line basis according to the dress, three consecutive dot information of the dot ahead and dot after the dot and the output of the edging data generation latch circuit are input. A plurality of the borders , each latching an output of the OR circuit group at a timing output by the OR circuit group.
And use data generation latch circuit consisting border data generation latch circuit group, the shift register edging for outputting border data to valid character data dot outputs the output of the border data generation latch circuit group by dot clock Shirisu And read the one line of the video RAM.
In out look timing, character data to be output and character data latch circuit group that latches character data read from the video RAM, and outputs the output of the character data latch circuit groups by dot clock Shirisu dot information of character data The shift register is used to form data for bordering the outside of the dots forming the outermost contour of the displayed character. Therefore, there is no need to store the data for bordering in the memory, and the memory can be saved.
【図面の簡単な説明】
【図１】通常の文字と縁取りした文字の一例を示す図で
ある。
【図２】文字データに対し縁取りすべき部分を説明する
ための図である。
【図３】本発明によるカラオケ用文字縁取り装置の実施
例を示す回路ブロック図である。
【図４】図３の回路の動作を説明するためのタイミング
チャートである。
【符号の説明】
１…文字
２…縁取り文字
２ａ…縁取り部
２ｂ…文字部
３…有効な文字データ
４…縁取りすべき部分
５…ビデオＲＡＭ
６…ＯＲ回路群
６ａ，６ｂ・・・…ＯＲ回路
７…縁取り用データ生成ラッチ回路群
７ａ，７ｂ・・・…縁取り用データ生成ラッチ回路
８…文字データ用ラッチ回路群
８ａ，８ｂ・・・…文字データ用ラッチ回路
９…縁取り用シフトレジスタ
１０…文字データ用シフトレジスタ
１１…ビデオＲＡＭアドレスカウンタBRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a diagram showing an example of a character bordered by a normal character. FIG. 2 is a diagram for explaining a portion to be bordered with character data; FIG. 3 is a circuit block diagram showing an embodiment of a karaoke character bordering device according to the present invention. FIG. 4 is a timing chart for explaining the operation of the circuit of FIG. 3; [Description of Signs] 1 ... Character 2 ... Bordering character 2a ... Bordering part 2b ... Character part 3 ... Valid character data 4 ... Part to be bordered 5 ... Video RAM 6 ... OR circuit group 6a, 6b ... OR circuit Reference numeral 7: Data generation latch circuit group for framing 7a, 7b ... Data generation latch circuit 8 for framing: Latch circuit group for character data 8a, 8b ... Latch circuit for character data 9: Shift register 10 for framing Character data shift register 11: Video RAM address counter
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭60−123888（ＪＰ，Ａ) 特開 昭61−248756（ＪＰ，Ａ) 特開 昭62−297895（ＪＰ，Ａ) 特開 平１−280789（ＪＰ，Ａ) 特開 平２−292970（ＪＰ，Ａ) 特開 平３−276980（ＪＰ，Ａ) 特開 平４−278995（ＪＰ，Ａ) 特開 平６−62354（ＪＰ，Ａ) 特開 平６−130937（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) G09G 5/24 H04N 5/278 H04N 5/445 ──────────────────────────────────────────────────続 き Continuation of the front page (56) References JP-A-60-123888 (JP, A) JP-A-61-248756 (JP, A) JP-A-62-297895 (JP, A) JP-A-1- 280789 (JP, A) JP-A-2-292970 (JP, A) JP-A-3-276980 (JP, A) JP-A 4-278995 (JP, A) JP-A-6-62354 (JP, A) JP-A-6-130937 (JP, A) (58) Fields investigated (Int. Cl. 7 , DB name) G09G 5/24 H04N 5/278 H04N 5/445
Claims (1)
ための文字縁取り装置において、 文字データを格納するビデオＲＡＭと、前記ビデオＲＡＭの文字データを構成する画面をライン
毎に読み出す際、前記画面の１つのラインのアドレスに
対し，前記１つのラインのアドレスの１つ下のラインの
アドレスおよび前記１つのラインのアドレスの１つ上の
ラインのアドレスを 生成するアドレスカウンタと、前記アドレスカウンタが出力するアドレスに従って１ラ
イン単位で読み出される すべてのドットそれぞれに対
し、そのドットを中心に１つ先のドットと１つ後のドッ
トの連続する３つのドット情報と縁取り用データ生成ラ
ッチ回路の出力とを入力とするＯＲ回路群と、前記ＯＲ回路群が出力するタイミングで 前記ＯＲ回路群
のそれぞれの出力をラッチする、多数の前記縁取り用デ
ータ生成ラッチ回路よりなる縁取り用データ生成ラッチ
回路群と、 前記縁取り用データ生成ラッチ回路群の出力をドットク
ロックによりシリースに出力し有効な文字データのドッ
トに対し縁取りデータを出力する縁取り用シフトレジス
タと、前記ビデオＲＡＭの前記１つのラインを読み出すタイミ
ングで、 前記ビデオＲＡＭより読み出される文字データ
をラッチする文字データ用ラッチ回路群と、 前記文字データ用ラッチ回路群の出力をドットクロック
によりシリースに出力し文字データのドット情報を出力
する文字データ用シフトレジスタとからなり、 表示される文字の最外郭を形成するドットの外側に縁取
りを行うデータを形成することを特徴とするカラオケ用
文字縁取り装置。(1) A character bordering device for bordering a character displayed on a screen, comprising: a video RAM for storing character data; and character data of the video RAM. Line screen
When reading each time, the address of one line on the screen
On the other hand, the line below the address of the one line
Address and one above the address of the one line
An address counter for generating a line address, and one line according to the address output by the address counter.
For each dot read out in units of input, an OR which receives as input three consecutive dot information of a dot ahead and a dot subsequent to that dot and the output of the bordering data generation latch circuit A plurality of the bordering data latching each output of the OR circuit group at a timing outputted by the OR circuit group.
A data generation latch circuit group including a data generation latch circuit; and a border shift for outputting the output of the border data generation latch circuit group to a series by a dot clock and outputting border data for valid character data dots. A register and a timing for reading the one line of the video RAM
And a character data latch circuit group for latching character data read from the video RAM, and outputs the output of the character data latch circuit group to a series by a dot clock to output dot information of the character data. A karaoke character bordering device, comprising: a character data shift register that forms data for bordering dots outside a dot forming the outermost contour of a displayed character.
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|---|---|---|---|
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| JPH08221049A JPH08221049A (en) | 1996-08-30 |
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Families Citing this family (1)
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|---|---|---|---|---|
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-
1995
- 1995-02-10 JP JP04650095A patent/JP3534475B2/en not_active Expired - Lifetime
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| JPH08221049A (en) | 1996-08-30 |
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