JP3484855B2 - Drive - Google Patents

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JP3484855B2 JP01690696A JP1690696A JP3484855B2 JP 3484855 B2 JP3484855 B2 JP 3484855B2 JP 01690696 A JP01690696 A JP 01690696A JP 1690696 A JP1690696 A JP 1690696A JP 3484855 B2 JP3484855 B2 JP 3484855B2
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  • Controls And Circuits For Display Device (AREA)
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Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は、画面上の文字の水
平方向の移動の最小単位を文字表示を構成するドット単
位で行うマトリックス型表示装置及びスクロール制御方
法に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a matrix type display device and a scroll control method in which a minimum unit of horizontal movement of a character on a screen is a dot unit constituting a character display.

【0002】[0002]

【従来の技術】図7にドット単位の水平移動の動作例を
示す。図7では、a)の表示を2ドット水平移動するこ
とにより、b)の表示となる表示例を示した。
2. Description of the Related Art FIG. 7 shows an example of horizontal movement in dot units. In FIG. 7, a display example in which the display in b) is displayed by horizontally moving the display in a) by 2 dots is shown.

【0003】従来のマトリックス表示装置及びスクロー
ル制御方法では、以下の方法でドット単位の水平スクロ
ールを実現していた。
In the conventional matrix display device and scroll control method, horizontal scroll in dot units is realized by the following method.

【0004】従来例の一例を図6に示し以下に説明をす
る。
An example of a conventional example is shown in FIG. 6 and will be described below.

【0005】図6において従来のスクロール制御方法
は、基準クロック8により制御され、表示桁アドレス1
3の文字コード記憶部2への出力、スクロール制御部2
9へのタイミング信号の供給、信号線駆動回路6へのシ
フトクロック32の供給、文字コード記憶部2、キャラ
クタジェネレータ3へのタイミング信号の供給を行うタ
イミング発生回路1と、文字コード14を、アドレスバ
ス、データバス及びコントロールバスを介して受け取り
記憶し、表示桁アドレス13がタイミング発生回路1か
ら与えられ表示桁アドレス13に対応して記憶している
文字コード14をキャラクタジェネレータ3に出力する
文字コード記憶部2と、入力された文字コード14に応
じた文字パターン15を並列直列変換部30に出力する
キャラクタジェネレータ3と、タイミング信号により制
御され入力された時系列にパラレルな文字パターンを時
系列に直列なシリアルな文字パターンに変換して信号線
駆動回路6に出力する並列直列変換部30と、タイミン
グ発生回路1の出力を与えられ、並列直列変換部30の
タイミング、信号線駆動回路6のシフトクロック32を
発生するスクロール制御部29と、タイミング信号によ
り制御され前述した並列直列変換部30の出力であるシ
リアルな文字パターン35を取り込み信号線に出力する
信号線駆動回路6から構成される。
In FIG. 6, the conventional scroll control method is controlled by the reference clock 8 and the display digit address 1
3 to the character code storage unit 2, scroll control unit 2
9, a timing generation circuit 1 for supplying a timing signal to the signal line driving circuit 6, a shift clock 32 to the signal line drive circuit 6, a timing signal to the character code storage unit 2 and the character generator 3, and a character code 14. A character code that is received and stored via a bus, a data bus, and a control bus, and the display digit address 13 is given from the timing generation circuit 1 and stored in correspondence with the display digit address 13 to the character generator 3. The storage unit 2, the character generator 3 that outputs the character pattern 15 according to the input character code 14 to the parallel-serial conversion unit 30, and the time-series parallel character pattern that is controlled by the timing signal and is input in time series. Convert to serial serial character pattern and output to signal line drive circuit 6 The parallel-to-serial conversion unit 30 and the scroll control unit 29 which receives the output of the timing generation circuit 1 and generates the timing of the parallel-to-serial conversion unit 30 and the shift clock 32 of the signal line drive circuit 6, and is controlled by the timing signal. The parallel line-to-serial converter 30 is composed of the signal line drive circuit 6 which takes in the serial character pattern 35 and outputs it to the signal line.

【0006】このようなマトリックス型表示装置及びス
クロール制御方法によりドット単位の水平スクロールを
行うときには、スクロール制御部から発生するシフトク
ロック32を、スクロール制御部29によりスクロール
するドット数に合わせて任意の位相または任意の回数分
に制御することで行うものであった。
When performing horizontal scrolling in dot units by such a matrix type display device and scroll control method, the shift clock 32 generated from the scroll control unit is set to an arbitrary phase according to the number of dots scrolled by the scroll control unit 29. Alternatively, it is performed by controlling the number of times as desired.

【0007】[0007]

【発明が解決しようとする課題】前述した従来のマトリ
ックス型表示装置及びスクロール制御方式は、文字表示
を行う場合に、キャラクタジェネレータの時系列にパラ
レルな文字パターンを並列直列変換部で時系列にシリア
ルな文字パターンに変換して信号線駆動回路に転送する
ため、液晶パネルの1走査線分を表示させるためには少
なくとも1走査線における表示ドット数以上の基準クロ
ックが必要である。例えば液晶パネルの表示文字数が2
行×16文字で一文字が横6×縦8ドットの画素構成と
し、フレーム周波数を100Hzとすると、基準クロッ
クは145KHz以上が必要であり、この例では1.6
KHzである走査信号などと比較して非常に高い周波数
となっている。
In the above-mentioned conventional matrix type display device and scroll control method, when character display is performed, a character pattern parallel to the time series of the character generator is serialized in time series by the parallel / serial conversion unit. In order to display one scanning line of the liquid crystal panel, a reference clock of at least the number of display dots in one scanning line is required in order to display the data for one scanning line of the liquid crystal panel. For example, the number of characters displayed on the LCD panel is 2
Assuming that the pixel configuration is row × 16 characters and each character is horizontal 6 × vertical 8 dots and the frame frequency is 100 Hz, the reference clock needs to be 145 KHz or higher.
The frequency is extremely higher than that of a scanning signal of KHz or the like.

【0008】本発明の目的は、マトリックス型表示装置
において、画面上の文字の水平方向の移動の最小単位を
文字表示を構成するドット単位で行うスクロール方法
を、低速度で実現することにある。
It is an object of the present invention to realize, at a low speed, a matrix type display device in which the minimum unit of horizontal movement of characters on the screen is a dot unit constituting a character display.

【0009】[0009]

【課題を解決するための手段】本課題を解決するための
駆動装置は、線順次走査により駆動されるマトリックス
型表示装置の駆動装置であって、文字コードが記憶さ
れ、前記表示装置の画面表示上における文字の表示位置
を指定する表示桁アドレスが入力されるとこれに対応し
て所定の文字コードを出力する文字コード記憶部と、該
文字コード記憶部が出力する文字コードに対応する文字
パターンを出力するキャラクタジェネレータと、前記出
力された文字パターンを記憶する文字パターン記憶手段
と、該文字パターン記憶手段の出力と時系列に続いて前
記キャラクタジェネレータから出力される前記文字パタ
ーンに対し、ドット単位でのスクロール量が記憶された
ドットスクロールレジスタの値に応じて所定ビット分ず
らした文字パターンを発生する文字パターン変換部と、
前記表示桁アドレスに導かれ、複数のビット数を持つ複
数のラッチのうちいずれかのラッチに前記文字パターン
変換部からの出力データを保持し、前記表示装置の信号
電極に出力する信号線駆動回路と、前記表示桁アドレス
とタイミング信号を発生させるタイミング発生回路と、
を有し、更に、前記文字コード記憶部、前記キャラクタ
ジェネレータ、前記文字パターン変換部及び前記信号線
駆動回路のそれぞれについて、それぞれの動作時間と同
一もしくはそれ以上の遅延時間を有する遅延手段をそれ
ぞれ有し、前記それぞれの遅延手段は直列に接続され、
基準クロックにより直列に接続された前記遅延手段のう
ちの初段の遅延手段の動作が開始され、前記それぞれの
遅延手段が動作する時間内は、対応する前記文字コード
記憶部、前記キャラクタジェネレータ、前記文字パター
ン変換部及び前記信号線駆動回路の何れかをそれぞれ動
作させ、前記直列に接続された前記遅延手段の最終段の
遅延手段の出力を受け、前記遅延手段の動作並びに前記
文字コード記憶部、前記キャラクタジェネレータ、前記
文字パターン変換部及び前記信号線駆動回路の動作を停
止し、1走査線分の信号線出力が、文字の表示桁+1回
の基準クロックで終了するよう構成されたことを特徴と
する。また、線順次走査により駆動されるマトリックス
型表示装置の駆動装置であって、前記表示装置の画面表
示上における文字の表示位置を指定する表示桁アドレス
に対し、桁単位でのスクロール量を記憶された桁スクロ
ールレジスタの値に応じて所定桁分ずらした表示桁アド
レスを発生させる表示桁アドレス変換部と、前記表示桁
アドレス変換部の出力が入力されあらかじめ記憶してい
る文字コードを出力する文字コード記憶部と、前記文字
コード記憶部が出力する文字コードに対応する文字パタ
ーンを出力するキャラクタジェネレータと、前記出力さ
れた文字パターンを記憶する文字パターン記憶手段と、
前記記憶手段の出力と時系列に続いて前記キャラクタジ
ェネレータから出力される前記文字パターンに対し、ド
ット単位でのスクロール量が記憶されたドットスクロー
ルレジスタの値に応じて所定ビット分ずらした文字パタ
ーンを発生する文字パターン変換部と、前記表示桁アド
レスに導かれ、複数のビット数を持つ複数のラッチのう
ちいずれかのラッチに前記文字パターン変換部からの出
力データを保持し、前記表示装置の信号電極に出力する
信号線駆動回路と、前記表示桁アドレスとタイミング信
号を発生させるタイミング発生回路と、を有し、更に、
前記文字コード記憶部、前記キャラクタジェネレータ、
前記文字パターン変換部及び前記信号線駆動回路のそれ
ぞれについて、それぞれの動作時間と同一もしくはそれ
以上の遅延時間を有する遅延手段をそれぞれ有し、前記
それぞれの遅延手段は直列に接続され、基準クロックに
より直列に接続された前記遅延手段のうちの初段の遅延
手段の動作が開始され、前記それぞれの遅延手段が動作
する時間内は、対応する前記文字コード記憶部、前記キ
ャラクタジェネレータ、前記文字パターン変換部及び前
記信号線駆動回路の何れかをそれぞれ動作させ、前記直
列に接続された前記遅延手段の最終段の遅延手段の出力
を受け、前記遅延手段の動作並びに前記文字コード記憶
部、前記キャラクタジェネレータ、前記文字パターン変
換部及び前記信号線駆動回路の動作を停止し、1走査線
分の信号線出力が、文字の表示桁+1回の基準クロック
で終了するよう構成されたことを特徴とする。
A drive device for solving the problem is a drive device of a matrix type display device driven by line-sequential scanning, in which a character code is stored and a screen display of the display device is performed. A character code storage unit that outputs a predetermined character code in response to the input of a display digit address that specifies the display position of a character on the upper side, and a character pattern that corresponds to the character code output by the character code storage unit A character generator that outputs the character pattern, a character pattern storage unit that stores the output character pattern, and a dot unit for the character pattern that is output from the character generator following the output of the character pattern storage unit and the time series. Character pattern shifted by a predetermined bit according to the value of the dot scroll register that stores the scroll amount in A character pattern conversion section for generating,
A signal line drive circuit which is guided to the display digit address and holds the output data from the character pattern conversion unit in any one of a plurality of latches having a plurality of bits and outputs the data to the signal electrode of the display device. And a timing generation circuit for generating the display digit address and the timing signal,
Further, each of the character code storage unit, the character generator, the character pattern conversion unit, and the signal line drive circuit has a delay unit that has a delay time that is the same as or longer than the respective operation time. And the delay means are connected in series,
The operation of the first-stage delay means of the delay means connected in series by the reference clock is started, and during the time when each of the delay means operates, the corresponding character code storage unit, the character generator, the character Any one of the pattern conversion unit and the signal line drive circuit is operated to receive the output of the delay unit at the final stage of the delay unit connected in series, the operation of the delay unit and the character code storage unit, The operation of the character generator, the character pattern conversion unit, and the signal line drive circuit is stopped, and the signal line output for one scanning line is configured to end at the character display digit + 1 reference clock of one time. To do. Further, in a matrix-type display driving device driven by line-sequential scanning, a scroll amount in units of digits is stored for a display digit address designating a display position of a character on a screen display of the display device. A display digit address conversion unit that generates a display digit address shifted by a predetermined digit according to the value of the digit scroll register, and a character code that outputs the character code stored in advance by the output of the display digit address conversion unit A storage unit, a character generator that outputs a character pattern corresponding to the character code output by the character code storage unit, and a character pattern storage unit that stores the output character pattern,
For the character pattern output from the character generator subsequently to the output of the storage means and the time series, a character pattern obtained by shifting a predetermined bit according to the value of the dot scroll register in which the scroll amount in dots is stored. The generated character pattern conversion unit and the output data from the character pattern conversion unit, which is guided to the display digit address and is held in any one of a plurality of latches having a plurality of bit numbers, holds the signal of the display device. A signal line drive circuit for outputting to the electrodes, and a timing generation circuit for generating the display digit address and the timing signal, and further,
The character code storage unit, the character generator,
Each of the character pattern conversion unit and the signal line drive circuit has a delay unit that has a delay time that is equal to or longer than the operation time of the respective unit, and the delay units are connected in series and are connected by a reference clock. The operation of the first-stage delay means of the delay means connected in series is started, and within the time when the respective delay means operate, the corresponding character code storage unit, the character generator, and the character pattern conversion unit. And each of the signal line drive circuits are operated to receive the output of the delay means at the final stage of the delay means connected in series, the operation of the delay means, the character code storage unit, the character generator, The operation of the character pattern conversion unit and the signal line drive circuit is stopped, and the signal line output for one scanning line is Characterized in that it is configured to terminate the display digits + one of the reference clock of characters.

【0010】[0010]

【0011】[0011]

【0012】[0012]

【0013】[0013]

【発明の実施の形態】本発明のマトリックス型表示装置
は、キャラクタジェネレータにより得られる複数ビット
の文字パターン信号を信号線駆動回路に転送する際に、
文字パターンをドット単位でスクロールした複数の文字
パターンに変換を行いパラレルで信号線駆動回路に1文
字を構成する水平方向のドット数ごと順次転送すること
により、1走査線分を表示させるためのクロック数を低
減させようとするものであり、キャラクタジェネレータ
と信号線駆動回路の中間に、ドット単位のスクロール量
を記憶するスクロールレジスタと、前回読み出した文字
パターンを記憶するラッチと、今回キャラクタジェネレ
ータから読み出した文字データと前述のラッチの出力と
スクロールレジスタの値からドットスクロールされた文
字データを得るセレクタで構成された文字データ変換部
を設けた特徴がある。
BEST MODE FOR CARRYING OUT THE INVENTION The matrix type display device of the present invention, when transferring a character pattern signal of a plurality of bits obtained by a character generator to a signal line drive circuit,
A clock for displaying one scanning line by converting a character pattern into a plurality of character patterns scrolled in dot units and sequentially transferring in parallel to the signal line drive circuit for each number of horizontal dots forming one character. It is intended to reduce the number, and a scroll register that stores the scroll amount in dot units in the middle of the character generator and the signal line drive circuit, a latch that stores the previously read character pattern, and a read from the character generator this time. It is characterized in that a character data conversion unit constituted by a selector that obtains dot-scrolled character data from the character data, the output of the above-mentioned latch, and the value of the scroll register is provided.

【0014】また、基準クロックで動作するタイミング
発生回路から出力される表示桁アドレスで示される画面
表示上での文字の表示位置にパラレルの文字パターンを
順次ラッチする複数のラッチにより信号線駆動回路を構
成し、基準クロックをトリガーとして、文字コード記憶
部、キャラクタジェネレータ、文字データ変換部のそれ
ぞれと同一もしくはそれ以上の動作時間を有する遅延回
路を介して得られたタイミング信号により前述の文字コ
ード記憶部、キャラクタジェネレータ、文字データ変換
部の動作と信号線駆動回路への文字パターンへのラッチ
を基準クロックに対して非同期に順次動作させることに
より、基準クロックの1クロック内で文字コード記憶
部、キャラクタジェネレータ、文字データ変換部のそれ
ぞれの動作と信号線駆動回路への文字コードのラッチを
終了するスクロール制御方法に本発明の特徴がある。
Further, the signal line drive circuit is constituted by a plurality of latches for sequentially latching parallel character patterns at the display positions of characters on the screen display indicated by the display digit address output from the timing generation circuit which operates with the reference clock. The character code storage unit is configured by a timing signal obtained through a delay circuit having an operation time equal to or longer than each of the character code storage unit, the character generator, and the character data conversion unit, using the reference clock as a trigger. The operation of the character generator and the character data conversion unit and the latch of the character pattern to the signal line drive circuit are sequentially operated asynchronously with respect to the reference clock, so that the character code storage unit and the character generator within one clock of the reference clock. , Each operation of character data converter and signal line There are features of the present invention to a scroll control method to end the latching character codes to the dynamic circuit.

【0015】以下に本発明の実施例を順を追って説明す
る。
Embodiments of the present invention will be described below step by step.

【0016】(1)第1の実施例 図1は本発明の第1の実施例を示す構成図である。(1) First embodiment FIG. 1 is a block diagram showing a first embodiment of the present invention.

【0017】図1の実施例では基準クロック8により制
御されるタイミング発生回路1の出力である表示桁アド
レス13が、アドレスバス、データバス及びコントロー
ルバスを介して書き込まれた文字コードが記憶されてい
る文字コード記憶部2に入力され、文字コード記憶部2
の出力である該当表示桁の文字コード14とタイミング
発生回路1から入力されるラスタアドレス17が、キャ
ラクタジェネレータ3に入力され、画面上の該当文字位
置、該当ラインの文字パターン15が、キャラクタジェ
ネレータ3から文字パターン変換部5に出力される。文
字パターン変換部5は、ドット単位のスクロール量の情
報がデータバス、コントロールバスを介して書き込まれ
るドットスクロールレジスタ4の値に合わせて、ドット
単位でスクロールされた時系列にパラレルな文字パター
ン16を発生させ、信号線駆動回路6に文字パターン1
6が、1文字分の水平方向のドット数ずつ順にラッチさ
れる。
In the embodiment shown in FIG. 1, the display digit address 13 which is the output of the timing generation circuit 1 controlled by the reference clock 8 stores the character code written via the address bus, the data bus and the control bus. Is input to the character code storage unit 2
The character code 14 of the corresponding display digit and the raster address 17 input from the timing generation circuit 1, which is the output of the, are input to the character generator 3, and the character pattern 15 of the corresponding character position on the screen and the corresponding line is displayed on the character generator 3. Is output to the character pattern conversion unit 5. The character pattern conversion unit 5 creates a time-series parallel character pattern 16 scrolled in dot units in accordance with the value of the dot scroll register 4 in which the information on the scroll amount in dot units is written via the data bus and the control bus. And generate a character pattern 1 on the signal line drive circuit 6.
6 are sequentially latched by the number of horizontal dots for one character.

【0018】ここで文字パターン変換部5について図3
に構成例、図4に動作例を示し説明する。図4では1文
字分の水平方向のドット数が6ドットの例を示す。文字
パターン変換部5は、ラッチ25に保持されている前回
読み出した1文字分の水平方向のドット数の文字パター
ン27と今回読み出した1文字分の水平方向のドット数
の文字パターン15から、セレクタ26を介すことで信
号線駆動回路6に送るための1文字分の水平方向のドッ
ト数の文字パターン16を発生させる。文字パターン1
6の発生は図4に示すようにドットスクロールレジスタ
の値によって、前回読み出した文字パターンと今回読み
出した文字パターンのどの部分を取り出すか、すなわち
どれだけの量をスクロールさせるかが決定される。
Here, the character pattern conversion unit 5 is shown in FIG.
An example of the configuration is shown in FIG. FIG. 4 shows an example in which the number of dots in the horizontal direction for one character is 6 dots. The character pattern conversion unit 5 selects a character pattern 27, which is held in the latch 25 and has a horizontal dot number of one character read previously, and a character pattern 15 having a horizontal dot number of one character, which is read this time, from the selector. By way of 26, the character pattern 16 having the number of dots in the horizontal direction for one character to be sent to the signal line drive circuit 6 is generated. Character pattern 1
As shown in FIG. 4, the occurrence of No. 6 is determined by the value of the dot scroll register, which part of the previously read character pattern and the currently read character pattern is extracted, that is, how much is scrolled.

【0019】次に図1の実施例における1走査線分の動
作を図5のタイミングチャートをもとに説明する。この
タイミングチャートでは、1走査線分の動作は、表示桁
数+1回の基準クロックにより行われる。
Next, the operation of one scanning line in the embodiment of FIG. 1 will be described with reference to the timing chart of FIG. In this timing chart, the operation for one scanning line is performed by the number of display digits + 1 the reference clock.

【0020】図5では基準クロックが”H”の間に、文
字コード読み出し〜文字パターン読み出し〜信号線駆動
回路のラッチを行い、基準クロックの立ち下がりで表示
桁アドレス、ラスタアドレスが変化する例を示す。
In FIG. 5, while the reference clock is "H", the reading of the character code, the reading of the character pattern, and the latching of the signal line drive circuit are performed, and the display digit address and the raster address change at the fall of the reference clock. Show.

【0021】基準クロックは、1走査線のデータ転送に
は表示桁数+1回入力される。この基準クロックの1回
目は、キャラクタジェネレータから読みだした文字パタ
ーンを文字パターン変換部のラッチに保持するために行
われ、信号線駆動回路の複数のラッチのどれかには文字
パターンが保持されない。
The reference clock is input by the number of display digits + 1 times for data transfer of one scanning line. The first time of this reference clock is performed to hold the character pattern read from the character generator in the latch of the character pattern conversion unit, and the character pattern is not held in any of the plurality of latches of the signal line drive circuit.

【0022】続いて2回目以降の基準クロックでは、基
準クロックが立ち上がると、文字コード記憶部からの該
当表示桁の文字コード読み出し、キャラクタジェネレー
タからの文字パターンの読み出し、文字パターン変換、
信号線駆動回路へのラッチの順に動作が行われ、文字パ
ターンが信号線駆動回路へラッチされると、信号線駆動
回路からのフィードバック信号によりRAM、ROMで
構成される文字コード記憶部、キャラクタジェネレータ
は次の読み出しに備えてプリチャージされ、表示桁アド
レスにより導かれる文字パターン変換部のラッチに、読
み出した文字パターンがラッチされる。その後表示桁数
+1番目のクロックまでこの動作が繰り返される。
Then, in the second and subsequent reference clocks, when the reference clock rises, the character code of the corresponding display digit is read from the character code storage unit, the character pattern is read from the character generator, the character pattern conversion is performed,
The operation is performed in the order of latching to the signal line driving circuit, and when the character pattern is latched to the signal line driving circuit, a feedback signal from the signal line driving circuit causes a character code storage unit including a RAM and a ROM, and a character generator. Is precharged in preparation for the next reading, and the read character pattern is latched by the latch of the character pattern conversion unit guided by the display digit address. After that, this operation is repeated until the number of display digits + 1 clock.

【0023】なお図1に図示したインバータ9、33
と、NANDゲート10、11、12と、文字コード記
憶部2、キャラクタジェネレータ3、文字パターン変換
部5及び信号線駆動回路6との動作時間の差が同一もし
くはそれ以上の動作時間を有する遅延素子7を用い、基
準クロック8の立ち上がりをトリガーとして、順に非同
期動作させれば、図5のタイミングチャートに示すよう
に基準クロックの1周期内でそれぞれの動作を終了させ
ることができる。
The inverters 9 and 33 shown in FIG.
And the NAND gates 10, 11 and 12 and the character code storage unit 2, the character generator 3, the character pattern conversion unit 5 and the signal line drive circuit 6 have the same or different operation time difference delay elements. 7 and using the rising edge of the reference clock 8 as a trigger, the asynchronous operations are sequentially performed, so that the respective operations can be completed within one cycle of the reference clock as shown in the timing chart of FIG.

【0024】(2)第2の実施例 本発明の第2の実施例を示す構成図を図2に示し、以下
に説明をする。
(2) Second Embodiment A configuration diagram showing a second embodiment of the present invention is shown in FIG. 2 and will be described below.

【0025】図2における実施例では、タイミング発生
回路1と文字コード記憶部2の間に、データバス、コン
トロールバスを介して書き込まれる桁スクロールレジス
タ18を設け、桁スクロールレジスタ18の出力とタイ
ミング発生回路1から出力される表示桁アドレス13か
ら表示桁アドレス変換部19を設けている。この表示桁
アドレス変換部19を介して、文字コード記憶部19に
変換後の表示桁アドレス20を与えることで、表示桁単
位の水平方向のスクロールをも可能としている。
In the embodiment shown in FIG. 2, a digit scroll register 18 written via a data bus and a control bus is provided between the timing generation circuit 1 and the character code storage unit 2, and the output of the digit scroll register 18 and timing generation. A display digit address conversion unit 19 is provided from the display digit address 13 output from the circuit 1. By giving the converted display digit address 20 to the character code storage section 19 via the display digit address conversion section 19, horizontal scrolling in display digit units is also possible.

【0026】図2では、ドット単位で水平スクロールを
行うドットスクロールレジスタ4、文字パターン変換部
5と、上記の桁スクロールレジスタ18、表示桁アドレ
ス変換部19とを組み合わせることで、任意の文字数、
任意のドット数を水平スクロールさせた画面表示をする
事が可能となる。
In FIG. 2, by combining the dot scroll register 4 for performing horizontal scrolling in dot units, the character pattern conversion unit 5, the digit scroll register 18, and the display digit address conversion unit 19, any number of characters can be displayed.
It is possible to display the screen by horizontally scrolling an arbitrary number of dots.

【0027】上記以外の部分の構成並びに動作について
は、図1における第1の実施例と同一であるため説明を
省略する。
The configuration and operation of the parts other than the above are the same as those in the first embodiment shown in FIG.

【0028】[0028]

【発明の効果】本発明のマトリックス型表示装置及びス
クロール制御方法によれば、画面の水平スクロールが、
文字を構成するドット単位で可能となる。
According to the matrix type display device and the scroll control method of the present invention, the horizontal scroll of the screen is
It is possible for each dot that constitutes a character.

【0029】また本発明では、回路の動作周波数が低く
できるので、動作周波数の低い素子または回路を使用す
る事ができる。例えば液晶パネルの表示文字数が2行×
16文字で一文字が横6×縦8ドットの画素構成とし、
フレーム周波数を100Hzとすると、基準クロックの
周波数は27KHzでよい。従って回路の簡略化、素子
の小型化がはかれる。特にRAM、ROMで構成される
文字コード記憶部、キャラクタジェネレータは、簡略化
された素子の構成をとることが可能であるため、半導体
基盤状に配置する際にはチップサイズの小型化がはかれ
る。さらに動作周波数の低減により i(消費電流)=
c(負荷容量)・v(動作電圧)・f(動作周波数)
の式で表される回路の消費電流を大幅に削減できる。
Further, in the present invention, since the operating frequency of the circuit can be lowered, it is possible to use an element or circuit having a low operating frequency. For example, the number of characters displayed on the LCD panel is 2 lines ×
With 16 characters, each character has a pixel configuration of horizontal 6 x vertical 8 dots,
When the frame frequency is 100 Hz, the frequency of the reference clock may be 27 KHz. Therefore, the circuit can be simplified and the device can be downsized. In particular, the character code storage unit composed of RAM and ROM and the character generator can have a simplified element structure, so that the chip size can be reduced when they are arranged on a semiconductor substrate. Further reduction of operating frequency i (current consumption) =
c (load capacity), v (operating voltage), f (operating frequency)
It is possible to significantly reduce the current consumption of the circuit represented by the formula.

【0030】以上の2点に加えて、ドットスクロールレ
ジスタと桁スクロールレジスタの双方を備えることによ
り、よりきめの細かい画面スクロールが実現できる。
By providing both a dot scroll register and a digit scroll register in addition to the above two points, finer screen scrolling can be realized.

【0031】本発明は、液晶、エレクトロルミネッセン
スまたは蛍光表示管などのマトリックス型表示装置に広
く応用できるものである。
The present invention can be widely applied to matrix type display devices such as liquid crystal, electroluminescent or fluorescent display tubes.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の第1の実施例を示す図である。FIG. 1 is a diagram showing a first embodiment of the present invention.

【図2】本発明の第2の実施例を示す図である。FIG. 2 is a diagram showing a second embodiment of the present invention.

【図3】本発明の文字パターン変換部の構成例を示す図
である。
FIG. 3 is a diagram showing a configuration example of a character pattern conversion unit of the present invention.

【図4】本発明の文字パターン変換部の動作を示す図で
ある。
FIG. 4 is a diagram showing an operation of a character pattern conversion unit of the present invention.

【図5】本発明のマトリックス表示装置及びスクロール
制御方式を説明するためのタイミングチャートである。
FIG. 5 is a timing chart for explaining a matrix display device and a scroll control method of the present invention.

【図6】従来のスクロール制御方式による実施例を示す
図である。
FIG. 6 is a diagram showing an example of a conventional scroll control method.

【図7】文字表示を構成するドット単位で行う画面上の
文字の水平移動の動作例を示す図である。
FIG. 7 is a diagram illustrating an operation example of horizontal movement of a character on a screen performed in dot units that form a character display.

【符号の説明】[Explanation of symbols]

1 タイミング発生回路 2 文字コード記憶部 3 キャラクタジェネレータ 4 ドットスクロールレジスタ 5 文字パターン変換部 6 信号線駆動回路 7 遅延回路 8 基準クロック 9、21、33、34 インバータ 10、11、12、22、23、24 NANDゲート 13 表示桁アドレス 14 文字コード 15 文字パターン 16 変換後の文字パターン 17 ラスタアドレス 18 桁スクロールレジスタ 19 表示桁アドレス変換部 20 変換後の文字パターン 25 ラッチ 26 セレクタ 27 前回読み出しデータ 28 ラッチクロック 29 スクロール制御部 30 並列直列変換部 31 タイミング信号 32 シフトクロック 35 シリアルな文字パターン 1 Timing generation circuit 2 character code storage 3 character generator 4-dot scroll register 5 character pattern converter 6 Signal line drive circuit 7 Delay circuit 8 reference clock 9, 21, 33, 34 Inverter NAND gates 10, 11, 12, 22, 23, 24 13 Display digit address 14 character code 15 character pattern 16 Character pattern after conversion 17 raster address 18 digit scroll register 19 Display digit address converter 20 Character pattern after conversion 25 latch 26 Selector 27 Previous read data 28 Latch clock 29 Scroll controller 30 Parallel-to-serial converter 31 Timing signal 32 shift clock 35 Serial character pattern

フロントページの続き (51)Int.Cl.7 識別記号 FI G09G 5/34 G09G 5/34 E M (58)調査した分野(Int.Cl.7,DB名) G09G 3/20 660 G09G 3/20 611 G09G 3/20 612 G09G 3/36 G09G 5/34 Continuation of front page (51) Int.Cl. 7 identification code FI G09G 5/34 G09G 5/34 EM (58) Fields investigated (Int.Cl. 7 , DB name) G09G 3/20 660 G09G 3/20 611 G09G 3/20 612 G09G 3/36 G09G 5/34

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】線順次走査により駆動されるマトリックス
型表示装置の駆動装置であって、 文字コードが記憶され、前記表示装置の画面表示上にお
ける文字の表示位置を指定する表示桁アドレスが入力さ
れるとこれに対応して所定の文字コードを出力する文字
コード記憶部と、 該文字コード記憶部が出力する文字コードに対応する文
字パターンを出力するキャラクタジェネレータと、 前記出力された文字パターンを記憶する文字パターン記
憶手段と、 該文字パターン記憶手段の出力と時系列に続いて前記キ
ャラクタジェネレータから出力される前記文字パターン
に対し、ドット単位でのスクロール量が記憶されたドッ
トスクロールレジスタの値に応じて所定ビット分ずらし
た文字パターンを発生する文字パターン変換部と、 前記表示桁アドレスに導かれ、複数のビット数を持つ複
数のラッチのうちいずれかのラッチに前記文字パターン
変換部からの出力データを保持し、前記表示装置の信号
電極に出力する信号線駆動回路と、 前記表示桁アドレスとタイミング信号を発生させるタイ
ミング発生回路と、 を有し、 更に、前記文字コード記憶部、前記キャラクタジェネレ
ータ、前記文字パターン変換部及び前記信号線駆動回路
のそれぞれについて、それぞれの動作時間と同一もしく
はそれ以上の遅延時間を有する遅延手段をそれぞれ有
し、 前記それぞれの遅延手段は直列に接続され、 基準クロックにより直列に接続された前記遅延手段のう
ちの初段の遅延手段の動作が開始され、 前記それぞれの遅延手段が動作する時間内は、対応する
前記文字コード記憶部、前記キャラクタジェネレータ、
前記文字パターン変換部及び前記信号線駆動回路の何れ
かをそれぞれ動作させ、 前記直列に接続された前記遅延手段の最終段の遅延手段
の出力を受け、前記遅延手段の動作並びに前記文字コー
ド記憶部、前記キャラクタジェネレータ、前記文字パタ
ーン変換部及び前記信号線駆動回路の動作を停止し、 1走査線分の信号線出力が、文字の表示桁+1回の基準
クロックで終了するよう構成されたことを特徴とする駆
動装置。
1. A driving device for a matrix type display device driven by line-sequential scanning, wherein a character code is stored and a display digit address for designating a display position of the character on the screen display of the display device is inputted. Then, in response to this, a character code storage unit that outputs a predetermined character code, a character generator that outputs a character pattern corresponding to the character code output by the character code storage unit, and a memory unit that stores the output character pattern A character pattern storage unit for outputting the character pattern storage unit and the character pattern output from the character generator following the output of the character pattern storage unit and the time series, and A character pattern conversion unit that generates a character pattern that is shifted by a predetermined bit by the display digit adder. A signal line drive circuit for holding the output data from the character pattern conversion unit in any one of a plurality of latches having a plurality of bit numbers and outputting the data to the signal electrode of the display device. A timing generation circuit for generating a display digit address and a timing signal, and further, for each of the character code storage section, the character generator, the character pattern conversion section and the signal line drive circuit, a respective operation time and Each delay means has a delay time of the same or more, and each delay means is connected in series, and the operation of the delay means in the first stage of the delay means connected in series by the reference clock is started. During the time when each of the delay units operates, the corresponding character code storage unit and the character generator Lator,
Either the character pattern conversion unit or the signal line drive circuit is operated, and the output of the delay unit at the final stage of the delay unit connected in series is received, and the operation of the delay unit and the character code storage unit. The operation of the character generator, the character pattern conversion unit, and the signal line drive circuit is stopped, and the signal line output for one scanning line is configured to end at the display digit of the character + the reference clock of one time. Characteristic drive device.
【請求項2】線順次走査により駆動されるマトリックス
型表示装置の駆動装置であって、 前記表示装置の画面表示上における文字の表示位置を指
定する表示桁アドレスに対し、桁単位でのスクロール量
を記憶された桁スクロールレジスタの値に応じて所定桁
分ずらした表示桁アドレスを発生させる表示桁アドレス
変換部と、 前記表示桁アドレス変換部の出力が入力されあらかじめ
記憶している文字コードを出力する文字コード記憶部
と、 前記文字コード記憶部が出力する文字コードに対応する
文字パターンを出力するキャラクタジェネレータと、 前記出力された文字パターンを記憶する文字パターン記
憶手段と、 前記記憶手段の出力と時系列に続いて前記キャラクタジ
ェネレータから出力される前記文字パターンに対し、ド
ット単位でのスクロール量が記憶されたドットスクロー
ルレジスタの値に応じて所定ビット分ずらした文字パタ
ーンを発生する文字パターン変換部と、 前記表示桁アドレスに導かれ、複数のビット数を持つ複
数のラッチのうちいずれかのラッチに前記文字パターン
変換部からの出力データを保持し、前記表示装置の信号
電極に出力する信号線駆動回路と、 前記表示桁アドレスとタイミング信号を発生させるタイ
ミング発生回路と、 を有し、 更に、前記文字コード記憶部、前記キャラクタジェネレ
ータ、前記文字パターン変換部及び前記信号線駆動回路
のそれぞれについて、 それぞれの動作時間と同一もしくはそれ以上の遅延時間
を有する遅延手段をそれぞれ有し、 前記それぞれの遅延手段は直列に接続され、 基準クロックにより直列に接続された前記遅延手段のう
ちの初段の遅延手段の動作が開始され、 前記それぞれの遅延手段が動作する時間内は、対応する
前記文字コード記憶部、前記キャラクタジェネレータ、
前記文字パターン変換部及び前記信号線駆動回路の何れ
かをそれぞれ動作させ、 前記直列に接続された前記遅延手段の最終段の遅延手段
の出力を受け、前記遅延手段の動作並びに前記文字コー
ド記憶部、前記キャラクタジェネレータ、前記文字パタ
ーン変換部及び前記信号線駆動回路の動作を停止し、 1走査線分の信号線出力が、文字の表示桁+1回の基準
クロックで終了するよう構成されたことを特徴とする駆
動装置。
2. A drive device for a matrix type display device driven by line-sequential scanning, wherein a scroll amount in a digit unit for a display digit address designating a display position of a character on a screen display of the display device. The display digit address conversion unit for generating a display digit address shifted by a predetermined digit according to the value of the stored digit scroll register, and the output of the display digit address conversion unit is input and the character code stored in advance is output. A character code storage unit, a character generator that outputs a character pattern corresponding to the character code output by the character code storage unit, a character pattern storage unit that stores the output character pattern, and an output of the storage unit. For the character pattern output from the character generator following the time series, in dot units A character pattern conversion unit that generates a character pattern shifted by a predetermined number of bits according to the value of the dot scroll register in which the crawl amount is stored, and one of a plurality of latches that are guided to the display digit address and that have a plurality of bit numbers. A signal line drive circuit that holds the output data from the character pattern conversion unit in the latch and outputs the data to the signal electrode of the display device; and a timing generation circuit that generates the display digit address and the timing signal. Furthermore, each of the character code storage unit, the character generator, the character pattern conversion unit, and the signal line drive circuit has a delay unit having a delay time equal to or longer than the respective operation time, The respective delay means are connected in series, and are connected in series by the reference clock. Operation of the first stage of the delay means of the extending means is started, the time during which the respective delay means operates, said corresponding character code storage unit, the character generator,
Either the character pattern conversion unit or the signal line drive circuit is operated, and the output of the delay unit at the final stage of the delay unit connected in series is received, and the operation of the delay unit and the character code storage unit. The operation of the character generator, the character pattern conversion unit, and the signal line drive circuit is stopped, and the signal line output for one scanning line is configured to end at the display digit of the character + the reference clock of one time. Characteristic drive device.
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