JP3273808B2 - テストパターン発生装置 - Google Patents
テストパターン発生装置Info
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Description
【０００１】
【産業上の利用分野】本発明は、マルチスキャン式テレ
ビジョン受像機の画面を調整するのに好適な、テストパ
ターン発生装置に関するものである。
ビジョン受像機の画面を調整するのに好適な、テストパ
ターン発生装置に関するものである。
【０００２】さらに詳述すれば本発明は、任意の水平お
よび垂直同期周波数に対応でき、殊に投写形カラーテレ
ビジョン受像機のコンバージェンス補正に好適な、テス
トパターン発生装置に関するものである。
よび垂直同期周波数に対応でき、殊に投写形カラーテレ
ビジョン受像機のコンバージェンス補正に好適な、テス
トパターン発生装置に関するものである。
【０００３】
【従来の技術】近年、映像メディアの多様化によって、
投写形カラーテレビジョン受像機はＮＴＳＣ方式のテレ
ビジョン受像機としてだけでなく、ＳＥＣＡＭ・ＰＡＬ
方式のテレビジョン受像機の外、ワークステーションの
映像映出装置としても用いられるようになってきた。
投写形カラーテレビジョン受像機はＮＴＳＣ方式のテレ
ビジョン受像機としてだけでなく、ＳＥＣＡＭ・ＰＡＬ
方式のテレビジョン受像機の外、ワークステーションの
映像映出装置としても用いられるようになってきた。
【０００４】これらテレビジョン方式における映像信号
の同期信号周波数はＮＴＳＣ方式とは異なるものである
ので、投写形カラーテレビジョン受像機の同期信号を、
これら入力映像信号の同期信号周波数に応じて変える、
いわゆる“マルチスキャン式”のものが用いられる。
の同期信号周波数はＮＴＳＣ方式とは異なるものである
ので、投写形カラーテレビジョン受像機の同期信号を、
これら入力映像信号の同期信号周波数に応じて変える、
いわゆる“マルチスキャン式”のものが用いられる。
【０００５】このようなマルチスキャン式投写形カラー
テレビジョン受像機のコンバージェンスを補正するに
は、普通、全画面をカバーして格子状をなすクロスハッ
チテストパターンを用い、Ｒ・Ｇ・Ｂ３色の前記クロス
ハッチ各ブロック投影位置が、全画面にわたって一致す
るように調整している。
テレビジョン受像機のコンバージェンスを補正するに
は、普通、全画面をカバーして格子状をなすクロスハッ
チテストパターンを用い、Ｒ・Ｇ・Ｂ３色の前記クロス
ハッチ各ブロック投影位置が、全画面にわたって一致す
るように調整している。
【０００６】このようなクロスハッチパターンを得るに
は、画面を同じ大きさのブロックに分割し、さらに各ブ
ロックを幾つかの画素に分割し、各ブロックの各画素に
それぞれクロスハッチを構成することのできるパターン
（以下「キャラクタパターン」という）を割合て、画面
を走査したとき所定の位置に所定のキャラクタパターン
が映出されるようにすればよい。
は、画面を同じ大きさのブロックに分割し、さらに各ブ
ロックを幾つかの画素に分割し、各ブロックの各画素に
それぞれクロスハッチを構成することのできるパターン
（以下「キャラクタパターン」という）を割合て、画面
を走査したとき所定の位置に所定のキャラクタパターン
が映出されるようにすればよい。
【０００７】上述したクロスハッチパターンの映出方法
を用いれば、各ブロックのキャラクタパターンを他のテ
ストパターンを映出できるようなものに置換えることに
よって、任意のパターンを描かせることもできる。
を用いれば、各ブロックのキャラクタパターンを他のテ
ストパターンを映出できるようなものに置換えることに
よって、任意のパターンを描かせることもできる。
【０００８】上記の機能を持つテストパターン発生器で
は、水平および垂直の同期周波数が所定の値であって、
この水平同期周波数により、内部に水平方向の長さを測
定するクロックパルス発生器を設け、このクロックパル
スが所定の数に達したことによって各ブロックと各画素
を検出し、このデータを所要のテストパターンを発生す
る部分パターンのアドレスとしている。また、上記の垂
直同期周波数により、１垂直期間におけるライン数が一
定値に達したとき１ブロックの垂直方向の所定の長さに
なるようにする。このとき、１走査線期間における総ク
ロック数および１画面における総ライン数は一定とな
る。そして、このときの水平同期周波数・垂直同期周波
数・１走査期間におけるクロック数および１画面のライ
ン数をそれぞれ基準値とする。
は、水平および垂直の同期周波数が所定の値であって、
この水平同期周波数により、内部に水平方向の長さを測
定するクロックパルス発生器を設け、このクロックパル
スが所定の数に達したことによって各ブロックと各画素
を検出し、このデータを所要のテストパターンを発生す
る部分パターンのアドレスとしている。また、上記の垂
直同期周波数により、１垂直期間におけるライン数が一
定値に達したとき１ブロックの垂直方向の所定の長さに
なるようにする。このとき、１走査線期間における総ク
ロック数および１画面における総ライン数は一定とな
る。そして、このときの水平同期周波数・垂直同期周波
数・１走査期間におけるクロック数および１画面のライ
ン数をそれぞれ基準値とする。
【０００９】投写形カラーテレビジョン受像機が、上述
したマルチスキャン式である場合、水平同期周波数およ
び垂直同期周波数が上記基準値と異なるときは、１走査
線期間における総クロック数および１画面における総ラ
イン数が上記の基準総クロック数および総ライン数と違
ってくるので、パターンの映出位置がずれ、画面全体に
わたるコンバージェンス調整ができなくなる。
したマルチスキャン式である場合、水平同期周波数およ
び垂直同期周波数が上記基準値と異なるときは、１走査
線期間における総クロック数および１画面における総ラ
イン数が上記の基準総クロック数および総ライン数と違
ってくるので、パターンの映出位置がずれ、画面全体に
わたるコンバージェンス調整ができなくなる。
【００１０】従来はこういった問題を避けるため、各周
波数に対するテストパターン発生器を複数準備し、ある
いは受像機内にテストパターン発生回路を内蔵する方法
が採用されていた。しかし、これらの方法は、複数のテ
ストパターン発生器または回路を準備しなければなら
ず、新規の周波数に対しては新たに発生器または回路を
追加しなければならないという問題点があった。
波数に対するテストパターン発生器を複数準備し、ある
いは受像機内にテストパターン発生回路を内蔵する方法
が採用されていた。しかし、これらの方法は、複数のテ
ストパターン発生器または回路を準備しなければなら
ず、新規の周波数に対しては新たに発生器または回路を
追加しなければならないという問題点があった。
【００１１】
【発明が解決しようとする課題】よって本発明の目的
は、上述した従来技術の欠点を解消し、任意の水平同期
周波数および垂直同期周波数の入力映像信号に対し、画
面の所定の位置に所定のテストパターンを発生させるこ
とのできるテストパターン発生装置を提供することにあ
る。
は、上述した従来技術の欠点を解消し、任意の水平同期
周波数および垂直同期周波数の入力映像信号に対し、画
面の所定の位置に所定のテストパターンを発生させるこ
とのできるテストパターン発生装置を提供することにあ
る。
【００１２】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明に係るテストパターン発生装置は、マルチ
スキャン式テレビジョン受像機の調整に使用するテスト
パターン発生装置において、入力複合同期信号を水平同
期信号と垂直同期信号に分離する同期分離手段と、前記
水平同期信号の周波数ｆＨと、前記受像機の有効画面を
同一サイズのブロックに分割して得られる水平ブロック
数ＮＨＢと、前記ブロックの水平方向の画素数Ｎ
ＨＤと、水平有効画面率をａＨとしたとき、 ｆＣＬＫ＝ｆＨ×ＮＨＢ×ＮＨＤ／ａＨ の演算より得られる周波数ｆＣＬＫの画素クロックを発
生するクロック発生手段と、前記クロック発生手段の出
力に基づいて前記水平方向の画素毎に計数した出力を水
平方向のブロックアドレスとして出力する水平方向ブロ
ックアドレス発生手段と、前記水平同期信号と前記垂直
同期信号より前記同一サイズの１ブロック当たりの垂直
方向のライン数を求める演算手段と、前記水平同期信号
に基づいて該演算手段の出力毎に計数した出力を垂直方
向のブロックアドレスとする垂直方向ブロックアドレス
発生手段と、前記水平同期信号に基づいて前記演算手段
の出力より前記１ブロック当たりの垂直方向のライン数
が全ブロックに対して等しくなるように間引きまたは追
加を行う垂直方向ブロック補正アドレス発生手段と、前
記水平方向ブロックアドレス発生手段の出力と、前記垂
直方向ブロックアドレス発生手段の出力および前記クロ
ック発生手段の出力をアドレスとし、表示テストパター
ンの映像出力制御信号と該表示テストパターンのキャラ
クタを記憶しているキャラクタメモリの水平アドレス信
号を読み出しデータとする記憶手段と、該水平アドレス
信号を一時的に記憶しておくバッファメモリと、該バッ
ファメモリの読み出し出力と前記垂直方向ブロック補正
アドレス発生手段の出力をアドレスとして読み出される
キャラクタメモリと、前記キャラクタメモリの出力を前
記映像出力制御信号により制御して出力する出力制御手
段と、を具備したものである。
めに、本発明に係るテストパターン発生装置は、マルチ
スキャン式テレビジョン受像機の調整に使用するテスト
パターン発生装置において、入力複合同期信号を水平同
期信号と垂直同期信号に分離する同期分離手段と、前記
水平同期信号の周波数ｆＨと、前記受像機の有効画面を
同一サイズのブロックに分割して得られる水平ブロック
数ＮＨＢと、前記ブロックの水平方向の画素数Ｎ
ＨＤと、水平有効画面率をａＨとしたとき、 ｆＣＬＫ＝ｆＨ×ＮＨＢ×ＮＨＤ／ａＨ の演算より得られる周波数ｆＣＬＫの画素クロックを発
生するクロック発生手段と、前記クロック発生手段の出
力に基づいて前記水平方向の画素毎に計数した出力を水
平方向のブロックアドレスとして出力する水平方向ブロ
ックアドレス発生手段と、前記水平同期信号と前記垂直
同期信号より前記同一サイズの１ブロック当たりの垂直
方向のライン数を求める演算手段と、前記水平同期信号
に基づいて該演算手段の出力毎に計数した出力を垂直方
向のブロックアドレスとする垂直方向ブロックアドレス
発生手段と、前記水平同期信号に基づいて前記演算手段
の出力より前記１ブロック当たりの垂直方向のライン数
が全ブロックに対して等しくなるように間引きまたは追
加を行う垂直方向ブロック補正アドレス発生手段と、前
記水平方向ブロックアドレス発生手段の出力と、前記垂
直方向ブロックアドレス発生手段の出力および前記クロ
ック発生手段の出力をアドレスとし、表示テストパター
ンの映像出力制御信号と該表示テストパターンのキャラ
クタを記憶しているキャラクタメモリの水平アドレス信
号を読み出しデータとする記憶手段と、該水平アドレス
信号を一時的に記憶しておくバッファメモリと、該バッ
ファメモリの読み出し出力と前記垂直方向ブロック補正
アドレス発生手段の出力をアドレスとして読み出される
キャラクタメモリと、前記キャラクタメモリの出力を前
記映像出力制御信号により制御して出力する出力制御手
段と、を具備したものである。
【００１３】
【作用】本発明に係るテストパターン発生装置を上記の
ように構成することにより、入力水平同期信号および垂
直同期信号の周波数が変わったとしても、前記ブロック
は画面の所定の位置に割合てられ、各ブロックの各画素
は各ブロックを等分割した位置に割合てられてそれぞれ
アドレス信号が発生され、このアドレス信号によって記
憶手段から所定のパターンが読出されてテストパターン
が映出されるので、そのテストパターンは常に所定の位
置に映出されることになる。
ように構成することにより、入力水平同期信号および垂
直同期信号の周波数が変わったとしても、前記ブロック
は画面の所定の位置に割合てられ、各ブロックの各画素
は各ブロックを等分割した位置に割合てられてそれぞれ
アドレス信号が発生され、このアドレス信号によって記
憶手段から所定のパターンが読出されてテストパターン
が映出されるので、そのテストパターンは常に所定の位
置に映出されることになる。
【００１４】
【実施例】次に実施例につき、図面を用いて詳細に説明
する。
する。
【００１５】図１は、本発明の一実施例における各機器
の接続関係を示している。１は映像信号源であり、ＮＴ
ＳＣまたはＳＥＣＡＭ・ＰＡＬ方式などのテレビジョン
受像機、任意の同期周波数を有するＶＴＲ、さらにワー
クステーション等の機器がこれに相当する。
の接続関係を示している。１は映像信号源であり、ＮＴ
ＳＣまたはＳＥＣＡＭ・ＰＡＬ方式などのテレビジョン
受像機、任意の同期周波数を有するＶＴＲ、さらにワー
クステーション等の機器がこれに相当する。
【００１６】２は本発明の一実施例によるテストパター
ン発生装置、３はテストパターンを発生させようとする
マルチスキャン式投写形テレビジョン受像機である。
ン発生装置、３はテストパターンを発生させようとする
マルチスキャン式投写形テレビジョン受像機である。
【００１７】もっとも、マルチスキャン式投写形カラー
テレビジョン受像機は通常のカラーブラウン管を有する
テレビジョン受像機でもよく、さらにモノクロームのテ
レビジョン受像機でもよい。さらに、テストパターンは
カラーテレビジョン受像機のコンバージェンス補正のた
めクロスハッチ図形を発生するものだけでなく、他のテ
ストパターンを発生するものについても同様である。
テレビジョン受像機は通常のカラーブラウン管を有する
テレビジョン受像機でもよく、さらにモノクロームのテ
レビジョン受像機でもよい。さらに、テストパターンは
カラーテレビジョン受像機のコンバージェンス補正のた
めクロスハッチ図形を発生するものだけでなく、他のテ
ストパターンを発生するものについても同様である。
【００１８】テストパターン発生装置２は、映像信号源
１から入力映像信号ｖinを受け、マルチステーション式
投写形テレビジョン受像機３へ出力信号ｖout を供給す
る。
１から入力映像信号ｖinを受け、マルチステーション式
投写形テレビジョン受像機３へ出力信号ｖout を供給す
る。
【００１９】図２は全画面４上に縦横の線によって区切
ったブロック５を示す図面、図３は各ブロックの画素６
を示す図面である。画面上には、このような線が映出さ
れているわけではなく、ソフトウェアによって描かれる
仮想線である。ブロックの数は、画面の形状とテストパ
ターンの形状によって選択すればよいが、図２ではＮＴ
ＳＣ方式の画面に合致するように、水平方向を２４、垂
直方向を１８に分割した場合を示している。図３では水
平、垂直方向とも８画素および８ラインに分割した場合
を示している。
ったブロック５を示す図面、図３は各ブロックの画素６
を示す図面である。画面上には、このような線が映出さ
れているわけではなく、ソフトウェアによって描かれる
仮想線である。ブロックの数は、画面の形状とテストパ
ターンの形状によって選択すればよいが、図２ではＮＴ
ＳＣ方式の画面に合致するように、水平方向を２４、垂
直方向を１８に分割した場合を示している。図３では水
平、垂直方向とも８画素および８ラインに分割した場合
を示している。
【００２０】次に図４を用い、本実施例の概要を説明す
る。
る。
【００２１】本実施例は、入力映像信号Ｖｉｎを同期分
離回路１１に加えて水平および垂直同期信号ｆＨおよび
ｆＶを検出し、このｆＨ・ｆＶを水平方向アドレス発生
回路１２と垂直方向アドレス発生回路１３に加えて、水
平方向のブロックおよび画素の読出タイミング信号Ｐ
ＢＨおよびＰＤＨ：垂直方向のブロックおよびラインの
読出タイミング信号ＰＢＶおよびＰ ＢＬ を作成し、この
ＰＢＨ・ＰＤＨ・Ｐ ＢＬ のタイミングによって、所要の
テストパターンを構成するデータをストアしてあるメモ
リ１４から、読出し出力回路１５によって所要のデータ
を読出し、出力することによりＶｏｕｔ を得ている。
離回路１１に加えて水平および垂直同期信号ｆＨおよび
ｆＶを検出し、このｆＨ・ｆＶを水平方向アドレス発生
回路１２と垂直方向アドレス発生回路１３に加えて、水
平方向のブロックおよび画素の読出タイミング信号Ｐ
ＢＨおよびＰＤＨ：垂直方向のブロックおよびラインの
読出タイミング信号ＰＢＶおよびＰ ＢＬ を作成し、この
ＰＢＨ・ＰＤＨ・Ｐ ＢＬ のタイミングによって、所要の
テストパターンを構成するデータをストアしてあるメモ
リ１４から、読出し出力回路１５によって所要のデータ
を読出し、出力することによりＶｏｕｔ を得ている。
【００２２】メモリ１４に格納するデータはテストパタ
ーンデータに限られないので、任意のパターンデータを
格納しておき、任意の図形データを格納しておき、所定
の位置に映出することができる。
ーンデータに限られないので、任意のパターンデータを
格納しておき、任意の図形データを格納しておき、所定
の位置に映出することができる。
【００２３】次に、図５を用いて本実施例の詳細を説明
する。ここで、同期分離回路１１には公知の回路をその
まま用いればよい。
する。ここで、同期分離回路１１には公知の回路をその
まま用いればよい。
【００２４】水平方向出力タイミング発生回路１２は、
上述の如く検出した水平同期信号ｆH を入力とし、画素
毎にパルスＰDHを発生するクロック発生器２１と、該Ｐ
DHをカウントし水平方向のブロック毎にパルスＰBHを発
生するＨカウンタ２２によって構成することができる。
上述の如く検出した水平同期信号ｆH を入力とし、画素
毎にパルスＰDHを発生するクロック発生器２１と、該Ｐ
DHをカウントし水平方向のブロック毎にパルスＰBHを発
生するＨカウンタ２２によって構成することができる。
【００２５】ここで、ＰDHは次の計算によって求めるこ
とができる。ただし、括弧内は水平方向のブロック数を
２４、画素数を８とした場合を示している。
とができる。ただし、括弧内は水平方向のブロック数を
２４、画素数を８とした場合を示している。
【００２６】
【数１】ＰDH＝ｆH ×水平方向ブロック数（２４）×水
平方向画素数（８）÷水平方向有効画面率 ここに水平方向有効画面率は、全水平方向ブロックの走
査時間を１水平走査時間で除したものである。
平方向画素数（８）÷水平方向有効画面率 ここに水平方向有効画面率は、全水平方向ブロックの走
査時間を１水平走査時間で除したものである。
【００２７】垂直方向出力タイミング発生回路１３は、
１ブロックのライン数ＮBLの演算回路２３，垂直方向ブ
ロック出力アドレスを決めるＶカウンタ２５，各ブロッ
クのラインアドレスを作成するラスタカウンタ２７およ
びデータ変換ＲＯＭ２８によって構成することができ、
それぞれレジスタ２４，２６および２９を持っている。
１ブロックのライン数ＮBLの演算回路２３，垂直方向ブ
ロック出力アドレスを決めるＶカウンタ２５，各ブロッ
クのラインアドレスを作成するラスタカウンタ２７およ
びデータ変換ＲＯＭ２８によって構成することができ、
それぞれレジスタ２４，２６および２９を持っている。
【００２８】１ブロックのライン数演算回路２３には上
記のｆH およびｆV を加え、１ブロック当りのライン数
ＮBLを算出する。このＮBLは、次式に示す全ブロック上
下端間の総ライン数ＮTVを垂直方向のブロック数で割れ
ば、計算によっても求められる。
記のｆH およびｆV を加え、１ブロック当りのライン数
ＮBLを算出する。このＮBLは、次式に示す全ブロック上
下端間の総ライン数ＮTVを垂直方向のブロック数で割れ
ば、計算によっても求められる。
【００２９】
【数２】ＮTV＝ｆH ÷ｆV ×垂直方向有効画面率 ここに垂直方向有効画面率は、全垂直方向ブロックの走
査時間を１垂直走査時間で除したものである。ＮTVはカ
ウンタで測ってもよい。
査時間を１垂直走査時間で除したものである。ＮTVはカ
ウンタで測ってもよい。
【００３０】上記の割算で割り切れないときは、切り上
げまたは切り下げを行ってＮBLを整数にする。このと
き、切り上げによって全ブロックの上下端が有効画面を
はみ出すときは切り下げ、はみ出ないときは切り上げ
る。このＮBLはレジスタ２４に記録される。
げまたは切り下げを行ってＮBLを整数にする。このと
き、切り上げによって全ブロックの上下端が有効画面を
はみ出すときは切り下げ、はみ出ないときは切り上げ
る。このＮBLはレジスタ２４に記録される。
【００３１】レジスタ２４から読出されたＮＢＬは、水
平同期信号と共にＶカウンタ２５に入力され、ＮＢＬを
カウントする毎に垂直方向のタイミングパルスＰＢＶを
出力する。このＰＢＶは所定数（１８）の垂直方向ブロ
ックアドレス（０〜１７）を与えるもので、レジスタ２
６に記録される。
平同期信号と共にＶカウンタ２５に入力され、ＮＢＬを
カウントする毎に垂直方向のタイミングパルスＰＢＶを
出力する。このＰＢＶは所定数（１８）の垂直方向ブロ
ックアドレス（０〜１７）を与えるもので、レジスタ２
６に記録される。
【００３２】レジスタ２４から読出されたＮBLは、水平
同期信号ｆH と共にラスタカウンタ２７にも入力され、
ＮBL本のラインをデータ変換ＲＯＭ２８に入力する。
同期信号ｆH と共にラスタカウンタ２７にも入力され、
ＮBL本のラインをデータ変換ＲＯＭ２８に入力する。
【００３３】データ変換ＲＯＭ２８では、ＮBL本のライ
ンの間引きまたは追加を行って所定数（８）にする。こ
のとき、ライン間隔が等しくなるようにする。この出力
タイミングパルスＰBLをレジスタ２９に記録する。
ンの間引きまたは追加を行って所定数（８）にする。こ
のとき、ライン間隔が等しくなるようにする。この出力
タイミングパルスＰBLをレジスタ２９に記録する。
【００３４】テストパターンメモリ１４には、キャラク
タパターンデータのアドレスと、コントラストと、Ｒ・
Ｇ・Ｂのオンオフデータを記憶させてある。キャラクタ
パターンデータは、キャラクタＲＯＭ３２に記憶させて
おく。
タパターンデータのアドレスと、コントラストと、Ｒ・
Ｇ・Ｂのオンオフデータを記憶させてある。キャラクタ
パターンデータは、キャラクタＲＯＭ３２に記憶させて
おく。
【００３５】キャラクタＲＡＭコントロール回路３０に
はＰＢＨおよびＰＢＶが加えられており、このＰＢＨお
よびＰＢＶによって指定されるブロックのキャタクタパ
ターンデータのアドレスをテストパターンメモリ１４か
ら読出し、そのアドレスをキャラクタＲＡＭ３１（バッ
ファメモリとして機能する）に書込む。
はＰＢＨおよびＰＢＶが加えられており、このＰＢＨお
よびＰＢＶによって指定されるブロックのキャタクタパ
ターンデータのアドレスをテストパターンメモリ１４か
ら読出し、そのアドレスをキャラクタＲＡＭ３１（バッ
ファメモリとして機能する）に書込む。
【００３６】キャラクタＲＯＭ３２には各ラインのアド
レス信号ＰBLが加えられており、ＰBLによって指定され
た１ライン分のキャラクタパターンデータを並列に出力
する。
レス信号ＰBLが加えられており、ＰBLによって指定され
た１ライン分のキャラクタパターンデータを並列に出力
する。
【００３７】キャラクタコントロール回路３４には、Ｐ
ＢＬによって指定された１ライン分についてテストパタ
ーンメモリ１４からコントラストおよびＲ・Ｇ・Ｂオン
オフデータが書込まれ、これを出力コントロール回路３
５に加える。
ＢＬによって指定された１ライン分についてテストパタ
ーンメモリ１４からコントラストおよびＲ・Ｇ・Ｂオン
オフデータが書込まれ、これを出力コントロール回路３
５に加える。
【００３８】出力コントロール回路３５は、並直列変換
回路３３によって直列に変換されたキャラクタパターン
データに、キャラクタコントロール回路３４から加えら
れるコントラスト，Ｒ・Ｇ・Ｂオンオフデータを加え、
所要のＲ・Ｇ・Ｂ信号を作成し、Ｖｏｕｔ を出力す
る。
回路３３によって直列に変換されたキャラクタパターン
データに、キャラクタコントロール回路３４から加えら
れるコントラスト，Ｒ・Ｇ・Ｂオンオフデータを加え、
所要のＲ・Ｇ・Ｂ信号を作成し、Ｖｏｕｔ を出力す
る。
【００３９】
【発明の効果】上述したとおり本発明によれば、映像信
号源の水平および垂直の同期信号周波数の変化に対応し
て任意の形状・任意の色彩のテストパターンを、マルチ
スキャン式投写形カラーテレビジョン受像機の有効画面
の所定の位置に映出することができるので、各周波数毎
にテストパターン発生器または内部回路を準備する必要
がなく経済的であるばかりでなく、取扱いが容易となる
利点がある。
号源の水平および垂直の同期信号周波数の変化に対応し
て任意の形状・任意の色彩のテストパターンを、マルチ
スキャン式投写形カラーテレビジョン受像機の有効画面
の所定の位置に映出することができるので、各周波数毎
にテストパターン発生器または内部回路を準備する必要
がなく経済的であるばかりでなく、取扱いが容易となる
利点がある。
【００４０】また本発明は、カラーテレビジョン受像機
だけでなくモノクロームテレビジョン受像機であって
も、任意の水平および垂直の同期周波数の入力に対し
て、画面の所定の位置にテストパターンを映出できる原
理には変わりない。さらに、投写形のテレビジョンだけ
でなく、単一のテレビジョン受像管によるテレビジョン
受像機の場合であってもよいことはいうまでもない。
だけでなくモノクロームテレビジョン受像機であって
も、任意の水平および垂直の同期周波数の入力に対し
て、画面の所定の位置にテストパターンを映出できる原
理には変わりない。さらに、投写形のテレビジョンだけ
でなく、単一のテレビジョン受像管によるテレビジョン
受像機の場合であってもよいことはいうまでもない。
【００４１】さらに、映出しようとする画像はテストパ
ターンに限られるものではなく、例えば文字スーパーを
行う場合等、入力信号源の水平および垂直同期周波数に
関係なく、任意の映像を任意の位置に映出できるので、
その応用範囲は極めて大きいものになる。
ターンに限られるものではなく、例えば文字スーパーを
行う場合等、入力信号源の水平および垂直同期周波数に
関係なく、任意の映像を任意の位置に映出できるので、
その応用範囲は極めて大きいものになる。
【図１】本発明の一実施例によるテストパターン発生装
置を使用する場合の各機器の接続関係を示す図である。
置を使用する場合の各機器の接続関係を示す図である。
【図２】全画面を縦横の仮想線で区切り、所定数のブロ
ックを構成することを示す説明図である。
ックを構成することを示す説明図である。
【図３】各ブロックを縦の仮想線で区切って水平方向の
画素を、横の仮想線で区切って垂直方向のラインを示す
説明図である。
画素を、横の仮想線で区切って垂直方向のラインを示す
説明図である。
【図４】本発明の一実施例の全体的構成を示すブロック
図である。
図である。
【図５】図４に示した実施例のより詳細な構成を示すブ
ロック図である。
ロック図である。
１ 映像信号源 ２ テストパターン発生装置 ３ マルチスキャン式投写形カラーテレビジョン受像機 ４ 全有効画面 ５ ブロック ６ 画素 １１ 同期分離回路 １２ 水平方向出力タイミング発生回路 １３ 垂直方向出力タイミング発生回路 １４ テストパターンメモリ １５ キャラクタ読出し出力回路 ２１ クロック発生器 ２２ Ｈカウンタ ２３ １ブロックのライン数演算回路 ２４ レジスタ ２５ Ｖカウンタ ２６ レジスタ ２７ ラスタカウンタ ２８ データ変換ＲＯＭ ２９ レジスタ ３０ キャラクタＲＡＭコントロール回路 ３１ キャラクタＲＡＭ ３２ キャラクタＲＯＭ ３３ 並直列変換回路 ３４ キャラクタコントロール回路 ３５ 出力コントロール回路 Ｖｉｎ 入力映像信号 Ｖｏｕｔ 出力映像信号 ｆＨ 水平同期周波数 ｆＶ 垂直同期周波数 ＮＢＬ １ブロックのライン数 ＮＴＶ 全ブロック上下端間の総ライン数 ＰＤＨ 水平方向画素アドレスパルス ＰＢＨ 水平方向ブロックアドレスパルス ＰＢＶ 垂直方向ブロックアドレスパルスＰ ＢＬ １ブロックのライン出力タイミングパルス
フロントページの続き (56)参考文献 特開 平１−263692（ＪＰ，Ａ) 特開 昭61−248082（ＪＰ，Ａ) 特開 昭61−117592（ＪＰ，Ａ) 特開 昭59−87379（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 17/00 - 17/06
Claims (1)
- 【請求項１】 マルチスキャン式テレビジョン受像機の
調整に使用するテストパターン発生装置において、 入力複合同期信号を水平同期信号と垂直同期信号に分離
する同期分離手段と、 前記水平同期信号の周波数ｆＨと、前記受像機の有効画
面を同一サイズのブロックに分割して得られる水平ブロ
ック数ＮＨＢと、前記ブロックの水平方向の画素数Ｎ
ＨＤと、水平有効画面率をａＨとしたとき、 ｆＣＬＫ＝ｆＨ×ＮＨＢ×ＮＨＤ／ａＨ の演算より得られる周波数ｆＣＬＫの画素クロックを発
生するクロック発生手段と、 前記クロック発生手段の出力に基づいて前記水平方向の
画素毎に計数した出力を水平方向のブロックアドレスと
して出力する水平方向ブロックアドレス発生手段と、 前記水平同期信号と前記垂直同期信号より前記同一サイ
ズの１ブロック当たりの垂直方向のライン数を求める演
算手段と、 前記水平同期信号に基づいて該演算手段の出力毎に計数
した出力を垂直方向のブロックアドレスとする垂直方向
ブロックアドレス発生手段と、 前記水平同期信号に基づいて前記演算手段の出力より前
記１ブロック当たりの垂直方向のライン数が全ブロック
に対して等しくなるように間引きまたは追加を行う垂直
方向ブロック補正アドレス発生手段と、 前記水平方向ブロックアドレス発生手段の出力と、前記
垂直方向ブロックアドレス発生手段の出力および前記ク
ロック発生手段の出力をアドレスとし、表示テストパタ
ーンの映像出力制御信号と該表示テストパターンのキャ
ラクタを記憶しているキャラクタメモリの水平アドレス
信号を読み出しデータとする記憶手段と、 該水平アドレス信号を一時的に記憶しておくバッファメ
モリと、 該バッファメモリの読み出し出力と前記垂直方向ブロッ
ク補正アドレス発生手段の出力をアドレスとして読み出
されるキャラクタメモリと、 前記キャラクタメモリの出力を前記映像出力制御信号に
より制御して出力する出力制御手段と、 を具備したことを特徴とするテストパターン発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16967192A JP3273808B2 (ja) | 1992-06-26 | 1992-06-26 | テストパターン発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16967192A JP3273808B2 (ja) | 1992-06-26 | 1992-06-26 | テストパターン発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0614349A JPH0614349A (ja) | 1994-01-21 |
| JP3273808B2 true JP3273808B2 (ja) | 2002-04-15 |
Family
ID=15890757
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16967192A Expired - Fee Related JP3273808B2 (ja) | 1992-06-26 | 1992-06-26 | テストパターン発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3273808B2 (ja) |
-
1992
- 1992-06-26 JP JP16967192A patent/JP3273808B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0614349A (ja) | 1994-01-21 |
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