JP3084395U - Power circuit - Google Patents

Power circuit

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JP3084395U
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Inventor
義仁 佐々木
Original Assignee
阪神エレクトリック株式会社
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Abstract

(57)【要約】 【課題】 過電圧を維持しないように抑える過電圧保護
回路は回路構成が大きく、また、ラッチ回路による過電
圧保護では、すぐに回路を停止してしまう。 【解決手段】 出力電圧が過電圧を維持しないように抑
える過電圧保護回路11と、スイッチング素子の入力電
圧が過電圧となった場合にラッチ回路が動作して、スイ
ッチング素子の動作を停止する(ラッチ回路による)過
電圧保護回路12の双方を設けた。
(57) [Problem] To provide an overvoltage protection circuit for suppressing overvoltage from being maintained, the circuit configuration is large, and the overvoltage protection by a latch circuit immediately stops the circuit. SOLUTION: An overvoltage protection circuit 11 for suppressing an output voltage from maintaining an overvoltage, and a latch circuit which operates when an input voltage of the switching element becomes overvoltage, stops the operation of the switching element (by the latch circuit). ) Both overvoltage protection circuits 12 are provided.

Description

【考案の詳細な説明】[Detailed description of the invention]

【0001】[0001]

【考案の属する技術分野】[Technical field to which the invention belongs]

本考案は、電源回路に係り、特に過電圧保護回路を備えた電源回路に関するも のである。 The present invention relates to a power supply circuit, and more particularly to a power supply circuit having an overvoltage protection circuit.

【0002】[0002]

【従来の技術】[Prior art]

スイッチング素子を介在してその出力電圧を負荷に印加するように構成した電 源回路においては、スイッチング素子の入力電圧が異常に上昇した時、あるいは 電源回路の主要各部に故障が生じて定電圧制御回路が機能しなくなった場合、出 力電圧が跳ね上がってしまう。 このような過電圧状態が発生すると、出力平滑用コンデンサの破損、スイッチ ングトランジスタや抵抗等の異常発熱、さらには負荷の破損等の問題が発生する 。このような過電圧により負荷が破壊されないように電源回路には、過電圧保護 回路が使用されている。 In a power supply circuit configured to apply its output voltage to a load via a switching element, constant voltage control is performed when the input voltage of the switching element rises abnormally or when a major part of the power supply circuit fails. If the circuit fails, the output voltage will jump. When such an overvoltage state occurs, problems such as damage to the output smoothing capacitor, abnormal heating of the switching transistor and the resistor, and damage to the load occur. An overvoltage protection circuit is used in the power supply circuit to prevent the load from being destroyed by such an overvoltage.

【0003】 スイッチング素子を介在してその出力電圧を負荷に印加するように構成した電 源回路に使用される一般的な過電圧保護回路は、過電圧が印加されるとスイッチ ング素子をオフ制御して、出力電圧を下げ、出力電圧が下がると、スイッチング 素子のオフ制御を解除して通常の定電圧制御に復帰し、出力電圧が増大すると再 びスイッチング素子をオフ制御を再開し、この動作の繰り返しにより、出力電圧 が過大になることによる電解コンデンサ及び出力端子に接続された電子機器等に 不具合が発生する現象等を防止するようにしている。 また、出力電圧が所定値以上に過大になるとラッチし回路が動作してスイッチ ング素子をオフさせてスイッチング動作を停止するようにしている。A general overvoltage protection circuit used for a power supply circuit configured to apply an output voltage to a load via a switching element controls off the switching element when an overvoltage is applied. When the output voltage decreases and the output voltage decreases, the switching element off control is released and normal constant voltage control is resumed.When the output voltage increases, the switching element off control is restarted again, and this operation is repeated. In this way, it is possible to prevent a phenomenon that a failure occurs in an electrolytic capacitor and an electronic device connected to the output terminal due to an excessive output voltage. Further, when the output voltage becomes excessively higher than a predetermined value, the latch circuit operates and the switching element is turned off to stop the switching operation.

【0004】[0004]

【考案が解決しようとする課題】[Problems to be solved by the invention]

過電圧発生時、スイッチング素子をオフ制御して、一時的に出力電圧を下げ、 出力電圧が下がると、オフ制御を解除して通常の定電圧制御に復帰し、出力電圧 が増大すると再びスイッチング素子のオフ制御を再開し、この動作の繰り返しに より、負荷を保護する過電圧保護回路では、回路構成が大きくなってしまう。 また、ラッチ回路による過電圧保護では、すぐに回路を停止してしまい、エラ ーモードにはいってしまう等、改善が望まれていた。 When an overvoltage occurs, the switching element is turned off to temporarily lower the output voltage.When the output voltage drops, the off control is released and the control returns to normal constant voltage control. By restarting the off control and repeating this operation, the circuit configuration of the overvoltage protection circuit for protecting the load becomes large. In addition, in the overvoltage protection by the latch circuit, an improvement has been desired, for example, the circuit is immediately stopped and an error mode is entered.

【0005】[0005]

【課題を解決するための手段】[Means for Solving the Problems]

上記目的を達成するために本考案は、スイッチング素子を介在して負荷に印加 される出力電圧が第1の設定値までの過大な電圧となったときには、前記スイッ チング素子をオフ制御して、出力電圧を下げ、出力電圧が下がると、前記スイッ チング素子のオフ制御を解除して通常の定電圧制御に復帰するる第1の過電圧保 護回路と、前記スイッチング素子の入力電圧に前記第1の設定値を越える過大な 電圧が印加されたときには、前記スイッチング素子をオフさせてスイッチング素 子の動作を停止する第2の過電圧保護回路とを備えたことを特徴とする。 In order to achieve the above object, the present invention is to control the switching element to be turned off when an output voltage applied to a load via a switching element becomes an excessive voltage up to a first set value. A first overvoltage protection circuit for reducing the output voltage and releasing the off control of the switching element when the output voltage decreases to return to the normal constant voltage control; and a first overvoltage protection circuit for applying the first voltage to the input voltage of the switching element. And a second overvoltage protection circuit for turning off the switching element and stopping the operation of the switching element when an excessive voltage exceeding the set value is applied.

【0006】 このように、過電圧を抑える回路と、回路を停止する回路の双方を電源回路に 設けたことで、印加された過電圧のレベルによりむやみに回路を停止する必要が なくなり、ある値までは電圧を抑えるだけですむ。As described above, since both the circuit for suppressing the overvoltage and the circuit for stopping the circuit are provided in the power supply circuit, it is not necessary to stop the circuit unnecessarily depending on the level of the applied overvoltage. You only need to reduce the voltage.

【0007】[0007]

【考案の実施の形態】[Embodiment of the invention]

以下、図1の回路図を用いて本考案を説明する。図1において、端子B1、B 2は直流の定電圧(+12V)の供給ラインに設けた電源端子を示す。B3は負 荷に印加される直流出力電圧(+40V)を供給する電源端子、また、G1,G 2はアース端子を示す。電源端子B3は、スイッチング素子FET1のソース・ ドレインを介して負荷Sの電源端子B4に接続されている。スイッチング素子F ET1のソース・ゲート間には、抵抗R1が接続されている。また、スイッチン グ素子FET1のゲートは、抵抗R2を介してトランジスタQ1のコレクタに接 続されている。トランジスタQ1のエミッタは接地され、また、トランジスタQ 1のベースは抵抗R4を介して接地されるとともに、抵抗R3,抵抗R5を介し て電源端子B1に接続されて、その接続点はオペアンプCP1の出力端子及びオ ペアンプCP2の出力端子に接続されている。 Hereinafter, the present invention will be described with reference to the circuit diagram of FIG. In FIG. 1, terminals B1 and B2 indicate power supply terminals provided on a supply line for a constant DC voltage (+12 V). B3 indicates a power supply terminal for supplying a DC output voltage (+40 V) applied to the load, and G1 and G2 indicate ground terminals. The power supply terminal B3 is connected to the power supply terminal B4 of the load S via the source / drain of the switching element FET1. A resistor R1 is connected between the source and the gate of the switching element FET1. The gate of the switching element FET1 is connected to the collector of the transistor Q1 via the resistor R2. The emitter of the transistor Q1 is grounded, the base of the transistor Q1 is grounded via a resistor R4, and connected to the power supply terminal B1 via resistors R3 and R5. The connection point is the output of the operational amplifier CP1. Terminal and the output terminal of the operational amplifier CP2.

【0008】 オペアンプCP1の基準電圧の入力端子は、抵抗R6を介して出力端子に接続 され、この抵抗R6の接続によりヒステリシス特性を持たせている。また、抵抗 R7と抵抗R8の直列な分圧回路が電源端子B1とアース端子G1間に接続され 、その接続点はオペアンプCP1の基準電圧の入力端子に接続されて、抵抗R7 と抵抗R8で分圧された基準電圧が印加されている。スイッチング素子FET1 の出力電圧が印加される電源端子B4とアース端子G2間には、抵抗R9と抵抗 R10の直列な分圧回路が接続され、その接続点はオペアンプCP1の他の入力 端子に接続され、スイッチング素子FET1の出力電圧が抵抗R9と抵抗R10 で分圧されてオペアンプCP1の他の入力端子に印加されている。これら、オペ アンプCP1と抵抗R7と抵抗R8からなる分圧回路及び抵抗R9と抵抗R10 からなる分圧回路は過電圧保護回路11を構成している。An input terminal of the reference voltage of the operational amplifier CP1 is connected to an output terminal via a resistor R6, and the connection of the resistor R6 provides a hysteresis characteristic. Further, a series voltage dividing circuit of the resistor R7 and the resistor R8 is connected between the power supply terminal B1 and the ground terminal G1, and the connection point is connected to the input terminal of the reference voltage of the operational amplifier CP1 and divided by the resistor R7 and the resistor R8. A compressed reference voltage is applied. A series voltage dividing circuit of a resistor R9 and a resistor R10 is connected between the power supply terminal B4 to which the output voltage of the switching element FET1 is applied and the ground terminal G2, and the connection point is connected to another input terminal of the operational amplifier CP1. The output voltage of the switching element FET1 is divided by the resistors R9 and R10 and applied to another input terminal of the operational amplifier CP1. The voltage divider composed of the operational amplifier CP1, the resistor R7 and the resistor R8 and the voltage divider composed of the resistor R9 and the resistor R10 constitute an overvoltage protection circuit 11.

【0009】 オペアンプCP2の基準電圧の入力端子は、抵抗R11を介して出力端子に接 続され、この抵抗R11の接続によりヒステリシス特性を持たせている。また、 抵抗R12と抵抗R13の直列な分圧回路が電源端子B2とアース端子G2間に 接続され、その接続点はオペアンプCP2の基準電圧の入力端子に接続されて、 抵抗R12と抵抗R13で分圧された基準電圧が印加されている。電源端子B4 とアース端子G2間には、抵抗R14と抵抗R15の直列な分圧回路が接続され 、その接続点はオペアンプCP2の他の入力端子に接続されて、スイッチング素 子FET1の入力電圧が抵抗R14と抵抗R15で分圧されてオペアンプCP2 の他の入力端子に印加されている。これら、オペアンプCP2と抵抗R12と抵 抗R13からなる分圧回路及び抵抗R14と抵抗R15からなる分圧回路はラッ チ回路12を構成している。An input terminal of the reference voltage of the operational amplifier CP2 is connected to an output terminal via a resistor R11, and the connection of the resistor R11 provides a hysteresis characteristic. Further, a series voltage dividing circuit of the resistor R12 and the resistor R13 is connected between the power supply terminal B2 and the ground terminal G2, and the connection point is connected to the input terminal of the reference voltage of the operational amplifier CP2. A compressed reference voltage is applied. A series voltage dividing circuit composed of a resistor R14 and a resistor R15 is connected between the power supply terminal B4 and the ground terminal G2, and the connection point is connected to another input terminal of the operational amplifier CP2 so that the input voltage of the switching element FET1 is reduced. The voltage is divided by the resistors R14 and R15 and applied to another input terminal of the operational amplifier CP2. The voltage divider composed of the operational amplifier CP2, the resistor R12 and the resistor R13 and the voltage divider composed of the resistor R14 and the resistor R15 constitute a latch circuit 12.

【0010】 次に動作について説明する。今、スイッチング素子FET1の出力電圧が第1 の設定値(+50V)までの範囲で過大な電圧となったときには、オペアンプC P1は、スイッチング素子をオフ制御して、出力電圧を下げる。そして、出力電 圧が下がるとオペアンプCP1は、スイッチング素子FET1のオフ制御を解除 する。スイッチング素子FET1の出力電圧が第1の設定値までの範囲で過大な 電圧となる状態では、オペアンプCP1はこの動作を繰り返す。 次に、スイッチング素子FET1の入力電圧が上記第1の設定値を越える過大 な電圧で印加されたときには、オペアンプCP2は、スイッチング素子FET1 をオフさせてスイッチング素子FET1の動作を停止する。Next, the operation will be described. Now, when the output voltage of the switching element FET1 becomes an excessive voltage in the range up to the first set value (+50 V), the operational amplifier CP1 controls the switching element to turn off and lowers the output voltage. Then, when the output voltage decreases, the operational amplifier CP1 releases the OFF control of the switching element FET1. When the output voltage of the switching element FET1 becomes excessively high in the range up to the first set value, the operational amplifier CP1 repeats this operation. Next, when the input voltage of the switching element FET1 is applied with an excessive voltage exceeding the first set value, the operational amplifier CP2 turns off the switching element FET1 and stops the operation of the switching element FET1.

【0011】[0011]

【考案の効果】[Effect of the invention]

以上説明したように本考案では、スイッチング素子を介在して負荷に印加され る出力電圧が過電圧を維持しないように抑える過電圧保護回路と、スイッチング 素子の入力電圧が過電圧となった場合にラッチ回路が動作して、スイッチング素 子の動作を停止する(ラッチ回路による)過電圧保護回路の双方を電源回路に設 けたことで、印加された過電圧のレベルにより回路を停止することができ、むや みに回路を停止する必要がなくなり、ある値までは電圧を抑えるだけですむ等、 極めて実用的である。 As described above, in the present invention, the overvoltage protection circuit that suppresses the output voltage applied to the load via the switching element from maintaining the overvoltage, and the latch circuit when the input voltage of the switching element becomes overvoltage, are provided. Since both the overvoltage protection circuit that operates and stops the operation of the switching element (by the latch circuit) is installed in the power supply circuit, the circuit can be stopped according to the applied overvoltage level, This is extremely practical, as there is no need to stop the operation and only the voltage needs to be reduced to a certain value.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本考案に係る実施の形態の概略回路図である。FIG. 1 is a schematic circuit diagram of an embodiment according to the present invention.

【符号の説明】[Explanation of symbols]

11 過電圧保護回路 12 ラッチ回路 B1、B2 電源端子 B3,B4 電源端子 CP1,CP2 オペアンプ G1,G2 アース端子 FET1 スイッチング素子 Q1 トランジスタ R7,R8 分圧回路 R9,R10 分圧回路 R12,R13 分圧回路 R14,R15 分圧回路 S 負荷 DESCRIPTION OF SYMBOLS 11 Overvoltage protection circuit 12 Latch circuit B1, B2 Power supply terminal B3, B4 Power supply terminal CP1, CP2 Operational amplifier G1, G2 Ground terminal FET1 Switching element Q1 Transistor R7, R8 Divider R9, R10 Divider R12, R13 Divider R14 , R15 Voltage divider circuit S load

Claims (1)

【実用新案登録請求の範囲】[Utility model registration claims] 【請求項1】 スイッチング素子を介在して負荷に印加
される出力電圧が第1の設定値までの過大な電圧となっ
たときには、前記スイッチング素子をオフ制御して、出
力電圧を下げ、出力電圧が下がると、前記スイッチング
素子のオフ制御を解除して通常の定電圧制御に復帰する
る第1の過電圧保護回路と、 前記スイッチング素子の入力電圧に前記第1の設定値を
越える過大な電圧が印加されたときには、前記スイッチ
ング素子をオフさせてスイッチング素子の動作を停止す
る第2の過電圧保護回路とを備えたことを特徴とする電
源回路。
When an output voltage applied to a load via a switching element becomes an excessive voltage up to a first set value, the switching element is turned off to lower the output voltage, and the output voltage is reduced. When the voltage drops, a first overvoltage protection circuit that releases the off control of the switching element and returns to the normal constant voltage control, and an excessive voltage exceeding the first set value is applied to the input voltage of the switching element. And a second overvoltage protection circuit for turning off the switching element and stopping the operation of the switching element when the voltage is applied.
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