JP3062358B2 - Microwave integrated circuit device - Google Patents

Microwave integrated circuit device

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JP3062358B2
JP3062358B2 JP4270469A JP27046992A JP3062358B2 JP 3062358 B2 JP3062358 B2 JP 3062358B2 JP 4270469 A JP4270469 A JP 4270469A JP 27046992 A JP27046992 A JP 27046992A JP 3062358 B2 JP3062358 B2 JP 3062358B2
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浩司 塚田
泰久 山下
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松下電子工業株式会社
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】この発明は、電界効果トランジス
タ等の能動素子およびこの能動素子に付随する回路素子
を同一の半導体基板上にモノリシックに形成して、一つ
のパッケージに納めたマイクロ波集積回路素子に関する
もので、マイクロ波の増幅、発振、変調等に用いること
ができるものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a microwave integrated circuit in which an active element such as a field-effect transistor and a circuit element associated with the active element are monolithically formed on the same semiconductor substrate and housed in one package. The present invention relates to an element and can be used for amplification, oscillation, modulation, and the like of microwaves.

【0002】[0002]

【従来の技術】近年、高周波回路技術の進展により、信
頼性,経済性,小型軽量性などの観点から、マイクロ波
集積回路装置が広く用いられるようになってきた。ま
た、トランジスタのような能動素子と、抵抗素子,キャ
パシタンス素子のような受動素子とが同一の半導体基板
上にモノリシックに作られているモノリシックマイクロ
波集積回路(MMICと略す)も開発されている(例え
ば、山下泰久他「携帯電話用パワーアンプモジュール」
National Technical Report Vol.36 No.4 Aug.(1990) p
34, MMICに関しては、今井哲二他著「化合物半導体
デバイス(2)、(1985年1月5日)工業調査会、
p33)。
2. Description of the Related Art In recent years, with the development of high-frequency circuit technology, microwave integrated circuit devices have been widely used from the viewpoints of reliability, economy, small size and light weight. Further, a monolithic microwave integrated circuit (abbreviated as MMIC) has been developed in which an active element such as a transistor and a passive element such as a resistance element and a capacitance element are monolithically formed on the same semiconductor substrate (MMIC). For example, Yasuhisa Yamashita et al. "Power Amplifier Module for Mobile Phones"
National Technical Report Vol.36 No.4 Aug. (1990) p
34, Regarding MMIC, Tetsuji Imai et al., “Compound Semiconductor Device (2), (January 5, 1985)
p33).

【0003】以下、図4ないし図6を参照しながら上述
した従来のマイクロ波集積回路装置について説明する。
図4は従来のマイクロ波集積回路装置の概略図、図5は
図4のマイクロ波集積回路装置の等価回路図、図6はマ
イクロ波集積回路装置に使用される能動素子である電界
効果トランジスタ(以下、「FET」と略す)のチップ
の概略図である。
Hereinafter, the above-described conventional microwave integrated circuit device will be described with reference to FIGS.
FIG. 4 is a schematic view of a conventional microwave integrated circuit device, FIG. 5 is an equivalent circuit diagram of the microwave integrated circuit device of FIG. 4, and FIG. 6 is a field effect transistor (active element) used in the microwave integrated circuit device. FIG. 1 is a schematic diagram of a chip of the present invention.

【0004】図4および図5において、21は例えばF
ETからなる能動素子である。22A,22Bはスルー
ラインであるマイクロストリップである。23A,23
Bはショートスタブであるマイクロストリップである。
24A〜24Dは高周波成分をアースに接地するチップ
キャパシタンスである。25はゲート保護を行うための
チップ抵抗である。26は低周波での発振を防ぐための
安定化用チップ抵抗である。27はゲート電圧値を調整
するためのチップ抵抗である。28A〜28Dは半導体
基板裏面に接続されているバイアホール(ビアホール)
である。29は高誘電率基板、30は裏面金属薄板であ
る。31は入力パッド、32は出力パッドである。33
は能動素子(FET)21に対するゲートバイアス用パ
ッド、34は能動素子(FET)21に対するドレイン
バイアス用パッドである。
In FIGS. 4 and 5, reference numeral 21 denotes, for example, F
It is an active element made of ET. 22A and 22B are microstrips which are through lines. 23A, 23
B is a microstrip that is a short stub.
24A to 24D are chip capacitances for grounding high frequency components to ground. 25 is a chip resistor for protecting the gate. Reference numeral 26 denotes a stabilizing chip resistor for preventing oscillation at a low frequency. 27 is a chip resistor for adjusting the gate voltage value. 28A to 28D are via holes (via holes) connected to the back surface of the semiconductor substrate
It is. 29 is a high dielectric constant substrate, 30 is a back metal thin plate. 31 is an input pad and 32 is an output pad. 33
Is a gate bias pad for the active element (FET) 21, and 34 is a drain bias pad for the active element (FET) 21.

【0005】図6において、35,36,37はそれぞ
れ能動素子(FET)21のチップのゲート,ソース,
ドレインである。以上のように構成されたマイクロ波集
積回路装置の動作を以下に説明する。能動素子(FE
T)21のゲートおよびドレインには、各々外部より、
ゲートバイアス用パッド33およびドレインバイアス用
パッド34を介してDCバイアスが印加される。
In FIG. 6, reference numerals 35, 36, and 37 denote a gate, a source, and a chip of the active element (FET) 21, respectively.
It is a drain. The operation of the microwave integrated circuit device configured as described above will be described below. Active element (FE
T) The gate and drain of 21 are externally
A DC bias is applied through a pad 33 for gate bias and a pad 34 for drain bias.

【0006】そして、入力パッド31から入った高周波
(RF)信号は、入力側のスルーライン(マイクロスト
リップ22A)とショートスタブ(マイクロストリップ
23A)とによって所望の周波数帯域で能動素子(FE
T)21のインピーダンスに整合された後、能動素子
(FET)21のゲートに伝播されて増幅され、能動素
子(FET)21のドレインから出力される増幅信号
は、同様に出力側のスルーライン(マイクロストリップ
22B)とショートスタブ(マイクロストリップ23
B)とによって所望の周波数帯域で負荷インピーダンス
に整合され、出力パッド32より取り出される。
A high frequency (RF) signal input from the input pad 31 is supplied to the active element (FE) in a desired frequency band by a through line (microstrip 22A) and a short stub (microstrip 23A) on the input side.
T), after being matched to the impedance of the active element (FET) 21, the amplified signal is propagated to the gate of the active element (FET) 21 and amplified, and the amplified signal output from the drain of the active element (FET) 21 is similarly output through line ( Microstrip 22B) and short stub (microstrip 23)
B), the impedance is matched to the load impedance in the desired frequency band, and is extracted from the output pad 32.

【0007】[0007]

【発明が解決しようとする課題】しかしながら、上記の
ような構成では、高誘電率基板29上に数多くのチップ
部品(能動素子(FET)21,チップキャパシタンス
24A〜24D,チップ抵抗25〜27)をマウントせ
ねばならず、その労力が多大であるという問題がある。
また、高誘電率基板29の面積が大きくなってしまうと
いう問題がある。これは、能動素子(FET)21はそ
の製造過程で抵抗素子やキャパシタンス素子を作ること
が可能であるにもかかわらず、単品でパッケージングさ
れ、そのチップ面積よりパッケージの面積が広いからで
ある。
However, in the above configuration, a large number of chip components (active elements (FETs) 21, chip capacitances 24A to 24D, chip resistors 25 to 27) are provided on the high dielectric substrate 29. There is a problem that the mounting has to be carried out and the labor is great.
Further, there is a problem that the area of the high dielectric constant substrate 29 becomes large. This is because the active element (FET) 21 is packaged as a single product and has a larger package area than its chip area, although a resistance element and a capacitance element can be produced in the manufacturing process.

【0008】この発明は、基板に能動素子等のチップ部
品をマウントしてマイクロ波集積回路装置を形成する際
に要するチップ部品数を削減して製造を容易にすること
を目的とする。
An object of the present invention is to reduce the number of chip components required when mounting a chip component such as an active element on a substrate to form a microwave integrated circuit device, and to facilitate manufacture.

【0009】[0009]

【課題を解決するための手段】請求項1記載のマイクロ
波集積回路素子は、半導体基板上に、信号が入力される
ゲートと、増幅信号が出力されるドレインと、接地され
るソースとを備えた電界効果トランジスタと、電界効果
トランジスタのゲートに一端を接続するとともに他端に
ゲートバイアスが印加される第1の抵抗素子と、電界効
果トランジスタのゲートに一端を接続した第2の抵抗素
子と、第1の抵抗素子の他端に一端を接続するとともに
電界効果トランジスタのソースに他端を接続した第1の
キャパシタンス素子と、第2の抵抗素子の他端に一端を
それぞれ接続するとともに電界効果トランジスタのソー
スに他端をそれぞれ接続した第3の抵抗素子および第2
のキャパシタンス素子とを備えている。請求項2記載の
マイクロ波集積回路素子は、半導体基板上に、信号が入
力されるベースと、増幅信号が出力されるコレクタと、
接地されるエミッタとを備えたバイポーラトランジスタ
と、バイポーラトランジスタのベースに一端を接続する
とともに他端にベースバイアスが印加される第1の抵抗
素子と、バイポーラトランジスタのベースに一端を接続
した第2の抵抗素子と、第1の抵抗素子の他端に一端を
接続するとともにバイポーラトランジスタのエミッタに
他端を接続した第1のキャパシタンス素子と、第2の抵
抗素子の他端に一端をそれぞれ接続するとともにバイポ
ーラトランジスタのエミッタに他端をそれぞれ接続した
第3の抵抗素子および第2のキャパシタンス素子とを備
えている。
According to a first aspect of the present invention, there is provided a microwave integrated circuit device, wherein a signal is input to a semiconductor substrate.
The gate, the drain from which the amplified signal is output, and the ground
Field-effect transistor with a source
Connect one end to the transistor gate and the other end
A first resistive element to which a gate bias is applied;
A second resistor element having one end connected to the gate of the transistor
And one end connected to the other end of the first resistance element
A first transistor having the other end connected to the source of the field effect transistor;
One end is connected to the other end of the capacitance element and the second resistance element.
Connect each of them together with the field-effect transistor saw.
A third resistance element having the other end connected to the
And a capacitance element. According to a second aspect of the present invention, there is provided a microwave integrated circuit device in which a signal is input to a semiconductor substrate.
The base that is input, the collector from which the amplified signal is output,
Bipolar transistor with emitter grounded
And connect one end to the base of the bipolar transistor
And a first resistor to which a base bias is applied to the other end.
Connect one end to the element and the base of the bipolar transistor
One end is connected to the other end of the second resistance element and the other end of the first resistance element.
Connected to the emitter of a bipolar transistor
A first capacitance element having the other end connected thereto, and a second resistance element;
Connect one end to the other end of the resistance element and
Connected the other end to the emitter of the transistor
A third resistance element and a second capacitance element;
There Ete.

【0010】[0010]

【作用】請求項1記載の構成によれば、能動素子である
電界効果トランジスタと第1,第2および第3の抵抗素
子と第1および第2のキャパシタンス素子とがひとつの
パッケージに納められることになり、電界効果トランジ
スタと第1,第2および第3の抵抗素子と第1および第
2のキャパシタンス素子等を使用して、増幅,発振,変
調用のマイクロ波集積回路装置を構成する際に、基板上
にマウントするチップ部品数が削減される。
According to the structure of the first aspect, the active element is provided.
Field effect transistor and first, second and third resistors
And the first and second capacitance elements are housed in one package, and the field-effect transistor
And the first, second and third resistance elements and the first and second resistance elements.
When configuring a microwave integrated circuit device for amplification, oscillation, and modulation using the two capacitance elements and the like, the number of chip components mounted on the substrate is reduced.

【0011】請求項2記載の構成によれば、能動素子
あるバイポーラトランジスタと第1,第2および第3の
抵抗素子と第1および第2のキャパシタンス素子とがひ
とつのパッケージに納められることになり、バイポーラ
トランジスタと第1,第2および第3の抵抗素子と第1
および第2のキャパシタンス素子等を使用して、増幅,
発振,変調用のマイクロ波集積回路装置を構成する際
に、基板上にマウントするチップ部品数が削減される。
[0011] According to the configuration of claim 2, wherein, in the active element
There bipolar transistor and the first, will be the second and third resistive element and the first and second capacitance elements are housed in one package, bipolar
Transistor , first, second and third resistance elements and first
And amplification using the second capacitance element and the like.
When configuring a microwave integrated circuit device for oscillation and modulation, the number of chip components mounted on a substrate is reduced.

【0012】[0012]

【実施例】以下、この発明の一実施例について図面を参
照しながら説明する。図1はこの発明の一実施例のマイ
クロ波集積回路素子を有するマイクロ波集積回路装置の
等価回路図、図2は同じくこの発明の一実施例のマイク
ロ波集積回路素子を有するマイクロ波集積回路装置の概
略図、図3はマイクロ波集積回路素子の概略図である。
An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is an equivalent circuit diagram of a microwave integrated circuit device having a microwave integrated circuit device according to one embodiment of the present invention. FIG. 2 is a microwave integrated circuit device having a microwave integrated circuit device according to one embodiment of the present invention. FIG. 3 is a schematic view of a microwave integrated circuit device.

【0013】図1および図2において、1はマイクロ波
集積回路素子で、同一の半導体基板上にGaAsFET
からなる能動素子1Aと抵抗素子1B〜1Dおよびキャ
パシタンス素子1E,1Fをモノリシックに形成して一
つのパッケージに納めるようにしている。能動素子1A
は、ゲートを信号入力端子1Gに接続し、ドレインを信
号出力端子1Hに接続し、ソースを接地端子1Iに接続
した状態に半導体基板上に形成している。第1の抵抗素
子1Bは、能動素子1Aのゲートに一端を接続するとと
もにゲートバイアス端子1Jに他端を接続した状態に半
導体基板上に形成している。第2の抵抗素子1Cは、能
動素子1Aのゲートに一端を接続した状態に半導体基板
上に形成している。
In FIGS. 1 and 2, reference numeral 1 denotes a microwave integrated circuit device, and a GaAs FET is formed on the same semiconductor substrate.
The active element 1A, the resistance elements 1B to 1D, and the capacitance elements 1E and 1F are monolithically formed and accommodated in one package. Active element 1A
Are formed on a semiconductor substrate with the gate connected to the signal input terminal 1G, the drain connected to the signal output terminal 1H, and the source connected to the ground terminal 1I. The first resistance element 1B is formed on the semiconductor substrate with one end connected to the gate of the active element 1A and the other end connected to the gate bias terminal 1J. The second resistance element 1C is formed on the semiconductor substrate with one end connected to the gate of the active element 1A.

【0014】第1のキャパシタンス素子1Eは、第1の
抵抗素子1Bの他端に一端を接続するとともに能動素子
1Aのソースに他端を接続した状態に半導体基板上に形
成している。第3の抵抗素子1Dおよび第2のキャパシ
タンス素子1Fは、第2の抵抗素子1Cの他端に一端を
それぞれ接続するとともに能動素子1Aのソースに他端
をそれぞれ接続した状態に半導体基板上に形成してい
る。
The first capacitance element 1E is formed on a semiconductor substrate with one end connected to the other end of the first resistance element 1B and the other end connected to the source of the active element 1A. The third resistance element 1D and the second capacitance element 1F are formed on the semiconductor substrate with one end connected to the other end of the second resistance element 1C and the other end connected to the source of the active element 1A. doing.

【0015】上記において、第1の抵抗素子1Bと第1
のキャパシタンス素子1Eとがバイアス用回路素子とし
て機能し、第2および第3の抵抗素子1C,1Dと第2
のキャパシタンス素子1Fとが安定化用回路素子として
機能する。2A,2Bはスルーラインであるマイクロス
トリップである。3A,3Bはショートスタブであるマ
イクロストリップである。4A〜4Cは高周波成分をア
ースに接地するチップキャパシタンスである。8A〜8
Cは基板裏面に接続されているバイアホール(ビアホー
ル)である。9は高誘電率基板、10は裏面金属薄板で
ある。11は入力パッド、12は出力パッドである。1
3は能動素子(FET)1に対するゲートバイアス用パ
ッド、14は能動素子(FET)1に対するドレインバ
イアス用パッドである。
In the above, the first resistive element 1B and the first
Functions as a bias circuit element, and the second and third resistance elements 1C, 1D and the second
Functions as a stabilizing circuit element. 2A and 2B are microstrips which are through lines. 3A and 3B are microstrips which are short stubs. Reference numerals 4A to 4C denote chip capacitances for grounding high-frequency components to ground. 8A-8
C is a via hole (via hole) connected to the back surface of the substrate. 9 is a high dielectric constant substrate, 10 is a back metal thin plate. 11 is an input pad and 12 is an output pad. 1
Reference numeral 3 denotes a gate bias pad for the active element (FET) 1, and reference numeral 14 denotes a drain bias pad for the active element (FET) 1.

【0016】図3において、15,16,17はそれぞ
れ能動素子(FET)1のチップのゲート,ソース,ド
レインである。19はゲートバイアス用パッドで、図1
のゲートバイアス用パッド13に相当する。18A,1
8Bは高周波成分をアースに接地する平行平板形(以下
MIMと略す)キャパシタンス素子であり、それぞれ図
1のキャパシタンス素子1E,1Fに相当する。5はゲ
ート保護のための抵抗素子で、図1の第1の抵抗素子1
Bに相当する。6は低周波での発振を防ぐための安定化
用抵抗素子で、図1の第2の抵抗素子1Cに相当する。
7はゲート電圧値を調整するための抵抗素子で、図1の
第3の抵抗素子1Dに相当する。
In FIG. 3, reference numerals 15, 16, and 17 denote the gate, source, and drain of the chip of the active device (FET) 1, respectively. 19 is a pad for gate bias, which is shown in FIG.
Of the gate bias pad 13. 18A, 1
Reference numeral 8B denotes a parallel plate type (hereinafter abbreviated as MIM) capacitance element for grounding a high frequency component to the ground, and corresponds to the capacitance elements 1E and 1F in FIG. 1, respectively. Reference numeral 5 denotes a resistance element for protecting the gate, and the first resistance element 1 shown in FIG.
B. Reference numeral 6 denotes a stabilizing resistance element for preventing oscillation at a low frequency, which corresponds to the second resistance element 1C in FIG.
Reference numeral 7 denotes a resistance element for adjusting a gate voltage value, which corresponds to the third resistance element 1D in FIG.

【0017】以上のように構成されたマイクロ波集積回
路素子は、第2のキャパシタンス素子1Eが図4のチッ
プキャパシタンス24Bの一部となるのみであるが、そ
の他の回路図上の構成については図1のものと略同じで
あり、動作も従来のマイクロ波集積回路装置に用いられ
た場合の動作と同じである。この実施例によると、能動
素子(FET)1と、第1,第2および第3の抵抗素子
1B〜1Dと第1および第2のキャパシタンス素子1
E,1Fとがひとつのパッケージに納められることにな
り、能動素子(FET)1と第1,第2および第3の抵
抗素子1B〜1Dと第1および第2のキャパシタンス素
子1E,1F等を使用して、増幅,発振,変調用のマイ
クロ波集積回路装置を構成する際に、高誘電率基板9上
にマウントするチップ部品数を削減することができ、製
造が容易となる。
In the microwave integrated circuit device configured as described above, the second capacitance element 1E is only a part of the chip capacitance 24B shown in FIG. 4, but the configuration on other circuit diagrams is not shown. The operation is substantially the same as that of the first embodiment, and the operation is the same as that of the conventional microwave integrated circuit device. According to this embodiment, an active element (FET) 1, first, second and third resistance elements 1B to 1D, and first and second capacitance elements 1
E and 1F are housed in one package, and the active element (FET) 1, the first, second and third resistance elements 1B to 1D, the first and second capacitance elements 1E and 1F, etc. When used to construct a microwave integrated circuit device for amplification, oscillation, and modulation, the number of chip components mounted on the high dielectric substrate 9 can be reduced, and manufacturing becomes easier.

【0018】また、能動素子(FET)1のパッケージ
内に第1ないし第3の抵抗素子1B〜1Dと、第1およ
び第2のキャパシタンス素子1E,1Fを内蔵している
ため、これらの部品を大変コンパクトに構成することが
でき、高誘電率基板9を小さくすることが可能である。
なお、この実施例では、能動素子をGaAsFETとし
たが、これに限定されるものではなく、増幅機能を有す
るものなら何でもよい。例えば、バイポーラトランジス
タや他の半導体材料による能動素子を用いることもで
き、バイポーラトランジスタの場合には、ゲート,ドレ
イン,ソースは、それぞれベース,コレクタ,エミッタ
となる。
Further, since the first to third resistance elements 1B to 1D and the first and second capacitance elements 1E and 1F are incorporated in the package of the active element (FET) 1, these components are not required. It can be made very compact and the high dielectric substrate 9 can be made smaller.
In this embodiment, the active element is a GaAs FET. However, the present invention is not limited to this. Any element having an amplifying function may be used. For example, a bipolar transistor or an active element made of another semiconductor material can be used. In the case of a bipolar transistor , the gate, the drain, and the source serve as a base, a collector, and an emitter, respectively.

【0019】また、上記実施例では、半導体を用いて各
抵抗素子を形成したが、タングステンのスパッタによっ
て抵抗素子を形成してもよい。また、キャパシタンス素
子としてはMIM形のものを用いたが、ダイオードを用
いてもよい。
In the above embodiment, each resistance element is formed using a semiconductor. However, the resistance element may be formed by sputtering tungsten. Although the MIM type is used as the capacitance element, a diode may be used.

【0020】[0020]

【発明の効果】請求項1記載のマイクロ波集積回路素子
によれば、能動素子である電界効果トランジスタと第
1,第2および第3の抵抗素子と第1および第2のキャ
パシタンス素子とがひとつのパッケージに納められるこ
とになり、電界効果トランジスタと第1,第2および第
3の抵抗素子と第1および第2のキャパシタンス素子等
を使用して、増幅,発振,変調用のマイクロ波集積回路
装置を構成する際に、基板上にマウントするチップ部品
数を削減することができ、製造が容易となり、組立の際
の省力化を達成することができる。
According to the microwave integrated circuit device of the first aspect , the field effect transistor which is an active device and the
1, the second and third resistance elements and the first and second capacitors.
The pasitance element is housed in one package, and the field effect transistor and the first, second and
When configuring a microwave integrated circuit device for amplification, oscillation, and modulation using the third resistance element and the first and second capacitance elements, the number of chip components mounted on the substrate is reduced. Therefore, the manufacturing can be facilitated and labor saving during assembly can be achieved.

【0021】また、電界効果トランジスタと第1,第2
および第3の抵抗素子と第1および第2のキャパシタン
ス素子とをひとつのパッケージに納めたことにより、
界効果トランジスタと第1,第2および第3の抵抗素子
と第1および第2のキャパシタンス素子との全体寸法を
小さくでき、これらの部品をマウントする高誘電率基板
を小型化することができる。請求項2記載のマイクロ波
集積回路素子によれば、能動素子であるバイポーラトラ
ンジスタと第1,第2および第3の抵抗素子と第1およ
び第2のキャパシタンス素子とがひとつのパッケージに
納められることになり、バイポーラトランジスタと第
1,第2および第3の抵抗素子と第1および第2のキャ
パシタンス素子等を使用して、増幅,発振,変調用のマ
イクロ波集積回路装置を構成する際に、基板上にマウン
トするチップ部品数を削減することができ、製造が容易
となり、組立の際の省力化を達成することができる。
Also, a field effect transistor and first and second
And third resistance element and first and second capacitors
Power devices in a single package.
Field effect transistor and first, second and third resistance elements
And the overall size of the first and second capacitance elements can be reduced, and the high dielectric constant substrate on which these components are mounted can be reduced in size. The microwave according to claim 2.
According to the integrated circuit device , the bipolar tiger which is the active device
The transistor , the first, second and third resistance elements, and the first and second capacitance elements are housed in one package, and the bipolar transistor , the first, second and third resistance elements and the first When configuring a microwave integrated circuit device for amplification, oscillation, and modulation using the first and second capacitance elements and the like, the number of chip components mounted on a substrate can be reduced, and manufacturing becomes easier. Thus, labor saving during assembly can be achieved.

【0022】また、バイポーラトランジスタと第1,第
2および第3の抵抗素子と第1および第2のキャパシタ
ンス素子とをひとつのパッケージに納めたことにより、
バイポーラトランジスタと第1,第2および第3の抵抗
素子と第1および第2のキャパシタンス素子との全体寸
法を小さくでき、これらの部品をマウントする高誘電率
基板を小型化することができる。
In addition, since the bipolar transistor , the first, second and third resistance elements, and the first and second capacitance elements are contained in one package,
The overall dimensions of the bipolar transistor , the first, second, and third resistance elements, and the first and second capacitance elements can be reduced, and the high-permittivity substrate on which these components are mounted can be reduced in size.

【図面の簡単な説明】[Brief description of the drawings]

【図1】この発明の一実施例のマイクロ波集積回路素子
を設けたマイクロ波集積回路装置の構成を示す等価回路
図である。
FIG. 1 is an equivalent circuit diagram showing a configuration of a microwave integrated circuit device provided with a microwave integrated circuit element according to one embodiment of the present invention.

【図2】同じくこの発明の一実施例のマイクロ波集積回
路素子を設けたマイクロ波集積回路装置の概略図であ
る。
FIG. 2 is a schematic diagram of a microwave integrated circuit device provided with a microwave integrated circuit element according to one embodiment of the present invention.

【図3】この発明の一実施例のマイクロ波集積回路素子
のチップ構成を示す概略図である。
FIG. 3 is a schematic diagram showing a chip configuration of a microwave integrated circuit device according to one embodiment of the present invention.

【図4】従来のマイクロ波集積回路装置の構成の一例を
示す概略図である。
FIG. 4 is a schematic diagram showing an example of a configuration of a conventional microwave integrated circuit device.

【図5】図4のマイクロ波集積回路装置の等価回路図で
ある。
5 is an equivalent circuit diagram of the microwave integrated circuit device of FIG.

【図6】従来のマイクロ波集積回路素子のチップ構成を
示す概略図である。
FIG. 6 is a schematic diagram showing a chip configuration of a conventional microwave integrated circuit device.

【符号の説明】[Explanation of symbols]

1 マイクロ波集積回路素子 1A 能動素子(FET) 1B 第1の抵抗素子 1C 第2の抵抗素子 1D 第3の抵抗素子 1E 第1のキャパシタンス素子 1F 第2のキャパシタンス素子 1G 信号入力端子 1H 信号出力端子 1I 接地端子 1J ゲートバイアス端子 DESCRIPTION OF SYMBOLS 1 Microwave integrated circuit element 1A Active element (FET) 1B 1st resistance element 1C 2nd resistance element 1D 3rd resistance element 1E 1st capacitance element 1F 2nd capacitance element 1G Signal input terminal 1H Signal output terminal 1I Ground terminal 1J Gate bias terminal

───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平4−30457(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 25/00 ────────────────────────────────────────────────── ─── Continuation of front page (56) References JP-A-4-30457 (JP, A) (58) Fields investigated (Int. Cl. 7 , DB name) H01L 25/00

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 半導体基板上に信号が入力されるゲー
トと、増幅信号が出力されるドレインと、接地されるソ
ースとを備えた電界効果トランジスタと、前記電界効果
トランジスタのゲートに一端を接続するとともに他端に
ゲートバイアスが印加される第1の抵抗素子と、前記
界効果トランジスタのゲートに一端を接続した第2の抵
抗素子と、前記第1の抵抗素子の他端に一端を接続する
とともに前記電界効果トランジスタのソースに他端を接
続した第1のキャパシタンス素子と、前記第2の抵抗素
子の他端に一端をそれぞれ接続するとともに前記電界効
果トランジスタのソースに他端をそれぞれ接続した第
の抵抗素子および第2のキャパシタンス素子とを備えた
マイクロ波集積回路素子。
A gate for receiving a signal on a semiconductor substrate ;
And the drain from which the amplified signal is output and the grounded source
A field effect transistor that includes a chromatography scan, the field effect
Connect one end to the transistor gate and the other end
A first resistance element gate bias is applied, said collector
A second resistor element having one end connected to the gate of the field effect transistor, a first capacitance connected to the other end to a source of the field effect transistor with the other end is connected to one end of said first resistor element An element and one end respectively connected to the other end of the second resistance element and the electric field effect element.
The other end of each transistor is connected to the source of the transistor .
And a second capacitance element.
【請求項2】 半導体基板上に、信号が入力されるベー
スと、増幅信号が出力されるコレクタと、接地されるエ
ミッタとを備えたバイポーラトランジスタと、前記バイ
ポーラトランジスタのベースに一端を接続するとともに
他端にベースバイアスが印加される第1の抵抗素子と、
前記バイポーラトランジスタのベースに一端を接続した
第2の抵抗素子と、前記第1の抵抗素子の他端に一端を
接続するとともに前記バイポーラトランジスタのエミッ
タに他端を接続した第1のキャパシタンス素子と、前記
第2の抵抗素子の他端に一端をそれぞれ接続するととも
に前記バイポーラトランジスタのエミッタに他端をそれ
ぞれ接続した第3の抵抗素子および第2のキャパシタン
ス素子とを備えたマイクロ波集積回路素子。
2. A base for receiving a signal on a semiconductor substrate.
Source, amplified signal output collector, and grounded
A bipolar transistor having a
Connect one end to the base of the polar transistor and
A first resistance element having a base bias applied to the other end,
One end was connected to the base of the bipolar transistor
One end is connected to a second resistance element and the other end of the first resistance element.
Connection and emission of the bipolar transistor.
A first capacitance element having the other end connected to the
One end is connected to the other end of the second resistance element.
The other end to the emitter of the bipolar transistor.
A third resistor element and a second capacitor respectively connected
A microwave integrated circuit device comprising:
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