JP3019093B1 - Switching power supply - Google Patents

Switching power supply

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JP3019093B1
JP3019093B1 JP10353384A JP35338498A JP3019093B1 JP 3019093 B1 JP3019093 B1 JP 3019093B1 JP 10353384 A JP10353384 A JP 10353384A JP 35338498 A JP35338498 A JP 35338498A JP 3019093 B1 JP3019093 B1 JP 3019093B1
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利貴 志賀
正彦 岡野
憲吾 小池
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    • Y02B70/00Technologies for an efficient end-user side electric power management and consumption
    • Y02B70/10Technologies improving the efficiency by using switched-mode power supplies [SMPS], i.e. efficient power electronics conversion e.g. power factor correction or reduction of losses in power supplies or efficient standby modes

Abstract

【要約】 【課題】 スイッチング装置において、磁歪音のない安
定した間欠発振動作が得られなかった。 【解決手段】 主スイッチ4とトランスの1次巻線3と
の直列回路を直流電源1に接続する。主スイッチ4をP
WMパルスでオン・オフ制御する。出力電圧を検出し、
これに応じた電流を発光ダイオード24に流す。スタン
バイ時には発光ダイオード24に強制的に電流If を流
す。ホトトランジスタ39のバイアス電源のためにコン
デンサ31を設ける。コンデンサ31を主スイッチ4の
オン期間に得られる巻線28の電圧で充電する。主スイ
ッチ4のオン・オフ開始時にホトトランジスタ39のコ
レクタ電圧を高め、主スイッチ4のオン時間幅及び電流
を制限する。
A switching device does not provide stable intermittent oscillation operation without magnetostrictive noise. A series circuit of a main switch and a primary winding of a transformer is connected to a DC power supply. Set main switch 4 to P
On / off control is performed by the WM pulse. Detect output voltage,
A current corresponding to this is passed through the light emitting diode 24. At the time of standby, the current If is forced to flow through the light emitting diode 24. A capacitor 31 is provided for a bias power supply of the phototransistor 39. The capacitor 31 is charged with the voltage of the winding 28 obtained during the ON period of the main switch 4. At the start of turning on / off the main switch 4, the collector voltage of the phototransistor 39 is raised to limit the on-time width and current of the main switch 4.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、出力電圧を帰還制
御によって一定に制御する形式のスイッチング電源装置
に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a switching power supply device in which an output voltage is controlled to be constant by feedback control.

【0002】[0002]

【従来の技術】スイッチング電源装置をTV、ディスプ
レイ、コンピュータシステム等の電源回路に使用する場
合には、節電のためにスタンバイ(待機)モードを設け
ることが必要になる。スタンバイモード時には軽負荷に
なるためにスイッチング素子のオン・オフによる電力供
給を間欠的に中断させ、平滑用コンデンサによって電力
供給を維持することができる。この様に中断期間を設け
ると、スイッチング素子のオン・オフの合計回数が少な
くなり、効率が向上する。
2. Description of the Related Art When a switching power supply is used in a power supply circuit of a TV, a display, a computer system, or the like, it is necessary to provide a standby mode for saving power. In the standby mode, the load is light, so that the power supply due to the on / off of the switching element is intermittently interrupted, and the power supply can be maintained by the smoothing capacitor. When the interruption period is provided in this manner, the total number of ON / OFF operations of the switching elements is reduced, and the efficiency is improved.

【0003】[0003]

【発明が解決しようとする課題】ところで、スタンバイ
モードにおいてスイッチング動作期間とスイッチング非
動作期間とを交互に配置すると、スイッチング動作期間
の最初の区間(起動区間)に比較的振幅の大きな電流が
スイッチング素子及び出力トランスの1次巻線に流れ、
スイッチング素子における損失の低減を妨害するのみで
なく、トランスから磁歪音(ノイズ)が発生する。この
問題を解決するためにスイッチング動作期間の初期にス
イッチング素子の電流を制御するためのソフトスタート
回路を設けることが考えられる。しかし、入力電圧変
化、又は負荷の変化、又は出力トランスの巻数比やイン
ダクタンスの変化等に拘らず、所望のソフトスタート効
果を容易に得ることが困難であった。
By the way, if the switching operation period and the switching non-operation period are alternately arranged in the standby mode, a current having a relatively large amplitude is supplied to the switching element in the first section (starting section) of the switching operation period. And flows through the primary winding of the output transformer,
Not only does the loss of the loss in the switching element is hindered, but also magnetostrictive noise (noise) is generated from the transformer. In order to solve this problem, it is conceivable to provide a soft start circuit for controlling the current of the switching element at the beginning of the switching operation period. However, it has been difficult to easily obtain a desired soft start effect regardless of a change in input voltage, a change in load, a change in the turns ratio of the output transformer, a change in inductance, and the like.

【0004】そこで、本発明の目的は入力電圧等の変動
が生じてもソフトスタート効果を良好に得ることができ
るスイッチング電源装置を提供することにある。
SUMMARY OF THE INVENTION It is an object of the present invention to provide a switching power supply capable of obtaining a good soft-start effect even when the input voltage or the like fluctuates.

【0005】上記課題を解決し、上記目的を達成するた
めの本発明は、実施例を示す図面の符号を参照して説明
すると、直流電源(1)の一端と他端との間に接続され
たトランス(2)の1次巻線(3)とスイッチ(4)と
の直列回路と、前記1次巻線(3)に電磁結合された2
次巻線(6)と、負荷(11)に直流電圧を供給するた
めに前記2次巻線(6)に接続された出力整流平滑回路
(7、8)と、前記出力整流平滑回路(7、8)の出力
電圧を検出する電圧検出回路(19、20)と、定電圧
制御用基準電圧を与えるための基準電圧源(22)と、
前記電圧検出回路(19、20)から得られる検出電圧
と前記基準電圧源(22)の定電圧制御用基準電圧との
差の信号からなる誤差信号を形成する誤差信号形成回路
(23)と、前記誤差信号に実質的に比例した電流を流
すことができるように誤差信号形成回路に結合された
記半導体制御素子(39)と、前記スイッチ(4)を流
れる電流を検出する電流検出手段(5)と、前記電流検
出手段(5)で検出されたスイッチ電流(I1 )と前記
半導体制御素子(39)の電流(I2)とを加算して
記スイッチのオン時間幅を制御するための加算信号(V
f )を形成する加算手段と、前記スイッチ(4)をオン
・オフ制御するためのスイッチ制御パルスを発生するパ
ルス発生器(51)と、パルス幅決定用基準電圧源(5
4a、54b)と、前記加算手段から得られた加算信号
(Vf)と前記パルス幅決定用基準電圧源の基準電圧
(Vth)とを比較し、前記加算信号(Vf )が前記パル
ス幅決定用基準電圧(Vth)よりも高くなった時に前記
スイッチ制御パルスによる前記スイッチ(4)の制御を
中断するように形成されたオン時間幅制御回路(55、
56)とを備えたスイッチング電源装置であって、前記
トランス(2)の前記1次巻線(3)に電磁結合された
帰還制御電源用巻線(28)と、前記スイッチ(4)の
オン期間に前記帰還制御電源用巻線(28)に得られた
電圧によって導通する整流素子(29)を介して前記帰
還制御電源用巻線(28)に並列接続された帰還制御電
源用コンデンサ(31)とを有し、前記帰還制御電源用
コンデンサ(31)が前記半導体制御素子(39)にこ
のバイアス電源として接続されていることを特徴とする
スイッチング電源装置に係わるものである。なお、請求
項2及び3に示すように、帰還制御系に発光ダイオード
24とホトトランジスタ39とを含め、1次側と2次側
を絶縁することが望ましい。また、請求項3に示すよう
に第1の負荷11とこれよりも軽い第2の負荷12とに
電力を供給するように構成することができる。また、請
求項4に示すように第1及び第2の電圧V11、V12を出
力する定電圧回路57を設けることが望ましい。
The present invention for solving the above-mentioned problems and achieving the above-mentioned objects will be described with reference to the reference numerals in the drawings showing the embodiments. The present invention is connected between one end and the other end of a DC power supply (1). A series circuit of a primary winding (3) of a transformer (2) and a switch (4);
A secondary winding (6); an output rectifying / smoothing circuit (7, 8) connected to the secondary winding (6) for supplying a DC voltage to a load (11); , 8) a voltage detection circuit (19, 20) for detecting the output voltage;
A reference voltage source (22) for providing a control reference voltage;
Detection voltage obtained from the voltage detection circuit (19, 20)
And a reference voltage for constant voltage control of the reference voltage source (22).
Error signal forming circuit for forming an error signal composed of a difference signal
And (23), the front coupled to the error signal forming circuit <br/> Symbol semiconductor control element (39) so as to be able to flow substantially proportional to the current to the error signal, the switch (4) Current detection means (5) for detecting a flowing current; and adding a switch current (I1) detected by the current detection means (5) and a current (I2) of the semiconductor control element (39) to a previous value. The addition signal (V) for controlling the ON time width of the switch
f) turning on the addition means forming (4) and the switch (4)
.A switch that generates a switch control pulse for off control
A pulse generator (51) and a reference voltage source (5
4a, 54b) and an addition signal obtained from the addition means.
(Vf) and the reference voltage of the pulse width determining reference voltage source
(Vth), and the added signal (Vf) is
When it becomes higher than the reference voltage (Vth)
The control of the switch (4) by the switch control pulse
An on-time width control circuit (55,
56) , comprising: a feedback control power supply winding (28) electromagnetically coupled to the primary winding (3) of the transformer (2); and turning on the switch (4). The feedback control power supply capacitor (31) connected in parallel to the feedback control power supply winding (28) via the rectifying element (29) that conducts by the voltage obtained in the feedback control power supply winding (28) during the period. ), Wherein the feedback control power supply capacitor (31) is connected to the semiconductor control element (39) as the bias power supply. It is desirable that the feedback control system includes the light emitting diode 24 and the phototransistor 39 so that the primary side and the secondary side are insulated. Further, as described in claim 3, it is possible to configure so as to supply power to the first load 11 and the second load 12 which is lighter than the first load. It is desirable to provide a constant voltage circuit 57 that outputs the first and second voltages V11 and V12.

【0006】[0006]

【発明の効果】各請求項の発明によれば、スイッチ4の
オン期間の電圧を使用するための巻線28とコンデンサ
31とによって帰還制御用半導体制御素子(例えばホト
トランジスタ39)にバイアス電圧が印加される。この
ため、半導体制御素子(例えばホトトランジスタ39)
のバイアス電圧が電源1の電圧に比例的に変化し、電源
1の電圧の変化に拘らずコンデンサ31によるソフトス
タート効果を良好に得ることができる。また、請求項2
の発明によれば、ソフトスタートと電圧制御との両
方を容易に達成することができる。また、請求項の発
明によれば正常モードと軽負荷モードとの切換えを容易
に達成することができる。
According to the present invention, the bias voltage is applied to the feedback control semiconductor control element (for example, the phototransistor 39) by the winding 28 and the capacitor 31 for using the voltage during the ON period of the switch 4. Applied. Therefore, the semiconductor control element (for example, the phototransistor 39)
Bias voltage changes in proportion to the voltage of the power supply 1, so that the soft start effect of the capacitor 31 can be favorably obtained regardless of the change in the voltage of the power supply 1. Claim 2
According to the inventions of the fourth to fourth aspects, both the soft start and the voltage control can be easily achieved. Further, according to the invention of claim 3 , switching between the normal mode and the light load mode can be easily achieved.

【0007】[0007]

【実施形態及び実施例】次に、図1〜図7を参照して本
発明の実施形態及び実施例を説明する。本発明の実施例
に係わるスイッチング電源装置を示す図1において、例
えば整流回路と平滑回路とから成る直流電源1の一端1
aと他端1bとの間には出力トランス2のインダクタン
スを有する1次巻線3とFETから成る主スイッチ4と
電流検出手段としての電流検出抵抗5との直列回路が接
続されている。第1の出力回路を構成するためにトラン
ス2の2次巻線6に対して第1の整流素子としての出力
整流ダイオード7を介して第1の出力平滑用コンデンサ
8が並列に接続されている。2次巻線6の極性及び整流
ダイオード7の極性は、主スイッチ4のオフ期間に整流
ダイオード7が導通するように決定されている。平滑用
コンデンサ8に接続された第1の直流出力端子9、10
には負荷11が接続されている。第2の出力回路を構成
するためにトランス2の3次巻線12に対して第2の整
流素子としての出力整流ダイオード13を介して第2の
出力平滑用コンデンサ14が接続されている。3次巻線
12の極性は、2次巻線6と同様に主スイッチ4のオフ
期間に整流ダイオード13が導通するように決定されて
いる。第2の平滑用コンデンサ14に接続された第2の
出力端子15、16間には第2の負荷17が接続されて
いる。なお、第1の負荷11のグランド端子10と第2
の負荷17のグランド端子16は相互に接続されてい
る。また、正常モード時に第1の出力端子9、10間の
第1の出力電圧V01が約120V、第2の出力端子1
5、16間の第2の出力電圧V02が約15Vとなる。
Embodiments and Examples Next, embodiments and examples of the present invention will be described with reference to FIGS. In FIG. 1 showing a switching power supply device according to an embodiment of the present invention, one end 1 of a DC power supply 1 comprising, for example, a rectifier circuit and a smoothing circuit.
A series circuit of a primary winding 3 having an inductance of the output transformer 2, a main switch 4 composed of an FET, and a current detecting resistor 5 as current detecting means is connected between the terminal a and the other end 1b. To configure a first output circuit, a first output smoothing capacitor 8 is connected in parallel to a secondary winding 6 of the transformer 2 via an output rectifier diode 7 as a first rectifier. . The polarity of the secondary winding 6 and the polarity of the rectifier diode 7 are determined so that the rectifier diode 7 conducts while the main switch 4 is off. First DC output terminals 9 and 10 connected to smoothing capacitor 8
Is connected to a load 11. To form a second output circuit, a second output smoothing capacitor 14 is connected to a tertiary winding 12 of the transformer 2 via an output rectifier diode 13 as a second rectifier. The polarity of the tertiary winding 12 is determined so that the rectifier diode 13 conducts during the off period of the main switch 4 as in the case of the secondary winding 6. A second load 17 is connected between the second output terminals 15 and 16 connected to the second smoothing capacitor 14. The ground terminal 10 of the first load 11 and the second terminal
The ground terminals 16 of the load 17 are connected to each other. In the normal mode, the first output voltage V01 between the first output terminals 9 and 10 is about 120 V, and the second output terminal 1
The second output voltage V02 between 5 and 16 is about 15V.

【0008】図1のスイッチング電源装置は、第1の出
力端子9、10間の第1の出力電圧V01を一定に制御す
るための電圧制御信号形成回路18を有する。この電圧
制御信号形成回路18は、第1の出力端子9、10間に
接続された電圧検出回路としての電圧検出抵抗19、2
0と、基準電圧源を構成するための抵抗21及びツェナ
ーダイオード22と、誤差信号形成回路即ち誤差増幅器
としてのトランジスタ23とから成る。トランジスタ2
3のベースは電圧検出抵抗19、20の分圧点に接続さ
れ、エミッタは基準電圧源としてのツェナーダイオード
22に接続されている。ツェナーダイオード22は抵抗
21を介して直流出力端子9、10間に接続されてい
る。従って、トランジスタ23のコレクタ電流は検出電
圧と基準電圧との差に対応して変化する。電圧制御信号
形成回路18の出力を光信号に変換するために第2の出
力端子15とトランジスタ23のコレクタとの間に発光
ダイオード24が接続されている。
The switching power supply of FIG. 1 has a voltage control signal forming circuit 18 for controlling the first output voltage V01 between the first output terminals 9 and 10 to be constant. The voltage control signal forming circuit 18 includes voltage detecting resistors 19, 2 connected as voltage detecting circuits connected between the first output terminals 9, 10.
0, a resistor 21 and a Zener diode 22 for constituting a reference voltage source, and a transistor 23 as an error signal forming circuit, that is, an error amplifier. Transistor 2
The base of 3 is connected to the voltage dividing point of the voltage detection resistors 19 and 20, and the emitter is connected to a Zener diode 22 as a reference voltage source. The Zener diode 22 is connected between the DC output terminals 9 and 10 via the resistor 21. Therefore, the collector current of the transistor 23 changes according to the difference between the detection voltage and the reference voltage. A light emitting diode 24 is connected between the second output terminal 15 and the collector of the transistor 23 to convert the output of the voltage control signal forming circuit 18 into an optical signal.

【0009】制御電源を構成するためにトランス2に4
次巻線25が設けられている。この4次巻線25には第
3の整流素子としての出力整流ダイオード26を介して
第3の出力平滑用コンデンサ27が並列に接続されてい
る。この4次巻線25及びダイオード26の極性は主ス
イッチ4のオフの期間にダイオード26がオンになるよ
うに決定されている。
To configure a control power supply,
A secondary winding 25 is provided. A third output smoothing capacitor 27 is connected in parallel to the fourth winding 25 via an output rectifier diode 26 as a third rectifier. The polarities of the quaternary winding 25 and the diode 26 are determined so that the diode 26 is turned on while the main switch 4 is off.

【0010】本発明に従ってソフトスタート制御を実行
するために帰還制御電源用巻線としての5次巻線28と
2つの整流ダイオード29、30と第4の出力平滑用コ
ンデンサ31とが設けられている。5次巻線28は4次
巻線25に連続的に形成され、両者は中間タップP1 に
よって分割されている。第4の出力平滑用コンデンサ3
1は第4の整流素子としての出力整流ダイオード29を
介して5次巻線28に並列に接続されている。第5の出
力整流ダイオード30は主スイッチ4のオフの期間に4
次巻線25に誘起する電圧でオンになる極性を有してダ
イオード26のカソードとダイオード29のカソードと
の間に接続されている。即ち、ダイオード30は4次巻
線25と2つのダイオード26、30とコンデンサ31
との閉回路でコンデンサ31を充電することができるよ
うに接続されている。5次巻線28及びダイオード29
の極性は、主スイッチ4のオンの期間に5次巻線28に
誘起する電圧でダイオード29がオンになってソフトス
タート用コンデンサと呼ぶこともできる第4の出力平滑
用コンデンサ31を充電できるように決定されている。
In order to execute the soft start control according to the present invention, a fifth winding 28 as a feedback control power supply winding, two rectifying diodes 29 and 30, and a fourth output smoothing capacitor 31 are provided. . The fifth winding 28 is formed continuously with the fourth winding 25, and both are divided by the intermediate tap P1. Fourth output smoothing capacitor 3
1 is connected in parallel to the fifth winding 28 via an output rectifier diode 29 as a fourth rectifier. The fifth output rectifier diode 30 is connected during the off period of the main switch 4.
It is connected between the cathode of the diode 26 and the cathode of the diode 29 with a polarity turned on by the voltage induced in the next winding 25. That is, the diode 30 is composed of the quaternary winding 25, the two diodes 26 and 30, and the capacitor 31.
Are connected so that the capacitor 31 can be charged in the closed circuit. Fifth winding 28 and diode 29
The polarity of is such that the diode 29 is turned on by the voltage induced in the fifth winding 28 while the main switch 4 is on, and the fourth output smoothing capacitor 31 which can be called a soft start capacitor can be charged. Has been determined.

【0011】主スイッチ4をオン・オフ制御するための
スイッチ制御信号形成回路32の正側電源ライン33は
制御電源としてのコンデンサ27の一端に接続されてい
ると共に起動抵抗34を介して直流電源1の一端1aに
接続され、グランド側ライン35は直流電源1の他端1
b及びコンデンサ27の他端に接続されている。制御信
号形成回路32は帰還制御信号供給端子としての入力信
号ライン36に接続されている。このライン36には電
流検出信号と定電圧制御信号との合成信号から成る帰還
制御信号Vf が入力する。この合成信号を形成するため
に、電流検出抵抗5の一端が抵抗37を介して入力信号
ライン36に接続されている。ソフトスタート用コンデ
ンサ31とダイオード29、30との接続点38と入力
信号ライン36との間に半導体制御素子としてのホトト
ランジスタ39が接続されている。ホトトランジスタ3
9は発光ダイオード24に光結合されている。なお、電
流検出抵抗5及びホトトランジスタ39の上述のような
接続によって電流I1 と電流I2 との加算回路が形成さ
れる。スイッチ制御信号形成回路32は入力信号ライン
36の電圧Vf に応答してスイッチ制御信号を形成し、
これを出力ライン40によって主スイッチ4のゲートに
与える。
A positive power supply line 33 of a switch control signal forming circuit 32 for controlling on / off of the main switch 4 is connected to one end of a capacitor 27 as a control power supply and is connected to a DC power supply 1 via a starting resistor 34. The ground line 35 is connected to the other end 1 of the DC power supply 1.
b and the other end of the capacitor 27. The control signal forming circuit 32 is connected to an input signal line 36 as a feedback control signal supply terminal. A feedback control signal Vf, which is a composite signal of a current detection signal and a constant voltage control signal, is input to the line 36. One end of the current detection resistor 5 is connected to the input signal line 36 via the resistor 37 to form this composite signal. A phototransistor 39 as a semiconductor control element is connected between a connection point 38 between the soft start capacitor 31 and the diodes 29 and 30 and the input signal line 36. Phototransistor 3
9 is optically coupled to the light emitting diode 24. The above-described connection of the current detection resistor 5 and the phototransistor 39 forms an addition circuit of the current I1 and the current I2. The switch control signal forming circuit 32 forms a switch control signal in response to the voltage Vf of the input signal line 36,
This is applied to the gate of main switch 4 by output line 40.

【0012】第1の負荷11への電力供給を実質的に停
止し、第1の負荷11よりも大幅に軽い第2の負荷17
への電力供給を行う動作即ちスタンバイモード又は軽負
荷モードのために第1及び第2のスタンバイモード決定
用トランジスタ41、42とツェナーダイオード43と
ダイオード44と2つの抵抗45、46とが設けられて
いる。
The power supply to the first load 11 is substantially stopped, and the second load 17 which is substantially lighter than the first load 11 is provided.
The first and second standby mode determining transistors 41 and 42, the Zener diode 43, the diode 44, and the two resistors 45 and 46 are provided for the operation of supplying power to the power supply, that is, the standby mode or the light load mode. I have.

【0013】npn型トランジスタ41のコレクタはツ
ェナーダイオード43を介して発光ダイオード24のカ
ソードに接続されている。このトランジスタ41のエミ
ッタはグランド端子16に接続され、このベースは軽負
荷モード(スタンバイモード)指令手段としてのスタン
バイ信号入力端子47に接続されている。スタンバイ信
号入力端子47にはスタンバイモード時にトランジスタ
41をオンに制御し、正常時にオフに制御する信号が入
力する。
The collector of the npn transistor 41 is connected to the cathode of the light emitting diode 24 via a Zener diode 43. The emitter of the transistor 41 is connected to the ground terminal 16, and the base is connected to a standby signal input terminal 47 as light load mode (standby mode) command means. A signal for turning on the transistor 41 in the standby mode and turning off the transistor 41 in the normal state is input to the standby signal input terminal 47.

【0014】ツェナーダイオード43はスタンバイモー
ド時にトランジスタ41がオンになった時に導通するも
のであって、約6Vのツェナー電圧を有する。
The Zener diode 43 conducts when the transistor 41 is turned on in the standby mode, and has a Zener voltage of about 6V.

【0015】pnp型トランジスタ42のエミッタはダ
イオード44を介して2次巻線6の上端に接続され、こ
のコレクタは第2の出力端子15に接続されている。抵
抗45はトランジスタ42のエミッタとベースとの間に
接続されている。抵抗46はpnp型トランジスタ42
のベースとnpn型トランジスタ41のコレクタとの間
に接続されている。従って、スタンバイモード時にnp
n型トランジスタ41がオンになると、pnp型トラン
ジスタ42もオンになり、第2の出力平滑用コンデンサ
14に2次巻線6と3次巻線12との両方が並列接続さ
れる。しかし、2次巻線6の電圧は3次巻線12の電圧
よりも高いので、スタンバイ時にはダイオード13がオ
フになり、2次巻線6から第2の出力端子15、16に
スタンバイ電圧が供給される。なお、スタンバイ時には
トランジスタ41及びツェナーダイオード43がオンに
なるので、第2の出力端子15、16間の電圧V02は2
次巻線6の正常時電圧よりも大幅に低いスタンバイ電圧
になる。
The emitter of the pnp transistor 42 is connected to the upper end of the secondary winding 6 via a diode 44, and the collector is connected to the second output terminal 15. The resistor 45 is connected between the emitter and the base of the transistor 42. The resistor 46 is a pnp transistor 42
And the collector of the npn-type transistor 41. Therefore, in standby mode, np
When the n-type transistor 41 is turned on, the pnp transistor 42 is also turned on, and both the secondary winding 6 and the tertiary winding 12 are connected to the second output smoothing capacitor 14 in parallel. However, since the voltage of the secondary winding 6 is higher than the voltage of the tertiary winding 12, the diode 13 is turned off during standby and the standby voltage is supplied from the secondary winding 6 to the second output terminals 15 and 16. Is done. During standby, the transistor 41 and the Zener diode 43 are turned on, so that the voltage V02 between the second output terminals 15 and 16 becomes 2
The standby voltage becomes much lower than the normal voltage of the next winding 6.

【0016】図2はスイッチ制御信号形成回路32の詳
細とこれに関連する部分を示す。このスイッチ制御信号
形成回路32は、主スイッチ4をオン・オフ制御するた
めのスイッチ制御パルスを発生するパルス発生器51
と、駆動回路52と、抵抗53と、オン時間幅制御用基
準電圧源用抵抗54a、54bと、オン時間幅制御用比
較器55と、オン時間幅制御用トランジスタ56と、定
電圧回路57とから成る。なお、比較器55とトランジ
スタ56によってスイッチ制御パルスのオン時間幅制御
回路が構成されている。
FIG. 2 shows details of the switch control signal forming circuit 32 and its related parts. The switch control signal forming circuit 32 includes a pulse generator 51 for generating a switch control pulse for turning on / off the main switch 4.
A drive circuit 52, a resistor 53, on-time width control reference voltage source resistors 54a and 54b, an on-time width control comparator 55, an on-time width control transistor 56, and a constant voltage circuit 57. Consists of The comparator 55 and the transistor 56 constitute an on-time width control circuit for the switch control pulse.

【0017】パルス発生器51は、パルス形成用比較器
58と、のこぎり波発生用コンデンサ59と、放電用抵
抗60と、充電制御用トランジスタ61と、ツェナーダ
イオード62と、抵抗63、64、65、66とダイオ
ード67、68とから成る。のこぎり波発生用コンデン
サ59の一端は充電制御用トランジスタ61を介して正
側電源ライン33に接続され、このコンデンサ59の他
端はグランドライン35に接続されている。放電用抵抗
60はコンデンサ59に並列に接続されている。定電圧
源として機能するツェナーダイオード62はトランジス
タ61のベースとグランドライン35との間に接続され
ている。トランジスタ61のベースは抵抗63を介して
定電圧回路57から導出された定電圧ライン69に接続
されている。制御パルス形成用比較器58の一方の入力
端子は抵抗64を介して定電圧ライン69に接続され、
他方の入力端子はのこぎり波発生用コンデンサ59の一
端に接続されている。参照電圧用抵抗65とダイオード
67は比較器58の一方の入力端子と出力端子との間に
接続されている。また、帰還用抵抗66とダイオード6
8とはトランジスタ61のベースと比較器58の出力端
子との間に接続されている。
The pulse generator 51 includes a pulse forming comparator 58, a sawtooth wave generating capacitor 59, a discharging resistor 60, a charge controlling transistor 61, a Zener diode 62, resistors 63, 64, 65, 66 and diodes 67 and 68. One end of the saw-wave generating capacitor 59 is connected to the positive power supply line 33 via the charge control transistor 61, and the other end of the capacitor 59 is connected to the ground line 35. The discharging resistor 60 is connected in parallel to the capacitor 59. The Zener diode 62 functioning as a constant voltage source is connected between the base of the transistor 61 and the ground line 35. The base of the transistor 61 is connected via a resistor 63 to a constant voltage line 69 derived from the constant voltage circuit 57. One input terminal of the control pulse forming comparator 58 is connected to a constant voltage line 69 via a resistor 64,
The other input terminal is connected to one end of the saw-wave generating capacitor 59. The reference voltage resistor 65 and the diode 67 are connected between one input terminal and the output terminal of the comparator 58. The feedback resistor 66 and the diode 6
8 is connected between the base of the transistor 61 and the output terminal of the comparator 58.

【0018】駆動回路52はスイッチ制御パルスに応答
して主スイッチ4を駆動するものであり、入力端子aと
出力端子bと一対の電源端子c、dとを有する。入力端
子aはパルス発生器51の出力ライン即ち比較器58の
出力ラインに接続され、出力端子bは抵抗53を介して
主スイッチ4のゲート(制御端子)に接続され、一方の
電源端子cは正電源ライン33に接続され、他方の電源
端子dはグランドライン35に接続されている。図3か
ら明らかなように駆動回路52は、npn型の第1及び
第2のトランジスタ52a、52bとNOT回路(反転
回路)52cとから成る。第1のトランジスタ52aの
コレクタは一方の電源端子cに接続され、エミッタは出
力端子bに接続され、ベースは入力端子aに接続されて
いる。第2のトランジスタ52bのコレクタは出力端子
bに接続され、エミッタは他方の電源端子dに接続さ
れ、ベースはNOT回路52cを介して入力端子aに接
続されている。従って、第1及び第2のトランジスタ5
2a、52bは互いに反対に動作する。
The drive circuit 52 drives the main switch 4 in response to a switch control pulse, and has an input terminal a, an output terminal b, and a pair of power terminals c and d. The input terminal a is connected to the output line of the pulse generator 51, that is, the output line of the comparator 58, the output terminal b is connected to the gate (control terminal) of the main switch 4 via the resistor 53, and one power supply terminal c is connected to The power supply terminal d is connected to the positive power supply line 33, and the other power supply terminal d is connected to the ground line 35. As is apparent from FIG. 3, the drive circuit 52 includes first and second npn transistors 52a and 52b and a NOT circuit (inverting circuit) 52c. The collector of the first transistor 52a is connected to one power supply terminal c, the emitter is connected to the output terminal b, and the base is connected to the input terminal a. The collector of the second transistor 52b is connected to the output terminal b, the emitter is connected to the other power supply terminal d, and the base is connected to the input terminal a via the NOT circuit 52c. Therefore, the first and second transistors 5
2a and 52b operate in opposite directions.

【0019】主スイッチ4のオン幅を決定するための比
較器55の一方の入力端子は入力信号ライン36に接続
され、他方の入力端子は2つの基準電圧源用抵抗54
a、54bの相互接続点に接続されている。基準電圧源
用抵抗54a、54bは定電圧ライン69とグランドラ
イン35との間に接続され、これ等の間の分割電圧をオ
ン幅決定用基準電圧として比較器55に与える。比較器
55の電源端子は定電圧ライン69とグランドライン3
5に接続されている。オン時間幅制御スイッチとしての
トランジスタ56はパルス発生用比較器58の出力端子
とグランドライン35との間に接続され、そのベースは
比較器55の出力端子に接続されている。フォトトラン
ジスタ39の出力ラインと抵抗37の出力ラインは相互
に接続されて加算回路が形成されている。従って、入力
信号ライン36には、電流検出抵抗5に基づく電流帰還
信号とフォトトランジスタ39に基づく電圧帰還信号
(電圧制御信号)との和が入力する。このため、比較器
55及びトランジスタ56は電圧帰還制御と電流帰還制
御との両方を実行する。主スイッチ4のオン期間におい
てこの電流が時間と共に増大し、この電流検出電圧が比
較器55の負入力端子の基準電圧Vthに至ると比較器5
5の出力が高レベルになり、トランジスタ56がオンに
なって駆動回路52の入力端子aがグランドに接続さ
れ、主スイッチ4は強制的にオフ状態に転換する。
One input terminal of the comparator 55 for determining the ON width of the main switch 4 is connected to the input signal line 36, and the other input terminal is connected to two reference voltage source resistors 54.
a, 54b. The reference voltage source resistors 54a and 54b are connected between the constant voltage line 69 and the ground line 35, and apply the divided voltage between them as the reference voltage for determining the ON width to the comparator 55. The power supply terminal of the comparator 55 is a constant voltage line 69 and a ground line 3
5 is connected. The transistor 56 as an on-time width control switch is connected between the output terminal of the pulse generation comparator 58 and the ground line 35, and its base is connected to the output terminal of the comparator 55. The output line of the phototransistor 39 and the output line of the resistor 37 are connected to each other to form an adding circuit. Therefore, the sum of the current feedback signal based on the current detection resistor 5 and the voltage feedback signal (voltage control signal) based on the phototransistor 39 is input to the input signal line 36. Therefore, the comparator 55 and the transistor 56 execute both the voltage feedback control and the current feedback control. During the ON period of the main switch 4, this current increases with time, and when this current detection voltage reaches the reference voltage Vth of the negative input terminal of the comparator 55, the comparator 5
5 becomes high level, the transistor 56 is turned on, the input terminal a of the drive circuit 52 is connected to the ground, and the main switch 4 is forcibly turned off.

【0020】定電圧回路57は電源ライン33とグラン
ドライン35との間に接続され、電源ライン33の電圧
を定電圧化してライン69に出力する。ライン69の電
圧はライン33の電圧よりも低い。なお、図示が省略さ
れているが、比較器58の電源端子は定電圧回路57の
出力ライン69に接続されている。また、定電圧回路5
7はライン33の電圧Vinの大きさに依存して第1及び
第2のレベルの電圧を発生する。第1のレベルは主スイ
ッチ4をオン・オフ制御信号を形成することができるレ
ベルであり、第2のレベルは主スイッチ4をオン・オフ
制御信号を形成することができないレベルである。
The constant voltage circuit 57 is connected between the power supply line 33 and the ground line 35, and converts the voltage of the power supply line 33 to a constant voltage and outputs the voltage to a line 69. The voltage on line 69 is lower than the voltage on line 33. Although not shown, the power supply terminal of the comparator 58 is connected to the output line 69 of the constant voltage circuit 57. In addition, the constant voltage circuit 5
7 generates first and second level voltages depending on the magnitude of the voltage Vin on the line 33. The first level is a level at which the main switch 4 can form an on / off control signal, and the second level is a level at which the main switch 4 cannot form an on / off control signal.

【0021】[0021]

【正常時動作】次に、図1及び図2に示すスイッチング
電源装置の正常時には、スタンバイ端子47が低レベル
であるので、トランジスタ41、42はオフであり、周
知の定電圧制御回路が形成される。この時の動作を図5
のt0 〜t4 期間を参照して説明する。図5のt0 時点
で図2の比較器58の出力電圧が低レベルから高レベル
に転換して制御パルスが発生し、これに対応するゲート
制御信号Vgsが主スイッチ4に図5(D)に示すように
印加され、主スイッチ4がオンになる。これにより、直
流電源1と1次巻線3と主スイッチ4と電流検出用抵抗
5とから成る閉回路に電流I1 が流れる。1次巻線3は
インダクタンスを有するので、電流I1 は傾斜を有して
増大し、電流検出用抵抗5の電圧が電流I1 の波形に対
応して変化し、電流I1 の帰還情報を含む帰還制御信号
としての入力電圧Vf も図5(B)に示すように傾斜を
有して増大する。電流I1 に対応する電圧Vf がt1 時
点で基準電圧Vthに達すると、比較器55の出力が低レ
ベルから高レベルに転換し、トランジスタ56がオンに
なり、パルス発生用比較器58の出力端子がトランジス
タ56を介してグランドに接続され、パルスのオン期間
が終了する。パルス発生用比較器58の出力電圧がt1
時点で低レベルになると、ダイオード67がオンにな
り、比較器58の正入力端子の電圧V1 が図5(A)に
示すように6.5Vから3.5Vまで低下し、負入力端
子の電圧V2 よりも低くなる。これにより、比較器58
の出力電圧の低レベルが保持される。また、比較器58
の出力電圧が低レベルになると、ダイオード68がオン
になり、トランジスタ61のベース電位がこのエミッタ
電位よりも低くなり、トランジスタ61のベース・エミ
ッタ間が逆バイアス状態となり、トランジスタ61がオ
フになるためコンデンサ59の充電が停止する。これに
より、コンデンサ59の電荷は抵抗60を介して放出さ
れ、この電圧V2 は図5(A)で破線で示すように一定
の傾斜を有して低下する。t3 時点でコンデンサ59の
電圧即ち比較器58の負入力端子の電圧V2 が正入力端
子の電圧V1 よりも低くなると、比較器58の出力電圧
は再び高レベルに戻り、次のパルスが発生する。図5
(B)のt1 〜t2 期間における電流I1に基づく電圧
Vf は主スイッチ4のストレージ作用に基づく電流によ
って生じるものである。t2 時点で主スイッチ4を通る
電流I1 が零になると、主スイッチ4の一対の主端子間
電圧としてのドレイン・ソース間電圧Vdsがオン時より
も高くなる。t2 〜t3 期間では電流I1 が零になるの
で、オン時間幅制御用即ち電流帰還制御用比較器55の
出力が低レベルに保持され、オン時間幅制御用トランジ
スタ56もオフに保たれる。従って、主スイッチ4のオ
フ期間の決定には比較器55が関与せず、オフ期間(例
えばt1 〜t3 )はのこぎり波用コンデンサ59の放電
のみに依存して決定され、一定になる。t3 時点で比較
器58の出力電圧が高レベルに戻ると、ダイオード67
及び68はオフになる。これにより、トランジスタ61
が再びオンになり、コンデンサ59が急速に充電され、
この電圧V2 は5Vになる。また、比較器58の正入力
端子の電圧V1 もt3 時点で直ちに6.5Vになる。従
って、比較器58の出力電圧は高レベルに保持される。
なお、この出力電圧の高レベルは6.5Vよりも高く設
定されている。
Next, when the switching power supply shown in FIGS. 1 and 2 is normal, the transistors 41 and 42 are off since the standby terminal 47 is at a low level, and a well-known constant voltage control circuit is formed. You. The operation at this time is shown in FIG.
The description will be made with reference to the period from t0 to t4. At time t0 in FIG. 5, the output voltage of the comparator 58 in FIG. 2 changes from the low level to the high level to generate a control pulse, and the corresponding gate control signal Vgs is applied to the main switch 4 as shown in FIG. As shown, the main switch 4 is turned on. As a result, a current I1 flows through a closed circuit including the DC power supply 1, the primary winding 3, the main switch 4, and the current detecting resistor 5. Since the primary winding 3 has an inductance, the current I1 increases with a gradient, the voltage of the current detecting resistor 5 changes in accordance with the waveform of the current I1, and the feedback control includes feedback information of the current I1. The input voltage Vf as a signal also increases with a slope as shown in FIG. When the voltage Vf corresponding to the current I1 reaches the reference voltage Vth at the time t1, the output of the comparator 55 changes from low level to high level, the transistor 56 is turned on, and the output terminal of the pulse generation comparator 58 is turned on. The transistor is connected to the ground via the transistor 56, and the ON period of the pulse ends. The output voltage of the pulse generating comparator 58 is t1
When the voltage becomes low at this point, the diode 67 is turned on, and the voltage V1 at the positive input terminal of the comparator 58 decreases from 6.5V to 3.5V as shown in FIG. It becomes lower than V2. Thereby, the comparator 58
Is maintained at a low level. Further, the comparator 58
Is low, the diode 68 is turned on, the base potential of the transistor 61 is lower than this emitter potential, the base-emitter of the transistor 61 is in a reverse bias state, and the transistor 61 is turned off. The charging of the capacitor 59 stops. As a result, the charge of the capacitor 59 is released through the resistor 60, and the voltage V2 decreases with a constant slope as shown by the broken line in FIG. At time t3, when the voltage of the capacitor 59, that is, the voltage V2 of the negative input terminal of the comparator 58 becomes lower than the voltage V1 of the positive input terminal, the output voltage of the comparator 58 returns to the high level again, and the next pulse is generated. FIG.
The voltage Vf based on the current I1 in the period t1 to t2 in (B) is generated by the current based on the storage action of the main switch 4. When the current I1 passing through the main switch 4 at time t2 becomes zero, the drain-source voltage Vds as the voltage between the pair of main terminals of the main switch 4 becomes higher than when it is on. During the period from t2 to t3, the current I1 becomes zero, so that the output of the comparator 55 for controlling the on-time width, that is, the current feedback control, is kept at a low level, and the transistor 56 for controlling the on-time width is also kept off. Therefore, the comparator 55 is not involved in the determination of the off period of the main switch 4, and the off period (for example, t1 to t3) is determined only depending on the discharge of the saw-tooth wave capacitor 59 and becomes constant. When the output voltage of the comparator 58 returns to the high level at time t3, the diode 67
And 68 are off. Thereby, the transistor 61
Is turned on again, the capacitor 59 is rapidly charged,
This voltage V2 becomes 5V. Also, the voltage V1 at the positive input terminal of the comparator 58 immediately becomes 6.5 V at the time t3. Therefore, the output voltage of the comparator 58 is kept at a high level.
The high level of the output voltage is set higher than 6.5V.

【0022】[0022]

【正常負荷時の電圧制御】負荷11の両端電圧が例えば
基準値よりも高くなると、比較器55の正入力端子の入
力電圧Vf が高くなり、主スイッチ4のオン開始点から
早い時期に基準電圧Vthに達し、比較器55の出力が高
レベルに転換し、トランジスタ56がオンになることに
よりPWMパルスのオン期間が終了し、PWMパルスの
オン幅が狭くなる。PWMパルス列のオフ幅は一定であ
るので、主スイッチ4のデューティ比は小さくなり、出
力電圧が基準に戻される。出力電圧が基準値よりも低く
なった時には上記の高くなった時と逆の動作になる。
[Voltage Control During Normal Load] When the voltage between both ends of the load 11 becomes higher than the reference value, for example, the input voltage Vf at the positive input terminal of the comparator 55 becomes higher. When the voltage reaches Vth, the output of the comparator 55 changes to a high level, and the transistor 56 is turned on, whereby the on-period of the PWM pulse ends, and the on-width of the PWM pulse is reduced. Since the OFF width of the PWM pulse train is constant, the duty ratio of the main switch 4 is reduced, and the output voltage is returned to the reference. When the output voltage becomes lower than the reference value, the operation is the reverse of that when the output voltage becomes higher.

【0023】[0023]

【スタンバイ動作】次に、スタンバイ時の動作を図6及
び図7を参照して説明する。図6(A)に示すようにス
タンバイ時にはスタンバイ信号入力端子47が高レベル
になる。これにより、スタンバイ時にはトランジスタ4
1及び42がオンに保たれ、電圧制御信号形成回路18
による電圧制御は中断され、図6(G)に説明的に示す
ように間欠的発振状態が生じる。この間欠的発振は図6
(C)に示す制御電源用コンデンサ27の電圧Vinの変
化に基づいて生じる。即ち、スタンバイモード時にはト
ランジスタ41及びツェナーダイオード43が導通状態
となり、発光ダイオード24の電流If が比較的大きく
なり、第1及び第2の出力電圧V01、V02を下げる動作
が生じる。この結果、主スイッチ4のオフの期間にトラ
ンス2の2次巻線6、3次巻線12、及び4次巻線25
に得られる電圧は正常時のこれ等の電圧よりも低くな
る。従って、4次巻線25に接続された制御電源用コン
デンサ27の電圧Vinは図6(C)のt0 〜t2 区間に
示すように徐々に低下する。なお、スタンバイ時に出力
電圧V01、V02を下げるような動作が生じても2次巻線
6の電圧がトランジスタ42を介して第2の出力端子1
5に供給されるため、第2の出力電圧V02は図6(B)
に示すようにt0 〜t2 区間で徐々に上昇する。但し、
スタンバイ時にはツェナーダイオード43によって第2
の出力電圧V02が制限されているので、第2の出力電圧
V02は正常時の第1の出力電圧V01よりも大幅に低い値
になり、第2の負荷17に適合する値となる。コンデン
サ27から供給される制御電源電圧Vinが発振停止しき
い値Vb になると、図2の定電圧回路57は図6(H)
に示す第2の定電圧V12を発生する。この第2の定電圧
V12はパルス発生器51及び比較器55を正常に動作さ
せることが不可能なレベルに設定されているので、主ス
イッチ4に対するオン・オフ制御信号の供給が図6のt
2 時点で中断する。しかし、制御電源用コンデンサ27
は起動抵抗34を介して直流電源1に接続されているの
で、起動抵抗34を介したコンデンサ27の充電が開始
し、この電圧Vinは図6(C)のt2 〜t3 区間に示す
ように徐々に上昇する。図6のt3 時点で制御電源電圧
Vinが発振開始電圧Va に達すると、定電圧回路57の
出力電圧V69は図6(H)に示すように第2の定電圧V
12よりも高い第1の定電圧V11になる。第1の定電圧V
11はパルス発生器51及び比較器55が正常に動作する
レベルに設定されているので、図6のt3 〜t4 区間に
おいてはt0 〜t2 区間と同様に主スイッチ4にオン・
オフ制御信号が供給される。これにより、t3 〜t4 区
間においてもt0 〜t2 区間と同一の動作が生じる。ス
タンバイモード時には、図6のt2 〜t3 に示すように
主スイッチ4にオン・オフ動作の休止期間が発生するの
で、単位時間当りの主スイッチ4のスイッチング回数が
正常時よりも少なくなり、主スイッチ4における損失が
少なくなり、効率が向上する。なお、t2 〜t3 の停止
期間ではコンデンサ14によって第2の負荷17に電力
が供給され、この電圧V02は徐々に低下する。
[Standby Operation] Next, the operation during standby will be described with reference to FIGS. As shown in FIG. 6A, the standby signal input terminal 47 goes high during standby. As a result, at the time of standby, the transistor 4
1 and 42 are kept on, and the voltage control signal forming circuit 18 is turned on.
Is interrupted, and an intermittent oscillation state occurs as shown in FIG. 6 (G). This intermittent oscillation is shown in FIG.
This occurs based on the change in the voltage Vin of the control power supply capacitor 27 shown in FIG. That is, in the standby mode, the transistor 41 and the Zener diode 43 become conductive, the current If of the light emitting diode 24 becomes relatively large, and the first and second output voltages V01 and V02 are reduced. As a result, the secondary winding 6, the tertiary winding 12, and the quaternary winding 25 of the transformer 2 are turned off while the main switch 4 is off.
Are lower than those in normal operation. Accordingly, the voltage Vin of the control power supply capacitor 27 connected to the quaternary winding 25 gradually decreases as shown in the section from t0 to t2 in FIG. It should be noted that even if an operation such as lowering the output voltages V01 and V02 occurs during standby, the voltage of the secondary winding 6 remains at the second output terminal 1 via the transistor 42.
5B, the second output voltage V02 is
As shown in the figure, it gradually rises in the section from t0 to t2. However,
At the time of standby, the second
Is limited, the second output voltage V02 is significantly lower than the normal first output voltage V01, and is a value suitable for the second load 17. When the control power supply voltage Vin supplied from the capacitor 27 reaches the oscillation stop threshold value Vb, the constant voltage circuit 57 of FIG.
A second constant voltage V12 shown in FIG. Since the second constant voltage V12 is set to a level at which the pulse generator 51 and the comparator 55 cannot operate normally, the supply of the ON / OFF control signal to the main switch 4 is not changed to the time t in FIG.
Interrupt at two points. However, the control power supply capacitor 27
Is connected to the DC power supply 1 via the starting resistor 34, the charging of the capacitor 27 via the starting resistor 34 starts, and this voltage Vin gradually increases as shown in the section from t2 to t3 in FIG. To rise. When the control power supply voltage Vin reaches the oscillation start voltage Va at the time point t3 in FIG. 6, the output voltage V69 of the constant voltage circuit 57 becomes the second constant voltage V2 as shown in FIG.
It becomes the first constant voltage V11 higher than 12. First constant voltage V
11 is set to a level at which the pulse generator 51 and the comparator 55 operate normally, so that the main switch 4 is turned on in the period t3 to t4 in FIG. 6 as in the period t0 to t2.
An off control signal is provided. As a result, the same operation as in the section between t0 and t2 occurs in the section between t3 and t4. In the standby mode, the main switch 4 has a pause period of the ON / OFF operation as shown at t2 to t3 in FIG. 6, so that the number of times of switching of the main switch 4 per unit time becomes smaller than that in the normal state, and 4, the loss is reduced and the efficiency is improved. During the stop period from t2 to t3, power is supplied to the second load 17 by the capacitor 14, and the voltage V02 gradually decreases.

【0024】[0024]

【ソフトスタート動作】本実施例ではトランス2の5次
巻線28の電圧によってソフトスタート用の第4の出力
平滑用コンデンサ31が充電され、このコンデンサ31
の電圧V3 が半導体制御素子としてのホトトランジスタ
39のコレクタ電圧即ちバイアス電圧となる。ソフトス
タート用コンデンサ31を充電するための第4の出力整
流ダイオード29は主スイッチ4のオン期間に5次巻線
28に誘起する電圧でオンになる極性を有する。従っ
て、ソフトスタート用コンデンサ31の電圧V3 は第1
及び第2の出力電圧V01、V02には依存しないで電源1
の電圧に依存している。このため、図6のt0 又はt3
で主スイッチ4のオン・オフ動作が開始すると、主スイ
ッチ4のオン期間の5次巻線28の電圧によってコンデ
ンサ31は図6(F)に示すように急速に充電され、こ
の電圧V3 は比較的高い値になる。ホトトランジスタ3
9のコレクタ・エミッタ間電圧VCEと電流増幅率hfeと
の関係は図4に示すように比例的関係にあるので、コン
デンサ31をバイアス電源として流れるホトトランジス
タ39の電流I2 は主スイッチ4のオン・オフ開始時に
おけるコンデンサ31の電圧V3 の急激な上昇に基づい
て図6(E)及び図7(E)に示すように上昇する。も
し、コンデンサ31の電圧V3 が一定であると仮定する
と、ホトトランジスタ39の電流I2 は図6(D)に示
す発光ダイオード24の電流If に比例し、t0 〜t2
区間、t3 〜t4 区間では比較的低い値から高い値に徐
々に上昇する。なお、発光ダイオード24の電流If は
既に説明したように図6(B)の第2の出力電圧V02に
比例している。発光ダイオード24の電流If が比較的
低い場合には主スイッチ4のオン時間幅が長くなり、図
7(B)に示す電流Id のピークが高くなり、トランス
2から磁歪音が発生する。これに対し、本実施例では、
ソフトスタート用コンデンサ31が設けられ、この電圧
V3 がホトトランジスタ39のコレクタバイアス電圧と
なっているので、主スイッチ4のオン・オフ動作開始区
間t0 〜t1 でホトトランジスタ39の電流I2 が大き
くなり、主スイッチ4のオン時間幅の低減及び主スイッ
チ4の電流Id の低減効果が得られ、トランス2の磁歪
音が抑制される。ソフトスタート後は発光ダイオード2
4の電流If の増大によってホトトランジスタ39の電
流I2 が徐々に増大し、主スイッチ4のオン時間幅及び
電流Idのピークは図7(B)に示すように徐々に小さ
くなる。なお、ソフトスタートの効果は、スイッチング
電源装置の正常動作を開始時にも得られる。
[Soft Start Operation] In this embodiment, the fourth output smoothing capacitor 31 for soft start is charged by the voltage of the fifth winding 28 of the transformer 2, and this capacitor 31
Is the collector voltage of the phototransistor 39 as a semiconductor control element, that is, the bias voltage. The fourth output rectifier diode 29 for charging the soft-start capacitor 31 has a polarity that is turned on by a voltage induced in the fifth winding 28 during the ON period of the main switch 4. Therefore, the voltage V3 of the soft start capacitor 31 is equal to the first voltage.
And the power supply 1 without depending on the second output voltages V01 and V02.
Voltage. Therefore, t0 or t3 in FIG.
When the ON / OFF operation of the main switch 4 is started, the capacitor 31 is rapidly charged by the voltage of the fifth winding 28 during the ON period of the main switch 4 as shown in FIG. High value. Phototransistor 3
Since the relationship between the collector-emitter voltage VCE 9 and the current amplification factor hfe is proportional as shown in FIG. 4, the current I2 of the phototransistor 39 flowing through the capacitor 31 as a bias power source is the ON / OFF of the main switch 4. 6 (E) and FIG. 7 (E) based on the rapid rise of the voltage V3 of the capacitor 31 at the start of turning off. Assuming that the voltage V3 of the capacitor 31 is constant, the current I2 of the phototransistor 39 is proportional to the current If of the light emitting diode 24 shown in FIG.
In the interval t3 to t4, the value gradually increases from a relatively low value to a high value. Note that the current If of the light emitting diode 24 is proportional to the second output voltage V02 in FIG. When the current If of the light emitting diode 24 is relatively low, the ON time width of the main switch 4 becomes long, the peak of the current Id shown in FIG. 7B becomes high, and the transformer 2 generates a magnetostrictive sound. In contrast, in the present embodiment,
Since the soft start capacitor 31 is provided and this voltage V3 is the collector bias voltage of the phototransistor 39, the current I2 of the phototransistor 39 increases in the on / off operation start section t0 to t1 of the main switch 4, The effect of reducing the ON time width of the main switch 4 and the current Id of the main switch 4 is obtained, and the magnetostrictive sound of the transformer 2 is suppressed. Light-emitting diode 2 after soft start
4, the current I2 of the phototransistor 39 gradually increases, and the on-time width of the main switch 4 and the peak of the current Id gradually decrease as shown in FIG. 7B. Note that the effect of the soft start can be obtained even when the normal operation of the switching power supply device is started.

【0025】上述から明らかなように本実施例によれ
ば、5次巻線28とソフトスタート用コンデンサ31を
設けたので、スタンバイモードの間欠発振期間におい
て、主スイッチ4及び1次巻線3に過大な電流が流れる
ことが防止され、トランス2の磁歪音(ノイズ)の発生
が抑制される。また、ソフトスタート用コンデンサ31
の電圧V3 は電源1の電圧に比例的に変化するので、電
源1の電圧の変化に拘らず、主スイッチ4の電流Id の
ピークを自動的に所定レベル以下に抑制することができ
る。即ち、電源1の電圧が例えば高くなると、ソフトス
タート用コンデンサ31の電圧V3 も高くなり、主スイ
ッチ4のオン時間幅及びその電流Id のピークの抑制効
果も大きくなり、電源1の電圧の上昇による電流Id の
ピークの増大を自動的に抑制することができる。なお、
トランス2の巻数比、巻線のインダクタンス、負荷17
等が変化した場合にも主スイッチ4の電流Id の自動的
補正動作が生じる。また、この実施例ではスタンバイ時
に1次巻線6の電圧をトランジスタ42を介して第2の
負荷17に供給し、ツェナーダイオード43によって第
2の電圧V02の値を所定値以下に制限する構成であるの
で、スタンバイ時における負荷17に対する電力供給と
間欠発振動作とを比較的簡単な回路によって達成するこ
とができる。
As is apparent from the above description, according to the present embodiment, since the fifth winding 28 and the soft start capacitor 31 are provided, the main switch 4 and the primary winding 3 are connected during the intermittent oscillation period of the standby mode. Excessive current is prevented from flowing, and generation of magnetostrictive noise (noise) of the transformer 2 is suppressed. Also, the soft start capacitor 31
Since the voltage V3 changes in proportion to the voltage of the power supply 1, the peak of the current Id of the main switch 4 can be automatically suppressed to a predetermined level or less regardless of the change in the voltage of the power supply 1. That is, for example, when the voltage of the power supply 1 increases, the voltage V3 of the soft start capacitor 31 also increases, the ON time width of the main switch 4 and the effect of suppressing the peak of the current Id also increase, and the voltage of the power supply 1 increases. The increase in the peak of the current Id can be automatically suppressed. In addition,
Turn ratio of transformer 2, winding inductance, load 17
In the case where the current value changes, the operation for automatically correcting the current Id of the main switch 4 occurs. In this embodiment, the voltage of the primary winding 6 is supplied to the second load 17 via the transistor 42 at the time of standby, and the value of the second voltage V02 is limited to a predetermined value or less by the Zener diode 43. Therefore, the power supply to the load 17 and the intermittent oscillation operation during standby can be achieved by a relatively simple circuit.

【0026】[0026]

【変形例】本発明は上述の実施例に限定されるものでな
く、例えば次の変形が可能なものである。 (1) 主スイッチ4をオン・オフ制御するためのスイ
ッチ制御信号形成回路の構成を種々変形できる。例え
ば、コンデンサ49の充電又は放電の制御によってもP
WMパルスの幅制御又はPWMパルスの間欠的発生を行
うことができる。 (2) 主スイッチ4をバイポーラトランジスタ等の半
導体スイッチに置き換えることができる。 (3) 発光ダイオード24とホトトランジスタ39と
の光結合回路を省いて電気的に結合する回路構成とする
ことができる。 (4) 3次巻線12を独立に設けないで、2次巻線6
の一部を3次巻線12として兼用することができる。 (5) 第1〜第4の出力整流ダイオード7、13、2
6、29をトランジスタ又はFETに基づく整流素子と
すること、又はダイオードとトランジスタ又はFETと
の並列回路から成る同期整流素子又は回路とすることが
できる。
[Modifications] The present invention is not limited to the above-described embodiment, and for example, the following modifications are possible. (1) The configuration of the switch control signal forming circuit for turning on / off the main switch 4 can be variously modified. For example, by controlling charge or discharge of the capacitor 49, P
The width control of the WM pulse or the intermittent generation of the PWM pulse can be performed. (2) The main switch 4 can be replaced with a semiconductor switch such as a bipolar transistor. (3) A circuit configuration in which the light coupling circuit between the light emitting diode 24 and the phototransistor 39 is electrically omitted without the optical coupling circuit can be provided. (4) The secondary winding 6 is not provided independently of the tertiary winding 12.
Can also be used as the tertiary winding 12. (5) First to fourth output rectifier diodes 7, 13, 2
6, 29 may be rectifiers based on transistors or FETs, or synchronous rectifiers or circuits comprising parallel circuits of diodes and transistors or FETs.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の実施例のスイッチング電源装置を示す
回路図である。
FIG. 1 is a circuit diagram showing a switching power supply device according to an embodiment of the present invention.

【図2】図1のスイッチ制御信号形成回路とこの近傍部
分を示す回路図である。
FIG. 2 is a circuit diagram showing a switch control signal forming circuit of FIG. 1 and a portion in the vicinity thereof;

【図3】図2の駆動回路を詳しく示す回路図である。FIG. 3 is a circuit diagram illustrating a driving circuit of FIG. 2 in detail;

【図4】図2のホトトランジスタの特性を示す図であ
る。
FIG. 4 is a diagram showing characteristics of the phototransistor of FIG. 2;

【図5】正常時における図2の各部の状態を示す波形図
である。
FIG. 5 is a waveform diagram showing a state of each unit in FIG. 2 in a normal state.

【図6】スタンバイ時における図2の各部の状態を示す
波形図である。
FIG. 6 is a waveform diagram showing a state of each unit in FIG. 2 during standby.

【図7】図6のオン・オフ動作区間を拡大して示す波形
図である。
FIG. 7 is an enlarged waveform diagram showing an on / off operation section in FIG. 6;

【符号の説明】[Explanation of symbols]

3 1次巻線 4 主スイッチ 31 スタンバイ用コンデンサ 39 ホトトランジスタ 47 スタンバイ信号入力端子 3 Primary winding 4 Main switch 31 Standby capacitor 39 Phototransistor 47 Standby signal input terminal

フロントページの続き (72)発明者 小池 憲吾 埼玉県新座市北野三丁目6番3号 サン ケン電気株式会社内 (56)参考文献 特開 平8−111975(JP,A) 特開 平8−111977(JP,A) 特開 平11−122921(JP,A) 実開 昭51−80614(JP,U) (58)調査した分野(Int.Cl.7,DB名) H02M 3/28 H02M 3/335 Continuation of the front page (72) Inventor Kengo Koike 3-6-3 Kitano, Niiza-shi, Saitama Sanken Electric Co., Ltd. (56) References JP-A 8-111975 (JP, A) JP-A 8-111977 (JP, A) JP-A-11-122921 (JP, A) JP-A-51-80614 (JP, U) (58) Fields investigated (Int. Cl. 7 , DB name) H02M 3/28 H02M 3 / 335

Claims (4)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 直流電源(1)の一端と他端との間に接
続されたトランス(2)の1次巻線(3)とスイッチ
(4)との直列回路と、 前記1次巻線(3)に電磁結合された2次巻線(6)
と、 負荷(11)に直流電圧を供給するために前記2次巻線
(6)に接続された出力整流平滑回路(7、8)と、 前記出力整流平滑回路(7、8)の出力電圧を検出する
電圧検出回路(19、20)と、 定電圧制御用基準電圧を与えるための基準電圧源(2
2)と、 前記電圧検出回路(19、20)から得られる検出電圧
と前記基準電圧源(22)の定電圧制御用基準電圧との
差の信号からなる誤差信号を形成する誤差信号形成回路
(23)と、 前記誤差信号に実質的に比例した電流を流すことができ
ように誤差信号形成回路に結合された前記半導体制御
素子(39)と、 前記スイッチ(4)を流れる電流を検出する電流検出手
段(5)と、 前記電流検出手段(5)で検出されたスイッチ電流(I
1 )と前記半導体制御素子(39)の電流(I2)とを
加算して前記スイッチのオン時間幅を制御するための加
信号(Vf )を形成する加算手段と、前記スイッチ(4)をオン・オフ制御するためのスイッ
チ制御パルスを発生するパルス発生器(51)と、 パルス幅決定用基準電圧源(54a、54b)と、 前記加算手段から得られた加算信号(Vf)と前記パル
ス幅決定用基準電圧源の基準電圧(Vth)とを比較し、
前記加算信号(Vf )が前記パルス幅決定用基準電圧
(Vth)よりも高くなった時に前記スイッチ制御パルス
による前記スイッチ(4)の制御を中断するように形成
されたオン時間幅制御回路(55、56)と を備えたス
イッチング電源装置であって、 前記トランス(2)の前記1次巻線(3)に電磁結合さ
れた帰還制御電源用巻線(28)と、 前記スイッチ(4)のオン期間に前記帰還制御電源用巻
線(28)に得られた電圧によって導通する整流素子
(29)を介して前記帰還制御電源用巻線(28)に並
列接続された帰還制御電源用コンデンサ(31)とを有
し、前記帰還制御電源用コンデンサ(31)が前記半導
体制御素子(39)にこのバイアス電源として接続され
ていることを特徴とするスイッチング電源装置。
1. A series circuit of a primary winding (3) and a switch (4) of a transformer (2) connected between one end and the other end of a DC power supply (1); Secondary winding (6) electromagnetically coupled to (3)
An output rectifying / smoothing circuit (7, 8) connected to the secondary winding (6) to supply a DC voltage to a load (11); and an output voltage of the output rectifying / smoothing circuit (7, 8). Detect
A voltage detection circuit (19, 20); and a reference voltage source (2 ) for supplying a constant voltage control reference voltage.
2) and a detection voltage obtained from the voltage detection circuit (19, 20)
And a reference voltage for constant voltage control of the reference voltage source (22).
Error signal forming circuit for forming an error signal composed of a difference signal
And (23), and coupled to said error signal forming circuit so as to be able to flow substantially proportional to the current in the error signal semiconductor control element (39), for detecting a current flowing through the switch (4) A current detection means (5); and a switch current (I) detected by the current detection means (5).
1) and the semiconductor control element (39) of the current (I2) and the pressure of the addition to for controlling the ON time width of the switch
Adding means for forming a computation signal (Vf), switch to on-off control of said switch (4)
A pulse generator (51) for generating a pulse control pulse, reference voltage sources for pulse width determination (54a, 54b), an addition signal (Vf) obtained from the addition means , and the pulse signal.
Comparison with the reference voltage (Vth) of the reference voltage source for determining the width,
The addition signal (Vf) is a reference voltage for determining the pulse width.
(Vth) when the switch control pulse
Formed so as to interrupt the control of the switch (4) by
A switching power supply apparatus having an on-time duration control circuit and (55, 56) that is, the said primary winding (3) to the magnetically coupled feedback control power winding of the transformer (2) (28 ), And in parallel with the feedback control power supply winding (28) via a rectifying element (29) that conducts by the voltage obtained in the feedback control power supply winding (28) during the ON period of the switch (4). And a feedback control power supply capacitor (31) connected thereto, wherein the feedback control power supply capacitor (31) is connected to the semiconductor control element (39) as the bias power supply. .
【請求項2】 前記半導体制御素子(39)を前記誤差
信号形成回路に光結合させるために前記誤差信号形成回
路に発光ダイオード(24)が接続されており、前記半
導体制御素子は前記発光ダイオード(24)に光結合さ
れたホトトランジスタ(39)であることを特徴とする
請求項1記載のスイッチング電源装置。
2. The method according to claim 1, wherein said semiconductor control element is provided with said error.
The error signal forming circuit is used for optical coupling to a signal forming circuit.
The switching power supply according to claim 1 , wherein a light emitting diode (24) is connected to the path, and the semiconductor control element is a phototransistor (39) optically coupled to the light emitting diode (24).
【請求項3】 第1の負荷(11)と前記第1の負荷
(11)よりも消費電力の小さい第2の負荷(17)と
に電力を供給するためのスイッチング電源装置であっ
て、 直流電源(1)の一端と他端との間に接続されたインダ
クタンスを有するトランスの1次巻線(3)とスイッチ
(4)との直列回路と、 前記1次巻線(3)に電磁結合された2次巻線(6)
と、 前記1次巻線(3)に電磁結合され且つ前記2次巻線
(6)よりも低い電圧が誘起するように巻数が決定され
た3次巻線(12)と、 前記1次巻線(3)、前記2次巻線(6)、及び前記3
次巻線(12)に電磁結合された4次巻線(25)と、 前記1次巻線(3)に電磁結合された5次巻線(28)
と、 前記2次巻線(6)と前記第1の負荷(11)のための
第1の出力端子(9)との間に接続され且つ前記スイッ
チ(4)のオフの期間に前記2次巻線(6)に誘起する
電圧によって導通する極性を有している第1の整流素子
(7)と、 前記第1の整流素子(7)を介して前記2次巻線(6)
に並列に接続された第1の出力平滑用コンデンサ(8)
と、 前記3次巻線(12)と前記第2の負荷(17)のため
の第2の出力端子(15)との間に接続され且つ前記ス
イッチ(4)のオフの期間に前記3次巻線(12)に誘
起する電圧によって導通する極性を有している第2の整
流素子(13)と、 前記第2の整流素子(13)を介して前記3次巻線(1
2)に並列に接続された第2の出力平滑用コンデンサ
(14)と、 前記第1及び第2の出力平滑用コンデンサ(8、14)
のグランド側出力端子を相互に接続する手段と、 前記第1の出力平滑用コンデンサ(8)の出力電圧を検
出する電圧検出回路(19、20)と、 定電圧制御用基準電圧を与えるための基準電圧源(2
2)と、 前記電圧検出回路(19、20)から得られる検出電圧
と前記基準電圧源(22)の定電圧制御用基準電圧との
差に対応する誤差信号を形成する誤差信号形成回路(2
3)と、 前記第2の出力平滑用コンデンサ(14)の一方の出力
端子と前記誤差信号形成回路(23)の出力端子との間
に接続され且つその発光量が前記第2の出力平滑用コン
デンサ(14)の出力電圧(V02)に対して比例的に変
化するようにその極性が決定されている発光ダイオード
(24)と、 前記誤差信号形成回路(23)の出力端子と前記第2の
出力平滑用コンデンサ(14)の他方の出力端子の間に
ツェナーダイオード(43)を介して接続された第1の
軽負荷モード決定用トランジスタ(41)と、 前記第1の負荷(11)に実質的に電力を供給せず、前
記第2の負荷(17)に電力を供給する軽負荷モードを
示す信号を前記第1の軽負荷モード決定用トランジスタ
(41)に供給し、この第1の軽負荷モード決定用トラ
ンジスタ(41)をオンにするための軽負荷モード指令
手段(47)と、 前記2次巻線(6)と前記第2の出力平滑用コンデンサ
(14)の一方の端子との間に接続され且つ前記軽負荷
モード時にオンになるように前記軽負荷モードを示す信
号に基づいて制御される第2の軽負荷モード決定用トラ
ンジスタ(42)と、 前記スイッチ(4)のオフの期間に前記4次巻線(2
5)に得られる電圧で導通する極性を有している第3の
整流素子(26)を介して前記4次巻線(25)に並列
に接続され且つそのグランド側端子が前記電源(1)の
他端に接続された第3の出力平滑用コンデンサ(27)
と、 前記スイッチ(4)のオン期間に前記5次巻線(28)
に得られる電圧で導通する極性を有している第4の整流
素子(29)を介して前記5次巻線(28)に並列に接
続され且つそのグランド側端子が前記電源(1)の他端
に接続された第4の出力平滑用コンデンサ(31)と、 前記スイッチ(4)と前記電源(1)の他端との間に接
続された電流検出抵抗(5)と、 帰還制御信号供給端子(36)と、 前記帰還制御信号供給端子(36)と前記電流検出抵抗
(37)との間に接続された合成用抵抗(37)と、 前記発光ダイオード(24)に光結合され且つ前記第4
の出力平滑用コンデンサ(31)と前記帰還制御信号供
給端子(36)との間に接続されたホトトランジスタ
(39)と、 前記電源(1)と前記第3の出力平滑用コンデンサ(2
7)との間に接続された起動用抵抗(34)と、 前記第3の出力平滑用コンデンサ(27)の電圧に基づ
いて前記スイッチ(4)をオン・オフ制御するためのス
イッチ制御パルスを発生するパルス発生器(51)と、 パルス幅決定用基準電圧源(54a、54b)と、 前記帰還制御信号供給端子(36)の電圧(Vf )と前
記パルス幅決定用基準電圧源(54a、54b)のパル
ス幅決定用基準電圧(Vth)とを比較して前記帰還制御
信号供給端子(36)の電圧(Vf )が前記パルス幅決
定用基準電圧(Vth)よりも高くなった時に前記スイッ
チ制御パルスによる前記スイッチ(4)のオン制御を中
断するためのオン時間幅制御回路(55、56)とを備
えていることを特徴とするスイッチング電源装置。
3. A switching power supply for supplying power to a first load (11) and a second load (17) having lower power consumption than the first load (11), comprising: A series circuit of a primary winding (3) and a switch (4) of a transformer having an inductance connected between one end and the other end of the power supply (1); and an electromagnetic coupling to the primary winding (3) Secondary winding (6)
A tertiary winding (12) electromagnetically coupled to the primary winding (3) and having a number of turns determined to induce a voltage lower than that of the secondary winding (6); Wire (3), said secondary winding (6) and said 3
A fourth winding (25) electromagnetically coupled to the secondary winding (12), and a fifth winding (28) electromagnetically coupled to the primary winding (3)
Connected between the secondary winding (6) and a first output terminal (9) for the first load (11), and connected to the secondary output terminal during the off-time of the switch (4). A first rectifying element (7) having a polarity conducting by a voltage induced in the winding (6); and the secondary winding (6) via the first rectifying element (7).
Output smoothing capacitor (8) connected in parallel to
Connected between the tertiary winding (12) and a second output terminal (15) for the second load (17), and connected to the tertiary winding during the off-time of the switch (4). A second rectifying element (13) having a polarity conducting by a voltage induced in the winding (12); and the tertiary winding (1) via the second rectifying element (13).
A second output smoothing capacitor (14) connected in parallel to 2); and the first and second output smoothing capacitors (8, 14).
Means for connecting the ground-side output terminals of each other, a voltage detection circuit (19, 20) for detecting the output voltage of the first output smoothing capacitor (8), and a constant voltage control reference voltage. Reference voltage source (2
(2) an error signal forming circuit (2) for forming an error signal corresponding to a difference between a detection voltage obtained from the voltage detection circuit (19, 20) and a reference voltage for constant voltage control of the reference voltage source (22).
3) is connected between one output terminal of the second output smoothing capacitor (14) and the output terminal of the error signal forming circuit (23), and the light emission amount is connected to the second output smoothing capacitor. A light emitting diode (24) whose polarity is determined so as to change in proportion to an output voltage (V02) of the capacitor (14); an output terminal of the error signal forming circuit (23); A first light load mode determining transistor (41) connected between the other output terminal of the output smoothing capacitor (14) via a zener diode (43); A signal indicating a light load mode for supplying power to the second load (17) without supplying power to the second load (17) is supplied to the first light load mode determining transistor (41). Load mode determination transformer A light load mode instructing means (47) for turning on a star (41), and connected between the secondary winding (6) and one terminal of the second output smoothing capacitor (14). A second light load mode determining transistor (42) controlled based on a signal indicating the light load mode so as to be turned on in the light load mode; Next winding (2
5) connected in parallel to the quaternary winding (25) via a third rectifying element (26) having a polarity conducting with the voltage obtained in the power supply (1); Output smoothing capacitor (27) connected to the other end of the circuit
And the fifth winding (28) during an ON period of the switch (4).
Is connected in parallel to the fifth winding (28) via a fourth rectifying element (29) having a polarity that conducts with a voltage obtained at the power supply (1) and a ground-side terminal of the fifth winding (28). A fourth output smoothing capacitor (31) connected to one end; a current detection resistor (5) connected between the switch (4) and the other end of the power supply (1); and a feedback control signal supply. A terminal (36), a combining resistor (37) connected between the feedback control signal supply terminal (36) and the current detection resistor (37), and an optically coupled light emitting diode (24); 4th
A phototransistor (39) connected between the output smoothing capacitor (31) and the feedback control signal supply terminal (36); the power supply (1); and the third output smoothing capacitor (2).
And a switch control pulse for controlling on / off of the switch (4) based on the voltage of the third output smoothing capacitor (27). A pulse generator (51) to be generated; reference voltage sources for pulse width determination (54a, 54b); a voltage (Vf) of the feedback control signal supply terminal (36); and a reference voltage source for pulse width determination (54a, 54b) is compared with the pulse width determining reference voltage (Vth), and when the voltage (Vf) of the feedback control signal supply terminal (36) becomes higher than the pulse width determining reference voltage (Vth), the switch is turned on. A switching power supply device comprising an ON time width control circuit (55, 56) for interrupting the ON control of the switch (4) by a control pulse.
【請求項4】 更に、前記第3の出力平滑用コンデンサ
(27)と前記パルス発生器(51)との間に第1及び
第2の電圧(V11、V12)を発生する定電圧回路(5
7)が設けられ、 前記定電圧回路(57)は前記第1の負荷(11)に正
常に電力を供給する時に前記第1の電圧(V11)を出力
し、前記軽負荷モードの時に前記第2の電圧(V12)を
発生するものであり、 前記第2の電圧(V12)は前記パルス発生器(51)を
非発振状態に保つレベルを有していることを特徴とする
請求項4記載のスイッチング電源装置。
4. A constant voltage circuit (5) for generating first and second voltages (V11, V12) between the third output smoothing capacitor (27) and the pulse generator (51).
7) is provided, wherein the constant voltage circuit (57) outputs the first voltage (V11) when power is normally supplied to the first load (11), and outputs the first voltage (V11) in the light load mode. The second voltage (V12) has a level for keeping the pulse generator (51) in a non-oscillating state. Switching power supply.
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