JP2985261B2 - Printed circuit board wiring design equipment - Google Patents
Printed circuit board wiring design equipmentInfo
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は電子機器実装設計におけるプリント板配線設
計に利用する。本発明はパターンの引出し方向を論理的
属性により決定して配置するプリント板配線設計装置に
関する。DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention is used for printed circuit board wiring design in electronic device packaging design. The present invention relates to a printed circuit board wiring design apparatus for arranging a pattern drawing direction determined by a logical attribute.
本発明は、表面実装部品を搭載するプリント配線板の
配線設計を行うプリント板配線設計装置において、 パターンの引出し方向を論理的属性により決定し、改
造の可能性の大きい信号パターンを部品パッドの外側に
引出すことにより、 基板の改造作業を少なくして工数およびコストを低減
できるようにしたものである。The present invention relates to a printed circuit board wiring designing apparatus for designing a wiring of a printed circuit board on which a surface mount component is mounted. By reducing the number of remodeling operations of the substrate, the number of steps and costs can be reduced.
従来、表面実装部品(QEP、SOJなど)を搭載したプリ
ント配線板の配線設計において部品搭載パッドからのパ
ターンの引出し方向は部品の論理的属性にかかわらず部
品ライブラリ中に決められた引出し方向に従っていた。Conventionally, in the wiring design of a printed wiring board on which surface-mounted components (QEP, SOJ, etc.) are mounted, the direction in which the pattern is drawn from the component mounting pads follows the direction determined in the component library regardless of the logical attributes of the components. .
上述した従来の表面実装対応の配線装置では、部品搭
載パッドからのパターンの引出し方向は部品ライブラリ
のパターン引出し方向で定められていて部品ピンの論理
的属性を考慮していないため、信号ピンであるかGVピン
(電源・GNDピン)であるかの区別がされず、そのため
に改造性の高い信号ピンがパッドの内側に、また改造性
のあまりないGVピンがパッドの外側に引出されてしまう
場合がある。このような場合、改造のためにパターンを
カットして部品をはずす特別な治具が必要となり、また
銅箔パッドの剥離などの事故により基板が使用不可能に
なる問題がある。In the above-described conventional wiring device for surface mounting, the pattern drawing direction from the component mounting pad is determined by the pattern drawing direction of the component library and does not take into account the logical attribute of the component pin. It is not distinguished whether it is a GV pin (power supply / GND pin), so that highly modifiable signal pins are pulled out inside the pad, and less modifiable GV pins are pulled out of the pad. There is. In such a case, there is a problem that a special jig for cutting a pattern and removing a part is required for remodeling, and there is a problem that the substrate cannot be used due to an accident such as peeling of a copper foil pad.
本発明はこのような問題を解決するもので、パターン
の引出し方向を論理的属性により決定して配線後に行わ
れる改造を削減できる装置を提供することを目的とす
る。An object of the present invention is to solve such a problem, and an object of the present invention is to provide an apparatus which can determine the drawing direction of a pattern based on a logical attribute and reduce modification performed after wiring.
本発明は、部品配置位置を設定する部品配置座標値と
各部品ごとに部品のパッドおよびランドの位置を定義す
る部品ライブラリとを入力する入力手段と、入力された
情報に基づきパッドおよびランドを配線領域マップ上に
展開する部品搭載パッド展開手段と、配線すべきピンペ
アをランドおよびパッドの位置により決定するピンペア
決定手段と、決定されたピンペアに基づき配線を行うと
ともに、すべての配線処理の終了を判定する配線手段
と、配線終了の判定を受けたときに配線パターンデータ
を外部ファイルに出力する配線データ出力手段とを備え
たプリント板配線設計装置において、前記入力手段に、
回路図の論理接続情報を入力する手段を含み、前記ピン
ペア決定手段に、ランドおよびパッド位置の他に前記論
理接続情報を付加してピンペアを決定する手段を含み、
前記ピンペア決定手段により決定された配線ピンペアの
一方のピンについて表面実装部品に接続されているか否
かを判定するとともに、そのピンが表面実装部品に接続
されているときにその接続が電源または接地側であるか
否かを判定する接続状態判定手段と、表面実装部品に接
続されているピンの一方が電源または接地側に接続され
ているときに、信号パターンを部品搭載パッドの内側か
ら引出せるように設定する信号パターン設定手段とを備
えたことを特徴とする。The present invention provides an input unit for inputting a component arrangement coordinate value for setting a component arrangement position and a component library for defining a position of a pad and a land of a component for each component, and wiring pads and lands based on the input information. Component mounting pad expanding means to be developed on the area map, pin pair determining means for determining the pin pair to be wired based on the land and pad positions, wiring based on the determined pin pair, and judging completion of all wiring processing Wiring means, and a printed circuit board wiring design device comprising a wiring data output means for outputting wiring pattern data to an external file when the determination of wiring completion is received, wherein the input means,
Means for inputting logical connection information of a circuit diagram, wherein the pin pair determining means includes means for adding the logical connection information in addition to land and pad positions to determine a pin pair,
It is determined whether or not one of the pins of the wiring pin pair determined by the pin pair determining means is connected to the surface mount component, and when the pin is connected to the surface mount component, the connection is made to the power or ground side. Connection state determination means for determining whether or not a signal pattern is drawn from the inside of the component mounting pad when one of the pins connected to the surface mount component is connected to the power or ground side. And a signal pattern setting means for setting
前記信号パターン設定手段は、表面実装部品に接続さ
れているピンの一方が電源または接地側に接続されてい
ないときに、信号パターンを部品搭載パッドの外側から
引出せるように設定する手段と、配線ピンペアの二つの
ピンについての配線処理が完了したか否かを判定し、完
了したときに配線処理完了通知を前記配線手段に送出す
る手段を含むことが望ましい。Said signal pattern setting means, when one of the pins connected to the surface mount component is not connected to the power supply or the ground side, means for setting so that the signal pattern can be drawn out of the component mounting pad, wiring It is desirable to include means for determining whether or not the wiring processing for the two pins of the pin pair is completed, and sending a wiring processing completion notification to the wiring means when the wiring processing is completed.
表面実装部品を搭載するプリント配線板の配線設計で
パターンをパッドから引出すときに、そのパターンの引
出し方向を論理的属性により決定して、改造の可能性の
大きい信号パターンは部品パッドの外側方向へ優先的に
引出すようにし、改造の可能性の小さい電源・GNDパタ
ーンは部品パッドの内側方向へ優先的に引出すように配
置する。When drawing a pattern from a pad in the wiring design of a printed wiring board on which surface-mounted components are mounted, the direction in which the pattern is drawn is determined by logical attributes, and signal patterns that are highly likely to be modified are directed outward from the component pads. The power supply and GND patterns that are less likely to be modified are arranged so as to be drawn out preferentially inward of the component pads.
これにより、改造のためにパターンをカットする頻度
を少なくして基板の損傷を減らし、工数およびコストを
低減することができる。As a result, the frequency of pattern cutting for remodeling can be reduced, the damage to the substrate can be reduced, and the number of steps and cost can be reduced.
次に、本発明実施例を図面に基づいて説明する。第1
図は本発明実施例の構成を示すブロック図、第2図は従
来例および本発明実施例に係る論理回路実装設計の流れ
を示すフローチャート、第3図は従来例および本発明実
施例に係る実装設計の流れを示すフローチャートであ
る。Next, embodiments of the present invention will be described with reference to the drawings. First
FIG. 2 is a block diagram showing a configuration of the embodiment of the present invention. FIG. 2 is a flowchart showing a flow of a logic circuit mounting design according to the conventional example and the embodiment of the present invention. FIG. It is a flowchart which shows the flow of a design.
本発明実施例装置は、論理回路設計に係るものであ
り、特に実装設計における配置および配線に係るもので
ある。The device according to the embodiment of the present invention relates to logic circuit design, and particularly relates to arrangement and wiring in mounting design.
本発明実施例は、部品配置位置を設定する部品配置座
標値22と各部品ごとに部品のパッドおよびランドの位置
を定義する部品ライブラリ23とを入力する入力手段1
と、入力された情報に基づきパッドおよびランドを配線
領域マップ上に展開する部品搭載パッド展開手段2と、
配線すべきピンペアをランドおよびパッドの位置により
決定するピンペア決定手段3と、決定されたピンペアに
基づき配線を行うとともに、すべての配線処理の終了を
判定する配線手段6と、配線終了の判定を受けたときに
配線パターンデータを外部ファイル24に出力する配線デ
ータ出力手段7とを備え、さらに、本発明の特徴とし
て、入力手段1に、回路図の論理接続情報21を入力する
手段を含み、ピンペア決定手段3に、ランドおよびパッ
ド位置の他に論理接続情報21を付加してピンペアを決定
する手段を含み、ピンペア決定手段3により決定された
配線ピンペアの一方のピンについて表面実装部品に接続
されているか否かを判定するとともに、そのピンが表面
実装部品に接続されているときにその接続が電源または
接地側であるか否かを判定する接続状態判定手段4と、
表面実装部品に接続されているピンの一方が電源または
接地側に接続されているときに、信号パターンを部品搭
載パッドの内側から引出せるように設定する信号パター
ン設定手段5とを備え、信号パターン設定手段5には、
表面実装部品に接続されているピンの一方が電源または
接地側に接続されていないときに、信号パターンを部品
搭載パッドの外側から引出せるように設定する手段と、
配線ピンペアの二つのピンについての配線処理が完了し
たか否かを判定し、完了したときに配線処理完了通知を
配線手段6に送出する手段を含む。The embodiment of the present invention is an input means 1 for inputting a component arrangement coordinate value 22 for setting a component arrangement position and a component library 23 for defining the positions of component pads and lands for each component.
Component mounting pad expanding means 2 for expanding pads and lands on a wiring area map based on the input information;
A pin pair determining means 3 for determining a pin pair to be wired based on the land and pad positions, a wiring means 6 for performing wiring based on the determined pin pair, and a wiring means 6 for determining completion of all wiring processing, and a determination of completion of wiring. Wiring data output means 7 for outputting wiring pattern data to an external file 24 when the input means 1 further includes means for inputting logical connection information 21 of a circuit diagram to the input means 1, The determining means 3 includes means for adding the logical connection information 21 in addition to the land and pad positions to determine the pin pair. One of the wiring pin pairs determined by the pin pair determining means 3 is connected to the surface mount component. And determine whether the connection is to the power or ground side when the pin is connected to a surface mount component. A connection state judging means 4 fixed to,
Signal pattern setting means 5 for setting a signal pattern to be drawn out from inside the component mounting pad when one of the pins connected to the surface mount component is connected to the power supply or the ground side; The setting means 5 includes:
Means for setting so that a signal pattern can be drawn out of the component mounting pad when one of the pins connected to the surface mount component is not connected to the power or ground side;
It includes means for judging whether or not wiring processing has been completed for two pins of the wiring pin pair, and sending a wiring processing completion notification to the wiring means 6 when the wiring processing has been completed.
次に、このように構成された本発明実施例の動作につ
いて説明する。第4図は本発明実施例の動作の流れを示
すフローチャートである。Next, the operation of the embodiment of the present invention thus configured will be described. FIG. 4 is a flowchart showing the flow of the operation of the embodiment of the present invention.
まず、回路図などの論理接続情報21をネットリストな
どの形で入力する(処理S1)。次に、プリント板上に搭
載する部品配置座標値22を入力する(処理S2)。各部品
ごとに部品のパッドやランドの位置を定義した部品ライ
ブラリ23を入力し、パッドやランドを配線領域マップ上
に展開する(処理S3)。次いで配線するべきピンペアを
処理S1で入力した論理接続情報21とランドおよびパッド
位置より決定する(処理S4)。First, logical connection information 21 such as a circuit diagram is input in the form of a netlist or the like (process S1). Next, a component arrangement coordinate value 22 to be mounted on the printed board is input (process S2). The part library 23 in which the positions of the pads and lands of the parts are defined for each part is input, and the pads and lands are developed on the wiring area map (processing S3). Next, a pin pair to be wired is determined from the logical connection information 21 input in step S1 and the land and pad positions (step S4).
この処理S4で決定した配線ピンペアの一方のピンにつ
いて表面実装部品に接続されているか否かを調べる(処
理S5)。表面実装部品に接続されていればそのピンが電
源・GND信号であるか否かを調べ(処理S6)、電源・GND
信号であれば信号パターンを部品搭載パッドの内側から
引出しviaホール(スルーホール)を設ける(処理S
7)。信号線であれば信号パターンを部品搭載パッドの
外側から引出しviaホールを設ける(処理S8)。It is checked whether or not one of the pins of the wiring pin pair determined in step S4 is connected to the surface mount component (step S5). If it is connected to a surface mount component, check whether the pin is a power / GND signal (process S6),
If it is a signal, the signal pattern is drawn from inside the component mounting pad and a via hole (through hole) is provided (processing S
7). If it is a signal line, a signal pattern is drawn from the outside of the component mounting pad and a via hole is provided (process S8).
次に、配線すべき二つのピンについて処理S5〜処理S8
までの処理が完了したか否かを調べ(処理S9)、完了し
ていなければ処理S5へ戻り、完了していれば処理S5〜処
理S8で発生したviaホールもしくはT/Hランドをルーティ
ングターゲットとして配線処理を行う(処理S10)。す
べてのピンペアについて処理を行ったか否かを調べ(処
理S11)、処理が行われていなければ処理S5へ戻り、処
理が行われていれば配線パターンデータを外部ファイル
24へ出力する(処理S12)。Next, processing S5 to processing S8 are performed for two pins to be wired.
It is checked whether or not the processing has been completed (processing S9). If not completed, the process returns to processing S5. If completed, the via hole or T / H land generated in processing S5 to processing S8 is set as a routing target. A wiring process is performed (process S10). It is checked whether or not the processing has been performed for all the pin pairs (processing S11). If the processing has not been performed, the process returns to the processing S5. If the processing has been performed, the wiring pattern data is stored in an external file.
Output to 24 (process S12).
第5図はこのような動作により結線されたパターンの
一例を示したものである。FIG. 5 shows an example of a pattern connected by such an operation.
以上説明したように本発明によれば、配線設計におけ
るパターンの引出し方向を論理的属性により決定して改
造の可能性が大きい信号パターンを部品パッドの外側へ
引出し、改造の可能性の小さい電源・GNDパターンを部
品パッドの内側へ引出すことにより、基板改造による表
面実装部品のはがし作業を少なくし、工数およびコスト
を低減することができる効果がある。As described above, according to the present invention, the pattern extraction direction in the wiring design is determined based on the logical attribute, and the signal pattern having a high possibility of modification is extracted to the outside of the component pad. Pulling out the GND pattern to the inside of the component pad has the effect of reducing the work of peeling off the surface-mounted component by remodeling the board, and reducing the number of steps and cost.
第1図は本発明実施例の構成を示すブロック図。 第2図は従来例および本発明実施例に係る論理回路設計
の流れを示すフローチャート。 第3図は従来例および本発明実施例に係る実装設計の流
れを示すフローチャート。 第4図は本発明実施例の動作の流れを示すフローチャー
ト。 第5図は本発明実施例により結線されたパターン例を示
す図。 1……入力手段、2……部品搭載パッド展開手段、3…
…ピンペア決定手段、4……接続状態判定手段、5……
信号パターン設定手段、6……配線手段、7……配線デ
ータ出力手段、13……GND用部品搭載パッド、14……パ
ターン、15……信号用部品搭載パッド、16……VCC用部
品搭載パッド、17……viaホール、21……論理接続情
報、22……部品配置座標値、23……部品ライブラリ、24
……外部ファイル。FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention. FIG. 2 is a flowchart showing a flow of a logic circuit design according to the conventional example and the embodiment of the present invention. FIG. 3 is a flowchart showing a flow of a packaging design according to a conventional example and an embodiment of the present invention. FIG. 4 is a flowchart showing the flow of the operation of the embodiment of the present invention. FIG. 5 is a diagram showing an example of a pattern connected according to the embodiment of the present invention. 1 ... input means, 2 ... component mounting pad deployment means, 3 ...
... Pin pair determination means, 4 ... Connection state determination means, 5 ...
Signal pattern setting means, 6 Wiring means, 7 Wiring data output means, 13 ... GND component mounting pad, 14 ... Pattern, 15 ... Signal component mounting pad, 16 ... VCC component mounting pad , 17 ... via hole, 21 ... logical connection information, 22 ... component arrangement coordinate value, 23 ... component library, 24
...... External file.
Claims (3)
各部品ごとに部品のパッドおよびランドの位置を定義す
る部品ライブラリとを入力する入力手段と、 入力された情報に基づきパッドおよびランドを配線領域
マップ上に展開する部品搭載パッド展開手段と、 配線すべきピンペアをランドおよびパッドの位置により
決定するピンペア決定手段と、 決定されたピンペアに基づき配線を行うとともに、すべ
ての配線処理の終了を判定する配線手段と、 配線終了の判定を受けたときに配線パターンデータを外
部ファイルに出力する配線データ出力手段と を備えたプリント板配線設計装置において、 前記入力手段に、回路図の論理接続情報を入力する手段
を含み、 前記ピンペア決定手段に、ランドおよびパッド位置の他
に前記論理接続情報を付加してピンペアを決定する手段
を含み、 前記ピンペア決定手段により決定された配線ピンペアの
一方のピンについて表面実装部品に接続されているか否
かを判定するとともに、そのピンが表面実装部品に接続
されているときにその接続が電源または接地側であるか
否かを判定する接続状態判定手段と、 表面実装部品に接続されているピンの一方が電源または
接地側に接続されているときに、信号パターンを部品搭
載パッドの内側から引出せるように設定する信号パター
ン設定手段と を備えたことを特徴とするプリント板配線設計装置。An input means for inputting a component arrangement coordinate value for setting a component arrangement position and a component library for defining a position of a pad and a land of a component for each component, and a pad and a land based on the input information. A component mounting pad developing means for developing on a wiring area map, a pin pair determining means for determining a pin pair to be wired based on a land and a pad position, wiring is performed based on the determined pin pair, and termination of all wiring processing is performed. A printed circuit board wiring design device comprising: wiring means for determining; and wiring data output means for outputting wiring pattern data to an external file when the determination of wiring completion is received. Means for inputting the logical connection information to the pin pair determining means in addition to the land and pad positions. Means for determining a pin pair in addition to determining whether or not one of the pins of the wiring pin pair determined by the pin pair determining means is connected to the surface mount component, and determining whether the pin is connected to the surface mount component. Connection state determination means for determining whether or not the connection is on the power or ground side when the connection is made, and a signal when one of the pins connected to the surface mount component is connected to the power or ground side. And a signal pattern setting means for setting a pattern so that the pattern can be pulled out from the inside of the component mounting pad.
品に接続されているピンの一方が電源または接地側に接
続されていないときに、信号パターンを部品搭載パッド
の外側から引出せるように設定する手段を含む請求項1
記載のプリント板配線設計装置。2. The signal pattern setting means sets a signal pattern from outside a component mounting pad when one of pins connected to a surface mount component is not connected to a power supply or a ground side. And means for performing
Printed circuit board wiring design device as described.
アの二つのピンについての配線処理が完了したか否かを
判定し、完了したときに配線処理完了通知を前記配線手
段に送出する手段を含む請求項1記載のプリント板配線
設計装置。3. The signal pattern setting means includes means for determining whether or not wiring processing for two pins of a wiring pin pair has been completed, and sending a wiring processing completion notification to the wiring means when the wiring processing has been completed. The printed wiring board design apparatus according to claim 1.
Priority Applications (1)
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---|---|---|---|
JP2229699A JP2985261B2 (en) | 1990-08-30 | 1990-08-30 | Printed circuit board wiring design equipment |
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Application Number | Priority Date | Filing Date | Title |
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JP2229699A JP2985261B2 (en) | 1990-08-30 | 1990-08-30 | Printed circuit board wiring design equipment |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04111075A JPH04111075A (en) | 1992-04-13 |
JP2985261B2 true JP2985261B2 (en) | 1999-11-29 |
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---|---|---|---|---|
JPH06180730A (en) * | 1992-12-14 | 1994-06-28 | Nec Corp | Circuit design supporting system |
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- 1990-08-30 JP JP2229699A patent/JP2985261B2/en not_active Expired - Fee Related
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JPH04111075A (en) | 1992-04-13 |
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