JP2835770B2 - 動画像符号化制御方式 - Google Patents
動画像符号化制御方式Info
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- JP2835770B2 JP2835770B2 JP9632690A JP9632690A JP2835770B2 JP 2835770 B2 JP2835770 B2 JP 2835770B2 JP 9632690 A JP9632690 A JP 9632690A JP 9632690 A JP9632690 A JP 9632690A JP 2835770 B2 JP2835770 B2 JP 2835770B2
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Description
【発明の詳細な説明】 〔概要〕 入力動画像信号を高能率符号化して記録する動画像符
号化制御方式に関し、 高能率符号化を行うと共に回路規模の縮小を図ること
を目的とし、 入力動画像信号の１画像を複数のブロックに分割して
ブロック対応に離散コサイン変換を行う離散コサイン変
換部と、該離散コサイン変換部からの変換係数に対して
フレーム内符号化又はフレーム間符号化を行う符号化部
と、該符号化部により符号化された動画像信号を記録す
る記録部と、前記符号化部に於けるフレーム内符号化と
フレーム間符号化との切替制御を行う制御部とを備え、
該制御部は、前記ブロック対応の変換係数の直流成分を
含む低周波成分側の一定数について、前記フレーム内信
号とフレーム間差分信号とについての比較を行って、前
記フレーム内符号化とフレーム間符号化との何れを選択
するかを判定して、前記符号化部を制御するように構成
した。
号化制御方式に関し、 高能率符号化を行うと共に回路規模の縮小を図ること
を目的とし、 入力動画像信号の１画像を複数のブロックに分割して
ブロック対応に離散コサイン変換を行う離散コサイン変
換部と、該離散コサイン変換部からの変換係数に対して
フレーム内符号化又はフレーム間符号化を行う符号化部
と、該符号化部により符号化された動画像信号を記録す
る記録部と、前記符号化部に於けるフレーム内符号化と
フレーム間符号化との切替制御を行う制御部とを備え、
該制御部は、前記ブロック対応の変換係数の直流成分を
含む低周波成分側の一定数について、前記フレーム内信
号とフレーム間差分信号とについての比較を行って、前
記フレーム内符号化とフレーム間符号化との何れを選択
するかを判定して、前記符号化部を制御するように構成
した。
本発明は、入力動画像信号を高能率符号化して記録す
る動画像符号化制御方式に関するものである。
る動画像符号化制御方式に関するものである。
動画像信号を符号化して磁気テープ，磁気ディスク，
光ディスク等の記録媒体に記録し、必要に応じて再生し
て表示するシステムに於いては、既に各種の符号化方式
が提案されており、例えば、動画像信号の１画面の複数
のブロックに分割し、ブロック対応に離散コサイン変換
を施し、且つフレーム内符号化又はフレーム間符号化を
変換係数領域で行う符号化方式が知られており、記録情
報量を削減することにより、大量の動画像信号を記録で
きるようにしている。このようなシステムに於いては、
符号化処理の為の回路規模を小さくすることが要望され
ている。
光ディスク等の記録媒体に記録し、必要に応じて再生し
て表示するシステムに於いては、既に各種の符号化方式
が提案されており、例えば、動画像信号の１画面の複数
のブロックに分割し、ブロック対応に離散コサイン変換
を施し、且つフレーム内符号化又はフレーム間符号化を
変換係数領域で行う符号化方式が知られており、記録情
報量を削減することにより、大量の動画像信号を記録で
きるようにしている。このようなシステムに於いては、
符号化処理の為の回路規模を小さくすることが要望され
ている。
第６図は従来例のブロック図であり、51は離散コサイ
ン変換器（DCT）、52,60,70,71は加算器、53はDCT係数
の直流分のフレーム間差分を求める直流分差回路、54は
フレーム内符号化とフレーム間符号化との何れの符号化
を行うかを判断して制御する制御部、55は量子化器
（Ｑ）、56はハフマン符号等による可変長符号復号回路
（VLC）、57は磁気ディスク装置等の記録装置、58は逆
量子化器（）、59は直流分差回路53の逆の処理を行う
直流分和回路、61とフレームメモリ（FM）、62は逆離散
コサイン変換器（IDCT）、63は表示装置、64〜69は遅延
回路（DL）、72,73は切替回路である。
ン変換器（DCT）、52,60,70,71は加算器、53はDCT係数
の直流分のフレーム間差分を求める直流分差回路、54は
フレーム内符号化とフレーム間符号化との何れの符号化
を行うかを判断して制御する制御部、55は量子化器
（Ｑ）、56はハフマン符号等による可変長符号復号回路
（VLC）、57は磁気ディスク装置等の記録装置、58は逆
量子化器（）、59は直流分差回路53の逆の処理を行う
直流分和回路、61とフレームメモリ（FM）、62は逆離散
コサイン変換器（IDCT）、63は表示装置、64〜69は遅延
回路（DL）、72,73は切替回路である。
入力動画像信号は、離散コサイン変換器51により１画
像が例えば８×８画素のブロックに分割されて、ブロッ
ク対応に離散コサイン変換が施され、変換されたDCT係
数は加算器52,70に加えられる。離散コサイン変換は、 但し、 i,j＝0,1,2,・・・,N−１ u,v＝0,1,2,・・・,N−１ で表される処理により、画素領域のｆ（u,v）を変換す
ると、Ｆ（i,j）は、i,jの位置による周波数成分を表す
ものとなる。このi,jの値が小さい程、低周波成分を表
し、従って、i,j＝０のＦ（0,0）は直流成分を示す。通
常の画像信号に離散コサイン変換を施すと、DCT係数は
低周波成分に集中し、i,jの値が大きい高周波成分の係
数値は０となる場合が多くなる。
像が例えば８×８画素のブロックに分割されて、ブロッ
ク対応に離散コサイン変換が施され、変換されたDCT係
数は加算器52,70に加えられる。離散コサイン変換は、 但し、 i,j＝0,1,2,・・・,N−１ u,v＝0,1,2,・・・,N−１ で表される処理により、画素領域のｆ（u,v）を変換す
ると、Ｆ（i,j）は、i,jの位置による周波数成分を表す
ものとなる。このi,jの値が小さい程、低周波成分を表
し、従って、i,j＝０のＦ（0,0）は直流成分を示す。通
常の画像信号に離散コサイン変換を施すと、DCT係数は
低周波成分に集中し、i,jの値が大きい高周波成分の係
数値は０となる場合が多くなる。
又制御部54により切替回路72,73が制御され、図示状
態の時にフレーム間符号化、反対側に切替えられた時に
フレーム内符号化が行われるものである。又直流分差回
路53に於いては、遅延回路64が１フレーム分の遅延時間
を有し、DCT係数の直流分について差分を求めることに
より、量子化器55をフレーム内符号化とフレーム間符号
化とに於いて共用できるようにするものである。又直流
分和回路59に於いては、遅延回路69が１フレーム分の遅
延時間を有し、フレーム内符号化の場合に於いてのみ、
逆量子化器58により逆量子化されたDCT係数の直流分の
フレーム間の加算が行われ、フレーム間符号化の場合は
逆量子化器58から得られたDCT係数はそのまま出力され
るものである。
態の時にフレーム間符号化、反対側に切替えられた時に
フレーム内符号化が行われるものである。又直流分差回
路53に於いては、遅延回路64が１フレーム分の遅延時間
を有し、DCT係数の直流分について差分を求めることに
より、量子化器55をフレーム内符号化とフレーム間符号
化とに於いて共用できるようにするものである。又直流
分和回路59に於いては、遅延回路69が１フレーム分の遅
延時間を有し、フレーム内符号化の場合に於いてのみ、
逆量子化器58により逆量子化されたDCT係数の直流分の
フレーム間の加算が行われ、フレーム間符号化の場合は
逆量子化器58から得られたDCT係数はそのまま出力され
るものである。
従って、切替回路72,73が図示状態の時、加算器52に
よりDCT係数のフレーム間差分が求められ、量子化器55
により量子化され、可変長符号復号回路56により可変長
符号化され、記録装置57に加えられて記録される。又量
子化器55により量子化されたDCT係数は、逆量子化器58
により逆量子化され、加算器60により前フレームのDCT
係数と加算されて、現フレームのDCT係数としてフレー
ムメモリ61に加えられる。
よりDCT係数のフレーム間差分が求められ、量子化器55
により量子化され、可変長符号復号回路56により可変長
符号化され、記録装置57に加えられて記録される。又量
子化器55により量子化されたDCT係数は、逆量子化器58
により逆量子化され、加算器60により前フレームのDCT
係数と加算されて、現フレームのDCT係数としてフレー
ムメモリ61に加えられる。
又制御部54により切替回路72,73が切替えられると、
直流分差回路53を介したDCT係数が量子化器55に加えら
れて量子化され、可変長符号復号回路56により可変長符
号化され、記録装置57に加えられて記録される。
直流分差回路53を介したDCT係数が量子化器55に加えら
れて量子化され、可変長符号復号回路56により可変長符
号化され、記録装置57に加えられて記録される。
又記録装置57から再生して表示装置63に動画像を表示
させる場合、記録装置57から読出された信号は、可変長
符号復号回路56により可変長符号信号が復号され、逆量
化器58により逆量子化されてDCT係数となり、フレーム
内符号化信号の場合は、DCT係数の直流分が直流分和回
路59により前フレームの直流分と加算器71により加算さ
れ、又フレーム間符号化信号の場合は、直流分和回路59
は逆量子化信号をそのまま通過させ、フレームメモリ61
に蓄積されている前フレームのDCT係数と加算器60によ
り加算され、逆離散コサイン変換器62により逆離散コサ
イン変換されて、元の動画像信号となり、表示装置63に
加えられて表示される。
させる場合、記録装置57から読出された信号は、可変長
符号復号回路56により可変長符号信号が復号され、逆量
化器58により逆量子化されてDCT係数となり、フレーム
内符号化信号の場合は、DCT係数の直流分が直流分和回
路59により前フレームの直流分と加算器71により加算さ
れ、又フレーム間符号化信号の場合は、直流分和回路59
は逆量子化信号をそのまま通過させ、フレームメモリ61
に蓄積されている前フレームのDCT係数と加算器60によ
り加算され、逆離散コサイン変換器62により逆離散コサ
イン変換されて、元の動画像信号となり、表示装置63に
加えられて表示される。
又制御部54は、加算器52からのDCT係数のフレーム間
差分信号と、DCT係数のフレーム内信号とを比較して、
情報量の少ない方を判定して、フレーム間符号化を行わ
せるか又はフレーム内符号化を行わせるかを制御するも
のである。このような判定制御が行われる間、フレーム
間符号化又はフレーム内符号化を行う為のDCT係数を遅
延させる必要があり、その為に遅延回路65〜68が設けら
れている。
差分信号と、DCT係数のフレーム内信号とを比較して、
情報量の少ない方を判定して、フレーム間符号化を行わ
せるか又はフレーム内符号化を行わせるかを制御するも
のである。このような判定制御が行われる間、フレーム
間符号化又はフレーム内符号化を行う為のDCT係数を遅
延させる必要があり、その為に遅延回路65〜68が設けら
れている。
第７図は従来例のフローチャートであり、制御部54に
於ける判定について示すものである。加算器52の出力の
DCT係数のフレーム間差分信号X1と直流分回路53の出力
のDCT係数のフレーム内信号X2とについて、それぞれ１
ブロックをａ×ａ画素とし、１ブロックのDCT係数の
フレーム間差分信号X1の累算値Ｋと、フレーム内信号X2
の累算値Ｌとについて、Ｋ＝0,L＝０とし、X1（Ｉ）,
X2（Ｉ）とした時のＩ＝１とし、Ｋ＝Ｋ＋ABS（X1
（Ｉ））及びＬ＝Ｌ＋ABS（X2（Ｉ））の加算処理を行
う。なお、ABSは絶対値を示す。
於ける判定について示すものである。加算器52の出力の
DCT係数のフレーム間差分信号X1と直流分回路53の出力
のDCT係数のフレーム内信号X2とについて、それぞれ１
ブロックをａ×ａ画素とし、１ブロックのDCT係数の
フレーム間差分信号X1の累算値Ｋと、フレーム内信号X2
の累算値Ｌとについて、Ｋ＝0,L＝０とし、X1（Ｉ）,
X2（Ｉ）とした時のＩ＝１とし、Ｋ＝Ｋ＋ABS（X1
（Ｉ））及びＬ＝Ｌ＋ABS（X2（Ｉ））の加算処理を行
う。なお、ABSは絶対値を示す。
次に、Ｉ＝Ｉ＋１とし、Ｉ＞ａ×ａか否か判定し
、Ｉ＞ａ×ａでない時はステップに移行し、Ｉ＞ａ
×ａの時はステップに移行する。即ち、ａ×ａ画素か
らなる１ブロックのDCT係数のフレーム間差分信号X1と
フレーム内信号X2とのそれぞれ絶対値の累算を行うもの
である。
、Ｉ＞ａ×ａでない時はステップに移行し、Ｉ＞ａ
×ａの時はステップに移行する。即ち、ａ×ａ画素か
らなる１ブロックのDCT係数のフレーム間差分信号X1と
フレーム内信号X2とのそれぞれ絶対値の累算を行うもの
である。
次に累算値K,Lについて比較し、Ｋ≧Ｌの時はフレ
ーム間符号化、Ｋ≧Ｌでない時はフレーム内符号化
を行うものである。
ーム間符号化、Ｋ≧Ｌでない時はフレーム内符号化
を行うものである。
前述のように、従来例に於いては、フレーム間符号化
とフレーム内符号化との判定の為に、制御部54於いて
は、１ブロックのａ×ａ個の係数のフレーム間差分信号
とフレーム内信号との総てを累算するものであり、その
累算処理及び比較処理が終了するまで、遅延回路65〜68
により各部のDCT係数を遅延させる必要がある。
とフレーム内符号化との判定の為に、制御部54於いて
は、１ブロックのａ×ａ個の係数のフレーム間差分信号
とフレーム内信号との総てを累算するものであり、その
累算処理及び比較処理が終了するまで、遅延回路65〜68
により各部のDCT係数を遅延させる必要がある。
従って、１ブロックの画素数を多くするに伴って遅延
回路65〜68の規模が大きくなり、回路規模を縮小して集
積回路化を容易とすることが困難となる。
回路65〜68の規模が大きくなり、回路規模を縮小して集
積回路化を容易とすることが困難となる。
本発明は、高能率符号化を行うと共に回路規模の縮小
を図ることを目的とするものである。
を図ることを目的とするものである。
本発明の動画像符号化制御方式は、動画像信号を離散
コサイン変換した後、フレーム内符号化を行うかフレー
ム間符号化を行うかを判定して制御するものであり、第
１図を参照して説明する。
コサイン変換した後、フレーム内符号化を行うかフレー
ム間符号化を行うかを判定して制御するものであり、第
１図を参照して説明する。
入力動画像信号の１画面を複数のブロックに分割し、
各ブロック対応に離散コサイン変換を行う離散コサイン
変換部１と、該離散コサイン変換部１からの変換係数に
対してフレーム内符号化又はフレーム間符号化を行う符
号化部２と、この符号化部２により符号化された動画像
信号を記録する磁気ディスク装置等からなる記録部３
と、符号化部２に於けるフレーム内符号化とフレーム間
符号化との切替制御を行う制御部４とを備え、この制御
部４は、ブロック対応の変換係数の直流成分を含む低周
波成分側の一定数について、フレーム内信号と、該フレ
ーム内信号と同一数の前記フレーム間差分信号とについ
て比較を行って、前記フレーム内符号化を行うか又はフ
レーム間符号化を行うかを判定して、符号化部２を制御
するものである。
各ブロック対応に離散コサイン変換を行う離散コサイン
変換部１と、該離散コサイン変換部１からの変換係数に
対してフレーム内符号化又はフレーム間符号化を行う符
号化部２と、この符号化部２により符号化された動画像
信号を記録する磁気ディスク装置等からなる記録部３
と、符号化部２に於けるフレーム内符号化とフレーム間
符号化との切替制御を行う制御部４とを備え、この制御
部４は、ブロック対応の変換係数の直流成分を含む低周
波成分側の一定数について、フレーム内信号と、該フレ
ーム内信号と同一数の前記フレーム間差分信号とについ
て比較を行って、前記フレーム内符号化を行うか又はフ
レーム間符号化を行うかを判定して、符号化部２を制御
するものである。
離散コサイン変換部１は、入力動画像信号の１の画面
を例えば８×８画素単位のブロックに分割して、離散コ
サイン変換を施すものであり、制御部４は、変換係数の
フレーム間差分信号とフレーム内信号とを用いてフレー
ム間符号化を行うかフレーム内符号化を行うかを判定す
るものであり、その場合に、フレーム間差分信号の絶対
値累算とフレーム内信号の絶対値累算との累算数を、１
ブロックを構成する画素数より少ない一定数とするもの
である。例えば、１ブロックが８×８画素の場合に、直
流成分を含む低周波成分側の32個の変換係数について累
算して比較するものである。それによって、累算回数が
少なくて済むから、制御部４に於いて判定結果が得られ
るまでの時間を短縮し、遅延回路の遅延時間を短縮する
ことが可能となり、回路規模の縮小を図ることができ
る。
を例えば８×８画素単位のブロックに分割して、離散コ
サイン変換を施すものであり、制御部４は、変換係数の
フレーム間差分信号とフレーム内信号とを用いてフレー
ム間符号化を行うかフレーム内符号化を行うかを判定す
るものであり、その場合に、フレーム間差分信号の絶対
値累算とフレーム内信号の絶対値累算との累算数を、１
ブロックを構成する画素数より少ない一定数とするもの
である。例えば、１ブロックが８×８画素の場合に、直
流成分を含む低周波成分側の32個の変換係数について累
算して比較するものである。それによって、累算回数が
少なくて済むから、制御部４に於いて判定結果が得られ
るまでの時間を短縮し、遅延回路の遅延時間を短縮する
ことが可能となり、回路規模の縮小を図ることができ
る。
以下図面を参照して本発明の実施例について詳細に説
明する。
明する。
第２図は本発明の実施例のブロック図であり、11は離
散コサイン変換器（DCT）、12は加算器、13はDCT係数の
直流分のフレーム間差分を求める直流分差回路、14はフ
レーム内符号化とフレーム間符号化との何れの符号化を
行うかを判断して制御する制御部、15はDCT係数を量子
化する量子化器（Ｑ）、16はハフマン符号等による可変
長符号復号回路（VLC）、17は磁気ディスク装置等の記
録装置、18は逆量子化器（）19は直流分差回路53の逆
の処理を行う直流分和回路、20,30,31は加算器、21とフ
レームメモリ（FM）、22は逆離散コサイン変換器（IDC
T）、23は陰極線管（CRT）等や液晶パネル等を用いた表
示装置、24〜29は遅延回路（DL）、32,33は切替回路、3
4は累算部である。
散コサイン変換器（DCT）、12は加算器、13はDCT係数の
直流分のフレーム間差分を求める直流分差回路、14はフ
レーム内符号化とフレーム間符号化との何れの符号化を
行うかを判断して制御する制御部、15はDCT係数を量子
化する量子化器（Ｑ）、16はハフマン符号等による可変
長符号復号回路（VLC）、17は磁気ディスク装置等の記
録装置、18は逆量子化器（）19は直流分差回路53の逆
の処理を行う直流分和回路、20,30,31は加算器、21とフ
レームメモリ（FM）、22は逆離散コサイン変換器（IDC
T）、23は陰極線管（CRT）等や液晶パネル等を用いた表
示装置、24〜29は遅延回路（DL）、32,33は切替回路、3
4は累算部である。
入力動画像信号を離散コサイン変換器11により離散コ
サイン変換し、フレーム内符号化又はフレーム間符号化
を行い、可変長符号復号回路16により可変長符号化し、
記録装置17に加てえ記録する動作及び記録装置17から読
出した符号化動画像信号を復号し逆離散コサイン変換器
22により逆離散コサイン変換して表示装置23に加え、動
画像を表示させる動作については、従来例と同様であ
り、重複する説明は省略する。
サイン変換し、フレーム内符号化又はフレーム間符号化
を行い、可変長符号復号回路16により可変長符号化し、
記録装置17に加てえ記録する動作及び記録装置17から読
出した符号化動画像信号を復号し逆離散コサイン変換器
22により逆離散コサイン変換して表示装置23に加え、動
画像を表示させる動作については、従来例と同様であ
り、重複する説明は省略する。
本発明の実施例に於いては、制御部14に於けるDCT係
数のフレーム間差分信号とフレーム内信号とを、累算部
34に於いて１ブロックについて累算する時に、１ブロッ
クの画素数より少ない個数について累算するものであ
り、例えば、離散コサイン変換器11からブロック対応及
び画素対応の信号が制御部14に加えられ、DCT係数の絶
対値累算の個数が制御される。又離散コサイン変換器11
の前段に、ブロックキャン回路を設けて、二次元配列の
動画像信号を一次元配列に変換することも可能である。
数のフレーム間差分信号とフレーム内信号とを、累算部
34に於いて１ブロックについて累算する時に、１ブロッ
クの画素数より少ない個数について累算するものであ
り、例えば、離散コサイン変換器11からブロック対応及
び画素対応の信号が制御部14に加えられ、DCT係数の絶
対値累算の個数が制御される。又離散コサイン変換器11
の前段に、ブロックキャン回路を設けて、二次元配列の
動画像信号を一次元配列に変換することも可能である。
第３図は制御部の要部ブロック図であり、41はカウン
タ、42,43は加算器、44,45は遅延回路（DL）、46は比較
回路、47はフリップフロップ、48,49は絶対値回路であ
る。遅延回路44,45は１画素分の遅延時間を有し、加算
器42,43とにより累算部34を構成している。
タ、42,43は加算器、44,45は遅延回路（DL）、46は比較
回路、47はフリップフロップ、48,49は絶対値回路であ
る。遅延回路44,45は１画素分の遅延時間を有し、加算
器42,43とにより累算部34を構成している。
又カウンタ41は、１ブロックをａ×ａ画素構成とする
と、例えば、離散コサイン変換器11に於ける画素対応の
クロック信号PSをカウントアップし、（ａ×ａ）/2のカ
ウント内容ｂとなると、遅延回路44,45にリセット信
号、フリップフロップ47のクロック端子CKにクロック信
号をそれぞれ加え、ａ×ａのカウント内容となると、カ
ウント内容をクリアする構成とすることができる。
と、例えば、離散コサイン変換器11に於ける画素対応の
クロック信号PSをカウントアップし、（ａ×ａ）/2のカ
ウント内容ｂとなると、遅延回路44,45にリセット信
号、フリップフロップ47のクロック端子CKにクロック信
号をそれぞれ加え、ａ×ａのカウント内容となると、カ
ウント内容をクリアする構成とすることができる。
従って、加算器12からのDCT係数のフレーム間差分信
号X1と、直流分差回路13からのDCT係数のフレーム内信
号X2とが、それぞれ絶対値回路48,49を介して加算器42,
43に加えられて、１ブロックについては、（ａ×ａ）/2
個のDCT係数値の絶対値累算が行われ、比較回路46に於
いて大小比較が行われ、比較結果は、累算処理が終了し
たタイミングに於いてフリップフロップ47にラッチさ
れ、Ｑ端子から判定出力信号として切替回路32,33及び
直流分和回路19に加えられ、フレーム間符号化とフレー
ム内符号化との切替制御が行われる。
号X1と、直流分差回路13からのDCT係数のフレーム内信
号X2とが、それぞれ絶対値回路48,49を介して加算器42,
43に加えられて、１ブロックについては、（ａ×ａ）/2
個のDCT係数値の絶対値累算が行われ、比較回路46に於
いて大小比較が行われ、比較結果は、累算処理が終了し
たタイミングに於いてフリップフロップ47にラッチさ
れ、Ｑ端子から判定出力信号として切替回路32,33及び
直流分和回路19に加えられ、フレーム間符号化とフレー
ム内符号化との切替制御が行われる。
第４図は本発明の実施例のフローチャートであり、累
算個数ｂ（ｂ＜（ａ×ａ））を設定し、フレーム間差分
信号X1（ｂ），フレーム内信号X2（ｂ）とし（１）、１
ブロックのDCT係数のフレーム間差分信号X1の累算値Ｋ
と、フレーム内信号X2の累算値Ｌとについて、Ｋ＝0,L
＝０とし（２）、X1（Ｉ）,X2（Ｉ）とした時のＩ＝１
とし（３）、Ｋ＝Ｋ＋ABS（X1（Ｉ））及びＬ＝Ｌ＋ABS
（X2（Ｉ））の加算処理を行う（４）。なお、ABSは絶
対値を示す。
算個数ｂ（ｂ＜（ａ×ａ））を設定し、フレーム間差分
信号X1（ｂ），フレーム内信号X2（ｂ）とし（１）、１
ブロックのDCT係数のフレーム間差分信号X1の累算値Ｋ
と、フレーム内信号X2の累算値Ｌとについて、Ｋ＝0,L
＝０とし（２）、X1（Ｉ）,X2（Ｉ）とした時のＩ＝１
とし（３）、Ｋ＝Ｋ＋ABS（X1（Ｉ））及びＬ＝Ｌ＋ABS
（X2（Ｉ））の加算処理を行う（４）。なお、ABSは絶
対値を示す。
次に、Ｉ＝Ｉ＋１とし（５）、Ｉ＞ｂか否か判定し
（６）、Ｉ＞ｂでない時はステップ（４）に移行し、Ｉ
＞ｂの時はステップ（７）に移行する。即ち、ａ×ａ画
素からなる１ブロックのDCT係数の中のｂ個のDCT係数に
ついて、フレーム間差分信号X1とフレーム内信号X2との
それぞれ絶対値の累算を行うものである。
（６）、Ｉ＞ｂでない時はステップ（４）に移行し、Ｉ
＞ｂの時はステップ（７）に移行する。即ち、ａ×ａ画
素からなる１ブロックのDCT係数の中のｂ個のDCT係数に
ついて、フレーム間差分信号X1とフレーム内信号X2との
それぞれ絶対値の累算を行うものである。
次に累算値K,Lについて比較し（７）、Ｋ≧Ｌの時は
フレーム間符号化（８）、Ｋ≧Ｌでない時はフレーム内
符号化（９）を行うものである。
フレーム間符号化（８）、Ｋ≧Ｌでない時はフレーム内
符号化（９）を行うものである。
１画面の画素数ａ×ａを８×８とした場合、第５図に
示すように、DCT係数Ｆ（i,j）のＦ（0,0）は直流成分
の値を示し、Ｆ（7,7）は最高周波数成分の値を示すこ
とになる。前述のように、通常の動画像信号に離散コサ
イン変換を施した時には、DCT係数は低周波成分に集中
することにより、従って、高周波成分について累算しな
くても、判定誤りを生じる可能性が極めて低くなる。
示すように、DCT係数Ｆ（i,j）のＦ（0,0）は直流成分
の値を示し、Ｆ（7,7）は最高周波数成分の値を示すこ
とになる。前述のように、通常の動画像信号に離散コサ
イン変換を施した時には、DCT係数は低周波成分に集中
することにより、従って、高周波成分について累算しな
くても、判定誤りを生じる可能性が極めて低くなる。
従って、本発明に於いては、例えば、１ブロックを構
成する画素数が前述のように８×８＝64個とすると、そ
の1/2の32個について直流成分を含む低周波成分側を累
算して比較するものである。この場合、直流成分を含む
低周波成分側を累算する為に、実線で示すジズザグスキ
ャンを行い、例えば、Ｆ（0,0）からＦ（4,3）までの32
個のDCT係数について絶対値累算を行うことになる。な
お、Ｆ（7,0）までの28個のDCT係数についての絶対値累
算を行うことも可能であり、又Ｆ（0,7）までの36個のD
CT係数についての絶対値累算を行うことも可能である。
通常の動画像信号の場合には、１ブロックの画素数の1/
2の個数のDCT係数の絶対値累算で充分である。
成する画素数が前述のように８×８＝64個とすると、そ
の1/2の32個について直流成分を含む低周波成分側を累
算して比較するものである。この場合、直流成分を含む
低周波成分側を累算する為に、実線で示すジズザグスキ
ャンを行い、例えば、Ｆ（0,0）からＦ（4,3）までの32
個のDCT係数について絶対値累算を行うことになる。な
お、Ｆ（7,0）までの28個のDCT係数についての絶対値累
算を行うことも可能であり、又Ｆ（0,7）までの36個のD
CT係数についての絶対値累算を行うことも可能である。
通常の動画像信号の場合には、１ブロックの画素数の1/
2の個数のDCT係数の絶対値累算で充分である。
又一点鎖線で示すように、横方向スキャンによりDCT
係数について絶対値累算を行うこともできる。又点線で
示すように、縦方向スキャンによりDCT係数について絶
対値累算を行うこともできる。何れの場合も１ブロック
を構成する画素数のほぼ1/2の個数のDCT係数について絶
対値累算を行うことになる。
係数について絶対値累算を行うこともできる。又点線で
示すように、縦方向スキャンによりDCT係数について絶
対値累算を行うこともできる。何れの場合も１ブロック
を構成する画素数のほぼ1/2の個数のDCT係数について絶
対値累算を行うことになる。
前述のように、制御部14の累算部34に於けるDCT係数
の累算個数が、従来例に比較してほぼ1/2となるから、
遅延回路25〜28の遅延時間も従来例に比較して1/2で済
むことになり、回路構成を縮小することができる。
の累算個数が、従来例に比較してほぼ1/2となるから、
遅延回路25〜28の遅延時間も従来例に比較して1/2で済
むことになり、回路構成を縮小することができる。
以上説明したように、本発明は、離散コサイン変換部
１により入力動画像信号の１画円を複数ブロックに分割
して離散コサイン変換を施し、符号化部２により符号化
して記録部３に記録し、制御部４により、ブロック対応
の変換係数の直流成分を含む低周波成分側の一定数につ
いて、フレーム内信号とフレーム間差分信号とについて
の比較を、絶対値累算等により行い、フレーム内符号化
とフレーム間符号化との何れの符号化の場合に情報量が
少なくなるかを判定して、符号化部２を制御するもので
あり、１ブロックを構成する画素数より少ない変換係数
の個数について判定するものであるから、遅延回路の遅
延時間を従来例に比較して1/2程度に短くすることが可
能となり、遅延回路の回路規模を縮小することができ
る。それによって、集積回路化も容易となる利点があ
る。
１により入力動画像信号の１画円を複数ブロックに分割
して離散コサイン変換を施し、符号化部２により符号化
して記録部３に記録し、制御部４により、ブロック対応
の変換係数の直流成分を含む低周波成分側の一定数につ
いて、フレーム内信号とフレーム間差分信号とについて
の比較を、絶対値累算等により行い、フレーム内符号化
とフレーム間符号化との何れの符号化の場合に情報量が
少なくなるかを判定して、符号化部２を制御するもので
あり、１ブロックを構成する画素数より少ない変換係数
の個数について判定するものであるから、遅延回路の遅
延時間を従来例に比較して1/2程度に短くすることが可
能となり、遅延回路の回路規模を縮小することができ
る。それによって、集積回路化も容易となる利点があ
る。
第１図は本発明の原理説明図、第２図は本発明の実施例
のブロック図、第３図は制御部の要部ブロック図、第４
図は本発明の実施例のフローチャート、第５図はスキャ
ン経路の説明図、第６図は従来例のブロック図、第７図
は従来例のフローチャートである。 １は離散コサイン変換部、２は符号化部、３は記録部、
４は制御部である。
のブロック図、第３図は制御部の要部ブロック図、第４
図は本発明の実施例のフローチャート、第５図はスキャ
ン経路の説明図、第６図は従来例のブロック図、第７図
は従来例のフローチャートである。 １は離散コサイン変換部、２は符号化部、３は記録部、
４は制御部である。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭63−232691（ＪＰ，Ａ) 特開 平３−124124（ＪＰ，Ａ) 特開 平３−124180（ＪＰ，Ａ) 1989年電子情報通信学会秋季全国大会 講演論文集，Ｄ−52 (58)調査した分野(Int.Cl.6，ＤＢ名) H04N 7/24 - 7/68
Claims (1)
- 【請求項１】入力動画像信号の１画面を複数のブロック
に分割してブロック対応に離散コサイン変換を行う離散
コサイン変換部（１）と、該離散コサイン変換部（１）
からの変換係数に対してフレーム内符号化又はフレーム
間符号化を行う符号化部（２）と、該符号化部（２）に
より符号化された動画像信号を記録する記録部（３）
と、前記符号化部（２）に於けるフレーム内符号化とフ
レーム間符号化との切替制御を行う制御部（４）とを備
え、 該制御部（４）は、前記ブロック対応の変換係数の直流
成分を含む低周波成分側の一定数の前記フレーム内信号
と、該フレーム内信号と同一数の前記フレーム間差分信
号とについて比較を行って、前記フレーム内付号化とフ
レーム間符号化との何れを選択するかを判定して、前記
符号化部（２）を制御する ことを特徴とする動画像符号化制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9632690A JP2835770B2 (ja) | 1990-04-13 | 1990-04-13 | 動画像符号化制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9632690A JP2835770B2 (ja) | 1990-04-13 | 1990-04-13 | 動画像符号化制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03295377A JPH03295377A (ja) | 1991-12-26 |
| JP2835770B2 true JP2835770B2 (ja) | 1998-12-14 |
Family
ID=14161886
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9632690A Expired - Fee Related JP2835770B2 (ja) | 1990-04-13 | 1990-04-13 | 動画像符号化制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2835770B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0454730A (ja) * | 1990-06-22 | 1992-02-21 | Matsushita Electric Ind Co Ltd | 符号化装置 |
| JPH05236466A (ja) * | 1992-02-25 | 1993-09-10 | Nec Corp | 動き補償フレーム間予測画像符号化装置及び方法 |
-
1990
- 1990-04-13 JP JP9632690A patent/JP2835770B2/ja not_active Expired - Fee Related
Non-Patent Citations (1)
| Title |
|---|
| １９８９年電子情報通信学会秋季全国大会講演論文集，Ｄ−５２ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03295377A (ja) | 1991-12-26 |
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|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |