JP2819911B2 - ディジタル信号処理回路 - Google Patents
ディジタル信号処理回路Info
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- JP2819911B2 JP2819911B2 JP4008227A JP822792A JP2819911B2 JP 2819911 B2 JP2819911 B2 JP 2819911B2 JP 4008227 A JP4008227 A JP 4008227A JP 822792 A JP822792 A JP 822792A JP 2819911 B2 JP2819911 B2 JP 2819911B2
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Description
【０００１】
【産業上の利用分野】本発明は、ディジタルデータを記
録再生するディジタル信号処理回路に関するものであ
る。
録再生するディジタル信号処理回路に関するものであ
る。
【０００２】
【従来の技術】ディジタル信号記録再生装置において、
１トラック分の記録信号の構成は、再生時にヘッドのト
ラックパターン上の位置を検出するためのＩＴＩ領域
と、複数の信号領域とにより構成されている。前記１ト
ラックの記録信号の一例として、ＩＴＩ領域と、テープ
の走行方向の位置などを示す情報用のＩｎｄｅｘ領域
と、音声信号用Ａｕｄｉｏ領域と、映像信号用Ｖｉｄｅ
ｏ領域とから構成される記録信号を考える。各領域は、
１トラック内に複数ヵ所に分かれていてもよい。
１トラック分の記録信号の構成は、再生時にヘッドのト
ラックパターン上の位置を検出するためのＩＴＩ領域
と、複数の信号領域とにより構成されている。前記１ト
ラックの記録信号の一例として、ＩＴＩ領域と、テープ
の走行方向の位置などを示す情報用のＩｎｄｅｘ領域
と、音声信号用Ａｕｄｉｏ領域と、映像信号用Ｖｉｄｅ
ｏ領域とから構成される記録信号を考える。各領域は、
１トラック内に複数ヵ所に分かれていてもよい。
【０００３】図４に従来例のトラックパターンを示す。
ここで、前記ＩＴＩ領域は、ブロック化したディジタル
データの始まりを示す同期パターンと、ブロックの順番
を示すＩＤとＩＤの誤りを検出するＩＤパリティとを変
調したパターンとから成る同期ブロック単位で構成され
る。又各信号領域間にはギャップが設けられている。図
５にＩＴＩの同期ブロックの構成を示す。図５（ａ）
は、変調前の同期ブロックの構成であり、同期ブロック
の順番を示すＩＤとＩＤの誤りを検出するＩＤパリティ
とから構成される。パターン（ａ）を変調し、同期パタ
ーンを付加した同期ブロックの構成を図５（ｂ）に示
す。
ここで、前記ＩＴＩ領域は、ブロック化したディジタル
データの始まりを示す同期パターンと、ブロックの順番
を示すＩＤとＩＤの誤りを検出するＩＤパリティとを変
調したパターンとから成る同期ブロック単位で構成され
る。又各信号領域間にはギャップが設けられている。図
５にＩＴＩの同期ブロックの構成を示す。図５（ａ）
は、変調前の同期ブロックの構成であり、同期ブロック
の順番を示すＩＤとＩＤの誤りを検出するＩＤパリティ
とから構成される。パターン（ａ）を変調し、同期パタ
ーンを付加した同期ブロックの構成を図５（ｂ）に示
す。
【０００４】記録されたテープのＩｎｄｅｘ領域、Ａｕ
ｄｉｏ領域、Ｖｉｄｅｏ領域の何れか又は組合せの領域
のみを記録し直す再記録を行なう場合、ＩＴＩ領域の同
期ブロックを検出し、同期ブロックのＩＤによりヘッド
のテープに対する位置を認識することにより、再記録の
タイミングを決定することができる。
ｄｉｏ領域、Ｖｉｄｅｏ領域の何れか又は組合せの領域
のみを記録し直す再記録を行なう場合、ＩＴＩ領域の同
期ブロックを検出し、同期ブロックのＩＤによりヘッド
のテープに対する位置を認識することにより、再記録の
タイミングを決定することができる。
【０００５】図６に従来例のブロック図を示す。６１は
再生ディジタル信号７１中のＩＴＩの同期ブロックを検
出し、同期ブロックのＩＤによりテープに対するヘッド
の位置を認識することにより、インサート用内部基準信
号７２を発生するインサート用内部基準信号発生回路で
ある。６２は、インサート用内部基準信号７２にしたが
って再記録タイミングを決定してインサート記録信号７
３を発生する記録信号発生回路である。
再生ディジタル信号７１中のＩＴＩの同期ブロックを検
出し、同期ブロックのＩＤによりテープに対するヘッド
の位置を認識することにより、インサート用内部基準信
号７２を発生するインサート用内部基準信号発生回路で
ある。６２は、インサート用内部基準信号７２にしたが
って再記録タイミングを決定してインサート記録信号７
３を発生する記録信号発生回路である。
【０００６】前記構成は、再生ディジタルデータ中のＩ
ＴＩ領域の同期ブロックの位置を検出することにより、
再記録タイミングを決定するため、非常に精度よく再記
録することができた。
ＴＩ領域の同期ブロックの位置を検出することにより、
再記録タイミングを決定するため、非常に精度よく再記
録することができた。
【０００７】しかしながら、ドロップアウトなどにより
１トラック内でＩＴＩ領域の同期ブロックが１つも検出
できなかった場合、再記録タイミングを決定することが
できない。
１トラック内でＩＴＩ領域の同期ブロックが１つも検出
できなかった場合、再記録タイミングを決定することが
できない。
【０００８】従来は、前記対策として、ＩＴＩ領域の同
期ブロックが検出できなかった場合、どのヘッドがテー
プ上をトレースしているかを示すヘッドスイッチ信号を
用いて再記録タイミングを決定していた。図６中のイン
サート用内部基準信号発生回路６１は、再生ディジタル
データ７１中にＩＴＩ領域の同期ブロックを検出できな
かった場合、ヘッドスイッチ信号７４により、インサー
ト用内部基準信号７２を発生する。
期ブロックが検出できなかった場合、どのヘッドがテー
プ上をトレースしているかを示すヘッドスイッチ信号を
用いて再記録タイミングを決定していた。図６中のイン
サート用内部基準信号発生回路６１は、再生ディジタル
データ７１中にＩＴＩ領域の同期ブロックを検出できな
かった場合、ヘッドスイッチ信号７４により、インサー
ト用内部基準信号７２を発生する。
【０００９】
【発明が解決しようとする課題】しかしながら、従来の
ディジタル信号処理回路では、ＩＴＩの同期ブロックが
検出できなかった場合のヘッドスイッチ信号による再記
録タイミングの決定には、ディジタル信号記録装置間の
互換におけるテープに対するトラックパターンのずれと
いう非常に大きな誤差が存在しており、再記録タイミン
グが信号領域間のギャップ以上にずれて、正常に再記録
できない危険性があった。
ディジタル信号処理回路では、ＩＴＩの同期ブロックが
検出できなかった場合のヘッドスイッチ信号による再記
録タイミングの決定には、ディジタル信号記録装置間の
互換におけるテープに対するトラックパターンのずれと
いう非常に大きな誤差が存在しており、再記録タイミン
グが信号領域間のギャップ以上にずれて、正常に再記録
できない危険性があった。
【００１０】
【課題を解決するための手段】上記課題を解決するため
に円筒状のシリンダ上に取り付けられたｎ（ｎは１以上
の整数）個のヘッドにより、テープ上の斜めのトラック
として、ブロック化したディジタルデータの始まりを示
す同期パターンを含む同期ブロック単位で構成されるＩ
ＴＩ領域と、１つ以上の信号領域とから構成される信号
を記録または再生するディジタル信号記録再生装置のデ
ィジタル信号処理回路であって、記録されたテープのＩ
ＴＩ領域を検出することにより、１つ以上の信号領域中
の１つ以上の領域を再記録する再記録手段として、記録
されたテープを再生した再生ディジタルデータ中のＩＴ
Ｉ領域の同期ブロックが検出された場合、ＩＴＩ領域の
同期ブロックの検出タイミングを基準として再記録のタ
イミングを作成してインサート用記録データを発生し、
かつ、どのヘッドがテープ上をトレースしているかを示
すヘッドスイッチ信号の変化点から再記録タイミングま
での時間を記憶し、ＩＴＩ領域が検出されなかった場
合、ヘッドスイッチ信号から同一ヘッドの１トレース前
の記憶時間後に、再記録のタイミングを作成してインサ
ート用記録データを発生するインサート手段により構成
される。
に円筒状のシリンダ上に取り付けられたｎ（ｎは１以上
の整数）個のヘッドにより、テープ上の斜めのトラック
として、ブロック化したディジタルデータの始まりを示
す同期パターンを含む同期ブロック単位で構成されるＩ
ＴＩ領域と、１つ以上の信号領域とから構成される信号
を記録または再生するディジタル信号記録再生装置のデ
ィジタル信号処理回路であって、記録されたテープのＩ
ＴＩ領域を検出することにより、１つ以上の信号領域中
の１つ以上の領域を再記録する再記録手段として、記録
されたテープを再生した再生ディジタルデータ中のＩＴ
Ｉ領域の同期ブロックが検出された場合、ＩＴＩ領域の
同期ブロックの検出タイミングを基準として再記録のタ
イミングを作成してインサート用記録データを発生し、
かつ、どのヘッドがテープ上をトレースしているかを示
すヘッドスイッチ信号の変化点から再記録タイミングま
での時間を記憶し、ＩＴＩ領域が検出されなかった場
合、ヘッドスイッチ信号から同一ヘッドの１トレース前
の記憶時間後に、再記録のタイミングを作成してインサ
ート用記録データを発生するインサート手段により構成
される。
【００１１】
【作用】本発明は上記した構成により、１トラック内で
ＩＴＩの同期ブロックが１つも検出できなかった場合で
も、同一ヘッドの１トレース前のヘッドスイッチ信号か
らの再記録タイミングを記憶しておき、現在のヘッドス
イッチ信号タイミングから記憶タイミングを用いて再記
録タイミングを決定することにより、ディジタル信号記
録再生装置間の互換におけるテープに対するトラックパ
ターンのずれという非常に大きな誤差の影響を受けなく
なり、ヘッドスイッチ信号のみで再記録タイミングを決
定するよりも、精度よく再記録することができる。
ＩＴＩの同期ブロックが１つも検出できなかった場合で
も、同一ヘッドの１トレース前のヘッドスイッチ信号か
らの再記録タイミングを記憶しておき、現在のヘッドス
イッチ信号タイミングから記憶タイミングを用いて再記
録タイミングを決定することにより、ディジタル信号記
録再生装置間の互換におけるテープに対するトラックパ
ターンのずれという非常に大きな誤差の影響を受けなく
なり、ヘッドスイッチ信号のみで再記録タイミングを決
定するよりも、精度よく再記録することができる。
【００１２】
【実施例】以下、本発明の一実施例について、図面を参
照しながら説明する。本発明のディジタル信号処理回路
は、１トラック分の記録信号の構成が再生時にヘッドの
トラックパターン上の位置を検出するためのＩＴＩ領域
と、複数の信号領域とにより構成されている場合に有効
である。前記１トラックの記録信号の一例として、従来
の技術で説明した記録信号と同一の記録信号を考える。
記録信号は、ＩＴＩ領域と、テープの走行方向の位置な
どを示す情報用のＩｎｄｅｘ領域と、音声信号用Ａｕｄ
ｉｏ領域と、映像信号用Ｖｉｄｅｏ領域とから構成され
る。各領域は、１トラック内に複数ヵ所に分かれていて
もよい。図４に１トラックの記録信号を示す。ここで、
前記ＩＴＩ領域は、ブロック化したディジタルデータの
始まりを示す同期パターンと、ブロックの順番を示すＩ
ＤとＩＤの誤りを検出するＩＤパリティとを変調したパ
ターンとから成る同期ブロック単位で構成される。又、
各信号領域間にはギャップが設けられている。図５にＩ
ＴＩの同期ブロックの構成を示す。図５（ａ）は、変調
前の同期ブロックの構成であり、同期ブロックの順番を
示すＩＤとＩＤの誤りを検出するＩＤパリティとから構
成される。前記パターン（ａ）を変調し、同期パターン
を付加した同期ブロックの構成を図５（ｂ）に示す。
照しながら説明する。本発明のディジタル信号処理回路
は、１トラック分の記録信号の構成が再生時にヘッドの
トラックパターン上の位置を検出するためのＩＴＩ領域
と、複数の信号領域とにより構成されている場合に有効
である。前記１トラックの記録信号の一例として、従来
の技術で説明した記録信号と同一の記録信号を考える。
記録信号は、ＩＴＩ領域と、テープの走行方向の位置な
どを示す情報用のＩｎｄｅｘ領域と、音声信号用Ａｕｄ
ｉｏ領域と、映像信号用Ｖｉｄｅｏ領域とから構成され
る。各領域は、１トラック内に複数ヵ所に分かれていて
もよい。図４に１トラックの記録信号を示す。ここで、
前記ＩＴＩ領域は、ブロック化したディジタルデータの
始まりを示す同期パターンと、ブロックの順番を示すＩ
ＤとＩＤの誤りを検出するＩＤパリティとを変調したパ
ターンとから成る同期ブロック単位で構成される。又、
各信号領域間にはギャップが設けられている。図５にＩ
ＴＩの同期ブロックの構成を示す。図５（ａ）は、変調
前の同期ブロックの構成であり、同期ブロックの順番を
示すＩＤとＩＤの誤りを検出するＩＤパリティとから構
成される。前記パターン（ａ）を変調し、同期パターン
を付加した同期ブロックの構成を図５（ｂ）に示す。
【００１３】記録されたテープのＩｎｄｅｘ領域、Ａｎ
ｄｉｏ領域、Ｖｉｄｅｏ領域の何れか又は組合せの領域
のみを記録し直す再記録を行なう場合、ＩＴＩの同期ブ
ロックを検出し、同期ブロックのＩＤを認識することに
より、再記録のタイミングを決定することができる。
ｄｉｏ領域、Ｖｉｄｅｏ領域の何れか又は組合せの領域
のみを記録し直す再記録を行なう場合、ＩＴＩの同期ブ
ロックを検出し、同期ブロックのＩＤを認識することに
より、再記録のタイミングを決定することができる。
【００１４】図１は本発明の一実施例のディジタル信号
処理回路のブロック図である。３１は再生ディジタル信
号４１中のＩＴＩの同期ブロックを検出し、同期ブロッ
クのＩＤによりテープに対するヘッドの位置を認識する
ことにより、インサート用内部基準信号４２を発生し、
ＩＴＩの同期ブロックが１つでも検出できれば１にセッ
トし、ｎ個のヘッドの内、どのヘッドがテープ上をトレ
ースしているかを示すヘッドスイッチ信号４３で０にリ
セットするマスク信号４４を出力するインサート用内部
基準信号発生回路である。３２は、ヘッドスイッチ信号
４３からインサート用内部基準信号４２が発生するまで
の時間を各々のヘッド毎に記憶し、記憶時間４５を出力
する記憶回路である。３３は、各ヘッド毎に、ヘッドス
イッチ信号４３から記憶時間４５後に、ＩＴＩ検出がで
きなかった場合のインサート用内部基準信号４６を発生
するインサート用内部基準信号発生回路である。３４
は、マスク信号４４が０の場合はインサート用内部基準
信号４６をそのまま出力信号４７として出力し、マスク
信号４４が１の場合はインサート用内部基準信号４６を
無効にして出力信号４７として出力するマスク回路であ
る。３６は、インサート用内部基準信号４２とマスク回
路３４の出力信号４７とのどちらかが発生すればその信
号をインサート用内部基準信号５０として出力する論理
和回路である。３７は、インサート用内部基準信号５０
にしたがって再記録タイミングを決定してインサート記
録信号５１を発生する記録信号発生回路である。
処理回路のブロック図である。３１は再生ディジタル信
号４１中のＩＴＩの同期ブロックを検出し、同期ブロッ
クのＩＤによりテープに対するヘッドの位置を認識する
ことにより、インサート用内部基準信号４２を発生し、
ＩＴＩの同期ブロックが１つでも検出できれば１にセッ
トし、ｎ個のヘッドの内、どのヘッドがテープ上をトレ
ースしているかを示すヘッドスイッチ信号４３で０にリ
セットするマスク信号４４を出力するインサート用内部
基準信号発生回路である。３２は、ヘッドスイッチ信号
４３からインサート用内部基準信号４２が発生するまで
の時間を各々のヘッド毎に記憶し、記憶時間４５を出力
する記憶回路である。３３は、各ヘッド毎に、ヘッドス
イッチ信号４３から記憶時間４５後に、ＩＴＩ検出がで
きなかった場合のインサート用内部基準信号４６を発生
するインサート用内部基準信号発生回路である。３４
は、マスク信号４４が０の場合はインサート用内部基準
信号４６をそのまま出力信号４７として出力し、マスク
信号４４が１の場合はインサート用内部基準信号４６を
無効にして出力信号４７として出力するマスク回路であ
る。３６は、インサート用内部基準信号４２とマスク回
路３４の出力信号４７とのどちらかが発生すればその信
号をインサート用内部基準信号５０として出力する論理
和回路である。３７は、インサート用内部基準信号５０
にしたがって再記録タイミングを決定してインサート記
録信号５１を発生する記録信号発生回路である。
【００１５】図２，図３にＡｕｄｉｏ領域のみの再記録
の場合の動作タイミングを示す。図２に示すように、Ｉ
ＴＩがインサート用内部基準信号発生回路３１で検出さ
れた場合、インサート用内部基準信号４２を発生する。
また、１トレース前に記憶回路３２に記憶されたヘッド
スイッチ信号４３からインサート用内部基準信号４２ま
での時間ｙと、ヘッドスイッチ信号４３とによりＩＴＩ
検出が抜けた場合のインサート用内部基準信号４６が発
生する。しかし、インサート用内部基準信号４６はマス
ク信号４４が１のためマスクされ、インサート用内部基
準信号４２が論理和３６の出力５０となる。また、記憶
回路３２でヘッドスイッチ信号４３からインサート用内
部基準信号４２までの時間ｘを記憶する。記録信号発生
回路３７は、インサート内部基準信号５０から、標準記
録パターンのＩＴＩ領域の終わりからＡｕｄｉｏ領域の
先頭までの時間であるＡ時間（回路の信号処理時間も考
慮して）後にＡｕｄｉｏデータを出力する。
の場合の動作タイミングを示す。図２に示すように、Ｉ
ＴＩがインサート用内部基準信号発生回路３１で検出さ
れた場合、インサート用内部基準信号４２を発生する。
また、１トレース前に記憶回路３２に記憶されたヘッド
スイッチ信号４３からインサート用内部基準信号４２ま
での時間ｙと、ヘッドスイッチ信号４３とによりＩＴＩ
検出が抜けた場合のインサート用内部基準信号４６が発
生する。しかし、インサート用内部基準信号４６はマス
ク信号４４が１のためマスクされ、インサート用内部基
準信号４２が論理和３６の出力５０となる。また、記憶
回路３２でヘッドスイッチ信号４３からインサート用内
部基準信号４２までの時間ｘを記憶する。記録信号発生
回路３７は、インサート内部基準信号５０から、標準記
録パターンのＩＴＩ領域の終わりからＡｕｄｉｏ領域の
先頭までの時間であるＡ時間（回路の信号処理時間も考
慮して）後にＡｕｄｉｏデータを出力する。
【００１６】図３に示すように、ＩＴＩがインサート用
内部基準信号発生回路３１で検出されなかった場合、イ
ンサート用内部基準信号４２は発生しない。１トレース
前に記憶回路３２に記憶されたヘッドスイッチ信号４３
からインサート用内部基準信号４２までの時間ｙと、ヘ
ッドスイッチ信号４３とによりＩＴＩ検出が抜けた場合
のインサート用内部基準信号４６が発生する。マスク回
路３４はマスク信号４４が０なので、入力のインサート
用内部基準信号４６をそのまま出力する（４７）。論理
和回路３６の出力５０は、インサート用内部基準信号４
７が出力される。また、ヘッドスイッチ信号４３からイ
ンサート用内部基準信号４２までの時間ｘは、同一ヘッ
ドの１トレース前の値ｙが維持される。記録信号発生回
路３７は、インサート内部基準信号５０から、標準記録
パターンのＩＴＩ領域の終わりからＡｕｄｉｏ領域の先
頭までの時間であるＡ時間（回路の信号処理時間も考慮
して）後にＡｕｄｉｏデータを出力する。ＩＴＩが検出
できなかった場合、図３に示すように、既に記録されて
いるパターンと再記録パターンとの間に、時間Ｅの誤差
が生じてしまう。誤差時間Ｅは、同一ヘッドで記録され
たトラック位置の相対ずれとシリンダの回転速度のずれ
により生じるものであり、ディジタル信号記録再生装置
間に生じるテープに対するトラックパターンのずれに比
べると十分に小さい。
内部基準信号発生回路３１で検出されなかった場合、イ
ンサート用内部基準信号４２は発生しない。１トレース
前に記憶回路３２に記憶されたヘッドスイッチ信号４３
からインサート用内部基準信号４２までの時間ｙと、ヘ
ッドスイッチ信号４３とによりＩＴＩ検出が抜けた場合
のインサート用内部基準信号４６が発生する。マスク回
路３４はマスク信号４４が０なので、入力のインサート
用内部基準信号４６をそのまま出力する（４７）。論理
和回路３６の出力５０は、インサート用内部基準信号４
７が出力される。また、ヘッドスイッチ信号４３からイ
ンサート用内部基準信号４２までの時間ｘは、同一ヘッ
ドの１トレース前の値ｙが維持される。記録信号発生回
路３７は、インサート内部基準信号５０から、標準記録
パターンのＩＴＩ領域の終わりからＡｕｄｉｏ領域の先
頭までの時間であるＡ時間（回路の信号処理時間も考慮
して）後にＡｕｄｉｏデータを出力する。ＩＴＩが検出
できなかった場合、図３に示すように、既に記録されて
いるパターンと再記録パターンとの間に、時間Ｅの誤差
が生じてしまう。誤差時間Ｅは、同一ヘッドで記録され
たトラック位置の相対ずれとシリンダの回転速度のずれ
により生じるものであり、ディジタル信号記録再生装置
間に生じるテープに対するトラックパターンのずれに比
べると十分に小さい。
【００１７】本発明は、記録トラックが、再生時にヘッ
ドのトラックパターン上の位置を検出するためのＩＴＩ
領域と、複数の信号領域とにより構成されている場合で
も、有効である。
ドのトラックパターン上の位置を検出するためのＩＴＩ
領域と、複数の信号領域とにより構成されている場合で
も、有効である。
【００１８】
【発明の効果】本発明は上記した構成により、１トラッ
ク内でＩＴＩの同期ブロックが１つも検出できなかった
場合でも、記録ヘッドの１トレース前のヘッドスイッチ
信号からの再記録タイミングを記憶しておき、現在のヘ
ッドスイッチ信号タイミングから記憶タイミングを用い
て再記録タイミングを決定することにより、ディジタル
信号記録再生装置間の互換におけるテープに対するトラ
ックパターンのずれという非常に大きな誤差の影響を受
けなくなり、ヘッドスイッチ信号のみで再記録タイミン
グを決定するより、再記録の精度を高めることができ
る。
ク内でＩＴＩの同期ブロックが１つも検出できなかった
場合でも、記録ヘッドの１トレース前のヘッドスイッチ
信号からの再記録タイミングを記憶しておき、現在のヘ
ッドスイッチ信号タイミングから記憶タイミングを用い
て再記録タイミングを決定することにより、ディジタル
信号記録再生装置間の互換におけるテープに対するトラ
ックパターンのずれという非常に大きな誤差の影響を受
けなくなり、ヘッドスイッチ信号のみで再記録タイミン
グを決定するより、再記録の精度を高めることができ
る。
【図１】本発明の実施例のディジタル信号処理回路
【図２】本発明の実施例の動作説明のためのタイミング
図
図
【図３】本発明の実施例の動作説明のためのタイミング
図
図
【図４】従来の実施例のトラックパターンを示す模式図
【図５】従来のＩＴＩ領域の同期ブロックを示す模式図
【図６】従来例のディジタル信号処理回路を示すブロッ
ク図
ク図
３１ 内部基準信号発生回路 ３２ 記憶回路 ３３ 内部基準信号発生回路 ３４ マスク回路 ３６ 論理和 ３７ 記録信号発生回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 河上 和夫 大阪府門真市大字門真1006番地 松下電 器産業株式会社内 (72)発明者 池谷 章 大阪府門真市大字門真1006番地 松下電 器産業株式会社内 (56)参考文献 特開 平５−54608（ＪＰ，Ａ) 特開 平２−37575（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) G11B 27/036 G11B 5/09 311 G11B 20/10
Claims (2)
- 【請求項１】円筒状のシリンダ上に取り付けられたｎ
（ｎは１以上の整数）個のヘッドにより、テープ上の斜
めのトラックとして、ブロック化したディジタルデータ
の始まりを示す同期パターンを含む同期ブロック単位で
構成されるＩＴＩ領域と、１つ以上の信号領域とから構
成される信号を記録または再生するディジタル信号記録
再生装置のディジタル信号処理回路であって、記録され
たテープの前記ＩＴＩ領域を検出することにより、前記
１つ以上の信号領域中の１つ以上の領域を再記録する再
記録手段として、記録されたテープを再生した再生ディ
ジタルデータ中の前記ＩＴＩ領域の前記同期ブロックが
検出された場合、前記ＩＴＩ領域の同期ブロックの検出
タイミングを基準として再記録のタイミングを作成して
インサート用記録データを発生し、かつ、どのヘッドが
テープ上をトレースしているかを示すヘッドスイッチ信
号の変化点から前記再記録のタイミングまでの時間を記
憶し、前記ＩＴＩ領域が検出されなかった場合、前記ヘ
ッドスイッチ信号から前記同一ヘッドの１トレース前の
前記記憶時間後に、再記録のタイミングを作成してイン
サート用記録データを発生するインサート手段を備えた
ことを特徴とするディジタル信号処理回路。 - 【請求項２】再記録手段は、記録されたテープを再生し
た再生ディジタルデータ中のＩＴＩ領域の同期ブロック
を検出することにより、前記各領域中の１つ以上の領域
のみを記録し直す再記録のタイミングの基準となるイン
サート用内部基準信号１を発生するインサート用内部基
準信号発生手段１と、ｎ個のヘッドの内、どのヘッドが
テープ上をトレースしているかを示すヘッドスイッチ信
号の変化点から前記インサート用内部基準信号１が発生
するまでの時間を各々のヘッド毎に記憶する記憶手段
と、各ヘッド毎に前記ヘッドスイッチ信号の変化点から
前記記憶時間後にＩＴＩ検出ができなかった場合のイン
サート用内部基準信号２を発生するインサート用内部基
準信号発生手段２と、１トラック内で前記ＩＴＩ領域の
同期ブロックがまだ検出されていない場合はインサート
用内部基準信号２をそのまま出力し、前記ＩＴＩ領域で
同期ブロックが既に検出されている場合は前記インサー
ト用内部基準信号２を無効にして出力するマスク手段
と、前記インサート用内部基準信号１と前記マスク手段
の出力のどちらかが発生すればその信号をインサート用
内部基準信号３として出力する論理和手段と、前記イン
サート用内部基準信号３のタイミングを基準にしてイン
サート用記録信号を発生する記録信号発生手段とを備え
たことを特徴とする請求項１記載のディジタル信号処理
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4008227A JP2819911B2 (ja) | 1992-01-21 | 1992-01-21 | ディジタル信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4008227A JP2819911B2 (ja) | 1992-01-21 | 1992-01-21 | ディジタル信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05198143A JPH05198143A (ja) | 1993-08-06 |
| JP2819911B2 true JP2819911B2 (ja) | 1998-11-05 |
Family
ID=11687281
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4008227A Expired - Fee Related JP2819911B2 (ja) | 1992-01-21 | 1992-01-21 | ディジタル信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2819911B2 (ja) |
-
1992
- 1992-01-21 JP JP4008227A patent/JP2819911B2/ja not_active Expired - Fee Related
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