JP2589707B2 - Keyboard device - Google Patents

Keyboard device

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JP2589707B2
JP2589707B2 JP62243324A JP24332487A JP2589707B2 JP 2589707 B2 JP2589707 B2 JP 2589707B2 JP 62243324 A JP62243324 A JP 62243324A JP 24332487 A JP24332487 A JP 24332487A JP 2589707 B2 JP2589707 B2 JP 2589707B2
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JP
Japan
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output
data
input
frequency
control unit
Prior art date
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JPS6486226A (en
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寿浩 古賀
博徳 畠中
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Panasonic Holdings Corp
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Matsushita Electric Industrial Co Ltd
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Description

【発明の詳細な説明】 産業上の利用分野 本発明はワードプロセッサ,パーソナルコンピュータ
等各種OA機器等において入力装置として使用されるキー
ボード装置に関するものである。
Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a keyboard device used as an input device in various OA devices such as a word processor and a personal computer.

従来の技術 以下に従来のキーボード装置の構成について説明す
る。
2. Description of the Related Art A configuration of a conventional keyboard device will be described below.

第3図は従来のキーボード装置の構成図であり、1は
機器本体内に配置された制御部、2は機器本体の制御部
1とキーボード装置とを接続するケーブル、Aはキーボ
ード装置でありシフトレジスタ3,キーマトリックス4を
内臓し、キーマトリックス4の各交点にはキーボード上
の各キー(図示せず)に対応するキースイッチ4aが配置
されている。(但し第3図においては3つのキースイッ
チを除いて図示してない) 以上のように構成されたキーボード装置につき以下そ
の動作を第4図に示したタイムチャートを用いて説明す
る。
FIG. 3 is a configuration diagram of a conventional keyboard device, wherein 1 is a control unit disposed in the device main body, 2 is a cable connecting the control unit 1 of the device main body and the keyboard device, and A is a keyboard device and is shifted. A key switch 4a corresponding to each key (not shown) on the keyboard is disposed at each intersection of the key matrix 4 and a register 3 and a key matrix 4. (However, not shown except for three key switches in FIG. 3) The operation of the keyboard device configured as described above will be described below with reference to a time chart shown in FIG.

まず、本体側の制御部1はストローブ信号(以下STB
と略する)を『L』にした後に1回リード動作を行な
う。このリード動作によりリードストローブ信号RDがア
クティブになりこのリードストローブ信号RDの立下りで
シフトレジスタ3はシフト動作を行なう。また、制御部
1はリードストローブ信号RDの立上りでデータD0〜D7を
読みこむ。これにより1回目のリード動作時シフトレジ
スタ3の出力Q1が『L』となり、制御部入力データはQ1
に接続されているキースイッチのどれかが押されていれ
ばそのビットが『L』となる。次に2回目移行のリード
動作時にはストローブ信号STBを『H』としてリード動
作を行なう。したがって2回目のリード動作時にはシフ
トレジスタ3の出力Q2が『L』となり、制御部入力デー
タはQ2に接続されたキースイッチの押下によりそのビッ
トが『L』となる。以後、同様には制御部1はリード動
作をキーマトリックス4を構成する全てのキースイッチ
につき行なう。
First, the control unit 1 on the main unit side transmits a strobe signal (hereinafter, STB
) Is set to “L”, and a read operation is performed once. This read operation activates the read strobe signal RD, and the shift register 3 performs a shift operation at the fall of the read strobe signal RD. The control unit 1 reads the data D0 to D7 at the rise of the read strobe signal RD. As a result, at the time of the first read operation, the output Q1 of the shift register 3 becomes “L”, and the input data of the control unit becomes Q1.
If any one of the key switches connected to is pressed, the bit becomes "L". Next, at the time of the second read operation, the read operation is performed by setting the strobe signal STB to “H”. Therefore, at the time of the second read operation, the output Q2 of the shift register 3 becomes "L", and the bit of the control unit input data becomes "L" when the key switch connected to Q2 is pressed. Thereafter, similarly, the control unit 1 performs the read operation for all the key switches constituting the key matrix 4.

発明が解決しようとする問題点 しかしながら、上記の従来の構成では8N個(Nは整
数)のキースイッチによって構成されるキーマトリック
スとN段のシフトレジスタを用いており、信号線がD0〜
D7用,リードストローブ信号RD用,ストローブ信号STB
用の計10本必要となる。そのため制御部1の入出力端子
もその数に合った数即ち10本が占有されてしまうため、
その他の回路の制御を行なうための端子数が少なくなっ
てしまうという問題がある。また、信号線の数が多いた
めコネクタも端子数の多いものが必要となり、コストア
ップにつながるという問題も有していた。まだ、上記し
た従来の構成のキーボード装置において信号線を単に減
らした場合には第5図に示しているようにシフトレジス
タの段数が増え回路規模が大きくなってしまうという問
題を有していた。すなわち、データ線の数をN分の1に
するとシフトレジスタは4N個必要になるといった具合で
ある。
Problems to be Solved by the Invention However, the above-mentioned conventional configuration uses a key matrix composed of 8N key switches (N is an integer) and an N-stage shift register, and the signal lines are D0 to D0.
D7, read strobe signal RD, strobe signal STB
A total of 10 are required. Therefore, the number of input / output terminals of the control unit 1 is occupied by the number corresponding to the number, that is, 10 terminals.
There is a problem that the number of terminals for controlling other circuits is reduced. In addition, since the number of signal lines is large, a connector having a large number of terminals is required, which leads to an increase in cost. Still further, when the number of signal lines is simply reduced in the above-described conventional keyboard device, there is a problem that the number of stages of the shift register increases and the circuit scale increases as shown in FIG. That is, if the number of data lines is reduced to 1 / N, 4N shift registers are required.

問題点を解決するための手段 本発明は、上記問題点を解決するために、制御部から
のクロック信号を入力して分周する分周回路と、この分
周回路からの分周出力を入力クロックとし、この入力ク
ロックに従って複数の出力ラインを順次選択的にオンに
するシフトレジスタを備え、複数の入力端子は2つのグ
ループに分けられ、第1のグループの入力端子に入力す
るデータを出力する第1の出力端子および第2のグルー
プの入力端子に入力するデータを出力する第2の出力端
子を備えるとともに前記分周回路からの分周出力に従っ
て各入力端子のデータを両グループ同時にシリアル形式
に変換してそれぞれ第1および第2の出力端子から出力
するデータセレクタを備える。
Means for Solving the Problems In order to solve the above problems, the present invention provides a frequency dividing circuit which receives a clock signal from a control unit and divides the frequency, and receives a frequency division output from the frequency dividing circuit. A shift register for selectively turning on a plurality of output lines in accordance with the input clock in accordance with the input clock; the plurality of input terminals are divided into two groups; and data input to the first group of input terminals are output. A second output terminal for outputting data to be input to a first output terminal and a second group of input terminals, and the data of each input terminal in both groups are simultaneously converted into a serial format in accordance with the frequency division output from the frequency division circuit. A data selector for converting and outputting the data from the first and second output terminals, respectively.

作用 上記構成により、キーマトリックスの一例のデータを
分周回路の分周比と同じ回数に分けてリード動作を行う
ため、シフトレジスタの段数の増加なしに本体の制御部
との接続のための信号線の数を減少させることがてき、
しかもデータセレクタは2つの出力端子を備え、それぞ
れの出力端子は各々対応するグループの入力端子のデー
タを分周回路の出力に従って両グループ同時に出力する
ので、キー読み取り1サイクルの時間が短くて済み、同
時に2つの接点のオン,オフ情報が出力できる。
Operation According to the above configuration, the read operation is performed by dividing the data of an example of the key matrix by the same number of times as the frequency division ratio of the frequency divider circuit, so that the signal for connection with the control unit of the main body without increasing the number of shift register stages. Can reduce the number of lines,
In addition, the data selector has two output terminals, and each output terminal simultaneously outputs the data of the input terminal of the corresponding group according to the output of the frequency dividing circuit, so that the time for one cycle of key reading can be shortened. The ON / OFF information of the two contacts can be output at the same time.

実施例 以下、本発明の一実施例について図面を参照しながら
説明する。
Embodiment Hereinafter, an embodiment of the present invention will be described with reference to the drawings.

第1図は本発明の一実施例におけるキーボード装置の
構成を示すものである。
FIG. 1 shows the configuration of a keyboard device according to one embodiment of the present invention.

第1図において11は機器本体内に配置された制御部、
12は機器本体内の制御部11とキーボード装置とを接続す
るケーブル、Bはキーボード装置でありシフトレジスタ
13,キーマトリックス14、4分周を行なう分周回路15,デ
ータセレクタ16を内臓している。
In FIG. 1, reference numeral 11 denotes a control unit arranged in the device body,
Reference numeral 12 denotes a cable for connecting the control unit 11 in the device body to the keyboard device, and B denotes a keyboard device, which is a shift register.
13, a key matrix 14, a frequency dividing circuit 15 for performing frequency division, and a data selector 16 are incorporated.

なお、14aはキーマトリックス14の各交点に接続され
たキースイッチである(但し第1図においては3つのキ
ースイッチを除いて図示していない)。
Reference numeral 14a denotes a key switch connected to each intersection of the key matrix 14 (however, not shown in FIG. 1 except for three key switches).

以上のように構成された本実施例のキーボード装置に
つき以下その動作を第2図に示したタイムチャートを用
いて説明する。
The operation of the keyboard device of this embodiment configured as described above will be described below with reference to the time chart shown in FIG.

まず、分周回路15はクロックCK入力を4分周し、第2
図に示すようにそれぞれ位相の異なる出力01〜04を発生
する。シフトレジスト13は分周回路出力01からの複数の
出力の内の1つ(本実施例において出力01)をクロック
CKとして入力し、この立下りでシフト動作を行なう。ま
た、データセレクタ16はコントロール入力S1〜S4により
出力Aout,BoutとしてA1〜A4の内を何れかを1つとと、B
1〜B4の内に何れか1つを出力する。まず、制御部11は
ストローブ信号STBを『L』にして1回目のリード動作
を行なう。このリード動作によりリードストローブ信号
RDがアクティブになりこのリードストローブ信号RDの立
下りで分周回路15が動作し出力01が『L』となる。この
とき分周回路15の出力の内02,03,04は『H』のままであ
る。シフトレジスタ13の出力はこの動作によりQ1のみ
『L』となり、出力SD0〜SD7にはキーマトリックスの1
列目のキースイッチの押下状況が出力される。データセ
レクタ16はコントロール入力S1〜S4のうちS1のみが
『L』であるため、出力AoutにAl即ちSD7を、出力Bout
にB1即ちSD6を出力する。従って制御部11はリードスト
ローブ信号RDの立上りにてこれらのデータをD7,D6端子
から読みとる。次に2回目のリード動作以後はストロー
ブ信号STBを『H』として動作を行なう。2回目のリー
ド動作時はリードストローブ信号RDの立下りで分周回路
出力は02のみ『L』となり、またシフトレジスタ3の状
態は1回目と同じであるからデータセレクタ16の出力は
AoutにA2出力即ちSD5を、BoutにB2即ちSD4が出力され制
御部11はこれらのデータをD7,D6端子から読み取る。同
様にして制御部11は3回目のリード動作でSD1,SD0を読
み取る。この4回のリード動作でキーマトリックス14の
1列目のデータが読み取りが終了する。そして、5〜8
回目のリード動作では分周回路15の出力は1〜4回目の
リード動作時と同じ状態に戻り、またシフトレジスタ13
は分周回路15の出力の01をクロックCKとしているため出
力Q2のみが『L』となりキーマトリックス14からの出力
SD7〜SD0には2列目のキースイッチの押下状況が出力さ
れる。従って制御部11のリードデータは5回目のリード
動作でSD7,SD6,6回目のリード動作でSD5,SD4、7回目に
てSD3,SD2、8回目にてSD1,SD0となる。以上のようにキ
ーマトリックス14の各列のデータを4回のリード動作で
読み取り、4N回のリード動作でキーマトリックスを構成
する全てのキースイッチの押下状況を読み取る。
First, the frequency dividing circuit 15 divides the clock CK input by four,
As shown in the figure, outputs 01 to 04 having different phases are generated. The shift resist 13 clocks one of the plurality of outputs from the frequency divider circuit output 01 (output 01 in this embodiment).
CK is input, and the shift operation is performed at this falling edge. In addition, the data selector 16 sets any one of A1 to A4 as the output Aout and Bout by the control inputs S1 to S4,
Any one of 1 to B4 is output. First, the controller 11 sets the strobe signal STB to "L" and performs the first read operation. This read operation causes the read strobe signal
RD becomes active, the frequency divider 15 operates at the falling edge of the read strobe signal RD, and the output 01 becomes "L". At this time, 02, 03, and 04 of the outputs of the frequency dividing circuit 15 remain "H". Due to this operation, the output of the shift register 13 becomes "L" for only Q1, and the outputs SD0 to SD7 output the 1 of the key matrix.
The pressing status of the key switch in the column is output. Since only S1 of the control inputs S1 to S4 is "L", the data selector 16 outputs Al, that is, SD7 to the output Aout, and outputs the output Bout
B6, that is, SD6. Therefore, the control unit 11 reads these data from the D7 and D6 terminals at the rise of the read strobe signal RD. Next, after the second read operation, the operation is performed with the strobe signal STB set to "H". At the time of the second read operation, the output of the frequency divider circuit becomes "L" only at 02 at the fall of the read strobe signal RD, and the state of the shift register 3 is the same as the first time.
A2 output, that is, SD5 is output to Aout, and B2, that is, SD4 is output to Bout, and the control unit 11 reads these data from the D7 and D6 terminals. Similarly, the control unit 11 reads SD1 and SD0 in the third read operation. The reading of the data in the first column of the key matrix 14 is completed by these four reading operations. And 5-8
In the second read operation, the output of the frequency divider 15 returns to the same state as in the first to fourth read operations.
Is output from the key matrix 14 because only the output Q2 becomes "L" since the output 01 of the frequency divider 15 is used as the clock CK.
The state of depression of the key switch in the second column is output to SD7 to SD0. Therefore, the read data of the control unit 11 is SD7, SD6 in the fifth read operation, SD5, SD4 in the sixth read operation, SD3, SD2 in the seventh read operation, and SD1, SD0 in the eighth read operation. As described above, the data of each column of the key matrix 14 is read by four read operations, and the pressed states of all the key switches constituting the key matrix are read by 4N read operations.

以上のように本実施例によれば、キーマトリックスの
1列のデータを分周回路の分周比と同じ回数に分けてデ
ータセレクタ経由でリード動作を行なうようにしたこと
により、シフトレジスタの段数の増加なしに本体制御部
とキーボード装置間の信号を減少させることができる。
As described above, according to the present embodiment, the data of one column of the key matrix is divided into the same number of times as the frequency division ratio of the frequency dividing circuit and the read operation is performed via the data selector, thereby reducing the number of stages of the shift register. The signal between the main body controller and the keyboard device can be reduced without increasing the number of signals.

発明の効果 本発明は、本体側制御部からのリードストローブ信号
を入力してそれを分周する分周回路とこの分周回路出力
によってデータ出力を選択されるデータセレクタを設け
たことにより、シフトレジスタの段数を増加させること
なしに本体側制御部とキーボード装置間の接続ケーブル
の信号線の数を減少でき、しかもデータセレクタは2つ
の出力端子を備え、それぞれの出力端子は各々対応する
グループの入力端子のデータを分周回路の出力に従って
両グループ同時に出力するので、キー読み取り1サイク
ルの時間が短くて済み、素早いキー入力能力を持った人
が使用した場合でもオン,オフ情報の検知が遅れること
による違和感が無く、しかも同時に2つの接点のオン,
オフ情報が出力されるので、同時に2つのキーを押して
文字入力するような場合でも検知遅れが起こりにくいと
いう効果を奏する。
According to the present invention, a shift circuit is provided by providing a frequency dividing circuit for inputting and dividing a read strobe signal from the main body side control unit and a data selector for selecting a data output by an output of the frequency dividing circuit. The number of signal lines of the connection cable between the main body control unit and the keyboard device can be reduced without increasing the number of register stages, and the data selector has two output terminals, each output terminal of each corresponding group. Since the data of the input terminal is output simultaneously from both groups according to the output of the frequency dividing circuit, the time for one cycle of key reading can be shortened, and the detection of ON / OFF information is delayed even if a person having quick key input capability uses the data. Without any discomfort, and at the same time turning on two contacts,
Since the OFF information is output, there is an effect that the detection delay hardly occurs even when characters are input by simultaneously pressing two keys.

【図面の簡単な説明】[Brief description of the drawings]

第1図は本発明の一実施例におけるキーボード装置と本
体側の制御部との接続状態を示す回路図、第2図は同実
施例におけるキーボード装置の動作を示すタイムチャー
ト、第3図及び第5図は従来のキーボード装置と本体側
の制御部との接続状態を示す回路図、第4図は同従来例
のキーボードにおける動作を示すタイムチャートであ
る。 11……本体側の制御部 12……ケーブル 13……シフトレジスタ 14……キーマトリックス 14a……キースイッチ 15……分周回路 16……データセレクタ
FIG. 1 is a circuit diagram showing a connection state between a keyboard device and a control unit on the main body side in one embodiment of the present invention, FIG. 2 is a time chart showing operation of the keyboard device in the embodiment, FIGS. FIG. 5 is a circuit diagram showing a connection state between a conventional keyboard device and a control unit on the main body side, and FIG. 4 is a time chart showing an operation of the keyboard of the conventional example. 11 Control unit on main unit 12 Cable 13 Shift register 14 Key matrix 14a Key switch 15 Frequency divider 16 Data selector

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】制御部からのクロック信号を入力して分周
する分周回路と、 前記分周回路からの分周出力を入力クロックとし、この
入力クロックに従って複数の出力ラインを順次選択的に
オンにするシフトレジスタと、 複数の入力端子は2つのグループに分けられ、第1のグ
ループの入力端子に入力するデータを出力する第1の出
力端子および第2のグループの入力端子に入力するデー
タを出力する第2の出力端子を備え、前記分周回路から
の分周出力に従って各入力端子のデータを両グループ同
時にシリアル形式に変換してそれぞれ第1および第2の
出力端子から出力するデータセレクタと、 前記シフトレジスタの複数の出力ラインと前記データセ
レクタの複数の入力ラインとの間にマトリックス状に接
続されたキースイッチとを備えた キーボード装置。
A frequency dividing circuit for dividing a frequency by inputting a clock signal from a control unit; a frequency divided output from the frequency dividing circuit being used as an input clock; A shift register to be turned on; a plurality of input terminals divided into two groups; a first output terminal for outputting data to be input to an input terminal of a first group; and a data to be input to an input terminal of a second group. A data output selector for converting data of each input terminal into a serial format simultaneously for both groups according to the frequency division output from the frequency division circuit, and outputting the data from the first and second output terminals, respectively. And a key switch connected in a matrix between a plurality of output lines of the shift register and a plurality of input lines of the data selector. Board device.
JP62243324A 1987-09-28 1987-09-28 Keyboard device Expired - Lifetime JP2589707B2 (en)

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JPS58225426A (en) * 1982-06-24 1983-12-27 Toshiba Corp Multiplexing processor
JPS61279917A (en) * 1985-06-05 1986-12-10 Hitachi Ltd Input device

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